JPH0837662A - 画像符号化復号化装置 - Google Patents
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- JPH0837662A JPH0837662A JP6170699A JP17069994A JPH0837662A JP H0837662 A JPH0837662 A JP H0837662A JP 6170699 A JP6170699 A JP 6170699A JP 17069994 A JP17069994 A JP 17069994A JP H0837662 A JPH0837662 A JP H0837662A
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Abstract
(57)【要約】
【目的】 画面を分割し各小領域毎に符号化あるいは復
号化を行う分割画像回路において、画面分割による画像
圧縮率の低下を防ぎ、しかも小型で低コストの画像符号
化装置あるいは画像復号化装置を提供することを目的と
する。 【構成】 入力された画像を所定の形状の小領域に分割
する画像分割回路８０１、分割した各小領域を符号化す
る小符号化装置１１０１−１〜４、小領域の符号を統合
する符号統合回路８０３、各小符号化装置が局所復号化
した画像を格納する共有メモリ回路１１０２により構成
される。 【効果】 本発明によれば、画像の符号化効率をほとん
ど落すことなく回路各所の動作速度の低速化が図れるた
め、小型・低価格の画像符号化装置あるいは画像復号化
装置あるいは画像符号化復号化装置を実現することがで
きる。
号化を行う分割画像回路において、画面分割による画像
圧縮率の低下を防ぎ、しかも小型で低コストの画像符号
化装置あるいは画像復号化装置を提供することを目的と
する。 【構成】 入力された画像を所定の形状の小領域に分割
する画像分割回路８０１、分割した各小領域を符号化す
る小符号化装置１１０１−１〜４、小領域の符号を統合
する符号統合回路８０３、各小符号化装置が局所復号化
した画像を格納する共有メモリ回路１１０２により構成
される。 【効果】 本発明によれば、画像の符号化効率をほとん
ど落すことなく回路各所の動作速度の低速化が図れるた
め、小型・低価格の画像符号化装置あるいは画像復号化
装置あるいは画像符号化復号化装置を実現することがで
きる。
Description
【０００１】
【産業上の利用分野】本発明は画像符号化装置あるいは
復号化装置もしくはこれら両者の機能を兼ね備えた画像
符号復号化装置に係わり、特にデジタル放送あるいはケ
ーブルテレビジョン等の映像符号化装置あるいは映像受
信端末や、画像蓄積装置におけるリアルタイム符号入力
装置、テレビ電話あるいはテレビ会議などの映像通信装
置の符号化復号化部分に適用される。
復号化装置もしくはこれら両者の機能を兼ね備えた画像
符号復号化装置に係わり、特にデジタル放送あるいはケ
ーブルテレビジョン等の映像符号化装置あるいは映像受
信端末や、画像蓄積装置におけるリアルタイム符号入力
装置、テレビ電話あるいはテレビ会議などの映像通信装
置の符号化復号化部分に適用される。
【０００２】
【従来の技術】画像信号をデジタル化してそのまま伝送
や蓄積するには通常のテレビジョン（ＴＶ）信号で100M
bps以上、ハイデフィニションＴＶ（ＨＤＴＶ）では1Gb
ps程度の伝送路あるいは蓄積媒体が必要になる。そのた
め画像信号の冗長度を削減し、画像の情報量を1/10から
1/1000程度までに低減する高能率符号化の研究が盛んに
なされている。その代表的なものに、インターナショナ
ル オーガニゼーションスタンダーダイゼーション(IS
O)が標準化を行ったISO/IEC 11172-2（92.11、通称MPEG
1）とその拡張であるISO/IEC CD 13818-2（93.11、通称
MPEG2）がある。以下、MPEG1とMPEG2を総称してMPEGと
呼び、MPEGを中心に従来の技術を説明する。なお、これ
らの詳細については上記のISO/IEC 11172-2およびISO/I
EC CD 13818-2に詳しい説明が記載されているため、本
説明ではこの概略のみを説明する。
や蓄積するには通常のテレビジョン（ＴＶ）信号で100M
bps以上、ハイデフィニションＴＶ（ＨＤＴＶ）では1Gb
ps程度の伝送路あるいは蓄積媒体が必要になる。そのた
め画像信号の冗長度を削減し、画像の情報量を1/10から
1/1000程度までに低減する高能率符号化の研究が盛んに
なされている。その代表的なものに、インターナショナ
ル オーガニゼーションスタンダーダイゼーション(IS
O)が標準化を行ったISO/IEC 11172-2（92.11、通称MPEG
1）とその拡張であるISO/IEC CD 13818-2（93.11、通称
MPEG2）がある。以下、MPEG1とMPEG2を総称してMPEGと
呼び、MPEGを中心に従来の技術を説明する。なお、これ
らの詳細については上記のISO/IEC 11172-2およびISO/I
EC CD 13818-2に詳しい説明が記載されているため、本
説明ではこの概略のみを説明する。
【０００３】図１はMPEG1,2を含む従来の符号化装置の
ブロック図である。入力されたデジタル画像２はバッフ
ァ３に一時的に蓄えられた後、マクロブロックと呼ばれ
る輝度信号１６画素ｘ１６画素、色差信号R-Y ８ｘ８画
素、B-Y ８ｘ８画素からなる処理単位に分割される。各
マクロブロックは動き補償(MC)および離散コサイン変換
(DCT)回路４にて、画面の動きを補正した予測信号との
差分がとらた後、離散コサイン変換され周波数成分の一
種であるＤＣＴ係数８が得られる。ＤＣＴの演算はマク
ロブロックの輝度信号をさらに４分割したブロック（色
輝度とも８画素ｘ８ライン）単位に行われる。ＤＣＴ係
数８とMC/DCT処理時に得られた動きベクトル９等の付加
情報は可変長符号化(VLC)回路５に入力され、それぞれ
あらかじめ規定された順番に規定された符号に変換され
符号バッファ６に入力される。符号バッファからは外部
の伝送機器あるいは蓄積装置の読み出し速度に合わせた
速度で符号７が読みだされる。符号バッファでは一定周
期で符号量計算し、発生符号量１０を符号量制御回路２
１２に通知する。符号量制御回路では符号量が所定の値
になるように量子化ステップサイズ２１３等を調節し、
これらの制御情報をMC/DCT回路４に通知する。
ブロック図である。入力されたデジタル画像２はバッフ
ァ３に一時的に蓄えられた後、マクロブロックと呼ばれ
る輝度信号１６画素ｘ１６画素、色差信号R-Y ８ｘ８画
素、B-Y ８ｘ８画素からなる処理単位に分割される。各
マクロブロックは動き補償(MC)および離散コサイン変換
(DCT)回路４にて、画面の動きを補正した予測信号との
差分がとらた後、離散コサイン変換され周波数成分の一
種であるＤＣＴ係数８が得られる。ＤＣＴの演算はマク
ロブロックの輝度信号をさらに４分割したブロック（色
輝度とも８画素ｘ８ライン）単位に行われる。ＤＣＴ係
数８とMC/DCT処理時に得られた動きベクトル９等の付加
情報は可変長符号化(VLC)回路５に入力され、それぞれ
あらかじめ規定された順番に規定された符号に変換され
符号バッファ６に入力される。符号バッファからは外部
の伝送機器あるいは蓄積装置の読み出し速度に合わせた
速度で符号７が読みだされる。符号バッファでは一定周
期で符号量計算し、発生符号量１０を符号量制御回路２
１２に通知する。符号量制御回路では符号量が所定の値
になるように量子化ステップサイズ２１３等を調節し、
これらの制御情報をMC/DCT回路４に通知する。
【０００４】図２に上記に示した従来例のMC/DCT回路４
の詳細図を示す。図２を説明する前に図３を用いてMPEG
1,2における動き補償動作を説明する。MPEG1およびMPEG
2ではＴＶの画面をＩピクチャ、Ｐピクチャ、Ｂピクチ
ャの３種類に分類した後に符号化を行う。Ｉピクチャは
画面をマクロブロック、ブロックに分割した後、これら
のブロックに対し直接ＤＣＴを施す符号化方法である。
このため、以下に説明するＰ、Ｂピクチャとは異なりＩ
ピクチャの情報単独で１つの画面を再生することができ
る。一方Ｐ、Ｂピクチャは事前に符号化した画面を元に
予測画像を作成し、予測画像との差分に対しＤＣＴを施
し符号化を行う。
の詳細図を示す。図２を説明する前に図３を用いてMPEG
1,2における動き補償動作を説明する。MPEG1およびMPEG
2ではＴＶの画面をＩピクチャ、Ｐピクチャ、Ｂピクチ
ャの３種類に分類した後に符号化を行う。Ｉピクチャは
画面をマクロブロック、ブロックに分割した後、これら
のブロックに対し直接ＤＣＴを施す符号化方法である。
このため、以下に説明するＰ、Ｂピクチャとは異なりＩ
ピクチャの情報単独で１つの画面を再生することができ
る。一方Ｐ、Ｂピクチャは事前に符号化した画面を元に
予測画像を作成し、予測画像との差分に対しＤＣＴを施
し符号化を行う。
【０００５】図３はＢピクチャにおける予測画像生成の
方法を説明するための図である。図３において前方(for
ward)参照画面と後方(backward)参照画面は先に符号化
を行った画像であり、前方参照画面は今から符号化する
符号化画面に対して時間的に前に位置し、後方参照画面
は時間的に後に位置する。符号化画面の１つの符号化マ
クロブロックに対する予測画像を生成するときには、前
方、後方各参照画面の同じ位置の周辺で符号化マクロブ
ロックに最も類似した部分を探し、予測マクロブロック
を生成する。画面内での符号化マクロブロックの位置と
予測マクロブロックの位置との差分を動きベクトルと呼
ぶ。予測信号の生成法には前方参照画面の予測マクロブ
ロックを用いる前方予測と、後方参照画面の予測マクロ
ブロックを用いる後方予測と、これら２つの予測信号を
画素ごとに平均した補間予測、予測信号をすべて同じ固
定値（１２８）にしたフレーム内予測がある。一般には
これら４つの予測モードのうち最も予測誤差電力が小さ
いものを選び予測信号とする。Ｐピクチャでは前方予測
とフレーム内予測のみが使用でき、後方予測、補間予測
は禁止される。なお、MPEG2ではＰピクチャに対して、
２つの前方予測信号を画素ごとに平均した予測（デュア
ル プライム予測）が追加されている。
方法を説明するための図である。図３において前方(for
ward)参照画面と後方(backward)参照画面は先に符号化
を行った画像であり、前方参照画面は今から符号化する
符号化画面に対して時間的に前に位置し、後方参照画面
は時間的に後に位置する。符号化画面の１つの符号化マ
クロブロックに対する予測画像を生成するときには、前
方、後方各参照画面の同じ位置の周辺で符号化マクロブ
ロックに最も類似した部分を探し、予測マクロブロック
を生成する。画面内での符号化マクロブロックの位置と
予測マクロブロックの位置との差分を動きベクトルと呼
ぶ。予測信号の生成法には前方参照画面の予測マクロブ
ロックを用いる前方予測と、後方参照画面の予測マクロ
ブロックを用いる後方予測と、これら２つの予測信号を
画素ごとに平均した補間予測、予測信号をすべて同じ固
定値（１２８）にしたフレーム内予測がある。一般には
これら４つの予測モードのうち最も予測誤差電力が小さ
いものを選び予測信号とする。Ｐピクチャでは前方予測
とフレーム内予測のみが使用でき、後方予測、補間予測
は禁止される。なお、MPEG2ではＰピクチャに対して、
２つの前方予測信号を画素ごとに平均した予測（デュア
ル プライム予測）が追加されている。
【０００６】前方参照画面および後方参照画面にはＩピ
クチャおよびＰピクチャのみが使用され、一組の前方、
後方参照画面の間には別のＩピクチャ、Ｐピクチャは存
在しない、すなわちＢピクチャのみが連続して存在す
る。また、Ｂピクチャが全く存在しないことも許されて
いる。Ｉピクチャ、Ｐピクチャの間隔は任意に設定でき
るが、３画面おき以下の固定値にとることが多い。ま
た、Ｉピクチャはランダムアクセスの基点あるいはエラ
ー時の復帰点として用いられ、その間隔は任意に設定で
きる。一般には０．５秒以下の間隔でＩピクチャを固定
的に挿入する、すなわち１２あるは１５フレームおき、
場合が多い。MPEGでは、これらＩピクチャの周期とＩお
よびＰピクチャの周期の記述にはそれぞれＮ、Ｍの記号
が用いられる。たとえばＮ＝１２、Ｍ＝３と記述した場
合には「ＢＢＩＢＢＰＢＢＰＢＢＰ」の周期で各フレー
ムが符号化される。実際に符号化する場合には、３番目
のＩピクチャのフレームが一番先に符号化され、引き続
き１番目、２番目のフレーム、次に６番目のｐピクチャ
のフレーム、そして４番目、５番目のフレームの順で符
号化される。そしてたとえば６番目のＰピクチャのフレ
ームは３番目のＩピクチャのフレームから予測され、４
番目のフレームは３番目のＩピクチャのフレームと６番
目のＰピクチャのフレームから予測される。
クチャおよびＰピクチャのみが使用され、一組の前方、
後方参照画面の間には別のＩピクチャ、Ｐピクチャは存
在しない、すなわちＢピクチャのみが連続して存在す
る。また、Ｂピクチャが全く存在しないことも許されて
いる。Ｉピクチャ、Ｐピクチャの間隔は任意に設定でき
るが、３画面おき以下の固定値にとることが多い。ま
た、Ｉピクチャはランダムアクセスの基点あるいはエラ
ー時の復帰点として用いられ、その間隔は任意に設定で
きる。一般には０．５秒以下の間隔でＩピクチャを固定
的に挿入する、すなわち１２あるは１５フレームおき、
場合が多い。MPEGでは、これらＩピクチャの周期とＩお
よびＰピクチャの周期の記述にはそれぞれＮ、Ｍの記号
が用いられる。たとえばＮ＝１２、Ｍ＝３と記述した場
合には「ＢＢＩＢＢＰＢＢＰＢＢＰ」の周期で各フレー
ムが符号化される。実際に符号化する場合には、３番目
のＩピクチャのフレームが一番先に符号化され、引き続
き１番目、２番目のフレーム、次に６番目のｐピクチャ
のフレーム、そして４番目、５番目のフレームの順で符
号化される。そしてたとえば６番目のＰピクチャのフレ
ームは３番目のＩピクチャのフレームから予測され、４
番目のフレームは３番目のＩピクチャのフレームと６番
目のＰピクチャのフレームから予測される。
【０００７】図３に戻り従来のＭＣ／ＤＣＴ回路の説明
を行う。入力されたデジタルの画像信号１１は画像メモ
リ２０１に入力され上記で説明した符号化順に並べ替え
られる。一方、同時に動き検出回路１２に入力され、す
でに符号化され参照画像メモリ２００に格納されている
参照画像信号２０２との間で、マクロブロックごとの動
きベクトルが検出される。なお、このときに画像メモリ
２０１にて遅延された画像信号２１４を同時に動き検出
回路２０２に入力し参照画像データ２０２からの後方予
測のベクトルを検出する。画像メモリ２０１にて所定の
時間遅延した信号は符号化画像信号２０３として、動き
補償回路１３に入力される、これと同時に動き補償回路
１３は動き検出回路１２にて検出された動きベクトル９
を元に参照画像メモリ２００より参照画像信号２０２を
読み出し予測信号とする。なお、Ｉピクチャではこの参
照画像信号は読み出さず固定値が用いられる。動き補償
回路では符号化信号２０３と参照画像信号２０２を対応
する画素ごとに差分をとり、差分画像信号２０４を生成
する。差分画像信号２０４はＤＣＴ回路２０５にてＤＣ
Ｔ係数に変換され、量子化回路２０６にて予め設定され
た量子化ステップサイズ２１３により量子化される。量
子化されたＤＣＴ係数８は動きベクトル９とともに可変
長符号化回路５に供給される。符号化する画像がＢピク
チャの場合はこれでＭＣ／ＤＣＴ回路の処理は終わる
が、ＩあるいはＰピクチャの場合には後の画像のために
参照画像信号再生する処理が必要となる。量子化された
ＤＣＴ係数８は逆量子化回路２０７にて、量子化したと
きと同じ量子化ステップサイズにて逆量子化され、その
結果は逆ＤＣＴ回路２０８にてＤＣＴの逆変換が施され
る。逆変換された再生差分画像信号２０９は、加算回路
２１０にて、そのブロックの参照画像信号２０２を所定
時間遅延させた信号と加算され再生画像信号２１１が得
られる。再生画像信号２１１は参照画像メモリ２００に
格納され後の画面の符号化時に参照画像信号として使用
される。
を行う。入力されたデジタルの画像信号１１は画像メモ
リ２０１に入力され上記で説明した符号化順に並べ替え
られる。一方、同時に動き検出回路１２に入力され、す
でに符号化され参照画像メモリ２００に格納されている
参照画像信号２０２との間で、マクロブロックごとの動
きベクトルが検出される。なお、このときに画像メモリ
２０１にて遅延された画像信号２１４を同時に動き検出
回路２０２に入力し参照画像データ２０２からの後方予
測のベクトルを検出する。画像メモリ２０１にて所定の
時間遅延した信号は符号化画像信号２０３として、動き
補償回路１３に入力される、これと同時に動き補償回路
１３は動き検出回路１２にて検出された動きベクトル９
を元に参照画像メモリ２００より参照画像信号２０２を
読み出し予測信号とする。なお、Ｉピクチャではこの参
照画像信号は読み出さず固定値が用いられる。動き補償
回路では符号化信号２０３と参照画像信号２０２を対応
する画素ごとに差分をとり、差分画像信号２０４を生成
する。差分画像信号２０４はＤＣＴ回路２０５にてＤＣ
Ｔ係数に変換され、量子化回路２０６にて予め設定され
た量子化ステップサイズ２１３により量子化される。量
子化されたＤＣＴ係数８は動きベクトル９とともに可変
長符号化回路５に供給される。符号化する画像がＢピク
チャの場合はこれでＭＣ／ＤＣＴ回路の処理は終わる
が、ＩあるいはＰピクチャの場合には後の画像のために
参照画像信号再生する処理が必要となる。量子化された
ＤＣＴ係数８は逆量子化回路２０７にて、量子化したと
きと同じ量子化ステップサイズにて逆量子化され、その
結果は逆ＤＣＴ回路２０８にてＤＣＴの逆変換が施され
る。逆変換された再生差分画像信号２０９は、加算回路
２１０にて、そのブロックの参照画像信号２０２を所定
時間遅延させた信号と加算され再生画像信号２１１が得
られる。再生画像信号２１１は参照画像メモリ２００に
格納され後の画面の符号化時に参照画像信号として使用
される。
【０００８】なお、画像復号化装置では、符号を解読し
た後、逆量子化２０７から参照画像メモリ２００への格
納までの処理を行うことにより、画像を再生することが
できる。
た後、逆量子化２０７から参照画像メモリ２００への格
納までの処理を行うことにより、画像を再生することが
できる。
【０００９】図４は画像メモリ２０１、参照画像メモリ
２００、動き検出回路１２の詳細図である。図４の動作
は第５図のタイミングチャートに示される動作をおこな
う。なお、図４、図５はＭが１から３までの場合に対応
している。すなわちＢピクチャがないモード（Ｍ＝１）
からＢピクチャが２枚ずつ連続して入るモード（Ｍ＝
３）にまでに対応している。以下、Ｍ＝３の場合を中心
に動作の説明を行う。入力画像がＰピクチャの場合、す
なわち図５のフレーム番号が３、６、９の場合にはベク
トル検出回路４５０−１において、参照画像メモリ２０
０に格納されている、３フレーム前の参照画像との間で
動きベクトルが検出が行われる。参照画像メモリ２００
では前方、後方２つの参照画像のための２つのフレーム
メモリ４１０、４１１をもち選択回路４１２にて参照画
像信号２０２−１に前方参照画像信号、２０２−２に後
方参照画像信号が対応するように、Ｍフレーム周期で切
り替えを行う。動き検出処理が終わった画像は、直後に
符号処理される。すなわちフレームメモリ４０１にて約
１フレーム時間遅延された信号が選択回路４０５にて選
択され符号化画像信号２０３として出力される。符号化
され、再生された画像信号２１１は参照画像メモリの中
の２つのフレームメモリ４１０、４１１のいずれか、よ
り古い参照信号が格納されている方に上書きされ格納さ
れる。符号化処理の開始時刻を、同じ時間帯に行う動き
検出処理開始時刻よりも若干早めることにより動き検出
処理時刻には画面先頭部分の参照画像信号を該当フレー
ムメモリ４１０あるいは４１１に格納しておくことがで
きる。
２００、動き検出回路１２の詳細図である。図４の動作
は第５図のタイミングチャートに示される動作をおこな
う。なお、図４、図５はＭが１から３までの場合に対応
している。すなわちＢピクチャがないモード（Ｍ＝１）
からＢピクチャが２枚ずつ連続して入るモード（Ｍ＝
３）にまでに対応している。以下、Ｍ＝３の場合を中心
に動作の説明を行う。入力画像がＰピクチャの場合、す
なわち図５のフレーム番号が３、６、９の場合にはベク
トル検出回路４５０−１において、参照画像メモリ２０
０に格納されている、３フレーム前の参照画像との間で
動きベクトルが検出が行われる。参照画像メモリ２００
では前方、後方２つの参照画像のための２つのフレーム
メモリ４１０、４１１をもち選択回路４１２にて参照画
像信号２０２−１に前方参照画像信号、２０２−２に後
方参照画像信号が対応するように、Ｍフレーム周期で切
り替えを行う。動き検出処理が終わった画像は、直後に
符号処理される。すなわちフレームメモリ４０１にて約
１フレーム時間遅延された信号が選択回路４０５にて選
択され符号化画像信号２０３として出力される。符号化
され、再生された画像信号２１１は参照画像メモリの中
の２つのフレームメモリ４１０、４１１のいずれか、よ
り古い参照信号が格納されている方に上書きされ格納さ
れる。符号化処理の開始時刻を、同じ時間帯に行う動き
検出処理開始時刻よりも若干早めることにより動き検出
処理時刻には画面先頭部分の参照画像信号を該当フレー
ムメモリ４１０あるいは４１１に格納しておくことがで
きる。
【００１０】入力画像がＩピクチャの時はベクトル検出
は行わず、Ｐピクチャと同様に１フレーム遅延した後に
符号化画像信号２０３として出力される。
は行わず、Ｐピクチャと同様に１フレーム遅延した後に
符号化画像信号２０３として出力される。
【００１１】入力画像がＢピクチャの場合はまず入力時
にＰピクチャと同様に前方参照画像に対する動きベクト
ルが検出される。次にその３フレーム時間後に後方参照
画像に対する動きベクトル検出を行う。遅延させるフレ
ーム数はＭの値に相当し、選択回路４０６にてＭ＝２の
場合と３の場合を切り替える。なおＭ＝１の場合にはＢ
ピクチャは存在しないため、後方予測は不要である。後
方予測の動き検出処理が終わった画像は、直後に符号処
理される。すなわちフレームメモリ４０３あるいは４０
４にて約１フレーム時間遅延された信号がＭの値に応じ
て選択回路４０５にて選択され符号化画像信号２０３と
して出力される。
にＰピクチャと同様に前方参照画像に対する動きベクト
ルが検出される。次にその３フレーム時間後に後方参照
画像に対する動きベクトル検出を行う。遅延させるフレ
ーム数はＭの値に相当し、選択回路４０６にてＭ＝２の
場合と３の場合を切り替える。なおＭ＝１の場合にはＢ
ピクチャは存在しないため、後方予測は不要である。後
方予測の動き検出処理が終わった画像は、直後に符号処
理される。すなわちフレームメモリ４０３あるいは４０
４にて約１フレーム時間遅延された信号がＭの値に応じ
て選択回路４０５にて選択され符号化画像信号２０３と
して出力される。
【００１２】ベクトル検出回路４５０−１，２では入力
された信号１１あるいは２１４に最も類似した部分を参
照信号２０２−１あるいは２０２−２から探し出し、そ
のときのベクトルの値を４５１−１，２として出力す
る。出力された信号はバスにまとめられて動きベクトル
信号９として出力される。
された信号１１あるいは２１４に最も類似した部分を参
照信号２０２−１あるいは２０２−２から探し出し、そ
のときのベクトルの値を４５１−１，２として出力す
る。出力された信号はバスにまとめられて動きベクトル
信号９として出力される。
【００１３】動きベクトル検出回路の動作内容を簡単に
説明する図を図６に、その動作タイミングチャートを図
７に示す。図６は図７の下に示すように２ｘ２画素の符
号化ブロックに最も類似するする部分を６（＝Ｗ）ｘＶ
（Ｖは３以上）の参照画面から探索する例である。図６
において、探索開始時はスイッチ６０３は入力信号１１
または２１４側を選択している。入力信号１１または２
１４は図７に示されるように参照信号０、１、６、７の
タイミングでＡ、Ｂ、Ｃ、Ｄの画素データを入力し、遅
延回路６０４−１〜３においてそれぞれ１クロックずつ
遅延される。同時にＲＡＭ６０３に格納され、検出単位
である４画素の入力の後は、スイッチ６０３を切り替え
て４個の入力信号を８画素周期で周期的に入力する。８
画素周期中データの存在しない期間はどのような値でも
構わない。一方、入力信号の入力開始と同時に参照画像
のうち探索する範囲のデータを参照信号２０２として入
力する。これらの信号は検出回路６０１−１〜８に入力
され、類似性が計測される。各々の検出回路に入力され
るデータは、参照信号はすべて同じデータ、入力信号は
１クロックずつ遅延させたデータがそれぞれ入力され
る。その結果、図７に示すように入力開始から８クロッ
ク経過すると各検出回路からそれぞれ位置が１画素ずつ
異なった部分との類似度６１４が出力される。この類似
度の出力は１クロックにいずれかの１検出回路のみが出
力するため最小値選択回路６０２は１クロックに１回ず
つ最小値の判定を行うことにより最も類似したベクトル
を検出することができる。類似度６１４の中には参照画
面の画面両端の境界にかかるブロック（例えば図７下の
番号で５、６、１１、１２の画素からなるブロック）も
含まれるので、最小値選択回路６０２はこうした境界に
かかるブロックは除外して処理を行う。なお、検出回路
６０１の内部は差分回路６１０にて２信号の差分をとっ
た後、絶対値回路６１１にて絶対値をとり、レジスタ６
１３に記憶していたこれまでの累積値６１４に加算す
る。４画素の最初画素のの加算直前にレジスタ６１３を
０にクリアすることにより、４クロック後に、累積値６
１４が該当部との類似度を表す値となる。図６および図
７では、説明をわかりやすくするために、通常１６ｘ１
６画素単位でおこなう動きベクトル検出を２ｘ２画素単
位に簡略化した。図６の回路にて１６ｘ１６画素単位の
検出を行う場合は検出回路数を増やす（参照画面の幅Ｗ
ｘ１６個程度）ことにより対応ができる。この検出回路
数を減らすために参照画面の左右境界部にかかる部分に
対応する検出器を省略し（ｗ−１６）ｘ１６個の検出回
路にてベクトル探索を行う方法も知られている。また、
入力信号を間欠的に入力するのではなく、連続的に入力
し回路内部で遅延させる方法も知られている。
説明する図を図６に、その動作タイミングチャートを図
７に示す。図６は図７の下に示すように２ｘ２画素の符
号化ブロックに最も類似するする部分を６（＝Ｗ）ｘＶ
（Ｖは３以上）の参照画面から探索する例である。図６
において、探索開始時はスイッチ６０３は入力信号１１
または２１４側を選択している。入力信号１１または２
１４は図７に示されるように参照信号０、１、６、７の
タイミングでＡ、Ｂ、Ｃ、Ｄの画素データを入力し、遅
延回路６０４−１〜３においてそれぞれ１クロックずつ
遅延される。同時にＲＡＭ６０３に格納され、検出単位
である４画素の入力の後は、スイッチ６０３を切り替え
て４個の入力信号を８画素周期で周期的に入力する。８
画素周期中データの存在しない期間はどのような値でも
構わない。一方、入力信号の入力開始と同時に参照画像
のうち探索する範囲のデータを参照信号２０２として入
力する。これらの信号は検出回路６０１−１〜８に入力
され、類似性が計測される。各々の検出回路に入力され
るデータは、参照信号はすべて同じデータ、入力信号は
１クロックずつ遅延させたデータがそれぞれ入力され
る。その結果、図７に示すように入力開始から８クロッ
ク経過すると各検出回路からそれぞれ位置が１画素ずつ
異なった部分との類似度６１４が出力される。この類似
度の出力は１クロックにいずれかの１検出回路のみが出
力するため最小値選択回路６０２は１クロックに１回ず
つ最小値の判定を行うことにより最も類似したベクトル
を検出することができる。類似度６１４の中には参照画
面の画面両端の境界にかかるブロック（例えば図７下の
番号で５、６、１１、１２の画素からなるブロック）も
含まれるので、最小値選択回路６０２はこうした境界に
かかるブロックは除外して処理を行う。なお、検出回路
６０１の内部は差分回路６１０にて２信号の差分をとっ
た後、絶対値回路６１１にて絶対値をとり、レジスタ６
１３に記憶していたこれまでの累積値６１４に加算す
る。４画素の最初画素のの加算直前にレジスタ６１３を
０にクリアすることにより、４クロック後に、累積値６
１４が該当部との類似度を表す値となる。図６および図
７では、説明をわかりやすくするために、通常１６ｘ１
６画素単位でおこなう動きベクトル検出を２ｘ２画素単
位に簡略化した。図６の回路にて１６ｘ１６画素単位の
検出を行う場合は検出回路数を増やす（参照画面の幅Ｗ
ｘ１６個程度）ことにより対応ができる。この検出回路
数を減らすために参照画面の左右境界部にかかる部分に
対応する検出器を省略し（ｗ−１６）ｘ１６個の検出回
路にてベクトル探索を行う方法も知られている。また、
入力信号を間欠的に入力するのではなく、連続的に入力
し回路内部で遅延させる方法も知られている。
【００１４】以上が従来の画像符号化回路の概要であ
る。これらの処理量は単位時間に入力される画素数に比
例する。そのため、各画素に対する全処理を１画素の入
力時間時内に処理する必要がある。すなわち、通常のＴ
Ｖ信号では１５Ｍ画素／秒程度の入力画素数であるた
め、１画素当りの処理を約７０ｎｓで実行しなければな
らない。通常は８ｘ８画素あるいは１６ｘ１６画素単位
で１つの処理を４μｓあるいは１６μｓ程度の時間で実
行し、これらの処理をパイプライン処理することによ
り、この条件を実現している。一方、ＨＤＴＶ信号では
通常のＴＶ信号の４倍から５倍程度の処理が必要であ
る。上記のようなパイプライン処理では非常に高速動作
の演算素子が必要になり装置のコストが上がり、回路規
模も大きくなる。そのため、ＨＤＴＶでは画面を複数の
小画面に分割し、各画面ごとに複数の小符号化回路を割
り当てて並列処理を行うことが行われることが多い。
る。これらの処理量は単位時間に入力される画素数に比
例する。そのため、各画素に対する全処理を１画素の入
力時間時内に処理する必要がある。すなわち、通常のＴ
Ｖ信号では１５Ｍ画素／秒程度の入力画素数であるた
め、１画素当りの処理を約７０ｎｓで実行しなければな
らない。通常は８ｘ８画素あるいは１６ｘ１６画素単位
で１つの処理を４μｓあるいは１６μｓ程度の時間で実
行し、これらの処理をパイプライン処理することによ
り、この条件を実現している。一方、ＨＤＴＶ信号では
通常のＴＶ信号の４倍から５倍程度の処理が必要であ
る。上記のようなパイプライン処理では非常に高速動作
の演算素子が必要になり装置のコストが上がり、回路規
模も大きくなる。そのため、ＨＤＴＶでは画面を複数の
小画面に分割し、各画面ごとに複数の小符号化回路を割
り当てて並列処理を行うことが行われることが多い。
【００１５】図８は従来の分割処理の画像符号化装置で
ある。入力画像信号２は画像分割回路８０１にて図の例
では４つの信号８０５−１，２，３，４に分割され、そ
れぞれ４つの小符号化装置１−１，２，３，４にて符号
化され、符号８０６−１，２，３，４が得られる。符号
８０６−１，２，３，４は符号統合回路８０３にて１つ
の符号７に統合される。この場合、小符号化装置の構成
は図１のものがそのまま使用できる。画面の分割の仕方
は、画面を数走査線単位（たとえば１画面１０２４走査
線を２５６走査線ずつ４分割）に分割する方法や、画面
を縦横４分割にする方法などがある。
ある。入力画像信号２は画像分割回路８０１にて図の例
では４つの信号８０５−１，２，３，４に分割され、そ
れぞれ４つの小符号化装置１−１，２，３，４にて符号
化され、符号８０６−１，２，３，４が得られる。符号
８０６−１，２，３，４は符号統合回路８０３にて１つ
の符号７に統合される。この場合、小符号化装置の構成
は図１のものがそのまま使用できる。画面の分割の仕方
は、画面を数走査線単位（たとえば１画面１０２４走査
線を２５６走査線ずつ４分割）に分割する方法や、画面
を縦横４分割にする方法などがある。
【００１６】図９は図８における画像分割回路８０１の
詳細図である。入力された画像信号１は画像の位置に応
じた切り替え信号９０３を出力する切り替え制御回路９
０２の指示に従い、スイッチ９０１にて４つの信号のう
ちのいずれかへ、画像信号を転送する。
詳細図である。入力された画像信号１は画像の位置に応
じた切り替え信号９０３を出力する切り替え制御回路９
０２の指示に従い、スイッチ９０１にて４つの信号のう
ちのいずれかへ、画像信号を転送する。
【００１７】図１０は図８における符号統合回路８０３
の詳細図である。それぞれの小符号化回路で生成された
符号８０６はファーストインファーストアウトメモリ
（ＦＩＦＯ）１００１に格納される。一方、ＦＩＦＯの
読み出しは該当画像分の符号の格納が終了した後に開始
する。読み出した符号１０１１はスイッチ１００３を介
して符号７として出力される。ＦＩＦＯ１００１−１よ
り該当画像分の符号の出力が終了すると終了信号１０１
０−１が出力され、終了信号を受けた切り替え制御回路
１００２はＦＩＦＯ１００１−１の読み出しを終了し、
ＦＩＦＯ１００１−２の読み出しを開始する。これと同
時にスイッチ１００４を出力１０１１−２側に切り替え
る。以下同様に予め規定した順序に従い４つのＦＩＦＯ
を順次読み出した後、再びＦＩＦＯ１００１−１から次
のフレームの符号の読み出しを行う。
の詳細図である。それぞれの小符号化回路で生成された
符号８０６はファーストインファーストアウトメモリ
（ＦＩＦＯ）１００１に格納される。一方、ＦＩＦＯの
読み出しは該当画像分の符号の格納が終了した後に開始
する。読み出した符号１０１１はスイッチ１００３を介
して符号７として出力される。ＦＩＦＯ１００１−１よ
り該当画像分の符号の出力が終了すると終了信号１０１
０−１が出力され、終了信号を受けた切り替え制御回路
１００２はＦＩＦＯ１００１−１の読み出しを終了し、
ＦＩＦＯ１００１−２の読み出しを開始する。これと同
時にスイッチ１００４を出力１０１１−２側に切り替え
る。以下同様に予め規定した順序に従い４つのＦＩＦＯ
を順次読み出した後、再びＦＩＦＯ１００１−１から次
のフレームの符号の読み出しを行う。
【００１８】
【発明が解決しようとする課題】上記に示した従来の分
割処理の画像符号化装置では、次の２つの課題がある。
第１の課題は、分割処理する各小符号化回路がそれぞれ
独立に符号化処理をするため、各領域の境界付近では画
面内、画面間の相関を充分用いて符号化をすることがで
きず、単一の符号化回路を用いて符号化した場合に比べ
符号化効率が低下する。特に動き補償フレーム間予測を
用いた方式では他の領域の画像を予測画像として使えな
いために、符号化効率の劣化が特に大きい。
割処理の画像符号化装置では、次の２つの課題がある。
第１の課題は、分割処理する各小符号化回路がそれぞれ
独立に符号化処理をするため、各領域の境界付近では画
面内、画面間の相関を充分用いて符号化をすることがで
きず、単一の符号化回路を用いて符号化した場合に比べ
符号化効率が低下する。特に動き補償フレーム間予測を
用いた方式では他の領域の画像を予測画像として使えな
いために、符号化効率の劣化が特に大きい。
【００１９】第２の課題は、、各小符号化回路がそれぞ
れ独立に符号化処理をするため、各小符号化回路内でし
か発生符号量を調節することしかできない。このため、
例えば、ある部分で多くの情報量が発生した場合、その
部分を符号化担当する小符号化回路の以降の処理担当部
分に割り当てる符号量が少なくなり、画質が低下し、特
に周辺の領域との境界部分で劣化が目立つ。
れ独立に符号化処理をするため、各小符号化回路内でし
か発生符号量を調節することしかできない。このため、
例えば、ある部分で多くの情報量が発生した場合、その
部分を符号化担当する小符号化回路の以降の処理担当部
分に割り当てる符号量が少なくなり、画質が低下し、特
に周辺の領域との境界部分で劣化が目立つ。
【００２０】本発明は上記の課題を解決し、小型で低コ
ストの画像符号化装置を提供することを目的とする。
ストの画像符号化装置を提供することを目的とする。
【００２１】
【課題を解決するための手段】本発明は上記の目的を達
成するために、まず、互いに隣接する領域どおしが重な
る領域を有する複数個の小画像に分割し、重複した領域
部分に書き込む信号は該当する各小符号化装置全てに伝
送する手段を設け符号化する。次に、隣接する領域を担
当する各小符号化装置間に、発生した情報量を通知する
手段を設け、１つの小符号化装置にて一時的に発生した
大量の情報量を隣接した小符号化装置にて吸収させる手
段を設ける。
成するために、まず、互いに隣接する領域どおしが重な
る領域を有する複数個の小画像に分割し、重複した領域
部分に書き込む信号は該当する各小符号化装置全てに伝
送する手段を設け符号化する。次に、隣接する領域を担
当する各小符号化装置間に、発生した情報量を通知する
手段を設け、１つの小符号化装置にて一時的に発生した
大量の情報量を隣接した小符号化装置にて吸収させる手
段を設ける。
【００２２】
【作用】各小符号化装置にて重複した領域部分を持つこ
とにより領域の境界付近においても画面内、画面間の画
素間の相関を利用することができ、単一の符号化装置に
比べた符号化効率の劣化を防止することができる。ま
た、発生した情報量を通知することにより、一時的に発
生した大量の情報量による画質の劣化を広範囲に分散す
ることができ、劣化を目立ちにくくすることができる。
とにより領域の境界付近においても画面内、画面間の画
素間の相関を利用することができ、単一の符号化装置に
比べた符号化効率の劣化を防止することができる。ま
た、発生した情報量を通知することにより、一時的に発
生した大量の情報量による画質の劣化を広範囲に分散す
ることができ、劣化を目立ちにくくすることができる。
【００２３】
【実施例】図１１に本発明を用いた実施例を示す。図１
１は図８の画像符号化装置に本発明を適用した例であ
る。図中１１００に示した部分が本発明による部分であ
り、その他の部分は図８のものと同じ機能であるため説
明を省略し、１１００の部分を中心に説明を行う。
１は図８の画像符号化装置に本発明を適用した例であ
る。図中１１００に示した部分が本発明による部分であ
り、その他の部分は図８のものと同じ機能であるため説
明を省略し、１１００の部分を中心に説明を行う。
【００２４】小符号化装置１１０１は入力された画像信
号８０５を符号化し符号８０６を出力するが、符号化処
理に用いる画面を保持するメモリを２種類持つ。１つは
符号化画像を格納するメモリであり各小符号化装置の処
理領域に対応する。もう１つは、参照画像を格納するメ
モリであり各小符号化装置の処理領域より広い、隣接し
た領域と重複した領域に対応するのメモリである。符号
化画像のメモリは、従来と同様に各小符号化装置１１０
１内に持ち、参照メモリは共有メモリ回路１１０２内に
持つ。小符号化装置１１０１から共有メモリ回路１１０
２へのアクセスはアクセス信号１１０３と読み出し信号
１１０４を用いる。
号８０５を符号化し符号８０６を出力するが、符号化処
理に用いる画面を保持するメモリを２種類持つ。１つは
符号化画像を格納するメモリであり各小符号化装置の処
理領域に対応する。もう１つは、参照画像を格納するメ
モリであり各小符号化装置の処理領域より広い、隣接し
た領域と重複した領域に対応するのメモリである。符号
化画像のメモリは、従来と同様に各小符号化装置１１０
１内に持ち、参照メモリは共有メモリ回路１１０２内に
持つ。小符号化装置１１０１から共有メモリ回路１１０
２へのアクセスはアクセス信号１１０３と読み出し信号
１１０４を用いる。
【００２５】図１２は小符号化回路１１０１の詳細図で
ある。小符号化回路１１０１の動作は図１の符号化装置
１とほとんど同じで、ＭＣ／ＤＣＴ回路１２０１に共有
メモリ回路１１０２への書き込み信号１１０３、読み出
し信号１１０４が追加されている点が異なる。図１２の
小符号化回路では重複領域として予測画像メモリを割り
当てている。予測画像を重複領域に割り当てることによ
り、従来該当領域外であった部分からも動き補償による
予測を行うことができるようになり、単一の符号化処理
装置による場合と同じ符号化効率が得られる。
ある。小符号化回路１１０１の動作は図１の符号化装置
１とほとんど同じで、ＭＣ／ＤＣＴ回路１２０１に共有
メモリ回路１１０２への書き込み信号１１０３、読み出
し信号１１０４が追加されている点が異なる。図１２の
小符号化回路では重複領域として予測画像メモリを割り
当てている。予測画像を重複領域に割り当てることによ
り、従来該当領域外であった部分からも動き補償による
予測を行うことができるようになり、単一の符号化処理
装置による場合と同じ符号化効率が得られる。
【００２６】図１３に共有メモリ回路１１０２の詳細図
を示す。書き込みは信号１１０３−１〜４を介して行
い、読み出しは信号１１０４−１〜４を用いて直接メモ
リにアクセスする。各小符号化回路より入力された書き
込み信号１１０３−１〜４はメモリ管理回路１３０１に
入力される。書き込み信号１１０３はメモリに対する制
御信号とデータを並べた信号列であり、例えば、書き込
み先頭アドレス、書き込みデータ数、書き込みデータ列
が順次転送される。書き込みデータ数は６４画素（８画
素ｘ８ライン：ブロックデータ）あるいは２５６画素
（１６画素ｘ１６ライン）あるいは３８４画素（８画素
ｘ８ライン信号を６つ：マクロブロックデータ）程度が
適当であり、２次元データを予め定められた走査法によ
って一次元信号に変換して転送する。なお、書き込みデ
ータ数は８画素あるいは１６画素の１次元データでも構
わない。また、分割後の小画面の符号化開始時に画面先
頭を示す信号と画面の大きさを転送する信号を転送し、
その後は符号化順にデータを転送するだけで予め定めら
れたアドレス順に書き込む方法でも構わない。メモリ管
理回路１３０１は書き込みアドレスにより該当するメモ
リを判断し、メモリアクセス信号１３１０−１〜４の該
当部分に信号を出力し、メモリ１３０３あるいはメモリ
１３０４に書き込む。書き込みは入力１次元データを元
の２次元データに戻したアドレスを用いて行う。
を示す。書き込みは信号１１０３−１〜４を介して行
い、読み出しは信号１１０４−１〜４を用いて直接メモ
リにアクセスする。各小符号化回路より入力された書き
込み信号１１０３−１〜４はメモリ管理回路１３０１に
入力される。書き込み信号１１０３はメモリに対する制
御信号とデータを並べた信号列であり、例えば、書き込
み先頭アドレス、書き込みデータ数、書き込みデータ列
が順次転送される。書き込みデータ数は６４画素（８画
素ｘ８ライン：ブロックデータ）あるいは２５６画素
（１６画素ｘ１６ライン）あるいは３８４画素（８画素
ｘ８ライン信号を６つ：マクロブロックデータ）程度が
適当であり、２次元データを予め定められた走査法によ
って一次元信号に変換して転送する。なお、書き込みデ
ータ数は８画素あるいは１６画素の１次元データでも構
わない。また、分割後の小画面の符号化開始時に画面先
頭を示す信号と画面の大きさを転送する信号を転送し、
その後は符号化順にデータを転送するだけで予め定めら
れたアドレス順に書き込む方法でも構わない。メモリ管
理回路１３０１は書き込みアドレスにより該当するメモ
リを判断し、メモリアクセス信号１３１０−１〜４の該
当部分に信号を出力し、メモリ１３０３あるいはメモリ
１３０４に書き込む。書き込みは入力１次元データを元
の２次元データに戻したアドレスを用いて行う。
【００２７】一方、読み出しの場合には読み出し信号１
１０４を用いてメモリ１３０３あるいは１３０４のいず
れか一方にアクセスする。読み出し信号１１０４は読み
出しアドレス線、データ線からなり書き込みとは独立に
読み出しを行うことができる。
１０４を用いてメモリ１３０３あるいは１３０４のいず
れか一方にアクセスする。読み出し信号１１０４は読み
出しアドレス線、データ線からなり書き込みとは独立に
読み出しを行うことができる。
【００２８】図１４にメモリ管理回路１２０１の詳細図
を示す。入力された書き込み信号１１０３のうち、アド
レスの部分はスイッチ１４０１を経由してアドレスＦＩ
ＦＯ１４０２に格納されデータ部分はデータＦＩＦＯ１
４０３に格納される。格納されたアドレス、データはス
イッチ１４０４およびスイッチ１４０７により選択され
該当するメモリに同時に書き込まれる。この際、アドレ
スデータはアドレス変換回路１４０５により各小符号化
回路の使用するアドレスに変換する。書き込み信号１１
０３−１〜４による書き込みが時間的に重なった場合に
は、重なった信号のうち１つのみを書き込み、他の書き
込みは最初の書き込みが終了するまで遅延させた後に実
行する。なお、ＦＩＦＯがオーバーフローする恐れがあ
る場合は該当する小符号化回路に通知し、データの入力
を中止させる。
を示す。入力された書き込み信号１１０３のうち、アド
レスの部分はスイッチ１４０１を経由してアドレスＦＩ
ＦＯ１４０２に格納されデータ部分はデータＦＩＦＯ１
４０３に格納される。格納されたアドレス、データはス
イッチ１４０４およびスイッチ１４０７により選択され
該当するメモリに同時に書き込まれる。この際、アドレ
スデータはアドレス変換回路１４０５により各小符号化
回路の使用するアドレスに変換する。書き込み信号１１
０３−１〜４による書き込みが時間的に重なった場合に
は、重なった信号のうち１つのみを書き込み、他の書き
込みは最初の書き込みが終了するまで遅延させた後に実
行する。なお、ＦＩＦＯがオーバーフローする恐れがあ
る場合は該当する小符号化回路に通知し、データの入力
を中止させる。
【００２９】図１５にメモリ管理回路のアドレス変換の
例を示す。図１５は水平１９２０画素、垂直１０２４ラ
インの画面を４分割する例である。なお、ＭＰＥＧ等の
画像符号化方式では輝度信号１６画素ｘ１６ライン毎に
処理をするため分割する領域の大きさは、水平垂直とも
に１６の倍数の矩形が好ましい。但し、画面の右端ある
いは下端を含む領域に関しては１６の倍数でなくても構
わない。また、インターレース画像の２つのフィールド
を１ライン毎に合成して作りだしたフレームを処理する
符号化装置においては、領域の垂直方向の画素数はフレ
ーム画像上で３２の倍数が望ましい。分割例（１）は水
平に４分割し、分割例（２）は水平垂直にそれぞれ２分
割した例である。ともに境界を接する隣接領域との間で
境界より１２８ラインあるいは１２８画素分の共有領域
を持った例である。なお、以降の説明ではメモリを２次
元のアドレスにより指定するものと考え、特に指定のな
いかぎり垂直アドレスを単にアドレスと呼ぶ。
例を示す。図１５は水平１９２０画素、垂直１０２４ラ
インの画面を４分割する例である。なお、ＭＰＥＧ等の
画像符号化方式では輝度信号１６画素ｘ１６ライン毎に
処理をするため分割する領域の大きさは、水平垂直とも
に１６の倍数の矩形が好ましい。但し、画面の右端ある
いは下端を含む領域に関しては１６の倍数でなくても構
わない。また、インターレース画像の２つのフィールド
を１ライン毎に合成して作りだしたフレームを処理する
符号化装置においては、領域の垂直方向の画素数はフレ
ーム画像上で３２の倍数が望ましい。分割例（１）は水
平に４分割し、分割例（２）は水平垂直にそれぞれ２分
割した例である。ともに境界を接する隣接領域との間で
境界より１２８ラインあるいは１２８画素分の共有領域
を持った例である。なお、以降の説明ではメモリを２次
元のアドレスにより指定するものと考え、特に指定のな
いかぎり垂直アドレスを単にアドレスと呼ぶ。
【００３０】分割例（１）では、画面を２５６走査線ご
とに分割した符号化装置において、各メモリ１３０３、
１３０４に垂直方向５１２走査線分のメモリを実装し、
どの小符号化回路もアドレス０〜２５５までを符号化処
理する領域、アドレス２５６〜５１１に共有領域を格納
している。第１のメモリ、例えば１３０４−１では、走
査線２５６〜３８３までを垂直アドレス２５６〜３８３
に、メモリ１３０４−２では領域１の走査線１２８〜２
５５までを垂直アドレス３８４〜５１１に、領域３の走
査線５１２〜６３９までを垂直アドレス２５６〜３８３
に格納している。従って、例えば走査線２４０のデータ
はメモリ１３０４−１のアドレス２４０に書き込まれる
のと同時にメモリ１３０４−２のアドレス４９６（２４
０＋２５６）に書き込まれる。また、走査線３００のデ
ータはメモリ１３０４−２のアドレス４４（３００−２
５６）に書き込まれるのと同時にメモリ１３０４−１の
アドレス３００（３００−２５６＋２５６）に書き込ま
れる。一般に走査線Ｐ本ずつの小領域に分割し、境界を
接する隣接領域１つに対しＱ走査線分のデータを共有す
る場合、各メモリの垂直アドレスはＰ＋２Ｑ必要であ
る。記号／を割り算後の小数点以下切り捨て処理、記号
％を剰余計算とすると、走査線Ｙのデータは領域ｎ（＝
Ｙ／Ｐ）のアドレスｙ（＝Ｙ％Ｐ、０≦ｙ≦Ｐ−１）に
書き込まれ、ｙ＜Ｑの場合には領域（ｎ−１）と共有さ
れ、領域（ｎ−１）のメモリのアドレス（ｙ＋Ｐ）に、
ｙ≧Ｐ−Ｑの場合には領域（ｎ＋１）と共有され、領域
（ｎ＋１）のメモリのアドレス（ｙ−（Ｐ−Ｑ）＋Ｐ＋
Ｑ＝ｙ＋２Ｑ）に格納される。上記の計算はアドレス変
換回路１４０５で実行され、固定値の加算・減算で実現
できる。特にＰ＝２５６、Ｑ＝１２８のようにＰが２の
ベキ乗、Ｑがその１／２の例では上記の例で示したよう
に加算・減算はビット操作のみで実現でき回路規模削減
の効果が大きい。Ｐが２のベキ乗、Ｑがその１／２未満
の場合もＱがＰの１／２の場合と同じアドレスを割り当
てることによりビット操作のみによる演算が可能にな
る。この場合、アドレスの途中にアクセスしない領域が
存在するが、この領域に対して実際のメモリ素子を割り
当てても割り当てなくても構わない。
とに分割した符号化装置において、各メモリ１３０３、
１３０４に垂直方向５１２走査線分のメモリを実装し、
どの小符号化回路もアドレス０〜２５５までを符号化処
理する領域、アドレス２５６〜５１１に共有領域を格納
している。第１のメモリ、例えば１３０４−１では、走
査線２５６〜３８３までを垂直アドレス２５６〜３８３
に、メモリ１３０４−２では領域１の走査線１２８〜２
５５までを垂直アドレス３８４〜５１１に、領域３の走
査線５１２〜６３９までを垂直アドレス２５６〜３８３
に格納している。従って、例えば走査線２４０のデータ
はメモリ１３０４−１のアドレス２４０に書き込まれる
のと同時にメモリ１３０４−２のアドレス４９６（２４
０＋２５６）に書き込まれる。また、走査線３００のデ
ータはメモリ１３０４−２のアドレス４４（３００−２
５６）に書き込まれるのと同時にメモリ１３０４−１の
アドレス３００（３００−２５６＋２５６）に書き込ま
れる。一般に走査線Ｐ本ずつの小領域に分割し、境界を
接する隣接領域１つに対しＱ走査線分のデータを共有す
る場合、各メモリの垂直アドレスはＰ＋２Ｑ必要であ
る。記号／を割り算後の小数点以下切り捨て処理、記号
％を剰余計算とすると、走査線Ｙのデータは領域ｎ（＝
Ｙ／Ｐ）のアドレスｙ（＝Ｙ％Ｐ、０≦ｙ≦Ｐ−１）に
書き込まれ、ｙ＜Ｑの場合には領域（ｎ−１）と共有さ
れ、領域（ｎ−１）のメモリのアドレス（ｙ＋Ｐ）に、
ｙ≧Ｐ−Ｑの場合には領域（ｎ＋１）と共有され、領域
（ｎ＋１）のメモリのアドレス（ｙ−（Ｐ−Ｑ）＋Ｐ＋
Ｑ＝ｙ＋２Ｑ）に格納される。上記の計算はアドレス変
換回路１４０５で実行され、固定値の加算・減算で実現
できる。特にＰ＝２５６、Ｑ＝１２８のようにＰが２の
ベキ乗、Ｑがその１／２の例では上記の例で示したよう
に加算・減算はビット操作のみで実現でき回路規模削減
の効果が大きい。Ｐが２のベキ乗、Ｑがその１／２未満
の場合もＱがＰの１／２の場合と同じアドレスを割り当
てることによりビット操作のみによる演算が可能にな
る。この場合、アドレスの途中にアクセスしない領域が
存在するが、この領域に対して実際のメモリ素子を割り
当てても割り当てなくても構わない。
【００３１】図１５の分割例（２）では画面を９６０ｘ
５１２画素の４つの小画面に分割する。この場合は符号
化する領域はメモリのアドレス０〜５１１に格納され、
アドレス５１２以降に共有領域のデータが格納される。
メモリ１３０４−１の例ではアドレス５１２〜６３９に
領域３の９６０画素ｘ１２８ライン（走査線５１２〜６
３９ライン）を、アドレス６４０〜７６７に領域２の１
２８画素ｘ５１２ライン（走査線０〜５１１ライン）の
垂直、水平アドレスを交換したものを、アドレス７６８
〜９６０に領域４の１２８画素ｘ１２８ライン（走査線
５１２〜６３９ライン）を格納する。書き込み時には、
例えば領域１〜４すべてに共有される部分のデータはメ
モリ１３０４−１〜４に同時に書き込まれる。アドレス
変換回路１４０５では以上のアドレス変換走査を行う。
水平垂直分割では水平分割に比べアドレス変換回路１４
０５はやや複雑になる。一方同じ共有範囲（境界より同
画素数の範囲）を実現する場合には各メモリ１３０３、
１３０４の容量は少なくなる。図１５の例では３／４の
容量になっている。なお、上記の説明は輝度信号を例に
取っておこなったが、色信号、あるいは輝度信号と色信
号の両方、すべてに適用可能である。
５１２画素の４つの小画面に分割する。この場合は符号
化する領域はメモリのアドレス０〜５１１に格納され、
アドレス５１２以降に共有領域のデータが格納される。
メモリ１３０４−１の例ではアドレス５１２〜６３９に
領域３の９６０画素ｘ１２８ライン（走査線５１２〜６
３９ライン）を、アドレス６４０〜７６７に領域２の１
２８画素ｘ５１２ライン（走査線０〜５１１ライン）の
垂直、水平アドレスを交換したものを、アドレス７６８
〜９６０に領域４の１２８画素ｘ１２８ライン（走査線
５１２〜６３９ライン）を格納する。書き込み時には、
例えば領域１〜４すべてに共有される部分のデータはメ
モリ１３０４−１〜４に同時に書き込まれる。アドレス
変換回路１４０５では以上のアドレス変換走査を行う。
水平垂直分割では水平分割に比べアドレス変換回路１４
０５はやや複雑になる。一方同じ共有範囲（境界より同
画素数の範囲）を実現する場合には各メモリ１３０３、
１３０４の容量は少なくなる。図１５の例では３／４の
容量になっている。なお、上記の説明は輝度信号を例に
取っておこなったが、色信号、あるいは輝度信号と色信
号の両方、すべてに適用可能である。
【００３２】図１１から図１５までの説明は画面の分割
数を４として行ってきたが、画面の分割数は４以外のい
くつの値にも適用できることは明白である。分割数が多
くなると１つの小符号化装置あたりの処理量が少なくな
るため、より低処理能力の回路を用いたり、逆に同じ処
理能力でより大面積の画像を符号化することが可能にな
る。ただし、１つの小画像符号化装置がある画面を符号
化終了し、次の画面の符号化を開始するには、領域を共
有する全ての小符号化装置の処理の終了を待つ必要があ
る。例えば水平分割の場合では、領域１の信号が入力さ
れ終わった時点で小符号化装置１１０１−１が処理を開
始し、領域２が入力され終わった時点で小符号化装置１
１０１−１が処理を開始するように、処理開始時間を小
符号化装置毎にずらした方が遅延が少なくなり、遅延補
正用のバッファ容量も少なくてすむ利点がある。こうし
た方法では、小符号化装置１１０１−１が次の符号化を
開始するには小符号化装置１１０１−２の終了を待たな
ければ、同様に小符号化装置１１０１−２は小符号化装
置１１０１−３の終了を、小符号化装置１１０１−３は
小符号化装置１１０１−４の終了を待たなければならな
い。いいかえれば、１つ前の小符号化装置の画面が入力
される前に符号化処理を終了しなくてはならない。その
結果、各小符号化装置が実質符号化処理を行う時間は３
／４になり、各小符号化装置の処理能力は全体の処理量
を１とした場合、１／４ではなく、１／３（＝１／４＊
４／３）になる。分割数を増やし、更に共有する領域の
小符号化装置数が増えた場合には、該当する全ての小符
号化装置の終了を待たないと次の画面の符号化を開始す
ることができない。そのため、分割数を増やしていって
も共有する領域が広い場合は必ずしも各小符号化装置の
処理能力を低くすることはできない。画像符号化の処理
単位が輝度信号で１６ｘ１６画素である点と、動きベク
トルの探索範囲が−１５〜＋１５程度で大部分の動きを
補償できることから、共有領域の走査線数は境界から１
６ライン（境界の上下３２ライン分が２つの領域により
共有される）が最適である。ただし、垂直方向の画面の
相関はあまり強くないことから共有領域を８ラインにし
ても画質への影響は少ない。１６ライン程度以下の共有
の場合は上記の符号化開始待ち時間による影響は小さ
い。
数を４として行ってきたが、画面の分割数は４以外のい
くつの値にも適用できることは明白である。分割数が多
くなると１つの小符号化装置あたりの処理量が少なくな
るため、より低処理能力の回路を用いたり、逆に同じ処
理能力でより大面積の画像を符号化することが可能にな
る。ただし、１つの小画像符号化装置がある画面を符号
化終了し、次の画面の符号化を開始するには、領域を共
有する全ての小符号化装置の処理の終了を待つ必要があ
る。例えば水平分割の場合では、領域１の信号が入力さ
れ終わった時点で小符号化装置１１０１−１が処理を開
始し、領域２が入力され終わった時点で小符号化装置１
１０１−１が処理を開始するように、処理開始時間を小
符号化装置毎にずらした方が遅延が少なくなり、遅延補
正用のバッファ容量も少なくてすむ利点がある。こうし
た方法では、小符号化装置１１０１−１が次の符号化を
開始するには小符号化装置１１０１−２の終了を待たな
ければ、同様に小符号化装置１１０１−２は小符号化装
置１１０１−３の終了を、小符号化装置１１０１−３は
小符号化装置１１０１−４の終了を待たなければならな
い。いいかえれば、１つ前の小符号化装置の画面が入力
される前に符号化処理を終了しなくてはならない。その
結果、各小符号化装置が実質符号化処理を行う時間は３
／４になり、各小符号化装置の処理能力は全体の処理量
を１とした場合、１／４ではなく、１／３（＝１／４＊
４／３）になる。分割数を増やし、更に共有する領域の
小符号化装置数が増えた場合には、該当する全ての小符
号化装置の終了を待たないと次の画面の符号化を開始す
ることができない。そのため、分割数を増やしていって
も共有する領域が広い場合は必ずしも各小符号化装置の
処理能力を低くすることはできない。画像符号化の処理
単位が輝度信号で１６ｘ１６画素である点と、動きベク
トルの探索範囲が−１５〜＋１５程度で大部分の動きを
補償できることから、共有領域の走査線数は境界から１
６ライン（境界の上下３２ライン分が２つの領域により
共有される）が最適である。ただし、垂直方向の画面の
相関はあまり強くないことから共有領域を８ラインにし
ても画質への影響は少ない。１６ライン程度以下の共有
の場合は上記の符号化開始待ち時間による影響は小さ
い。
【００３３】一般に水平方向の画面の相関が強いことか
ら水平方向には全画素を同じ領域として処理した方が符
号化効率が向上する。小符号化装置の数と分割領域の数
は必ずしも一致しなくてもよい。小符号化装置の数が少
ない場合には処理を終了した小符号化装置が同じ画面の
別の領域を符号化することになる。小符号化装置の数が
多い場合には、１つの小符号化装置あたりの処理を少な
くできるが、実際には、前の画面の符号化が終わらない
と次の符号化が開始できないため、１６ライン程度共有
の例では領域分割数をＲとすると小符号化装置の処理能
力は１／（Ｒ−１）必要になる。ただし、Ｂピクチャの
ように他の画面の予測には用いない画面の符号化に対し
ては１／Ｒの処理能力で対応できる。
ら水平方向には全画素を同じ領域として処理した方が符
号化効率が向上する。小符号化装置の数と分割領域の数
は必ずしも一致しなくてもよい。小符号化装置の数が少
ない場合には処理を終了した小符号化装置が同じ画面の
別の領域を符号化することになる。小符号化装置の数が
多い場合には、１つの小符号化装置あたりの処理を少な
くできるが、実際には、前の画面の符号化が終わらない
と次の符号化が開始できないため、１６ライン程度共有
の例では領域分割数をＲとすると小符号化装置の処理能
力は１／（Ｒ−１）必要になる。ただし、Ｂピクチャの
ように他の画面の予測には用いない画面の符号化に対し
ては１／Ｒの処理能力で対応できる。
【００３４】以上の共有メモリの書き込み操作では、以
下の効果がある。各小符号化装置１１０１において隣接
する小符号化装置の参照画像をアクセスすることができ
るため動き補償の範囲が単一の符号化装置の場合と同じ
にとることができ、分割符号化方式の欠点を補うことが
できる。共有領域を同時に書き込むことにより単位時間
当りのメモリへの書き込み回数は単一符号化装置を用い
た場合と同じ回数になる。従って、メモリ管理回路やメ
モリは、単一符号化装置を用いた場合と同じ動作速度の
ものを用いることができ、特に高速な素子や複雑な回路
を必要としない。
下の効果がある。各小符号化装置１１０１において隣接
する小符号化装置の参照画像をアクセスすることができ
るため動き補償の範囲が単一の符号化装置の場合と同じ
にとることができ、分割符号化方式の欠点を補うことが
できる。共有領域を同時に書き込むことにより単位時間
当りのメモリへの書き込み回数は単一符号化装置を用い
た場合と同じ回数になる。従って、メモリ管理回路やメ
モリは、単一符号化装置を用いた場合と同じ動作速度の
ものを用いることができ、特に高速な素子や複雑な回路
を必要としない。
【００３５】図１６は図１２のＭＣ／ＤＣＴ回路１１０
３の詳細図である。ＭＣ／ＤＣＴ回路１１０３全体の動
作は従来のＭＣ／ＤＣＴ回路４とほぼ同じであるので説
明を省略する。図１６のＭＣ／ＤＣＴ回路１１０３では
図２の参照画像メモリ２００に相当する部分が外部の共
有メモリ回路１１０２の中に設けられている点が本発明
に係わる部分である。そのため書き込み信号１１０３、
読み出し信号１１０４が追加されている。この部分を除
けばＭＣ／ＤＣＴ回路１１０３とＭＣ／ＤＣＴ回路４と
は全く同じである。
３の詳細図である。ＭＣ／ＤＣＴ回路１１０３全体の動
作は従来のＭＣ／ＤＣＴ回路４とほぼ同じであるので説
明を省略する。図１６のＭＣ／ＤＣＴ回路１１０３では
図２の参照画像メモリ２００に相当する部分が外部の共
有メモリ回路１１０２の中に設けられている点が本発明
に係わる部分である。そのため書き込み信号１１０３、
読み出し信号１１０４が追加されている。この部分を除
けばＭＣ／ＤＣＴ回路１１０３とＭＣ／ＤＣＴ回路４と
は全く同じである。
【００３６】このように本発明を適用した画像符号化装
置８００は、単一の符号化装置と同じ符号化効率を保ち
ながら、画面を４分割し処理することにより各小符号化
装置処理量が約１／３〜１／４になり、低速デバイスの
みを用いて符号化処理が可能となる。その結果、低速で
小規模あるいは低速で低コストが実現でき、装置全体の
小型化あるは低コスト化あるいはその両方が達成でき
る。また、本発明は小符号化装置１１０１としてプロセ
ッサ等によるソフトウエア処理をしたときにその効果が
大きい。現在のプロセッサの能力では通常のＴＶ信号を
単一プロセッサで符号化することは難しい。一方、ソフ
トウエア処理により符号化処理が実現できれば、処理方
法の改良や、新符号化方式への対応など容易に実行でき
るほか、装置の開発、メンテナンスの時間、手間も削減
できる。本発明を適用することにより、ソフトウェア処
理の利点を生かしながら、かつ、単一ハードウェアによ
る符号化効率と同じ効率を得ることが可能になる。この
とき、各小符号化装置１１０１に固有の番号をつけてお
き、その番号をもとに符号化領域位置、アドレス変換方
法等を設定するようにすれば、全ての小符号化装置を同
じ構成にすることができ、ハードウエェア処理で実現す
る場合には装置の基版あるいはLSI等の生産性・検査効
率が向上し、ソフトウェア処理で実現する場合には上記
の生産性向上の他に実行ソフトウェアの配送の時間・手
間を削減できる。
置８００は、単一の符号化装置と同じ符号化効率を保ち
ながら、画面を４分割し処理することにより各小符号化
装置処理量が約１／３〜１／４になり、低速デバイスの
みを用いて符号化処理が可能となる。その結果、低速で
小規模あるいは低速で低コストが実現でき、装置全体の
小型化あるは低コスト化あるいはその両方が達成でき
る。また、本発明は小符号化装置１１０１としてプロセ
ッサ等によるソフトウエア処理をしたときにその効果が
大きい。現在のプロセッサの能力では通常のＴＶ信号を
単一プロセッサで符号化することは難しい。一方、ソフ
トウエア処理により符号化処理が実現できれば、処理方
法の改良や、新符号化方式への対応など容易に実行でき
るほか、装置の開発、メンテナンスの時間、手間も削減
できる。本発明を適用することにより、ソフトウェア処
理の利点を生かしながら、かつ、単一ハードウェアによ
る符号化効率と同じ効率を得ることが可能になる。この
とき、各小符号化装置１１０１に固有の番号をつけてお
き、その番号をもとに符号化領域位置、アドレス変換方
法等を設定するようにすれば、全ての小符号化装置を同
じ構成にすることができ、ハードウエェア処理で実現す
る場合には装置の基版あるいはLSI等の生産性・検査効
率が向上し、ソフトウェア処理で実現する場合には上記
の生産性向上の他に実行ソフトウェアの配送の時間・手
間を削減できる。
【００３７】図１７は本発明を適用した第２の実施例で
ある。図１７では本発明を画像復号化装置１７００に適
用している。画像復号化装置１７００は画像符号化装置
１もしくは８００などで生成した符号列を入力し、元の
画像を再生する装置である。入力符号列７は符号分割回
路１７０１に入力され、予め分割された領域に対応する
符号１７１０−１〜４に分割される。分割された符号１
７１０は小復号化装置１７０２に入力され、画像が再生
１７０２される。再生された画像１７０２−１〜４は画
像合成回路１７０３において、１枚の画像２に合成され
る。
ある。図１７では本発明を画像復号化装置１７００に適
用している。画像復号化装置１７００は画像符号化装置
１もしくは８００などで生成した符号列を入力し、元の
画像を再生する装置である。入力符号列７は符号分割回
路１７０１に入力され、予め分割された領域に対応する
符号１７１０−１〜４に分割される。分割された符号１
７１０は小復号化装置１７０２に入力され、画像が再生
１７０２される。再生された画像１７０２−１〜４は画
像合成回路１７０３において、１枚の画像２に合成され
る。
【００３８】図１８は符号分割回路１７０１の詳細図で
ある。入力された符号７は、ヘッダ検出回路１８０２に
おいて、そのヘッダ部分が検出・解析され画面上のどの
位置の符号化が調べられる。その位置情報１８１１に従
って、切り換え制御回路１８０３はスイッチ１８０１を
制御信号１８１０を用いて切り替える。
ある。入力された符号７は、ヘッダ検出回路１８０２に
おいて、そのヘッダ部分が検出・解析され画面上のどの
位置の符号化が調べられる。その位置情報１８１１に従
って、切り換え制御回路１８０３はスイッチ１８０１を
制御信号１８１０を用いて切り替える。
【００３９】図１９に復号化回路１７０２の詳細図を示
す。入力された符号１７１０は、一旦、符号バッファ１
９０１に蓄えられた後に可変長復号化回路１９０２によ
って読みだされ、解読される。解読の結果、差分画像の
ＤＣＴ係数８と動きベクトル９等の復号化情報がＭＣ／
ｉＤＣＴ回路１９０３に入力される。ＭＣ／ｉＤＣＴ回
路１９０３ではＤＣＴ係数８を逆量子化をした後、ＤＣ
Ｔ逆変換（ｉＤＣＴ）により差分画像を再生する。一
方、動きベクトル９等の情報で示された予測画像を共有
メモリ回路１１０２に格納された参照画像から読み出し
信号１７１３を用いて生成し、再生した差分画像に加え
る。これらの処理は先に述べたように第３図の逆量子化
２０７から参照画像メモリ２００への格納までの処理を
と同じである。この操作により再生画像が得られる。再
生画像は出力バッファ１９０４に蓄えられ、表示に同期
して読みだされ、ＴＶの画面等に表示される。同時に、
共有メモリ回路１１０２に書き込み信号１７１２を介し
て格納する。
す。入力された符号１７１０は、一旦、符号バッファ１
９０１に蓄えられた後に可変長復号化回路１９０２によ
って読みだされ、解読される。解読の結果、差分画像の
ＤＣＴ係数８と動きベクトル９等の復号化情報がＭＣ／
ｉＤＣＴ回路１９０３に入力される。ＭＣ／ｉＤＣＴ回
路１９０３ではＤＣＴ係数８を逆量子化をした後、ＤＣ
Ｔ逆変換（ｉＤＣＴ）により差分画像を再生する。一
方、動きベクトル９等の情報で示された予測画像を共有
メモリ回路１１０２に格納された参照画像から読み出し
信号１７１３を用いて生成し、再生した差分画像に加え
る。これらの処理は先に述べたように第３図の逆量子化
２０７から参照画像メモリ２００への格納までの処理を
と同じである。この操作により再生画像が得られる。再
生画像は出力バッファ１９０４に蓄えられ、表示に同期
して読みだされ、ＴＶの画面等に表示される。同時に、
共有メモリ回路１１０２に書き込み信号１７１２を介し
て格納する。
【００４０】図２０に画像合成回路１７０３の詳細図を
示す。切り換え制御回路２００２は表示タイミングを監
視し、表示部分に該当する領域の再生画像信号１７１１
−１〜４をスイッチ２００１で選択し、画素データを読
み出し出力画像信号２へ出力する。
示す。切り換え制御回路２００２は表示タイミングを監
視し、表示部分に該当する領域の再生画像信号１７１１
−１〜４をスイッチ２００１で選択し、画素データを読
み出し出力画像信号２へ出力する。
【００４１】以上、本発明は図１７のように画像復号化
装置にも適用することができる。従来、分割処理を行う
復号化装置は他の小領域からの予測を禁止した特殊な符
号でなければ画像を再生することができなかった。本発
明を適用することにより、この制約がなくなり、あわせ
て、符号化装置の場合と同様に回路規模の削減の効果も
得られる。また、符号化装置の場合と同様に、特にソフ
トウェア処理を行った場合にその効果が大きい。画像の
分割の仕方は水平分割のみ垂直方向のライン数は１６の
倍数、インターレース画像の場合は３２の倍数でなけれ
ばならない。
装置にも適用することができる。従来、分割処理を行う
復号化装置は他の小領域からの予測を禁止した特殊な符
号でなければ画像を再生することができなかった。本発
明を適用することにより、この制約がなくなり、あわせ
て、符号化装置の場合と同様に回路規模の削減の効果も
得られる。また、符号化装置の場合と同様に、特にソフ
トウェア処理を行った場合にその効果が大きい。画像の
分割の仕方は水平分割のみ垂直方向のライン数は１６の
倍数、インターレース画像の場合は３２の倍数でなけれ
ばならない。
【００４２】以下、上記２実施例の変形例を示す。以下
の変形例あるいは以下の変形例の組み合わせが本発明に
包含されることは明白である。
の変形例あるいは以下の変形例の組み合わせが本発明に
包含されることは明白である。
【００４３】図２１に小符号化回路１１０１の変形例を
示す。図２１の符号化回路ではＭＣ／ＤＣＴ回路４と可
変長復号化回路５と間にＤＣＴ係数８、動きベクトル９
等の情報を一時的に蓄えれるバッファ２１０２が置かれ
ている点である。ＭＣ／ＤＣＴ４の処理は先にも説明し
たように画素数に比例した処理量になるため、予め固定
的に定められた時間内に１処理単位（８ｘ８ブロックの
処理あるいはマクロブロックの処理）を行うことがハー
ドウェアの実現上望ましい。一方、可変長符号化５の処
理量は発生する符号量に依存し上記の１処理単位ごとの
処理量は異なる。これら性質の異なる２つの処理をパイ
プライン処理する場合には、例えば可変長符号の処理時
間がＭＣ／ＤＣＴ処理時間よりも長くなると、ＭＣ／Ｄ
ＣＴの１処理単位の処理が終了しても可変長符号化の該
当処理が終わらず、ＭＣ／ＤＣＴ回路４が次の処理の開
始待つ問題点がある。この解決策として、ＭＣ／ＤＣＴ
４の１処理単位時間内に可変長符号化５の該当する処理
終わらせるように、高速な可変長符号化回路を用いる方
法と、ＭＣ／ＤＣＴ回路４の処理を高速化し可変長符号
化処理の待ち時間が生じても規定時間内に規定の処理を
実行できるようにする方法の２つが知られている。いず
れの方法も高速処理回路が必要になるため装置の低コス
トか小型化には不向きであった。図２１のようにバッフ
ァ２１０２を置くことにより、ＭＣ／ＤＣＴ、可変長符
号化の両処理の処理量の片寄を吸収することができ、両
回路とも低速で処理を行うことが可能になる。バッファ
の量は最大、画面１枚の情報を格納できる量、すなわち
１画面の画素数と同じ数のＤＣＴ係数と動きベクトル情
報等を保持できることが望ましいが、実質的には１画面
の画素数の１／２〜１／４程度の容量でかまわない。実
際の動作時には、バッファ２１０１に予め定めた個数の
ＤＣＴ係数が入力された時点で可変長符号化回路５の処
理を開始させる。なお、本発明は第１１図に示した実施
例と組み合わせて用いると、さらに回路規模を削減でき
るが、単一の小符号化回路を用いた画像符号化装置に適
用しても同程度の回路規模削減効果が得られる。
示す。図２１の符号化回路ではＭＣ／ＤＣＴ回路４と可
変長復号化回路５と間にＤＣＴ係数８、動きベクトル９
等の情報を一時的に蓄えれるバッファ２１０２が置かれ
ている点である。ＭＣ／ＤＣＴ４の処理は先にも説明し
たように画素数に比例した処理量になるため、予め固定
的に定められた時間内に１処理単位（８ｘ８ブロックの
処理あるいはマクロブロックの処理）を行うことがハー
ドウェアの実現上望ましい。一方、可変長符号化５の処
理量は発生する符号量に依存し上記の１処理単位ごとの
処理量は異なる。これら性質の異なる２つの処理をパイ
プライン処理する場合には、例えば可変長符号の処理時
間がＭＣ／ＤＣＴ処理時間よりも長くなると、ＭＣ／Ｄ
ＣＴの１処理単位の処理が終了しても可変長符号化の該
当処理が終わらず、ＭＣ／ＤＣＴ回路４が次の処理の開
始待つ問題点がある。この解決策として、ＭＣ／ＤＣＴ
４の１処理単位時間内に可変長符号化５の該当する処理
終わらせるように、高速な可変長符号化回路を用いる方
法と、ＭＣ／ＤＣＴ回路４の処理を高速化し可変長符号
化処理の待ち時間が生じても規定時間内に規定の処理を
実行できるようにする方法の２つが知られている。いず
れの方法も高速処理回路が必要になるため装置の低コス
トか小型化には不向きであった。図２１のようにバッフ
ァ２１０２を置くことにより、ＭＣ／ＤＣＴ、可変長符
号化の両処理の処理量の片寄を吸収することができ、両
回路とも低速で処理を行うことが可能になる。バッファ
の量は最大、画面１枚の情報を格納できる量、すなわち
１画面の画素数と同じ数のＤＣＴ係数と動きベクトル情
報等を保持できることが望ましいが、実質的には１画面
の画素数の１／２〜１／４程度の容量でかまわない。実
際の動作時には、バッファ２１０１に予め定めた個数の
ＤＣＴ係数が入力された時点で可変長符号化回路５の処
理を開始させる。なお、本発明は第１１図に示した実施
例と組み合わせて用いると、さらに回路規模を削減でき
るが、単一の小符号化回路を用いた画像符号化装置に適
用しても同程度の回路規模削減効果が得られる。
【００４４】図２２は図１６のＭＣ／ＤＣＴ回路１２０
１の変形例である。図１６と異なる第一の点は動き検出
回路２２０３に参照画像１１０４ではなく遅延させた入
力画像２２１０が入力されている点である。通常、参照
画像とそれに対応する入力画像の差は小さいため、本来
は参照画像１１０４を用いて動き検出を行う所を、入力
画像を遅延させた信号２２１０を用いて動き検出を行う
ことができる。図２２の実施例では参照画像による検出
と入力画像による検出との誤差を吸収するために動き補
償回路２２０２内にて、参照画像を用いた小範囲の動き
検出を行っている。
１の変形例である。図１６と異なる第一の点は動き検出
回路２２０３に参照画像１１０４ではなく遅延させた入
力画像２２１０が入力されている点である。通常、参照
画像とそれに対応する入力画像の差は小さいため、本来
は参照画像１１０４を用いて動き検出を行う所を、入力
画像を遅延させた信号２２１０を用いて動き検出を行う
ことができる。図２２の実施例では参照画像による検出
と入力画像による検出との誤差を吸収するために動き補
償回路２２０２内にて、参照画像を用いた小範囲の動き
検出を行っている。
【００４５】図２３は図２２におけるフレームメモリ回
路２２０１の詳細図である。従来、図４にあるように参
照画像２１１を入力していたメモリ４１０、４１１の代
わりに入力画像１１を格納するメモリ２３０１、２３０
２が使われる。メモリ２３０１、２３０２は各小領域に
共有領域の部分を加えただけの容量が必要であり、格納
する画素数は他のメモリ４０１〜４０４よりも多い。こ
れは信号１１に全画面分の画像データを流しておき、メ
モリ４０１、２３０１、２３０２にて必要な部分のみを
書き込むことにより実現できる。なお、メモリ２３０１
あるいは２３０２への格納は入力された画像１１がＩピ
クチャあるいはＰピクチャに該当するときにのみ行われ
る。入力された画像は選択回路２３０３により２２１０
−１が前方予測用の信号、２２１０−２が後方予測用の
信号に並び替えられて出力される。
路２２０１の詳細図である。従来、図４にあるように参
照画像２１１を入力していたメモリ４１０、４１１の代
わりに入力画像１１を格納するメモリ２３０１、２３０
２が使われる。メモリ２３０１、２３０２は各小領域に
共有領域の部分を加えただけの容量が必要であり、格納
する画素数は他のメモリ４０１〜４０４よりも多い。こ
れは信号１１に全画面分の画像データを流しておき、メ
モリ４０１、２３０１、２３０２にて必要な部分のみを
書き込むことにより実現できる。なお、メモリ２３０１
あるいは２３０２への格納は入力された画像１１がＩピ
クチャあるいはＰピクチャに該当するときにのみ行われ
る。入力された画像は選択回路２３０３により２２１０
−１が前方予測用の信号、２２１０−２が後方予測用の
信号に並び替えられて出力される。
【００４６】これら図２２、図２３の処理により、図１
６の実施例において、動き検出時の参照画像の読み出し
回数を大幅に削減することができる。参照画像は、前の
画像の符号化および局所的な復号化が終了した後に該当
部分を符号化するまでの期間に読み出し、動き検出を行
わなければならない。そのため、高速な読み出しと、大
量なデータ転送が要求されていた。参照画像の代わりに
入力画像を用いて動き検出を行うことにより、読み出し
信号１１０４の信号線数の削減や、共有メモリ回路１１
０２の読み出し回路の低速化、メモリ素子１３０３、１
３０４の低速化を図ることができ、回路規模、回路コス
トの低減が図れる。参照画像が書き込まれた後でなけれ
ば動き検出処理が行えなかった点が、参照画像の書き込
みとは独立に動き検出を行うことができるため回路構成
の自由度が増えさらに回路規模コストを削減することが
できる。また、フレームメモリ２２０１と動き検出回路
１２を画像符号化装置から切り離し時間的あるいは空間
的もしくはその両方とも別に処理を行うことも可能であ
る。このような機能を有する画像符号化装置あるいは画
像符号化方法も本発明に含まれる。具体的には、オフラ
インで画像の並び替えや動きベクトルの検出を行い蓄積
しておき、符号化装置の動作に連動して、蓄積した画像
および動きベクトルデータを信号線２０３、９を用いて
入力することにより実現できる。なお、これらの変形例
は単一の符号化回路を用いた画像符号化装置にも適用が
可能なことは明白である。図１１に示した実施例と組み
合わせて用いると、さらに高い効果が得られる。すなわ
ち、図１１では、符号化装置部分は入力された画素レー
トの数分の１の処理レートで動作しているが、共有メモ
リ回路１１０２は入力される画像の画素レートに比例し
た処理レートが要求される。図２２の発明を適用するこ
とにより、この処理レートの高い箇所の処理の一部を小
符号化装置内の低速処理にて実行することができ、装置
全体の小型化が図れる。
６の実施例において、動き検出時の参照画像の読み出し
回数を大幅に削減することができる。参照画像は、前の
画像の符号化および局所的な復号化が終了した後に該当
部分を符号化するまでの期間に読み出し、動き検出を行
わなければならない。そのため、高速な読み出しと、大
量なデータ転送が要求されていた。参照画像の代わりに
入力画像を用いて動き検出を行うことにより、読み出し
信号１１０４の信号線数の削減や、共有メモリ回路１１
０２の読み出し回路の低速化、メモリ素子１３０３、１
３０４の低速化を図ることができ、回路規模、回路コス
トの低減が図れる。参照画像が書き込まれた後でなけれ
ば動き検出処理が行えなかった点が、参照画像の書き込
みとは独立に動き検出を行うことができるため回路構成
の自由度が増えさらに回路規模コストを削減することが
できる。また、フレームメモリ２２０１と動き検出回路
１２を画像符号化装置から切り離し時間的あるいは空間
的もしくはその両方とも別に処理を行うことも可能であ
る。このような機能を有する画像符号化装置あるいは画
像符号化方法も本発明に含まれる。具体的には、オフラ
インで画像の並び替えや動きベクトルの検出を行い蓄積
しておき、符号化装置の動作に連動して、蓄積した画像
および動きベクトルデータを信号線２０３、９を用いて
入力することにより実現できる。なお、これらの変形例
は単一の符号化回路を用いた画像符号化装置にも適用が
可能なことは明白である。図１１に示した実施例と組み
合わせて用いると、さらに高い効果が得られる。すなわ
ち、図１１では、符号化装置部分は入力された画素レー
トの数分の１の処理レートで動作しているが、共有メモ
リ回路１１０２は入力される画像の画素レートに比例し
た処理レートが要求される。図２２の発明を適用するこ
とにより、この処理レートの高い箇所の処理の一部を小
符号化装置内の低速処理にて実行することができ、装置
全体の小型化が図れる。
【００４７】図２４は図２２の動き検出回路１２の詳細
図である。図４の回路と異なる点は、インターレース走
査された画像に対応したことである。インターレース画
像が入力された場合は、１つの１６画素ｘ１６ラインの
マクロブロックをそのままの形で検出したベクトル２４
１０と、奇数ラインのみの１６画素ｘ８ラインと偶数ラ
インのみの１６画素ｘ８ラインとに分離した後にそれぞ
れ検出したベクトル２４１１、２４１２との３種類のベ
クトルが１つの動きベクトル検出回路２４０１から出力
される。出力されたベクトルはそれぞれバッファ２４０
２、２４０３、２４０４に蓄えられ信号線９を介して読
みだされる。動き検出回路１２には前方予測の動きベク
トル検出回路２４０１−１と後方予測の動きベクトル検
出回路２４０１−２と２つが設置される。一方、非イン
ターレース画像すなわちフィールド画像などの順次走査
画像が入力された場合には、１つの１６画素ｘ１６ライ
ンのマクロブロックをそのままの形で検出したベクトル
２４１０と、マクロブロックの上半分の１６画素ｘ８ラ
インと下半分の１６画素ｘ８ラインとに分離した後にそ
れぞれ検出したベクトル２４１１、２４１２との３種類
のベクトルが１つの動きベクトル検出回路２４０１から
出力される。これらの機能により、限られた回路規模で
種々の走査構造を持つ画像に対して高い予測効率を実現
することが可能となる。
図である。図４の回路と異なる点は、インターレース走
査された画像に対応したことである。インターレース画
像が入力された場合は、１つの１６画素ｘ１６ラインの
マクロブロックをそのままの形で検出したベクトル２４
１０と、奇数ラインのみの１６画素ｘ８ラインと偶数ラ
インのみの１６画素ｘ８ラインとに分離した後にそれぞ
れ検出したベクトル２４１１、２４１２との３種類のベ
クトルが１つの動きベクトル検出回路２４０１から出力
される。出力されたベクトルはそれぞれバッファ２４０
２、２４０３、２４０４に蓄えられ信号線９を介して読
みだされる。動き検出回路１２には前方予測の動きベク
トル検出回路２４０１−１と後方予測の動きベクトル検
出回路２４０１−２と２つが設置される。一方、非イン
ターレース画像すなわちフィールド画像などの順次走査
画像が入力された場合には、１つの１６画素ｘ１６ライ
ンのマクロブロックをそのままの形で検出したベクトル
２４１０と、マクロブロックの上半分の１６画素ｘ８ラ
インと下半分の１６画素ｘ８ラインとに分離した後にそ
れぞれ検出したベクトル２４１１、２４１２との３種類
のベクトルが１つの動きベクトル検出回路２４０１から
出力される。これらの機能により、限られた回路規模で
種々の走査構造を持つ画像に対して高い予測効率を実現
することが可能となる。
【００４８】図２５は図２４の動きベクトル検出回路２
４０１の詳細図である。全体の動作は図６、図７に示し
た回路と同じである。検出単位は１６ｘ１６画素である
が、検出回路の数は従来例で説明したように探索範囲に
よって異なるため汎用的にＮ個としてある。本発明の特
徴は各検出回路２５０１の内部の信号処理が２系等にな
った点と、最小値選択回路２５０３、２５０４、２５０
５が３つになった点である。検出回路２５０１ではマク
ロブロックの各画素毎の差分値の絶対値和を計算する
が、絶対値回路６１１で計算された差分の絶対値をスイ
ッチ２５５０を用いて加算器６１２と加算器２５５１に
出力先を切り替える。この切り替え方法を奇数ラインと
偶数ラインに応じて行うと先のインターレース走査信号
対応の動きベクトル検出が実現でき、上部８ラインと下
部８ラインで切り替えると１６ｘ８画素の動きベクトル
検出が実現できる。これら加算器６１２、２５５１の加
算結果はそれぞれレジスタ６１３、２５５２に格納され
る。１つのマクロブロック分、すなわち２５６画素の演
算が終わった時点で、レジスタ６１３には偶数ライン分
あるいは上部８ライン分の差分値２５１０、レジスタ２
５５２には奇数ライン分あるいは下部８ライン分の差分
値２５１２が格納されている。この２つの差分値を加算
器２５５３で加算するとマクロブロック全体の差分値２
５１１が得られる。これら３つの差分値を各対応する最
小値選択回路２５０３、２５０４、２５０５に入力し、
各最小値選択回路内で独立に最小値を選択すれば、すべ
ての処理を終了した時点で、マクロブロック全体に対す
るベクトル２４１０、奇数ライン分あるいは上部８ライ
ン分に対するベクトル２４１２、偶数ライン分あるいは
下部８ライン分に対するベクトル２４１１の３つのベク
トルが得られる。図２５において、スイッチ２５５０の
切り替え方を変えることによって上記で説明した分割以
外の分割方法、例えばマクロブロックの左右分割等、を
容易に実現できる。なお、これらの動作は探索範囲や検
出単位の大きさには依存せず、また動くベクトル検出回
路の従来例の項目で述べた検出方法の変形例全てに適用
が可能である。
４０１の詳細図である。全体の動作は図６、図７に示し
た回路と同じである。検出単位は１６ｘ１６画素である
が、検出回路の数は従来例で説明したように探索範囲に
よって異なるため汎用的にＮ個としてある。本発明の特
徴は各検出回路２５０１の内部の信号処理が２系等にな
った点と、最小値選択回路２５０３、２５０４、２５０
５が３つになった点である。検出回路２５０１ではマク
ロブロックの各画素毎の差分値の絶対値和を計算する
が、絶対値回路６１１で計算された差分の絶対値をスイ
ッチ２５５０を用いて加算器６１２と加算器２５５１に
出力先を切り替える。この切り替え方法を奇数ラインと
偶数ラインに応じて行うと先のインターレース走査信号
対応の動きベクトル検出が実現でき、上部８ラインと下
部８ラインで切り替えると１６ｘ８画素の動きベクトル
検出が実現できる。これら加算器６１２、２５５１の加
算結果はそれぞれレジスタ６１３、２５５２に格納され
る。１つのマクロブロック分、すなわち２５６画素の演
算が終わった時点で、レジスタ６１３には偶数ライン分
あるいは上部８ライン分の差分値２５１０、レジスタ２
５５２には奇数ライン分あるいは下部８ライン分の差分
値２５１２が格納されている。この２つの差分値を加算
器２５５３で加算するとマクロブロック全体の差分値２
５１１が得られる。これら３つの差分値を各対応する最
小値選択回路２５０３、２５０４、２５０５に入力し、
各最小値選択回路内で独立に最小値を選択すれば、すべ
ての処理を終了した時点で、マクロブロック全体に対す
るベクトル２４１０、奇数ライン分あるいは上部８ライ
ン分に対するベクトル２４１２、偶数ライン分あるいは
下部８ライン分に対するベクトル２４１１の３つのベク
トルが得られる。図２５において、スイッチ２５５０の
切り替え方を変えることによって上記で説明した分割以
外の分割方法、例えばマクロブロックの左右分割等、を
容易に実現できる。なお、これらの動作は探索範囲や検
出単位の大きさには依存せず、また動くベクトル検出回
路の従来例の項目で述べた検出方法の変形例全てに適用
が可能である。
【００４９】また、分割加算器２５５１、レジスタ２５
５２の信号処理系統と最小値選択回路の数を増やし、そ
れに対応したスイッチ２５５０、加算器２５５３をもち
いれば１つのマクロブロックの分割の数を増やすことが
できる。例えば、図２６（１）に示すように、スイッチ
２６０１を用いて誤差信号を４系等に分割し、左上８ｘ
８画素は蓄積加算器２５６０−１、右上８ｘ８画素は蓄
積加算器２５６０−２、左下８ｘ８画素は蓄積加算器２
５６０−３、右下８ｘ８画素は蓄積加算器２５６０−
４、となるようにスイッチ２６０１を切り替えれば、図
の右に示したようにマクロブロック内の８ｘ８のブロッ
ク単位のベクトル４つと１６ｘ１６のベクトルの合計５
つを同時に１つの回路で検出することができる。また、
図２６（２）に示すように、例えば蓄積加算結果２６１
０−１、２を加算する加算器２６０３、蓄積加算結果２
６１０−３、４を加算する加算器２６０４を設置し、そ
れぞれの加算結果２６１０−６、７を用いることによ
り、図２６（１）の例に加え新たにマクロブロックを上
下に２分割した単位での動きベクトルを求めることがで
きる。図２６（３）は誤差信号の分割にスイッチ２６０
５、２６０６の２つを用いた例である。スイッチ２６０
５、２６０６の切り替え方を変えることにより、１つの
マクロブロックを、例えば図の右に示したような異なる
２つの分割法によって分割した単位での動きベクトル検
出が可能になる。ここで、蓄積加算信号２６０１−１、
２のそれぞれの最小値の和と、蓄積加算信号２６０１−
３、４のそれぞれの最小値の和を比較することにより２
つの分割法のうち最適な方法を選択することができる。
これらの変形例により、わずかな回路規模の増加で、複
数の分割法の動きベクトルを求めることが可能になり、
画像の予測効率を高めることができる。図２６におい
て、スイッチ２６０１の出力数を３あるいは５以上の値
Ｎs個にし、それと同じＮs個の蓄積加算回路２５６０を
用いてＮs個の領域単位での動きベクトル検出を行う方
法あるいは回路も本発明に包含される。またスイッチ２
６０５、２６０６の他に１つ以上のスイッチを設け、合
計Ｍs個のスイッチを互いに異なる切り替え方をするこ
とにより、Ｍs個の分割方法に対応した動きベクトルお
よび最適な分割方法を検出する方法あるいは回路も本発
明に包含される。さらに、これらを組み合わせて、Ｎs
個の領域に分割する方法Ｍs通りの各動きベクトルおよ
び最適な分割方法を検出する方法あるいは回路も本発明
に包含される。なお、Ｍs通りの分割方法における領域
の分割数は同じ個数でなくても構わない。
５２の信号処理系統と最小値選択回路の数を増やし、そ
れに対応したスイッチ２５５０、加算器２５５３をもち
いれば１つのマクロブロックの分割の数を増やすことが
できる。例えば、図２６（１）に示すように、スイッチ
２６０１を用いて誤差信号を４系等に分割し、左上８ｘ
８画素は蓄積加算器２５６０−１、右上８ｘ８画素は蓄
積加算器２５６０−２、左下８ｘ８画素は蓄積加算器２
５６０−３、右下８ｘ８画素は蓄積加算器２５６０−
４、となるようにスイッチ２６０１を切り替えれば、図
の右に示したようにマクロブロック内の８ｘ８のブロッ
ク単位のベクトル４つと１６ｘ１６のベクトルの合計５
つを同時に１つの回路で検出することができる。また、
図２６（２）に示すように、例えば蓄積加算結果２６１
０−１、２を加算する加算器２６０３、蓄積加算結果２
６１０−３、４を加算する加算器２６０４を設置し、そ
れぞれの加算結果２６１０−６、７を用いることによ
り、図２６（１）の例に加え新たにマクロブロックを上
下に２分割した単位での動きベクトルを求めることがで
きる。図２６（３）は誤差信号の分割にスイッチ２６０
５、２６０６の２つを用いた例である。スイッチ２６０
５、２６０６の切り替え方を変えることにより、１つの
マクロブロックを、例えば図の右に示したような異なる
２つの分割法によって分割した単位での動きベクトル検
出が可能になる。ここで、蓄積加算信号２６０１−１、
２のそれぞれの最小値の和と、蓄積加算信号２６０１−
３、４のそれぞれの最小値の和を比較することにより２
つの分割法のうち最適な方法を選択することができる。
これらの変形例により、わずかな回路規模の増加で、複
数の分割法の動きベクトルを求めることが可能になり、
画像の予測効率を高めることができる。図２６におい
て、スイッチ２６０１の出力数を３あるいは５以上の値
Ｎs個にし、それと同じＮs個の蓄積加算回路２５６０を
用いてＮs個の領域単位での動きベクトル検出を行う方
法あるいは回路も本発明に包含される。またスイッチ２
６０５、２６０６の他に１つ以上のスイッチを設け、合
計Ｍs個のスイッチを互いに異なる切り替え方をするこ
とにより、Ｍs個の分割方法に対応した動きベクトルお
よび最適な分割方法を検出する方法あるいは回路も本発
明に包含される。さらに、これらを組み合わせて、Ｎs
個の領域に分割する方法Ｍs通りの各動きベクトルおよ
び最適な分割方法を検出する方法あるいは回路も本発明
に包含される。なお、Ｍs通りの分割方法における領域
の分割数は同じ個数でなくても構わない。
【００５０】図２７は図１１の符号化回路８００の変形
例である。図１１と異なる点は各小符号化回路２７０１
−１〜４の間に符号量制御の情報を通知する信号線２７
１０〜２７１５が付加された点である。これらの信号線
により他の小符号化回路の符号量制御情報を得て、それ
に応じた符号量制御を行うことにより、一時的な大量な
符号発生により１つの小符号化回路の符号化した画質の
みが著しく劣化したり、逆に符号が発生が少ないために
周辺の領域に比べ画質が著しく向上することを防止する
ことができる。各小符号化回路間の通知の組み合わせ
は、小符号化装置の数をＣとした場合、最大Ｃ＊（Ｃ−
１）本の信号線が考えられる。しかし、画質の違いが目
立つのは２つの領域の境界部分であることから、画面上
で境界を接する領域を担当する小符号化回路間でのみ符
号量制御の情報を通知すれば信号本数を削減することが
でき、回路規模の削減ができる。水平分割の例では小符
号化装置の数をＣとした場合、２＊（Ｃ−１）本の信号
線でＣ＊（Ｃ−１）本の信号線の場合とほぼ同等の効果
が得られる。また、画面上の距離が一定値以下の領域を
担当する小符号化回路間でのみ符号量制御の情報を通知
しても、上記と同様の効果が得られる。
例である。図１１と異なる点は各小符号化回路２７０１
−１〜４の間に符号量制御の情報を通知する信号線２７
１０〜２７１５が付加された点である。これらの信号線
により他の小符号化回路の符号量制御情報を得て、それ
に応じた符号量制御を行うことにより、一時的な大量な
符号発生により１つの小符号化回路の符号化した画質の
みが著しく劣化したり、逆に符号が発生が少ないために
周辺の領域に比べ画質が著しく向上することを防止する
ことができる。各小符号化回路間の通知の組み合わせ
は、小符号化装置の数をＣとした場合、最大Ｃ＊（Ｃ−
１）本の信号線が考えられる。しかし、画質の違いが目
立つのは２つの領域の境界部分であることから、画面上
で境界を接する領域を担当する小符号化回路間でのみ符
号量制御の情報を通知すれば信号本数を削減することが
でき、回路規模の削減ができる。水平分割の例では小符
号化装置の数をＣとした場合、２＊（Ｃ−１）本の信号
線でＣ＊（Ｃ−１）本の信号線の場合とほぼ同等の効果
が得られる。また、画面上の距離が一定値以下の領域を
担当する小符号化回路間でのみ符号量制御の情報を通知
しても、上記と同様の効果が得られる。
【００５１】図２８に図２７の符号化回路２６０１−２
の詳細図を示す。なお、他の符号化回路２６０１−１、
３、４もほぼ同様な動作を行う。現在符号化している画
面の符号量は信号線１０を介して符号制御回路２８０１
に入力される。符号制御回路２８０１では予め定められ
た値と発生符号量を比較し、発生符号量が大きければ符
号量を減らす方向に、発生符号量が少なければ符号量を
増加させる方向に制御する。すなわち、予め定められた
値と発生符号量の差に応じた値を符号量制御情報として
信号線２７１１、２７１３に出力し隣接する小符号化回
路に通知する。一方、隣接する小符号化回路から信号線
２７１０、２７１２を介して入力された符号量制御情報
は先の符号量１０に加味され制御される。
の詳細図を示す。なお、他の符号化回路２６０１−１、
３、４もほぼ同様な動作を行う。現在符号化している画
面の符号量は信号線１０を介して符号制御回路２８０１
に入力される。符号制御回路２８０１では予め定められ
た値と発生符号量を比較し、発生符号量が大きければ符
号量を減らす方向に、発生符号量が少なければ符号量を
増加させる方向に制御する。すなわち、予め定められた
値と発生符号量の差に応じた値を符号量制御情報として
信号線２７１１、２７１３に出力し隣接する小符号化回
路に通知する。一方、隣接する小符号化回路から信号線
２７１０、２７１２を介して入力された符号量制御情報
は先の符号量１０に加味され制御される。
【００５２】図２９に図２８の符号化制御回路２８０１
の詳細図を示す。隣接する小符号化回路より通知された
符号量制御情報２７１０、２７１２をそれぞれ係数回路
２９０２、２９０１にてｋ２倍、ｋ１倍され、現在符号
化している画面の符号量１０と加算される。加算された
結果２９１０は予め設定された符号量２９１５との差分
をとられる。この差分値２９１１の絶対値が一定値以上
であれば制御回路２９０７は制御線２９１２、２９１３
を介して、係数回路２９０６、２９０８の係数値ｋ３、
ｋ４を制御して、隣接する小符号化回路へ差分値２９１
１のそれぞれｋ３倍、ｋ４倍の値を符号量制御情報２７
１１、２７１３へ出力させる。一方、差分情報２９１１
は、現在の量子化ステップサイズや係数ｋ３、ｋ４や画
面内の位置情報等からから算出される制御情報２９１４
とあわせて、予め定められた算出法により量子化ステッ
プサイズ２１３が得られ、出力される。なおここで、ｋ
１、ｋ２、ｋ３、ｋ４は全て１以下、０以上の値であ
り、ｋ３＋ｋ４も１以下、０以上であることが望まし
い。また、２つの隣接する小符号化回路間で符号量制御
情報が往復・発振しないように、信号２７１０の値が大
きな正数のときには信号２７１１が大きな正の値となら
ないように、また信号２７１２の値が大きな正数のとき
には信号２７１３が大きな正の値とならないように、同
様に信号２７１０の値が絶対値の大きな負数のときには
信号２７１１が絶対値の大きな負の値とならないよう
に、また信号２７１２の値が絶対値の大きな負数のとき
には信号２７１３が絶対値の大きな負の値とならないよ
うにｋ３、ｋ４を制御される。具体的な数値例としてｋ
１＝１、ｋ２＝１、ｋ３＋ｋ４＝０．２５等が挙げられ
る。
の詳細図を示す。隣接する小符号化回路より通知された
符号量制御情報２７１０、２７１２をそれぞれ係数回路
２９０２、２９０１にてｋ２倍、ｋ１倍され、現在符号
化している画面の符号量１０と加算される。加算された
結果２９１０は予め設定された符号量２９１５との差分
をとられる。この差分値２９１１の絶対値が一定値以上
であれば制御回路２９０７は制御線２９１２、２９１３
を介して、係数回路２９０６、２９０８の係数値ｋ３、
ｋ４を制御して、隣接する小符号化回路へ差分値２９１
１のそれぞれｋ３倍、ｋ４倍の値を符号量制御情報２７
１１、２７１３へ出力させる。一方、差分情報２９１１
は、現在の量子化ステップサイズや係数ｋ３、ｋ４や画
面内の位置情報等からから算出される制御情報２９１４
とあわせて、予め定められた算出法により量子化ステッ
プサイズ２１３が得られ、出力される。なおここで、ｋ
１、ｋ２、ｋ３、ｋ４は全て１以下、０以上の値であ
り、ｋ３＋ｋ４も１以下、０以上であることが望まし
い。また、２つの隣接する小符号化回路間で符号量制御
情報が往復・発振しないように、信号２７１０の値が大
きな正数のときには信号２７１１が大きな正の値となら
ないように、また信号２７１２の値が大きな正数のとき
には信号２７１３が大きな正の値とならないように、同
様に信号２７１０の値が絶対値の大きな負数のときには
信号２７１１が絶対値の大きな負の値とならないよう
に、また信号２７１２の値が絶対値の大きな負数のとき
には信号２７１３が絶対値の大きな負の値とならないよ
うにｋ３、ｋ４を制御される。具体的な数値例としてｋ
１＝１、ｋ２＝１、ｋ３＋ｋ４＝０．２５等が挙げられ
る。
【００５３】信号２７１３の出力系統を遅延回路２９０
７によって遅延させることにより、小符号化回路２７０
２−２と２７０２−３の処理開始時刻の時間差を吸収
し、画面上でほぼ同じ水平位置から制御がかかるように
なる。逆に信号２７１１が到達した時点では、小符号化
回路２７０１−１はすでに該当水平位置の符号化処理が
終わっているため、制御の対象となる位置が画面上右に
ずれる。
７によって遅延させることにより、小符号化回路２７０
２−２と２７０２−３の処理開始時刻の時間差を吸収
し、画面上でほぼ同じ水平位置から制御がかかるように
なる。逆に信号２７１１が到達した時点では、小符号化
回路２７０１−１はすでに該当水平位置の符号化処理が
終わっているため、制御の対象となる位置が画面上右に
ずれる。
【００５４】図３０は小符号化回路１１０１の変形例で
あり、符号調整回路３００１が設置された点が図１２の
回路と異なる。また、図３１は小符号化回路１１０１の
別の変形例であり、符号調整回路３１０１が設置される
位置が図３０の回路と異なる。３０図、図３１の符号調
整回路３００１、３１０１は可変長符号化回路５から出
力された符号３０１０を操作して所定の符号量にする機
能を持つ。符号量の設定は符号化装置外部より行い、た
とえば、１フレームの符号量の最大値、あるフレームか
ら別のフレームまでの間の符号量の値を設定することに
より行う。符号量の調整は先に説明した符号量制御回路
２１２等で主に行うが、正確に制御することは難しく、
ある程度の符号量の誤差が生じてしまう。符号調整回路
３００１、３１０１はこの誤差を調整しさらに高精度な
符号量の制御を行う。
あり、符号調整回路３００１が設置された点が図１２の
回路と異なる。また、図３１は小符号化回路１１０１の
別の変形例であり、符号調整回路３１０１が設置される
位置が図３０の回路と異なる。３０図、図３１の符号調
整回路３００１、３１０１は可変長符号化回路５から出
力された符号３０１０を操作して所定の符号量にする機
能を持つ。符号量の設定は符号化装置外部より行い、た
とえば、１フレームの符号量の最大値、あるフレームか
ら別のフレームまでの間の符号量の値を設定することに
より行う。符号量の調整は先に説明した符号量制御回路
２１２等で主に行うが、正確に制御することは難しく、
ある程度の符号量の誤差が生じてしまう。符号調整回路
３００１、３１０１はこの誤差を調整しさらに高精度な
符号量の制御を行う。
【００５５】図３２に符号量調整回路３００１の詳細図
を示す。入力された符号３０１０はシフト回路３２０１
に順次入力される。シフト回路３２０１では所定のビッ
ト数が入力された時点で入力された信号をパラレル符号
３２１０に出力を行う。テーブル３２０２ではパラレル
符号３２１０のどの部分が可変長符号の切れ目かを判断
し、そのビット数３２１１と一連の符号列の区切り符号
を示す信号３２１２を出力する。テーブル３２１０の内
容は、たとえば可変長符号が１０、１１、０１０、０１
１、００１０、００１１の６種類（Ａ〜Ｆ）で符号００
０１が区切り信号（ｚ）とすると、４ビットの入力値を
持ち、各入力値に対応して以下の出力値設定しておく。
を示す。入力された符号３０１０はシフト回路３２０１
に順次入力される。シフト回路３２０１では所定のビッ
ト数が入力された時点で入力された信号をパラレル符号
３２１０に出力を行う。テーブル３２０２ではパラレル
符号３２１０のどの部分が可変長符号の切れ目かを判断
し、そのビット数３２１１と一連の符号列の区切り符号
を示す信号３２１２を出力する。テーブル３２１０の内
容は、たとえば可変長符号が１０、１１、０１０、０１
１、００１０、００１１の６種類（Ａ〜Ｆ）で符号００
０１が区切り信号（ｚ）とすると、４ビットの入力値を
持ち、各入力値に対応して以下の出力値設定しておく。
【００５６】 テーブル３２０２の設定例１ 入力値 出力値（ビット数） 出力値（区切り符号） Ａ １０ｘｘ ２ ０ Ｂ １１ｘｘ ２ ０ Ｃ ０１０ｘ ３ ０ Ｄ ０１１ｘ ３ ０ Ｅ ００１０ ４ ０ Ｆ ００１１ ４ ０ ｚ ０００１ ３ １ ００００ １ ０ （未使用） ここで、入力値は２進数で表示してあり、ｘの記号は
０、１のいずれの値でもよいことを示す。すなわち、入
力値０１ｘは入力値０１０と０１１の両方を示す。ま
た、区切り符号出力は１の時、その符号が区切り符号で
あることを示す。この例では、入力された符号３０１０
は入力値の上位ビット（左側）から詰められている。テ
ーブル３２０２より出力されたビット数３２１１はシフ
ト回路３２０１に入力され、ビット数３２１１のビット
数だけデータがシフトされる。このとき、必要であれば
符号３０１０が入力される。一方、パラレル符号３２１
０とそれに対応したビット数３２１１はそれぞれ符号Ｆ
ＩＦＯ３２０３および符号長ＦＩＦＯ３２０４に入力さ
れ、格納される。ここで符号ＦＩＦＯ３２０３には実際
の符号の長さ（ビット数３２１１）にかかわらずパラレ
ル符号３２１０全ビット数、すなわち上記のテーブルの
例では４ビットが格納される。一方、該当符号が区切り
符号の場合には区切り符号を示す信号線３２１２を介し
て制御回路３２０５に通知される。通常の場合、符号Ｆ
ＩＦＯ３２０３および符号長ＦＩＦＯ３２０４に格納さ
れた信号は所定のタイミングで信号線３２１３および３
２１４に出力され、パラレル−シリアル変換回路３２０
６にて、符号３２１３と符号長３２１４から、可変長符
号列３０１１が再生される。ここで、制御回路３２０５
は区切り符号の位置をもとにパラレル−シリアル変換回
路３２０６を制御し、符号の追加、削除を行い、所定の
符号量になるよう調整を行う。以下に、調整の例を示
す。
０、１のいずれの値でもよいことを示す。すなわち、入
力値０１ｘは入力値０１０と０１１の両方を示す。ま
た、区切り符号出力は１の時、その符号が区切り符号で
あることを示す。この例では、入力された符号３０１０
は入力値の上位ビット（左側）から詰められている。テ
ーブル３２０２より出力されたビット数３２１１はシフ
ト回路３２０１に入力され、ビット数３２１１のビット
数だけデータがシフトされる。このとき、必要であれば
符号３０１０が入力される。一方、パラレル符号３２１
０とそれに対応したビット数３２１１はそれぞれ符号Ｆ
ＩＦＯ３２０３および符号長ＦＩＦＯ３２０４に入力さ
れ、格納される。ここで符号ＦＩＦＯ３２０３には実際
の符号の長さ（ビット数３２１１）にかかわらずパラレ
ル符号３２１０全ビット数、すなわち上記のテーブルの
例では４ビットが格納される。一方、該当符号が区切り
符号の場合には区切り符号を示す信号線３２１２を介し
て制御回路３２０５に通知される。通常の場合、符号Ｆ
ＩＦＯ３２０３および符号長ＦＩＦＯ３２０４に格納さ
れた信号は所定のタイミングで信号線３２１３および３
２１４に出力され、パラレル−シリアル変換回路３２０
６にて、符号３２１３と符号長３２１４から、可変長符
号列３０１１が再生される。ここで、制御回路３２０５
は区切り符号の位置をもとにパラレル−シリアル変換回
路３２０６を制御し、符号の追加、削除を行い、所定の
符号量になるよう調整を行う。以下に、調整の例を示
す。
【００５７】発生した情報が”ＡＥＡＤｚＡＡＢｚ”の
とき入力符号３０１０は”１０ ００１０ １０ ０１
１ ０００１ １０ １０ １１ ０００１”の２５ビ
ットとなる。なお、符号列は左側が先頭すなわち先に送
信されるビットを表す。見やすくするために符号の切れ
目部分に空白文字をいれてあるが、実際には連続した符
号列が入力される。このとき、テーブル３２０２により
符号は分離され、以下のデータが順番に符号ＦＩＦＯ３
２０３および符号長ＦＩＦＯ３２０４に入力される。
とき入力符号３０１０は”１０ ００１０ １０ ０１
１ ０００１ １０ １０ １１ ０００１”の２５ビ
ットとなる。なお、符号列は左側が先頭すなわち先に送
信されるビットを表す。見やすくするために符号の切れ
目部分に空白文字をいれてあるが、実際には連続した符
号列が入力される。このとき、テーブル３２０２により
符号は分離され、以下のデータが順番に符号ＦＩＦＯ３
２０３および符号長ＦＩＦＯ３２０４に入力される。
【００５８】 ここで区切り符号の１つ前の符号を削除することにより
符号量を削減する。すなわち４番目の情報Ｄと８番目の
情報Ｂを削除する。その結果、出力される可変長符号列
３０１１は”１０ ００１０ １０ ０００１ １０１
０ ０００１”の２０ビットとなる。一般に符号を削減
すると再生される信号に劣化が生じる。さらに、劣化し
た画像が予測画像として用いられる場合には、符号化装
置の予測画像と復号化装置の予測画像がこの劣化により
若干異なるため、以降の画面にも劣化が波及する。従っ
て、以下ような場合を優先的に符号削除を行うことによ
り視覚的に画像劣化を最小限にとどめることができる。
（１）ＢピクチャのＤＣＴ係数、（２）振幅の小さいＤ
ＣＴ係数（すなわち＋１、−１のもの）、（３）高い周
波数のＤＣＴ係数。
符号量を削減する。すなわち４番目の情報Ｄと８番目の
情報Ｂを削除する。その結果、出力される可変長符号列
３０１１は”１０ ００１０ １０ ０００１ １０１
０ ０００１”の２０ビットとなる。一般に符号を削減
すると再生される信号に劣化が生じる。さらに、劣化し
た画像が予測画像として用いられる場合には、符号化装
置の予測画像と復号化装置の予測画像がこの劣化により
若干異なるため、以降の画面にも劣化が波及する。従っ
て、以下ような場合を優先的に符号削除を行うことによ
り視覚的に画像劣化を最小限にとどめることができる。
（１）ＢピクチャのＤＣＴ係数、（２）振幅の小さいＤ
ＣＴ係数（すなわち＋１、−１のもの）、（３）高い周
波数のＤＣＴ係数。
【００５９】また符号を削除するのではなく、符号語長
の短い符号に置き換えることによっても同様な効果を得
ることができる。たとえば、高い周波数のＤＣＴ係数あ
るいは直流成分の振幅を１レベル小さくすることにより
実現できる。
の短い符号に置き換えることによっても同様な効果を得
ることができる。たとえば、高い周波数のＤＣＴ係数あ
るいは直流成分の振幅を１レベル小さくすることにより
実現できる。
【００６０】符号量を増加させるためにはパラレル−シ
リアル変換回路３２０６にて復号化装置において復号化
に使われないスタッフィングの符号を挿入することによ
って実現できる。たとえばＭＰＥＧの場合には、符号の
同期を示すスタートコードの前に０ビットを８の倍数個
挿入する方法がある。また、同じ情報を示しかつ符号語
長のより長い符号に置き換えることによっても同様の効
果が得られる。たとえばＭＰＥＧの場合には、一部のＤ
ＣＴ係数には２ビットから１７ビットまでの可変長の符
号が割り当てられているが、同時に２０ビットあるいは
２８ビットの固定長符号も割り当てられている。従っ
て、通常、１７ビット以下の可変長符号として符号化さ
れるＤＣＴ係数を、２０ビットあるいは２８ビットの固
定長符号に置き換えることによって符号量を増加させる
ことができる。この符号の増加処理においては直接画像
が劣化することはない。
リアル変換回路３２０６にて復号化装置において復号化
に使われないスタッフィングの符号を挿入することによ
って実現できる。たとえばＭＰＥＧの場合には、符号の
同期を示すスタートコードの前に０ビットを８の倍数個
挿入する方法がある。また、同じ情報を示しかつ符号語
長のより長い符号に置き換えることによっても同様の効
果が得られる。たとえばＭＰＥＧの場合には、一部のＤ
ＣＴ係数には２ビットから１７ビットまでの可変長の符
号が割り当てられているが、同時に２０ビットあるいは
２８ビットの固定長符号も割り当てられている。従っ
て、通常、１７ビット以下の可変長符号として符号化さ
れるＤＣＴ係数を、２０ビットあるいは２８ビットの固
定長符号に置き換えることによって符号量を増加させる
ことができる。この符号の増加処理においては直接画像
が劣化することはない。
【００６１】これらの符号量の増減の調整処理を組み合
わせることにより所定の符号量に微調整することができ
る。符号調整回路３００１、３１０１は可変長符号化回
路５の中で符号化と同時に行っても構わない。また、符
号ＦＩＦＯ３２０３および符号長ＦＩＦＯ３２０４はシ
フトレジスタ、バッファ、リングバッファでも構わな
い。
わせることにより所定の符号量に微調整することができ
る。符号調整回路３００１、３１０１は可変長符号化回
路５の中で符号化と同時に行っても構わない。また、符
号ＦＩＦＯ３２０３および符号長ＦＩＦＯ３２０４はシ
フトレジスタ、バッファ、リングバッファでも構わな
い。
【００６２】符号調整回路３１０１の構成は符号調整回
路３００１とほとんど同じである。異なる点は、図３０
では符号バッファ６が通知していた符号発生量１０を通
知する機能が追加された点である。符号量の調整を符号
バッファの出力の後で行うため、１画面の符号化が終了
し、符号がすべてバッファ６に格納され、発生符号量が
既知になった後に、符号量の調整を行うことができる。
したがって、１画面単位等の比較的大きい単位での高精
度な調整が可能となる。
路３００１とほとんど同じである。異なる点は、図３０
では符号バッファ６が通知していた符号発生量１０を通
知する機能が追加された点である。符号量の調整を符号
バッファの出力の後で行うため、１画面の符号化が終了
し、符号がすべてバッファ６に格納され、発生符号量が
既知になった後に、符号量の調整を行うことができる。
したがって、１画面単位等の比較的大きい単位での高精
度な調整が可能となる。
【００６３】このような符号量の高精度な調整を行うこ
とにより、符号列中の一部分を別の符号に置き換える操
作が可能になる。すなわち、テレビジョンのデジタル放
送において、ある映像の放送中に、その一部にコマーシ
ャルや臨時ニュース等を挿入する場合に相当する。この
ような置き換え操作では置き換えられる部分と置き換え
る部分の符号量が異なると復号化装置において符号を一
時的に蓄えるバッファ１９０１がオーバーフローあるい
はアンダーフローしてしまい、画像の大きな劣化が生じ
てしまう。本発明の高精度な符号量調整により、こうし
た劣化を防止あるいは、劣化の確率を最小限にとどめる
ことが可能になる。
とにより、符号列中の一部分を別の符号に置き換える操
作が可能になる。すなわち、テレビジョンのデジタル放
送において、ある映像の放送中に、その一部にコマーシ
ャルや臨時ニュース等を挿入する場合に相当する。この
ような置き換え操作では置き換えられる部分と置き換え
る部分の符号量が異なると復号化装置において符号を一
時的に蓄えるバッファ１９０１がオーバーフローあるい
はアンダーフローしてしまい、画像の大きな劣化が生じ
てしまう。本発明の高精度な符号量調整により、こうし
た劣化を防止あるいは、劣化の確率を最小限にとどめる
ことが可能になる。
【００６４】先に示したテーブル３２０２は以下の変形
例により、そのデータ容量を削減することができる。す
なわち、パラレル符号３２０１をその先頭に連続する０
符号の個数と最初の１符号の後に続く符号に分離して入
力を行う。先の符号の例では先頭に続く０の個数は最大
３個、最初の１符号の後に続く符号長は最大１ビットで
あるため、テーブルのデータの種類は先の設定例１の場
合（４ビット１６通り）に比べて半分の３ビット８通り
に削減できる。なお、この場合、シフト回路にて先頭に
続く０の個数の計測回路が必要になる。以下に本変形例
によるテーブル３２０２の設定例を示す。入力値の項の
うち左半分２ビットは０符号の連続数の２進数表示、右
の１ビットは最初に出現する１符号の後に続く符号を示
す。
例により、そのデータ容量を削減することができる。す
なわち、パラレル符号３２０１をその先頭に連続する０
符号の個数と最初の１符号の後に続く符号に分離して入
力を行う。先の符号の例では先頭に続く０の個数は最大
３個、最初の１符号の後に続く符号長は最大１ビットで
あるため、テーブルのデータの種類は先の設定例１の場
合（４ビット１６通り）に比べて半分の３ビット８通り
に削減できる。なお、この場合、シフト回路にて先頭に
続く０の個数の計測回路が必要になる。以下に本変形例
によるテーブル３２０２の設定例を示す。入力値の項の
うち左半分２ビットは０符号の連続数の２進数表示、右
の１ビットは最初に出現する１符号の後に続く符号を示
す。
【００６５】 テーブル３２０２の設定例２ 入力値 出力値（ビット数） 出力値（区切り符号） Ａ ００ ０（１０ｘｘ） ２ ０ Ｂ ００ １（１１ｘｘ） ２ ０ Ｃ ０１ ０（０１０ｘ） ３ ０ Ｄ ０１ １（０１１ｘ） ３ ０ Ｅ １０ ０（００１０） ４ ０ Ｆ １０ １（００１１） ４ ０ ｚ １１ Ｘ ０００１） ３ １ （−− − ００００） １ ０ （未使用） このテーブルの設定例では”００００”の符号を解読す
るには０の連続数を表すビットをもう１ビット追加する
必要があるが、ＭＰＥＧ等ではすべて０からなる符号
は、同期符号と混同する恐れがあるため通常禁止されて
いるため問題ない。本変形例は先頭に０の続く個数の長
い符号セットほどテーブルのデータ数の削減の効果が大
きくなる。例えば、ＭＰＥＧのＤＣＴ係数の可変長符号
は最後尾の符号ビットを除けば最長１６ビットの符号が
あるため、２の１６乗（65536）個のテーブルデータが
必要であった。しかし、その符号の先頭に続く０符号の
個数は最大１１個（４ビット）、最初に出現する１符号
の後に続く符号長は最大５ビットであるため、合計して
９ビット、すなわち２の９乗（512）個のテーブルデー
タで済み、テーブルサイズを１２８分の１に削減でき
る。テーブルサイズを削減することにより、例えばＬＳ
Ｉ化したときのチップサイズが小さくなり、ＬＳＩ製作
コストを低減したり、テーブルアクセスの高速化が図れ
るため、同じ回路規模でより高速な処理、あるいは同じ
処理速度でより小型低価格の回路構成をとることができ
る。
るには０の連続数を表すビットをもう１ビット追加する
必要があるが、ＭＰＥＧ等ではすべて０からなる符号
は、同期符号と混同する恐れがあるため通常禁止されて
いるため問題ない。本変形例は先頭に０の続く個数の長
い符号セットほどテーブルのデータ数の削減の効果が大
きくなる。例えば、ＭＰＥＧのＤＣＴ係数の可変長符号
は最後尾の符号ビットを除けば最長１６ビットの符号が
あるため、２の１６乗（65536）個のテーブルデータが
必要であった。しかし、その符号の先頭に続く０符号の
個数は最大１１個（４ビット）、最初に出現する１符号
の後に続く符号長は最大５ビットであるため、合計して
９ビット、すなわち２の９乗（512）個のテーブルデー
タで済み、テーブルサイズを１２８分の１に削減でき
る。テーブルサイズを削減することにより、例えばＬＳ
Ｉ化したときのチップサイズが小さくなり、ＬＳＩ製作
コストを低減したり、テーブルアクセスの高速化が図れ
るため、同じ回路規模でより高速な処理、あるいは同じ
処理速度でより小型低価格の回路構成をとることができ
る。
【００６６】図３２に示したシフト回路３２０１および
テーブル３２０３の回路構成は、復号化装置の可変長復
号化回路にも適応が可能である。この場合、テーブル３
２０３の構成は設定例１でも設定例２でもいずれでも適
用でき、設定例２を適用すれば上記の符号量調整回路の
説明部分で示したものと同じ効果が得られる。本発明を
適用する可変長復号化回路は複数の小復号化回路１７０
２からなる復号化装置に適用しても、単一の復号化回路
からなる復号化装置に適用しても構わない。
テーブル３２０３の回路構成は、復号化装置の可変長復
号化回路にも適応が可能である。この場合、テーブル３
２０３の構成は設定例１でも設定例２でもいずれでも適
用でき、設定例２を適用すれば上記の符号量調整回路の
説明部分で示したものと同じ効果が得られる。本発明を
適用する可変長復号化回路は複数の小復号化回路１７０
２からなる復号化装置に適用しても、単一の復号化回路
からなる復号化装置に適用しても構わない。
【００６７】図３３は図２３のフレームメモリ回路２２
０１と図２４の動き検出回路２２０３の変形例である。
本変形例の特徴は図２３のフレームメモリ回路２２０１
と図２４の動き検出回路１２がフィールド単位の画像を
格納するようになった点であり、これにより、フレーム
単位の符号化処理にしか対応していなかったものが、フ
ィールド単位の符号化処理にも対応できるようになる。
具体的には１つのフレームをなす２つのフィールド間で
予測処理を行えるようになるため、動きの大きい映像の
符号化の時にも通常の映像の場合と同程度の符号化効率
を実現できる。動き検出回路２２０３においては、後述
する図３５の動き補償回路と組み合わせて適用すること
により、図２５の動きベクトル検出回路のようにフィー
ルド／フレームの両方のベクトルを検出する検出回路を
用いなくても、従来の図６のような動きベクトル検出回
路を用いてフィールド／フレーム単位での動きベクトル
を検出できる。また、フィールド毎に動き検出を行うた
め検出単位が１６ｘ８画素でよく、フレーム単位の検出
の場合の半分で済む。このため、動きベクトル検出回路
４５０内の検出回路数は半分のＮ／２個で検出すること
ができ、動きベクトル検出回路の回路規模が約半分に削
減される。
０１と図２４の動き検出回路２２０３の変形例である。
本変形例の特徴は図２３のフレームメモリ回路２２０１
と図２４の動き検出回路１２がフィールド単位の画像を
格納するようになった点であり、これにより、フレーム
単位の符号化処理にしか対応していなかったものが、フ
ィールド単位の符号化処理にも対応できるようになる。
具体的には１つのフレームをなす２つのフィールド間で
予測処理を行えるようになるため、動きの大きい映像の
符号化の時にも通常の映像の場合と同程度の符号化効率
を実現できる。動き検出回路２２０３においては、後述
する図３５の動き補償回路と組み合わせて適用すること
により、図２５の動きベクトル検出回路のようにフィー
ルド／フレームの両方のベクトルを検出する検出回路を
用いなくても、従来の図６のような動きベクトル検出回
路を用いてフィールド／フレーム単位での動きベクトル
を検出できる。また、フィールド毎に動き検出を行うた
め検出単位が１６ｘ８画素でよく、フレーム単位の検出
の場合の半分で済む。このため、動きベクトル検出回路
４５０内の検出回路数は半分のＮ／２個で検出すること
ができ、動きベクトル検出回路の回路規模が約半分に削
減される。
【００６８】図３３の動作は図２３の動作とほぼ同じで
ある。図３３では、図２３の各メモリ４０１〜４０４お
よび参照画像用のメモリ２３０１、２３０２を２つに分
割し、それぞれにデータ量が半分であるフィールド画像
画像を格納する。符号化処理をする画像は図２３の場合
と同様に選択回路４０５により選択するが１つのフレー
ムのうちどちらのフィールドを処理するかはスイッチ３
３０１あるいはスイッチ３３０２あるいはスイッチ３３
０３を用いて選択する。画像をフレーム単位で符号化す
るときにはこれらのスイッチは例えばライン毎に切り替
えられ、フィールド単位で符号化処理をするときにはそ
れぞれのスイッチを下側（４０１−２、４０３−２、４
０４−２の出力側）に設定する。一方、参照用の画像は
メモリ２３０１、２３０２に格納され、図３４に例示し
たタイミングに従い、選択回路３３０４を制御する。信
号線３３５０、３３５４はフレームを構成する２フィー
ルドのうち時間的に前方にあるフィールド（フィールド
A）の参照画像を出力し、信号線３３５１は後方にある
フィールド（フィールドB）の参照画像を出力する。こ
れらの参照画像の切り替えのタイミングは図３４に示す
ように、ＩピクチャもしくはＰピクチャ（図中入力信号
を太線で囲んだ画像）の入力が終了した時点で切り替わ
る。ただし、信号線３３５０は入力終了から１フィール
ド時間遅延して切り替えられる。これらの参照信号もと
に動き検出回路２２０３にて動きベクトルを検出する
が、動きベクトル検出回路３３２１は主にフィールドA
の参照画像による後方予測ベクトル、動きベクトル検出
回路３３２２はフィールドBの参照画像による後方予測
ベクトル、動きベクトル検出回路３３２３はフィールド
Aの参照画像による前方予測ベクトル、動きベクトル検
出回路３３２４はフィールドBの参照画像による前方予
測ベクトルを検出する。なお、動きベクトル検出回路３
３２１は一時的にフレームメモリ回路２２０１内の選択
回路３３０６により信号が切り替えられ、Ｐピクチャ内
のフィールド間予測、すなわちフィールド6Aを参照画像
としフィールド6Bを入力画像とするような前方予測予測
ベクトルにも用いられる（図３４＊印）。検出されたベ
クトルはそれぞれバッファ３３２５〜３３２８に格納さ
れ、仮の動きベクトル２２１１として次の動き補償回路
より読みだされる。
ある。図３３では、図２３の各メモリ４０１〜４０４お
よび参照画像用のメモリ２３０１、２３０２を２つに分
割し、それぞれにデータ量が半分であるフィールド画像
画像を格納する。符号化処理をする画像は図２３の場合
と同様に選択回路４０５により選択するが１つのフレー
ムのうちどちらのフィールドを処理するかはスイッチ３
３０１あるいはスイッチ３３０２あるいはスイッチ３３
０３を用いて選択する。画像をフレーム単位で符号化す
るときにはこれらのスイッチは例えばライン毎に切り替
えられ、フィールド単位で符号化処理をするときにはそ
れぞれのスイッチを下側（４０１−２、４０３−２、４
０４−２の出力側）に設定する。一方、参照用の画像は
メモリ２３０１、２３０２に格納され、図３４に例示し
たタイミングに従い、選択回路３３０４を制御する。信
号線３３５０、３３５４はフレームを構成する２フィー
ルドのうち時間的に前方にあるフィールド（フィールド
A）の参照画像を出力し、信号線３３５１は後方にある
フィールド（フィールドB）の参照画像を出力する。こ
れらの参照画像の切り替えのタイミングは図３４に示す
ように、ＩピクチャもしくはＰピクチャ（図中入力信号
を太線で囲んだ画像）の入力が終了した時点で切り替わ
る。ただし、信号線３３５０は入力終了から１フィール
ド時間遅延して切り替えられる。これらの参照信号もと
に動き検出回路２２０３にて動きベクトルを検出する
が、動きベクトル検出回路３３２１は主にフィールドA
の参照画像による後方予測ベクトル、動きベクトル検出
回路３３２２はフィールドBの参照画像による後方予測
ベクトル、動きベクトル検出回路３３２３はフィールド
Aの参照画像による前方予測ベクトル、動きベクトル検
出回路３３２４はフィールドBの参照画像による前方予
測ベクトルを検出する。なお、動きベクトル検出回路３
３２１は一時的にフレームメモリ回路２２０１内の選択
回路３３０６により信号が切り替えられ、Ｐピクチャ内
のフィールド間予測、すなわちフィールド6Aを参照画像
としフィールド6Bを入力画像とするような前方予測予測
ベクトルにも用いられる（図３４＊印）。検出されたベ
クトルはそれぞれバッファ３３２５〜３３２８に格納さ
れ、仮の動きベクトル２２１１として次の動き補償回路
より読みだされる。
【００６９】図３５は図２２の動き補償回路２２０２の
詳細図である。動き補償回路２２０２では動き検出回路
２２０３の検出した仮の動きベクトル２２１１をもと
に、フレーム予測／フィールド予測のうち最適な予測方
法と最適なベクトル９を決定し、差分画像信号２２１２
を出力する。同時に半画素精度の動きベクトル検出も行
う。最適な予測方法決定の例を図３６を用いて説明をす
る。
詳細図である。動き補償回路２２０２では動き検出回路
２２０３の検出した仮の動きベクトル２２１１をもと
に、フレーム予測／フィールド予測のうち最適な予測方
法と最適なベクトル９を決定し、差分画像信号２２１２
を出力する。同時に半画素精度の動きベクトル検出も行
う。最適な予測方法決定の例を図３６を用いて説明をす
る。
【００７０】図３６（１）はフィールド毎に符号化を行
う場合の予測方法の選択法を説明する図である。図中の
丸印は一つの走査線（水平方向の画素列）を表し、縦方
向は画面の垂直方向に、横方向は時間軸に対応する。図
はフィールド中、同じマクロブロックに含まれる４ライ
ンのみ取り出して記述しており、インターレース構造を
取っているため第１のフィールドと第２のフィールドは
垂直方向に半ライン分だけずれた構造になっている。図
中では４フィールド分の画像を示しており、左側の２フ
ィールドは参照画像（参照A、参照B）のフィールド、右
側は符号化する画像（符号A、符号B）のフィールドを示
している。それぞれ右側２フィールド、左側２フィール
ドは時間的に連続したフィールドであるが、参照のフィ
ールドと符号化フィールドは必ずしも連続していない。
ただし、本図では参照のフィールドと符号化フィールド
の間のフィールドは省略してある。図中の矢印は図３３
の動き検出回路にて検出した動きベクトルの垂直成分を
記してある。本来は対応する全ての走査線間に矢印（図
では各符号走査線１本当り２〜３本、合計１６〜２４
本）を記入するべきであるが、本図では見やすくするた
めに、そのうちの代表的なものを選択し、見やすい位置
に配置した。従って、例えば図中fA0を記されている予
測のベクトルは参照Aと記されたフィールドの１番目の
走査線から符号Aと記されたフィールドの１番目の走査
線へ書かれているが、実際には同じ方向大きさの矢印
が、それぞれ２〜４番目の走査線間にも存在し、これら
３本は省略されている。なお、図中の矢印に付された３
文字の記号は、第１の文字が前方予測のベクトル(f)か
後方予測のベクトル(b)か、２文字目が第１の参照フィ
ールド(A)か第２の参照フィールド(B)かを、末尾の数字
は予測の種類（参照->符号A:0,参照->符号B:1, 符号A->
符号B:2）を示している。すなわち先頭２文字の４通り
の組み合わせが図３３の動きベクトルのバッファ３３２
５〜３３２８に対応し、末尾の数字がバッファに格納さ
れる順番を表す。フィールド毎の符号化では、符号Aの
フィールド符号時にはベクトルfA0を用いて参照Aフィー
ルドから、あるいはベクトルfB0を用いて参照Bフィール
ドからの予測のうち予測誤差の少ないほうを選択する。
同様に符号Bのフィールド符号時にはベクトルfA2を用い
て符号Aフィールド（フィールド単位の符号化では、符
号Aフィールドの符号化終了後は符号Aフィールド新たな
参照フィールドになる）から、あるいはベクトルfB1を
用いて参照Bフィールドからの予測のうち予測誤差の少
ないほうを選択する。これらの処理はフィールド単位の
符号化のＢピクチャにおいても同じである。ただし、Ｂ
ピクチャ前方予測では符号A->符号Bの予測はできないた
め、ベクトルfA2のかわりにベクトルfA1が用いられる。
後方予測の場合には前方予測の場合のベクトルの記号の
fをbに置き換えたベクトルを用いて同様に行うことがで
きる。これらフィールド単位の符号化時の予測はすべて
１６ｘ８画素単位の予測を基準としている。すなわち１
６ｘ１６のマクロブロックを上下に２分割した予測であ
り、１つのマクロブロックあたり２つの動きベクトルが
必要になる。この２つのベクトルが同じ値であるとき
は、１６ｘ１６画素単位の予測に置き換えることができ
る。図中および以降、ベクトルfA0を用いて参照Aフィー
ルドから生成した予測画像をR(A,fA0)と記述する。
う場合の予測方法の選択法を説明する図である。図中の
丸印は一つの走査線（水平方向の画素列）を表し、縦方
向は画面の垂直方向に、横方向は時間軸に対応する。図
はフィールド中、同じマクロブロックに含まれる４ライ
ンのみ取り出して記述しており、インターレース構造を
取っているため第１のフィールドと第２のフィールドは
垂直方向に半ライン分だけずれた構造になっている。図
中では４フィールド分の画像を示しており、左側の２フ
ィールドは参照画像（参照A、参照B）のフィールド、右
側は符号化する画像（符号A、符号B）のフィールドを示
している。それぞれ右側２フィールド、左側２フィール
ドは時間的に連続したフィールドであるが、参照のフィ
ールドと符号化フィールドは必ずしも連続していない。
ただし、本図では参照のフィールドと符号化フィールド
の間のフィールドは省略してある。図中の矢印は図３３
の動き検出回路にて検出した動きベクトルの垂直成分を
記してある。本来は対応する全ての走査線間に矢印（図
では各符号走査線１本当り２〜３本、合計１６〜２４
本）を記入するべきであるが、本図では見やすくするた
めに、そのうちの代表的なものを選択し、見やすい位置
に配置した。従って、例えば図中fA0を記されている予
測のベクトルは参照Aと記されたフィールドの１番目の
走査線から符号Aと記されたフィールドの１番目の走査
線へ書かれているが、実際には同じ方向大きさの矢印
が、それぞれ２〜４番目の走査線間にも存在し、これら
３本は省略されている。なお、図中の矢印に付された３
文字の記号は、第１の文字が前方予測のベクトル(f)か
後方予測のベクトル(b)か、２文字目が第１の参照フィ
ールド(A)か第２の参照フィールド(B)かを、末尾の数字
は予測の種類（参照->符号A:0,参照->符号B:1, 符号A->
符号B:2）を示している。すなわち先頭２文字の４通り
の組み合わせが図３３の動きベクトルのバッファ３３２
５〜３３２８に対応し、末尾の数字がバッファに格納さ
れる順番を表す。フィールド毎の符号化では、符号Aの
フィールド符号時にはベクトルfA0を用いて参照Aフィー
ルドから、あるいはベクトルfB0を用いて参照Bフィール
ドからの予測のうち予測誤差の少ないほうを選択する。
同様に符号Bのフィールド符号時にはベクトルfA2を用い
て符号Aフィールド（フィールド単位の符号化では、符
号Aフィールドの符号化終了後は符号Aフィールド新たな
参照フィールドになる）から、あるいはベクトルfB1を
用いて参照Bフィールドからの予測のうち予測誤差の少
ないほうを選択する。これらの処理はフィールド単位の
符号化のＢピクチャにおいても同じである。ただし、Ｂ
ピクチャ前方予測では符号A->符号Bの予測はできないた
め、ベクトルfA2のかわりにベクトルfA1が用いられる。
後方予測の場合には前方予測の場合のベクトルの記号の
fをbに置き換えたベクトルを用いて同様に行うことがで
きる。これらフィールド単位の符号化時の予測はすべて
１６ｘ８画素単位の予測を基準としている。すなわち１
６ｘ１６のマクロブロックを上下に２分割した予測であ
り、１つのマクロブロックあたり２つの動きベクトルが
必要になる。この２つのベクトルが同じ値であるとき
は、１６ｘ１６画素単位の予測に置き換えることができ
る。図中および以降、ベクトルfA0を用いて参照Aフィー
ルドから生成した予測画像をR(A,fA0)と記述する。
【００７１】フレーム単位の符号化においてはフレーム
単位の予測とフィールドに２分割しての予測が主に使わ
れる。一般の映像では静止部分や水平方向の動きが多い
ため、図では水平のベクトル（参照A->符号A、参照B->
符号B）が多く、これらはフレーム単位の予測に含まれ
る。一方それ以外の動きでは時間的に近いフィールドか
らの予測、すなわち参照Bからの予測が多くなり、これ
らはフィールド単位の予測に含まれる。従って、フレー
ム単位の予測と、参照Bからの予測とにより大部分の動
きをカバーすることが可能になる。フレーム単位の前方
（Ｐ、Ｂピクチャ）予測時のベクトルはfA0あるいはfB1
を用いる。理想的な場合にはこの２つのベクトルは同じ
値になるが、実際には若干異なる場合もある。従って、
２つのベクトルfA0、fB1に対応するフレーム予測信号を
生成し、予測誤差の小さいものを選択する。この選択後
に参照Bからのフィールド予測信号による予測誤差を調
べ、３者のうち最適なものを選択する。フレーム単位の
後方予測時は前方予測の場合のベクトルの記号のfをbに
置き換えたベクトルを用いて同様に行うことができる。
ただしフィールド予測時は参照Aフィールドからベクト
ルbA0,bA1を用いて予測信号を生成する。
単位の予測とフィールドに２分割しての予測が主に使わ
れる。一般の映像では静止部分や水平方向の動きが多い
ため、図では水平のベクトル（参照A->符号A、参照B->
符号B）が多く、これらはフレーム単位の予測に含まれ
る。一方それ以外の動きでは時間的に近いフィールドか
らの予測、すなわち参照Bからの予測が多くなり、これ
らはフィールド単位の予測に含まれる。従って、フレー
ム単位の予測と、参照Bからの予測とにより大部分の動
きをカバーすることが可能になる。フレーム単位の前方
（Ｐ、Ｂピクチャ）予測時のベクトルはfA0あるいはfB1
を用いる。理想的な場合にはこの２つのベクトルは同じ
値になるが、実際には若干異なる場合もある。従って、
２つのベクトルfA0、fB1に対応するフレーム予測信号を
生成し、予測誤差の小さいものを選択する。この選択後
に参照Bからのフィールド予測信号による予測誤差を調
べ、３者のうち最適なものを選択する。フレーム単位の
後方予測時は前方予測の場合のベクトルの記号のfをbに
置き換えたベクトルを用いて同様に行うことができる。
ただしフィールド予測時は参照Aフィールドからベクト
ルbA0,bA1を用いて予測信号を生成する。
【００７２】図３５に戻り、制御回路３５１０は入力さ
れたベクトル２２１１（上記のfA0等）をもとに４つの
メモリ３５０２〜３５０４に４種類の図３６右中央の表
に示した参照画像信号を格納する。信号格納時には動き
ベクトルによって示される部分１６ｘ８画素とその左右
１画素、上下２画素を合わせて１８ｘ１２画素を格納す
る。図３６右側の表中、orで示したものはベクトル検出
時の誤差が小さいほうを用いる。図３６の（２）の場合
はベクトル検出時の誤差信号をベクトル値とともにバッ
ファ３３２７等に格納しておき、ベクトルfA0の誤差が
ベクトルfB1の誤差より小さい場合にはメモリ３５０３
にR(B,fA0)を格納し、ベクトルfB1の誤差が小さいとき
にはR(A,fB1)を格納する。メモリ３５０２〜３５０４に
格納した信号のうち必要なものを同時に読み出し、予測
信号回路３５０５にて２種の予測信号３５２０、３５２
１を生成する。予測信号３５２０はフレーム予測信号
（図３６予測信号枠内の第１あるいは第２の予測信
号）、予測信号３５２１はフィールド予測信号（図３６
予測信号枠内の第３の予測信号）である。予測信号３５
２０、３５２１は半画素回路３５０７−１〜９に入力さ
れベクトル２２１１の±0.5画素の範囲の半画素予測信
号３５３０−１〜９および３５３１−１〜９を生成す
る。これらは検出器３５０６−１〜９により、符号化画
像信号２０３と画素毎の差分が取られ、１６ｘ８画素全
体での誤差電力が３５５１および３５５２が計算され
る。最小値選択回路３５５４は誤差電力３５５１、３５
５２の小さいほうを選択し、選択情報と誤差電力を信号
線３５２３−１に出力する。最小値選択回路３５０８は
各検出器３５０６−１〜９の出力３５２３−１〜９の誤
差電力を比較し、最も小さいものを選択する。選択結果
は予測のモードと半画素単位の動きベクトルとして信号
線９に出力される。一方各半画素予測信号３５３０−１
〜９および３５３１−１〜９と符号化画像信号２０３は
選択差分回路３５０９に蓄えられ、誤差が最小になった
予測信号が選択され、画素毎に差分画像信号２２１２と
して出力される。
れたベクトル２２１１（上記のfA0等）をもとに４つの
メモリ３５０２〜３５０４に４種類の図３６右中央の表
に示した参照画像信号を格納する。信号格納時には動き
ベクトルによって示される部分１６ｘ８画素とその左右
１画素、上下２画素を合わせて１８ｘ１２画素を格納す
る。図３６右側の表中、orで示したものはベクトル検出
時の誤差が小さいほうを用いる。図３６の（２）の場合
はベクトル検出時の誤差信号をベクトル値とともにバッ
ファ３３２７等に格納しておき、ベクトルfA0の誤差が
ベクトルfB1の誤差より小さい場合にはメモリ３５０３
にR(B,fA0)を格納し、ベクトルfB1の誤差が小さいとき
にはR(A,fB1)を格納する。メモリ３５０２〜３５０４に
格納した信号のうち必要なものを同時に読み出し、予測
信号回路３５０５にて２種の予測信号３５２０、３５２
１を生成する。予測信号３５２０はフレーム予測信号
（図３６予測信号枠内の第１あるいは第２の予測信
号）、予測信号３５２１はフィールド予測信号（図３６
予測信号枠内の第３の予測信号）である。予測信号３５
２０、３５２１は半画素回路３５０７−１〜９に入力さ
れベクトル２２１１の±0.5画素の範囲の半画素予測信
号３５３０−１〜９および３５３１−１〜９を生成す
る。これらは検出器３５０６−１〜９により、符号化画
像信号２０３と画素毎の差分が取られ、１６ｘ８画素全
体での誤差電力が３５５１および３５５２が計算され
る。最小値選択回路３５５４は誤差電力３５５１、３５
５２の小さいほうを選択し、選択情報と誤差電力を信号
線３５２３−１に出力する。最小値選択回路３５０８は
各検出器３５０６−１〜９の出力３５２３−１〜９の誤
差電力を比較し、最も小さいものを選択する。選択結果
は予測のモードと半画素単位の動きベクトルとして信号
線９に出力される。一方各半画素予測信号３５３０−１
〜９および３５３１−１〜９と符号化画像信号２０３は
選択差分回路３５０９に蓄えられ、誤差が最小になった
予測信号が選択され、画素毎に差分画像信号２２１２と
して出力される。
【００７３】予測信号生成回路３５０５は図３６右端に
示した予測信号の組（｜記号の両側に示した組）をメモ
リ３５０２〜３５０４から順次読み出し、ライン（１８
画素）毎に出力する。なお、図３６右端に示した予測信
号の組のうち第１組と第２組がフレーム予測信号、第３
組がフィールド予測信号を表すが、第１組と第２組は先
に述べたように動きベクトル検出時の誤差の大きさによ
り、いずれか一方のみが使われる。
示した予測信号の組（｜記号の両側に示した組）をメモ
リ３５０２〜３５０４から順次読み出し、ライン（１８
画素）毎に出力する。なお、図３６右端に示した予測信
号の組のうち第１組と第２組がフレーム予測信号、第３
組がフィールド予測信号を表すが、第１組と第２組は先
に述べたように動きベクトル検出時の誤差の大きさによ
り、いずれか一方のみが使われる。
【００７４】図３７に半画素回路３５０７の詳細図を示
す。入力されたフレーム予測信号３５２０は、遅延回路
３７１０および３７０１〜３７０８により所定の時間遅
延させられた後に、平均値回路３７０９にてそれらの一
部の平均が計算され半画素フレーム予測信号３５３０が
出力される。７５画素入力し終わった時点での各信号線
３７２０a〜i、A〜Iとブロックの位置関係を示す。
す。入力されたフレーム予測信号３５２０は、遅延回路
３７１０および３７０１〜３７０８により所定の時間遅
延させられた後に、平均値回路３７０９にてそれらの一
部の平均が計算され半画素フレーム予測信号３５３０が
出力される。７５画素入力し終わった時点での各信号線
３７２０a〜i、A〜Iとブロックの位置関係を示す。
【００７５】 ａ〜ｉ、Ａ〜Ｉはそれぞれ信号線３７２０a〜i、A〜Iが
この位置の画素を保持していることを示し、ｘは遅延回
路内に保持され、ｚはすでに廃棄されていることを表
す。７５画素を入力し終わったこの時点で符号化画像信
号２０２は入力される。すなわち、符号化画像信号の第
１の画素と先の動きベクトルによりのｅあるいはＥで示
した位置の画素が対応する。半画素信号の生成法は、例
えば符号化画像信号の第１の画素に対応する予測信号値
は、半画素のベクトルが（-0.5、-0.5）の場合、フレー
ム予測で（ｉ＋ｈ＋ｆ＋ｅ＋２）／４、フィールド予測
で（Ｉ＋Ｈ＋Ｆ＋Ｅ＋２）／４、（0、+0.5）の場合、
フレーム予測で（ｅ＋ｂ＋１）／２、フィールド予測で
（Ｅ＋Ｂ＋１）／２、（0、0）の場合、フレーム予測で
ｅ、フィールド予測でＥとなる。ここで記号／は割り算
後結果を切り捨てて整数にする操作を表し、ａ〜ｉ、Ａ
〜Ｉはそれぞれ信号線３７２０a〜i、A〜Iの値を表す。
平均値回路３７０９、３７１９における平均値のとりか
たは各回路３５０７−１〜９によりすべて異なる。例え
ば平均値回路３７０９の場合は次の計算を行う。
この位置の画素を保持していることを示し、ｘは遅延回
路内に保持され、ｚはすでに廃棄されていることを表
す。７５画素を入力し終わったこの時点で符号化画像信
号２０２は入力される。すなわち、符号化画像信号の第
１の画素と先の動きベクトルによりのｅあるいはＥで示
した位置の画素が対応する。半画素信号の生成法は、例
えば符号化画像信号の第１の画素に対応する予測信号値
は、半画素のベクトルが（-0.5、-0.5）の場合、フレー
ム予測で（ｉ＋ｈ＋ｆ＋ｅ＋２）／４、フィールド予測
で（Ｉ＋Ｈ＋Ｆ＋Ｅ＋２）／４、（0、+0.5）の場合、
フレーム予測で（ｅ＋ｂ＋１）／２、フィールド予測で
（Ｅ＋Ｂ＋１）／２、（0、0）の場合、フレーム予測で
ｅ、フィールド予測でＥとなる。ここで記号／は割り算
後結果を切り捨てて整数にする操作を表し、ａ〜ｉ、Ａ
〜Ｉはそれぞれ信号線３７２０a〜i、A〜Iの値を表す。
平均値回路３７０９、３７１９における平均値のとりか
たは各回路３５０７−１〜９によりすべて異なる。例え
ば平均値回路３７０９の場合は次の計算を行う。
【００７６】 検出回路 対応ベクトル 計算 ３５０７−１ (-0.5,-0.5) （ｉ＋ｈ＋ｆ＋ｅ＋２）／４ ３５０７−２ (-0.5, 0) （ｈ＋ｅ＋１）／２ ３５０７−３ (-0.5,+0.5) （ｇ＋ｈ＋ｄ＋ｅ＋２）／４ ３５０７−４ ( 0,-0.5) （ｆ＋ｅ＋１）／２ ３５０７−５ ( 0, 0) ｅ ３５０７−６ ( 05,-0.5) （ｅ＋ｄ＋１）／２ ３５０７−７ (+0.5,-0.5) （ｃ＋ｂ＋ｆ＋ｅ＋２）／４ ３５０７−８ (+0.5, 0) （ｅ＋ｂ＋１）／２ ３５０７−９ (+0.5,+0.5) （ｅ＋ｄ＋ｂ＋ａ＋２）／４ フィールド予測信号も同様に遅延回路３７１１〜３７１
８により所定の時間遅延させられた後に、平均値回路３
７１９にてそれらの一部の平均が計算され半画素フレー
ム予測信号３５３１が出力される。平均値のとりかたは
各回路３５０７−１〜９によりすべて異なる。ここで、
遅延回路３７１３、３７１６は３６画素分の遅延、遅延
回路３７０３、３７０６、３７１０は１８画素分の遅
延、それ以外の遅延回路は１画素分の遅延である。以上
はフレーム単位に符号化した場合であるが、フィールド
単位に予測した場合には、２つのフィールド予測信号を
３５２０、３５２１に入力しフレーム予測と同様の計算
を行う。この時遅延回路３７１０、３７１３、３７１６
はそれぞれ０画素、１８画素、１８画素の遅延になるよ
う、すなわちに半画素回路３５０７の上半分と下半分が
同一の処理を行うように、外部より設定する。
８により所定の時間遅延させられた後に、平均値回路３
７１９にてそれらの一部の平均が計算され半画素フレー
ム予測信号３５３１が出力される。平均値のとりかたは
各回路３５０７−１〜９によりすべて異なる。ここで、
遅延回路３７１３、３７１６は３６画素分の遅延、遅延
回路３７０３、３７０６、３７１０は１８画素分の遅
延、それ以外の遅延回路は１画素分の遅延である。以上
はフレーム単位に符号化した場合であるが、フィールド
単位に予測した場合には、２つのフィールド予測信号を
３５２０、３５２１に入力しフレーム予測と同様の計算
を行う。この時遅延回路３７１０、３７１３、３７１６
はそれぞれ０画素、１８画素、１８画素の遅延になるよ
う、すなわちに半画素回路３５０７の上半分と下半分が
同一の処理を行うように、外部より設定する。
【００７７】図３８に符号量制御回路の実施例を示す。
従来の符号量制御回路と異なる点は、動きベクトル検出
時に使われた各誤差信号３８１０を符号量メモリ３８０
１に蓄積し符号量制御に用いる点である。既に説明した
ように動きベクトルの検出は符号化に先だって行われ
る。そのため、そのとき生じた各部分での誤差の大きさ
をもとに画面内の発生情報量の偏りの予測を行えば、精
度の高い符号量制御を行うことができる。また、情報量
の多い箇所に多くの符号を割り当てることができるた
め、画面内の画質を一定にする効果もある。具体的に
は、所定の小領域毎の差分合計に比例して、この小領域
に符号を割り当てる。すなわち、ｉ番目の小領域の誤差
値をＥｒ（ｉ）、ｉ番目の小領域までの誤差値の累積を
ＳＥｒ（ｉ）、領域数をｎ、１画面に割り当てられた符
号量をＢとすると、全画面の誤差値の合計ＳＥＲ（ｎ）
に対する、符号化をおこなう部分までの誤差値の合計の
比率、すなわちＳＥｒ（ｉ）／ＳＥｒ（ｎ）を信号線３
８１１を介して符号量制御回路３８０３に通知する。符
号量制御回路ではＢ＊ＳＥｒ（ｉ）／ＳＥｒ（ｎ）と実
際に発生した符号量を比較し、発生符号量の方が多けれ
ば画質を粗くし、少なければ画質を細かくし、割り当て
られた符号量になるよう制御を行う。上記の説明は画面
内の小領域間の符号量の割当法をを例にとって行った
が、数画面（例えばＰピクチャとその前に連続するＢピ
クチャ）中の画面間の符号量の割当法にも適応できる。
また、全画面の誤差値の合計が一定値以上になった場合
にその画面をＩピクチャとして符号化するよう制御する
方法も本発明に含まれる。上記の説明は誤差値として動
きベクトル検出時に使われる画素毎の差分の絶対値和を
前提としていたが、動きベクトル検出時に別の類似度の
類似度の評価値、例えば画素毎の差分の二乗和や、差分
信号をアダマールやＤＣＴ変換等により直交変換した後
の信号の絶対値和などを評価値として用いてもよい。こ
れらの評価値は実際に発生する符号量により近いため、
より精度の高い符号量制御が可能となる。また、先の画
素毎の差分の絶対値和、あるいは上記の評価値を変換し
た値、例えば二乗、対数などの処理をした値、をもちい
ても制御精度向上の効果が得られる。なお、画像を分割
処理する符号化装置にも単一の符号化回路からなる符号
化装置にも適用可能である。
従来の符号量制御回路と異なる点は、動きベクトル検出
時に使われた各誤差信号３８１０を符号量メモリ３８０
１に蓄積し符号量制御に用いる点である。既に説明した
ように動きベクトルの検出は符号化に先だって行われ
る。そのため、そのとき生じた各部分での誤差の大きさ
をもとに画面内の発生情報量の偏りの予測を行えば、精
度の高い符号量制御を行うことができる。また、情報量
の多い箇所に多くの符号を割り当てることができるた
め、画面内の画質を一定にする効果もある。具体的に
は、所定の小領域毎の差分合計に比例して、この小領域
に符号を割り当てる。すなわち、ｉ番目の小領域の誤差
値をＥｒ（ｉ）、ｉ番目の小領域までの誤差値の累積を
ＳＥｒ（ｉ）、領域数をｎ、１画面に割り当てられた符
号量をＢとすると、全画面の誤差値の合計ＳＥＲ（ｎ）
に対する、符号化をおこなう部分までの誤差値の合計の
比率、すなわちＳＥｒ（ｉ）／ＳＥｒ（ｎ）を信号線３
８１１を介して符号量制御回路３８０３に通知する。符
号量制御回路ではＢ＊ＳＥｒ（ｉ）／ＳＥｒ（ｎ）と実
際に発生した符号量を比較し、発生符号量の方が多けれ
ば画質を粗くし、少なければ画質を細かくし、割り当て
られた符号量になるよう制御を行う。上記の説明は画面
内の小領域間の符号量の割当法をを例にとって行った
が、数画面（例えばＰピクチャとその前に連続するＢピ
クチャ）中の画面間の符号量の割当法にも適応できる。
また、全画面の誤差値の合計が一定値以上になった場合
にその画面をＩピクチャとして符号化するよう制御する
方法も本発明に含まれる。上記の説明は誤差値として動
きベクトル検出時に使われる画素毎の差分の絶対値和を
前提としていたが、動きベクトル検出時に別の類似度の
類似度の評価値、例えば画素毎の差分の二乗和や、差分
信号をアダマールやＤＣＴ変換等により直交変換した後
の信号の絶対値和などを評価値として用いてもよい。こ
れらの評価値は実際に発生する符号量により近いため、
より精度の高い符号量制御が可能となる。また、先の画
素毎の差分の絶対値和、あるいは上記の評価値を変換し
た値、例えば二乗、対数などの処理をした値、をもちい
ても制御精度向上の効果が得られる。なお、画像を分割
処理する符号化装置にも単一の符号化回路からなる符号
化装置にも適用可能である。
【００７８】図３９は図３８の符号量制御回路の変形例
である。図３８の実施例と異なる点は符号量制御用のメ
モリが２面になり、その一方は外部から入力画像に応じ
た設定が可能な点である。図３８の実施例では、画面内
の画質は一定になるように制御がかかる。しかし、実際
には一部をより高画質にした方が画面全体の画質が向上
したように感じられたり、また符号者が意図的に画面の
一部を高画質化する用途がある。こうした場合には符号
配分の重み係数３９１０を符号配分補正用メモリ３９０
１に入力し、符号量制御回路３９０２では、読み出した
係数３９１１を加味して量子化ステップサイズを決定す
る。符号配分補正メモリ３９０１には、画面をいくつか
の小領域に分割した時、それぞれの小領域に対応した符
号配分の重み係数を格納する。例えば、１小領域あたり
８ビットのメモリを持ち、メモリに格納した値をＷ（０
〜２５５）としたとき、量子化の値を一時的にＷ／１２
８倍する。
である。図３８の実施例と異なる点は符号量制御用のメ
モリが２面になり、その一方は外部から入力画像に応じ
た設定が可能な点である。図３８の実施例では、画面内
の画質は一定になるように制御がかかる。しかし、実際
には一部をより高画質にした方が画面全体の画質が向上
したように感じられたり、また符号者が意図的に画面の
一部を高画質化する用途がある。こうした場合には符号
配分の重み係数３９１０を符号配分補正用メモリ３９０
１に入力し、符号量制御回路３９０２では、読み出した
係数３９１１を加味して量子化ステップサイズを決定す
る。符号配分補正メモリ３９０１には、画面をいくつか
の小領域に分割した時、それぞれの小領域に対応した符
号配分の重み係数を格納する。例えば、１小領域あたり
８ビットのメモリを持ち、メモリに格納した値をＷ（０
〜２５５）としたとき、量子化の値を一時的にＷ／１２
８倍する。
【００７９】符号配分の重み係数３９１１の入力は符号
化開始時に一度だけ設定しても、１画面毎に設定しても
構わない。１画面毎に設定したほうがより細かな補正が
可能であるが、逆に入力する符号配分の重み係数の情報
量が増えてしまう。例えば１９２０画素ｘ１０２４ライ
ンｘ３０Ｈｚの画像に対し、１６ｘ１６画素に対し８ビ
ットの係数を入力すると、約1.8Ｍｂｐｓの転送レート
になる。符号配分の重み係数の転送レートを下げるため
の以下の変形例も本発明に包含される。
化開始時に一度だけ設定しても、１画面毎に設定しても
構わない。１画面毎に設定したほうがより細かな補正が
可能であるが、逆に入力する符号配分の重み係数の情報
量が増えてしまう。例えば１９２０画素ｘ１０２４ライ
ンｘ３０Ｈｚの画像に対し、１６ｘ１６画素に対し８ビ
ットの係数を入力すると、約1.8Ｍｂｐｓの転送レート
になる。符号配分の重み係数の転送レートを下げるため
の以下の変形例も本発明に包含される。
【００８０】（１）符号配分の重み係数の対応する領域
を広げる。あるいは係数のビット数を少なくする。例え
ば、６４ｘ１６画素に４ビットの係数を割り当てると、
転送レートは１／８になる。小領域の形状は任意で構わ
ないが、マクロブロックの形状単位に設定したほうが正
確な補正ができ、連続して処理されるＬ個のマクロブロ
ックの形状（水平１６ｘＬ画素、垂直１６画素）にする
と符号配分補正用メモリ３９０１をランダムアクセスし
なくてすむためメモリのアドレス回路を削減できる。ま
た水平分割した符号化装置に適用する場合も余分な符号
配分補正用メモリを持たずに済む。
を広げる。あるいは係数のビット数を少なくする。例え
ば、６４ｘ１６画素に４ビットの係数を割り当てると、
転送レートは１／８になる。小領域の形状は任意で構わ
ないが、マクロブロックの形状単位に設定したほうが正
確な補正ができ、連続して処理されるＬ個のマクロブロ
ックの形状（水平１６ｘＬ画素、垂直１６画素）にする
と符号配分補正用メモリ３９０１をランダムアクセスし
なくてすむためメモリのアドレス回路を削減できる。ま
た水平分割した符号化装置に適用する場合も余分な符号
配分補正用メモリを持たずに済む。
【００８１】（２）予め定められたフレーム数(Ｎｗフ
レーム)に１回、符号配分の重み係数を入力する。これ
により、転送レートが１／Ｎｗになる。
レーム)に１回、符号配分の重み係数を入力する。これ
により、転送レートが１／Ｎｗになる。
【００８２】（３）重み係数を符号化して転送し、符号
配分補正用メモリ３９０１の入力時に復号して入力す
る。例えば同じ重み係数が連続する場合には、その係数
値と連続する個数を伝送する。連続数の最大を２５５個
（８ビット）とすると、係数値の変化毎に１６ビットの
情報が発生する。１マクロブロックライン（上記例では
１９２０ｘ１６画素）あたり平均１０回の変化点があっ
たとすると転送レートは約３００ｋｂｐｓと１／６にな
る。連続数をハフマン符号等の可変長を用いたり、係数
値の変化差分値を可変長符号で符号化する処理等を行え
ば、さらに転送レートを低くすることができる。ただ
し、この変形例では１画面当りの重み係数を符号量が可
変になるため転送の開始、終了等を通知する制御が必要
になる。
配分補正用メモリ３９０１の入力時に復号して入力す
る。例えば同じ重み係数が連続する場合には、その係数
値と連続する個数を伝送する。連続数の最大を２５５個
（８ビット）とすると、係数値の変化毎に１６ビットの
情報が発生する。１マクロブロックライン（上記例では
１９２０ｘ１６画素）あたり平均１０回の変化点があっ
たとすると転送レートは約３００ｋｂｐｓと１／６にな
る。連続数をハフマン符号等の可変長を用いたり、係数
値の変化差分値を可変長符号で符号化する処理等を行え
ば、さらに転送レートを低くすることができる。ただ
し、この変形例では１画面当りの重み係数を符号量が可
変になるため転送の開始、終了等を通知する制御が必要
になる。
【００８３】（４）数フレームにわたる重み係数の分布
を記述する符号を伝送し、符号配分補正用メモリ３９０
１の出力時にこの符号を展開して所望の係数値を得る。
以下に分布の記述の例を示す。例は３フレーム同じ係数
値を続けた後、画面が右に移動したため係数値も右にず
らした例である。（）は（）内に記した内容の処理に応
じた符号を意味する。
を記述する符号を伝送し、符号配分補正用メモリ３９０
１の出力時にこの符号を展開して所望の係数値を得る。
以下に分布の記述の例を示す。例は３フレーム同じ係数
値を続けた後、画面が右に移動したため係数値も右にず
らした例である。（）は（）内に記した内容の処理に応
じた符号を意味する。
【００８４】 （１画面分係数値転送）（第１係数値）（第２係数値）.....（最終係数値） （前画面と同一係数を使用） （前画面と同一係数を使用） （前画面の左隣の係数を使用）（画面左端第１係数値）（画面左端第２係数値 ） ..... （画面左端最終係数値） ..... 以上の様な符号化処理を、上記（３）の変形例と組み合
わせることにより転送レートをさらに下げることができ
る。一方、符号の解析処理は複雑になるが、マイクロプ
ロセッサあるいはディジタルシグナルプロセッサ等を配
置し、ソフトウェアにより処理を行えば少ないハード追
加で実現ができる。なお、画像を分割処理する符号化装
置にも単一の符号化回路からなる符号化装置にも適用可
能である。
わせることにより転送レートをさらに下げることができ
る。一方、符号の解析処理は複雑になるが、マイクロプ
ロセッサあるいはディジタルシグナルプロセッサ等を配
置し、ソフトウェアにより処理を行えば少ないハード追
加で実現ができる。なお、画像を分割処理する符号化装
置にも単一の符号化回路からなる符号化装置にも適用可
能である。
【００８５】図４０は図１３に示した共有メモリ回路１
１０２の変形例である。図１３では各小符号化あるいは
復号化装置に対応するメモリを２面持ち、読み出し用と
書き込み込み用に分けていたが、図４０では読み出しと
書き込みを１つのメモリ１３０３で行っている。こうし
た処理を行うことによりメモリ管理回路４００１の回路
規模はやや増大するが、メモリ１３０３の数は半分にな
る。メモリ素子はその高集積化がめざましいため、１画
面を４分割した程度画像の大きさの画像（１９２０画素
ｘ２５６ラインｘ８ビット＋該当色信号では６Ｍビット
程度）２枚を１つの素子に格納することは十分可能であ
り、１つの素子に格納したほうが回路規模も小さくな
る。
１０２の変形例である。図１３では各小符号化あるいは
復号化装置に対応するメモリを２面持ち、読み出し用と
書き込み込み用に分けていたが、図４０では読み出しと
書き込みを１つのメモリ１３０３で行っている。こうし
た処理を行うことによりメモリ管理回路４００１の回路
規模はやや増大するが、メモリ１３０３の数は半分にな
る。メモリ素子はその高集積化がめざましいため、１画
面を４分割した程度画像の大きさの画像（１９２０画素
ｘ２５６ラインｘ８ビット＋該当色信号では６Ｍビット
程度）２枚を１つの素子に格納することは十分可能であ
り、１つの素子に格納したほうが回路規模も小さくな
る。
【００８６】メモリ管理回路４００１ではメモリの読み
出し機能が追加される。メモリの読み出し処理は書き込
み処理と同様に読みだすブロックの先頭画素のアドレス
等を信号線１１０４を用いて設定し、設定した後に所望
の画素が連続してあるいは間欠的に信号線１１０４のデ
ータ線に出力される。読み出しアドレスの設定は先頭の
画素のアドレスの代わりにマクロブロックの番号、マク
ロブロック内のブロックの番号、該当マクロブロックの
動きベクトルを設定してもよい。
出し機能が追加される。メモリの読み出し処理は書き込
み処理と同様に読みだすブロックの先頭画素のアドレス
等を信号線１１０４を用いて設定し、設定した後に所望
の画素が連続してあるいは間欠的に信号線１１０４のデ
ータ線に出力される。読み出しアドレスの設定は先頭の
画素のアドレスの代わりにマクロブロックの番号、マク
ロブロック内のブロックの番号、該当マクロブロックの
動きベクトルを設定してもよい。
【００８７】図４０の共有メモリ回路はメモリのアクセ
ス回数が２倍になる点、また読み出しを設定してから該
当する画素データが出力されるまでの時間に若干の遅延
がある点から、本変形例は比較的メモリアクセス数の少
ない、復号化回路（図１７）へ適用したときに特に効果
が得られる。
ス回数が２倍になる点、また読み出しを設定してから該
当する画素データが出力されるまでの時間に若干の遅延
がある点から、本変形例は比較的メモリアクセス数の少
ない、復号化回路（図１７）へ適用したときに特に効果
が得られる。
【００８８】図４１は図４０の変形例であり、図４０の
メモリ１３０１−１〜４が１つのメモリ４１０１に集約
されている。このためメモリ管理回路４１０２は全ての
小符号化回路あるいは小復号化回路のメモリアクセスを
１つのバス４１１０で行う。メモリ管理回路４１０２内
部には、各アドレス入力線毎にＦＩＦＯあるいはバッフ
ァメモリが接続され、このＦＩＦＯあるいはバッファメ
モリにアドレスが設定された時点でメモリ４１０１の所
定のアドレスにアクセスをする。いくつかのアドレス設
定がほぼ同時刻に行われた場合はそれらの設定に順序づ
けをし順番に処理を行う。順序づけには、少しでも早い
時刻に書き込まれたものから処理をする方法や、予め定
められた順番にＦＩＦＯあるいはバッファメモリの設定
の有無を確認しておき、設定されていたものを処理する
方法等がある。後者はアクセスの優先順位を自由に設定
できる利点はあるが優先順位の低いものは設定してから
データ処理される間での待ち時間が長くなる場合があ
る。
メモリ１３０１−１〜４が１つのメモリ４１０１に集約
されている。このためメモリ管理回路４１０２は全ての
小符号化回路あるいは小復号化回路のメモリアクセスを
１つのバス４１１０で行う。メモリ管理回路４１０２内
部には、各アドレス入力線毎にＦＩＦＯあるいはバッフ
ァメモリが接続され、このＦＩＦＯあるいはバッファメ
モリにアドレスが設定された時点でメモリ４１０１の所
定のアドレスにアクセスをする。いくつかのアドレス設
定がほぼ同時刻に行われた場合はそれらの設定に順序づ
けをし順番に処理を行う。順序づけには、少しでも早い
時刻に書き込まれたものから処理をする方法や、予め定
められた順番にＦＩＦＯあるいはバッファメモリの設定
の有無を確認しておき、設定されていたものを処理する
方法等がある。後者はアクセスの優先順位を自由に設定
できる利点はあるが優先順位の低いものは設定してから
データ処理される間での待ち時間が長くなる場合があ
る。
【００８９】図４０、図４１の変形例を用いた復号化回
路では、メモリアクセス回数が最も多い場合をもとにメ
モリのアクセス速度を決定する。例えば、先に説明した
MPEGではＢピクチャの補間予測の場合に最もメモリアク
セス回数が増大し１画素あたり４回（予測画像読み込み
２回、再生画像書き込み１回、表示読み出し１回）にな
る。また、説明を省略したがMPEG2で採用されたＤｕａ
ｌ ｐｒｉｍｅ予測もＢピクチャと同様に４回のアクセ
スが必要である。１９２０ｘ２５６ｘ３０Ｈｚｘ１．５
（色信号分）の画像の場合は約２２Ｍ画素／秒であるこ
とから、８８Ｍ画素／秒のアクセスが必要になる。現在
の大容量のメモリのアクセス速度は３０〜４０ｎｓ前後
であることから、１回に２画素（１６ビット）アクセス
すすることにより、８８Ｍ画素／秒のアクセスを達成す
ることができる。しかし、この場合はアクセスのオーバ
ーヘッドを最小限に抑さえなければならないため、回路
構成が複雑になり回路規模が増大する。また、実際には
１画面内の予測が全て補間予測あるいはＤｕａｌ ｐｒ
ｉｍｅ予測であることはほとんどないため、平均のアク
セス回数はさらに少ない。従って、メモリのアクセス回
数を８８Ｍ画素／秒よりも少ない値で回路を設計してお
き、アクセス処理回数が所定の回数を越えたあるいは越
える恐れのあるときには、補間予測あるいはＤｕａｌ
ｐｒｉｍｅ予測を簡略処理により実行する回路を付加す
ることによって、小復号化回路および復号化装置全体の
回路規模を小さくすることができる。補間予測あるいは
Ｄｕａｌ ｐｒｉｍｅ予測の簡略処理としては図４２に
示すように従来２画素の平均を取っていた予測値をその
いずれかの１画素で置き換えることによって実現する。
このときメモリへのアクセス回数は１画素あたり３回と
なる。図４２（１）は従来の補間予測あるいはＤｕａｌ
ｐｒｉｍｅ予測における補間処理を示し、以降（２）
〜（４）に簡略処理を示す。図の白丸印あるいは黒丸印
のついた画素だけを読みだす。これらの簡略処理により
再生する画像の画質はやや劣化するが、両予測とも類似
した画像の平均値を予測画像としている点、簡略処理を
するブロック数が確率的に非常に少ない点から、再生画
像の劣化は通常ほとんど気にならない程度のものにな
る。一方、簡略処理による効果は上記に説明した回路の
小型化が図れる。あるいは逆に従来と同じ回路でより低
速のメモリを使うこともできる。低速のメモリを使う
と、回路コストを削減できる他に、最先端の大容量メモ
リ（一般には再高速のメモリに比べアクセス速度が遅
い）を使用できることになり回路規模削減にも効果があ
る。（２）の簡略処理１では一方の予測画像しか用いな
いた復号化のモードを例えば補間予測から前方予測に強
制的に切り替えることにより回路の変更増大を最小限に
抑さえることができる。一方、（３）の簡略処理２では
ライン毎に予測画像を切り替えているため、２つの予測
画像の特徴を予測画像に反映させることができる。一般
には２つの予測画像はほぼ同一のものであるが、標準化
の規定では任意の画像の組み合わせが許されている。簡
略処理２は２つの画像が異なるものであっても、簡略処
理による劣化を最小限におさえることができる。簡略処
理２は垂直方向に分割する方法も包含する。（４）の簡
略処理３は簡略処理２に水平方向の変化を加えたもの
で、簡略処理による誤差の周波数成分が垂直水平とも高
周波成分になるため、人間の視覚に感じにくくなり、劣
化がより少なく感じられる効果がある。さらに、（５）
の簡略処理４は簡略処理２において、予測画像２の画素
を用いる箇所にて、予測画像１の周辺の画素から空間補
間した画素を作り、この空間補間画素と予測画像２の画
素との間で平均値処理を行い予測画像を作りだす。この
場合、予測画像生成の回路構成はやや複雑になるが、最
も処理速度に影響するメモリへのアクセス頻度は他の簡
略処理と同じになる。簡略処理による劣化も他の簡略処
理の場合よりもさらにおさえることができる。図では空
間補間画素作成時に境界の画素は空間補間画素を使用し
ていないが、ブロック外の画素を用いて空間補間画素を
生成する方法、ブロック内の空間的に近い位置の画素を
空間補間画素とする方法も本発明に包含される。また、
簡略処理４は簡略処理２をベースとしているが、簡略処
理３に空間画素補間による方法を適用しても同様の効果
が得られる。
路では、メモリアクセス回数が最も多い場合をもとにメ
モリのアクセス速度を決定する。例えば、先に説明した
MPEGではＢピクチャの補間予測の場合に最もメモリアク
セス回数が増大し１画素あたり４回（予測画像読み込み
２回、再生画像書き込み１回、表示読み出し１回）にな
る。また、説明を省略したがMPEG2で採用されたＤｕａ
ｌ ｐｒｉｍｅ予測もＢピクチャと同様に４回のアクセ
スが必要である。１９２０ｘ２５６ｘ３０Ｈｚｘ１．５
（色信号分）の画像の場合は約２２Ｍ画素／秒であるこ
とから、８８Ｍ画素／秒のアクセスが必要になる。現在
の大容量のメモリのアクセス速度は３０〜４０ｎｓ前後
であることから、１回に２画素（１６ビット）アクセス
すすることにより、８８Ｍ画素／秒のアクセスを達成す
ることができる。しかし、この場合はアクセスのオーバ
ーヘッドを最小限に抑さえなければならないため、回路
構成が複雑になり回路規模が増大する。また、実際には
１画面内の予測が全て補間予測あるいはＤｕａｌ ｐｒ
ｉｍｅ予測であることはほとんどないため、平均のアク
セス回数はさらに少ない。従って、メモリのアクセス回
数を８８Ｍ画素／秒よりも少ない値で回路を設計してお
き、アクセス処理回数が所定の回数を越えたあるいは越
える恐れのあるときには、補間予測あるいはＤｕａｌ
ｐｒｉｍｅ予測を簡略処理により実行する回路を付加す
ることによって、小復号化回路および復号化装置全体の
回路規模を小さくすることができる。補間予測あるいは
Ｄｕａｌ ｐｒｉｍｅ予測の簡略処理としては図４２に
示すように従来２画素の平均を取っていた予測値をその
いずれかの１画素で置き換えることによって実現する。
このときメモリへのアクセス回数は１画素あたり３回と
なる。図４２（１）は従来の補間予測あるいはＤｕａｌ
ｐｒｉｍｅ予測における補間処理を示し、以降（２）
〜（４）に簡略処理を示す。図の白丸印あるいは黒丸印
のついた画素だけを読みだす。これらの簡略処理により
再生する画像の画質はやや劣化するが、両予測とも類似
した画像の平均値を予測画像としている点、簡略処理を
するブロック数が確率的に非常に少ない点から、再生画
像の劣化は通常ほとんど気にならない程度のものにな
る。一方、簡略処理による効果は上記に説明した回路の
小型化が図れる。あるいは逆に従来と同じ回路でより低
速のメモリを使うこともできる。低速のメモリを使う
と、回路コストを削減できる他に、最先端の大容量メモ
リ（一般には再高速のメモリに比べアクセス速度が遅
い）を使用できることになり回路規模削減にも効果があ
る。（２）の簡略処理１では一方の予測画像しか用いな
いた復号化のモードを例えば補間予測から前方予測に強
制的に切り替えることにより回路の変更増大を最小限に
抑さえることができる。一方、（３）の簡略処理２では
ライン毎に予測画像を切り替えているため、２つの予測
画像の特徴を予測画像に反映させることができる。一般
には２つの予測画像はほぼ同一のものであるが、標準化
の規定では任意の画像の組み合わせが許されている。簡
略処理２は２つの画像が異なるものであっても、簡略処
理による劣化を最小限におさえることができる。簡略処
理２は垂直方向に分割する方法も包含する。（４）の簡
略処理３は簡略処理２に水平方向の変化を加えたもの
で、簡略処理による誤差の周波数成分が垂直水平とも高
周波成分になるため、人間の視覚に感じにくくなり、劣
化がより少なく感じられる効果がある。さらに、（５）
の簡略処理４は簡略処理２において、予測画像２の画素
を用いる箇所にて、予測画像１の周辺の画素から空間補
間した画素を作り、この空間補間画素と予測画像２の画
素との間で平均値処理を行い予測画像を作りだす。この
場合、予測画像生成の回路構成はやや複雑になるが、最
も処理速度に影響するメモリへのアクセス頻度は他の簡
略処理と同じになる。簡略処理による劣化も他の簡略処
理の場合よりもさらにおさえることができる。図では空
間補間画素作成時に境界の画素は空間補間画素を使用し
ていないが、ブロック外の画素を用いて空間補間画素を
生成する方法、ブロック内の空間的に近い位置の画素を
空間補間画素とする方法も本発明に包含される。また、
簡略処理４は簡略処理２をベースとしているが、簡略処
理３に空間画素補間による方法を適用しても同様の効果
が得られる。
【００９０】なお、本発明は上記で説明した以外のいか
なる画素数の画像に対しても適用でき回路の小型化の効
果が得られる。また、画像分割した復号化装置に限ら
ず、単一の復号化回路をもつ画像復号化装置にも適用が
でき同じ効果がある。
なる画素数の画像に対しても適用でき回路の小型化の効
果が得られる。また、画像分割した復号化装置に限ら
ず、単一の復号化回路をもつ画像復号化装置にも適用が
でき同じ効果がある。
【００９１】図４０、図４１に示した回路構成および制
御方法は画像符号化装置に適用可能である。
御方法は画像符号化装置に適用可能である。
【００９２】図４３は本発明を適用した画像符号化復号
化装置の実施例である。画像信号および符号を画面上の
該当する位置に応じて分割し、符号化および復号化処理
を行う。入力画像信号２−１および入力符号７−１は符
号／画像分割回路４３０１にて画像、符号それぞれ独立
のタイミングで４つに分割され、信号線４３１０−１〜
４を介し小符号化復号化回路４３０１−１〜４に入力さ
れる。信号線４３１０−１〜４では画像信号と符号信号
が空間的に多重されている。小符号化復号化回路４３０
１−１〜４は入力された画像信号に対し符号化処理を行
い、符号に対しては復号化処理を行う。これらの処理は
既に説明した小符号化回路１１０１や小復号化回路１７
０２と同じ処理である。符号化あるいは復号化された結
果は画像／符号合成回路４３０３にて符号、再生画像そ
れぞれ独立のタイミングで合成され、出力符号７−２お
よび再生画像信号２−２が得られる。
化装置の実施例である。画像信号および符号を画面上の
該当する位置に応じて分割し、符号化および復号化処理
を行う。入力画像信号２−１および入力符号７−１は符
号／画像分割回路４３０１にて画像、符号それぞれ独立
のタイミングで４つに分割され、信号線４３１０−１〜
４を介し小符号化復号化回路４３０１−１〜４に入力さ
れる。信号線４３１０−１〜４では画像信号と符号信号
が空間的に多重されている。小符号化復号化回路４３０
１−１〜４は入力された画像信号に対し符号化処理を行
い、符号に対しては復号化処理を行う。これらの処理は
既に説明した小符号化回路１１０１や小復号化回路１７
０２と同じ処理である。符号化あるいは復号化された結
果は画像／符号合成回路４３０３にて符号、再生画像そ
れぞれ独立のタイミングで合成され、出力符号７−２お
よび再生画像信号２−２が得られる。
【００９３】符号化復号化における参照画像は共有メモ
リ４３０４に格納されており、アクセス信号４３１２と
読み出し信号４３１３を用いてアクセスを行う。これら
アクセス信号４３１２と読み出し信号４３１３は小符号
化装置のものと、小復号化装置のものを空間的に多重し
ても時間的に多重しても構わない。共有メモリ回路４３
０３の内部のメモリ数はそれぞれの小符号化回路・小復
号化回路に対応して１メモリずつ、合計８つの独立した
メモリ構成でも、対応する小符号化回路・小復号化回路
に１メモリずつ、合計４つの独立したメモリ構成でも、
小符号化回路に１メモリ、小復号化回路に、合計２つの
独立したメモリ構成でも、あるいは１つのメモリ構成で
も構わない。独立のメモリ数が減れば回路規模は小さく
なるが、逆に１小符号化回路あるいは小復号化回路に対
するアクセス速度が遅くなる、もしくは非常に高速なメ
モリ素子を必要が必要になる。メモリ構成とアクセス用
の信号の多重方法は、それぞれ独立であり、全ての組み
合わせが可能である。
リ４３０４に格納されており、アクセス信号４３１２と
読み出し信号４３１３を用いてアクセスを行う。これら
アクセス信号４３１２と読み出し信号４３１３は小符号
化装置のものと、小復号化装置のものを空間的に多重し
ても時間的に多重しても構わない。共有メモリ回路４３
０３の内部のメモリ数はそれぞれの小符号化回路・小復
号化回路に対応して１メモリずつ、合計８つの独立した
メモリ構成でも、対応する小符号化回路・小復号化回路
に１メモリずつ、合計４つの独立したメモリ構成でも、
小符号化回路に１メモリ、小復号化回路に、合計２つの
独立したメモリ構成でも、あるいは１つのメモリ構成で
も構わない。独立のメモリ数が減れば回路規模は小さく
なるが、逆に１小符号化回路あるいは小復号化回路に対
するアクセス速度が遅くなる、もしくは非常に高速なメ
モリ素子を必要が必要になる。メモリ構成とアクセス用
の信号の多重方法は、それぞれ独立であり、全ての組み
合わせが可能である。
【００９４】図４４は図１１に示した画像符号化装置の
変形例である。図４４の変形例は符号化装置だけではな
く復号化装置、符号化復号化装置にも適用可能である。
変形例である。図４４の変形例は符号化装置だけではな
く復号化装置、符号化復号化装置にも適用可能である。
【００９５】図４４の図１１の共有メモリ回路１１０２
を分散させて各小符号化回路４４０１内に設置してあ
る。そのため共有する部分の画像情報は信号線４４１０
〜４４１５を介して転送され、各小符号化回路内の共有
メモリに格納される。なお、図４４では共有情報は小符
号化回路４４０１−１と２、２と３、３と４の間のみに
設定された例である。
を分散させて各小符号化回路４４０１内に設置してあ
る。そのため共有する部分の画像情報は信号線４４１０
〜４４１５を介して転送され、各小符号化回路内の共有
メモリに格納される。なお、図４４では共有情報は小符
号化回路４４０１−１と２、２と３、３と４の間のみに
設定された例である。
【００９６】図４５は小符号化回路４４０１−２の詳細
図である。小共有メモリ回路４５０１が配置された点が
図１２の小符号化回路１１０１と異なる以外は、図１２
の小符号化回路１１０１と同じ動作をする。小共有メモ
リ回路４５０１は同じ小符号化回路４４０１の局所再生
した参照画像１１０３を保持する他、画像を共有する小
符号化回路からの共有画像信号４４１１、４４１３を受
信し参照画像１１０３と同じメモリに保持する。一方、
参照画像１１０３のうち、他の小符号化回路にて共有画
像として用いる信号は共有画像信号４４１０あるいは４
４１２へ出力し、該当の小符号化回路に転送する。な
お、小符号化回路４４０１−３の構成は小符号化回路４
４０１−２とほとんど同じであり、共有画像信号４４１
０〜４４１３の部分が異なる信号線に接続される。ま
た、小符号化回路４４０１−１、４は共有画像信号線の
数が４本から２本になる。
図である。小共有メモリ回路４５０１が配置された点が
図１２の小符号化回路１１０１と異なる以外は、図１２
の小符号化回路１１０１と同じ動作をする。小共有メモ
リ回路４５０１は同じ小符号化回路４４０１の局所再生
した参照画像１１０３を保持する他、画像を共有する小
符号化回路からの共有画像信号４４１１、４４１３を受
信し参照画像１１０３と同じメモリに保持する。一方、
参照画像１１０３のうち、他の小符号化回路にて共有画
像として用いる信号は共有画像信号４４１０あるいは４
４１２へ出力し、該当の小符号化回路に転送する。な
お、小符号化回路４４０１−３の構成は小符号化回路４
４０１−２とほとんど同じであり、共有画像信号４４１
０〜４４１３の部分が異なる信号線に接続される。ま
た、小符号化回路４４０１−１、４は共有画像信号線の
数が４本から２本になる。
【００９７】図４６は図４５の小共有メモリ回路４５０
１の詳細図である。参照画像信号１１０３および共有画
像信号４４１０、４４１３はメモリ管理回路４６０１に
入力され、メモリ管理回路４６０１内のバッファメモリ
あるいはＦＩＦＯに保持される。メモリ管理回路４６０
１はバッファメモリあるいはＦＩＦＯにデータが入力さ
れると、そのデータをメモリ１３０３あるいは１３０４
の該当する箇所に書き込む。一方、メモリ１３０３ある
いは１３０４の読み出しは信号線１１０４を介して図１
３に示した共有メモリ回路と同様に行う。
１の詳細図である。参照画像信号１１０３および共有画
像信号４４１０、４４１３はメモリ管理回路４６０１に
入力され、メモリ管理回路４６０１内のバッファメモリ
あるいはＦＩＦＯに保持される。メモリ管理回路４６０
１はバッファメモリあるいはＦＩＦＯにデータが入力さ
れると、そのデータをメモリ１３０３あるいは１３０４
の該当する箇所に書き込む。一方、メモリ１３０３ある
いは１３０４の読み出しは信号線１１０４を介して図１
３に示した共有メモリ回路と同様に行う。
【００９８】参照画像信号１１０３は転送スイッチ４６
０４にも入力される。転送スイッチは入力された信号が
共有される部分の信号であれば共有画像信号４４１０あ
るいは４４１２へ出力し、該当の小符号化回路に転送す
る。
０４にも入力される。転送スイッチは入力された信号が
共有される部分の信号であれば共有画像信号４４１０あ
るいは４４１２へ出力し、該当の小符号化回路に転送す
る。
【００９９】上記図４４から図４６までの変形例によれ
ば、第１１図と同じ符号化処理速度で同じ符号化効率を
達成できる。さらに、第１１図では共有メモリ回路１１
０２に集中していた信号線を分散することにより全体の
信号線数を減らすことが可能になる。例えば、各小符号
化回路あたりアクセス信号１１０３がデータ８本、制御
２本、読み出し信号１１０４がデータ８本、アドレス１
０本、制御４本とすると共有メモリ回路１１０２の入力
信号本数は１２８本になる。一方、図４４の変形例では
共有画像信号４４１０〜４４１３はそれぞれデータ８
本、制御２本とすると合計で６０本となり半分以下にな
る。また信号線の集中の度合いも、第１１図では共有メ
モリ回路一箇所に１２８本に対し、変形例では４０本に
なる。信号線の集中を回避することにより、画像符号化
装置８００を１つのＬＳＩにした場合には信号線のレイ
アウトが容易になりチップサイズも小さくなる。小画像
符号化回路および共有メモリ回路をそれぞれ１つのＬＳ
Ｉにした場合には特に共有メモリ回路のＬＳＩのピン数
増加による高価格化を避けることができる。また、符号
化回路および共有メモリ回路をそれぞれ１つの基版に
し、それらをコネクタやケーブル等で接続する場合には
コネクタ数あるいはケーブル数を削減することができ
る。なお、本変形例はとくに画像を水平分割した時に信
号本数を減らす効果が高い。また、分割数を多くするほ
ど信号本数を減らす効果は高くなる。
ば、第１１図と同じ符号化処理速度で同じ符号化効率を
達成できる。さらに、第１１図では共有メモリ回路１１
０２に集中していた信号線を分散することにより全体の
信号線数を減らすことが可能になる。例えば、各小符号
化回路あたりアクセス信号１１０３がデータ８本、制御
２本、読み出し信号１１０４がデータ８本、アドレス１
０本、制御４本とすると共有メモリ回路１１０２の入力
信号本数は１２８本になる。一方、図４４の変形例では
共有画像信号４４１０〜４４１３はそれぞれデータ８
本、制御２本とすると合計で６０本となり半分以下にな
る。また信号線の集中の度合いも、第１１図では共有メ
モリ回路一箇所に１２８本に対し、変形例では４０本に
なる。信号線の集中を回避することにより、画像符号化
装置８００を１つのＬＳＩにした場合には信号線のレイ
アウトが容易になりチップサイズも小さくなる。小画像
符号化回路および共有メモリ回路をそれぞれ１つのＬＳ
Ｉにした場合には特に共有メモリ回路のＬＳＩのピン数
増加による高価格化を避けることができる。また、符号
化回路および共有メモリ回路をそれぞれ１つの基版に
し、それらをコネクタやケーブル等で接続する場合には
コネクタ数あるいはケーブル数を削減することができ
る。なお、本変形例はとくに画像を水平分割した時に信
号本数を減らす効果が高い。また、分割数を多くするほ
ど信号本数を減らす効果は高くなる。
【０１００】図４７は図２５の動きベクトル検出回路２
４０１の変形例である。動きベクトル検出回路２４０１
をコアとしてその周辺回路を設置することによって動き
ベクトルの検出範囲を広げている。図４７の詳細を説明
する前に図４８を用いて動作の概要を説明する。図４８
は動き検出に用いるマクロブロックの順番と位置を図示
している。第１の例は上に符号化画像のマクロブロック
列、下に参照画像のマクロブロック列を示している。１
つの四角形が１つのマクロブロック（１６ｘ１６画素）
に対応し、２５６画素からなり、図の左のマクロブロッ
クから順次入力し処理を行う。図２５の動きベクトル検
出回路の説明では各画素は上の画素から水平方向にスキ
ャンして入力することを仮定していたが、本変形例では
左側の画素から垂直にスキャンして入力する。これは図
２５の回路の動作の垂直アドレス（位置）と水平アドレ
ス（位置）を入れ替えただけで各動作は全く同じであ
る。
４０１の変形例である。動きベクトル検出回路２４０１
をコアとしてその周辺回路を設置することによって動き
ベクトルの検出範囲を広げている。図４７の詳細を説明
する前に図４８を用いて動作の概要を説明する。図４８
は動き検出に用いるマクロブロックの順番と位置を図示
している。第１の例は上に符号化画像のマクロブロック
列、下に参照画像のマクロブロック列を示している。１
つの四角形が１つのマクロブロック（１６ｘ１６画素）
に対応し、２５６画素からなり、図の左のマクロブロッ
クから順次入力し処理を行う。図２５の動きベクトル検
出回路の説明では各画素は上の画素から水平方向にスキ
ャンして入力することを仮定していたが、本変形例では
左側の画素から垂直にスキャンして入力する。これは図
２５の回路の動作の垂直アドレス（位置）と水平アドレ
ス（位置）を入れ替えただけで各動作は全く同じであ
る。
【０１０１】第１の例では参照マクロブロック１Ａ、１
Ｂ、１Ｃが符号マクロブロック１の入力に対応して入力
され、１Ａ、１Ｂ、１Ｃ、２Ａ、２Ｂ、２Ｃ、を用いて
符号マクロブロック１の動きベクトルが探索される。符
号マクロブロック２に対しては参照マクロブロック１
Ａ、１Ｂ、１Ｃ、２Ａ、２Ｂ、２Ｃ、３Ａ、３Ｂ、３Ｃ
が用いられ、そのうち１Ａ、１Ｂ、１Ｃ、２Ａ、２Ｂ、
２Ｃは先の符号マクロブロック１の処理時に入力した画
素を保持しておき、新たに３Ａ、３Ｂ、３Ｃの画素のみ
を入力する。
Ｂ、１Ｃが符号マクロブロック１の入力に対応して入力
され、１Ａ、１Ｂ、１Ｃ、２Ａ、２Ｂ、２Ｃ、を用いて
符号マクロブロック１の動きベクトルが探索される。符
号マクロブロック２に対しては参照マクロブロック１
Ａ、１Ｂ、１Ｃ、２Ａ、２Ｂ、２Ｃ、３Ａ、３Ｂ、３Ｃ
が用いられ、そのうち１Ａ、１Ｂ、１Ｃ、２Ａ、２Ｂ、
２Ｃは先の符号マクロブロック１の処理時に入力した画
素を保持しておき、新たに３Ａ、３Ｂ、３Ｃの画素のみ
を入力する。
【０１０２】符号マクロブロック２と参照マクロブロッ
ク１Ｂが位置的には対応し、水平垂直±１６画素（第１
のマクロブロックのみは水平０〜＋１６）の範囲を探索
している。通常は、参照マクロブロック２Ｂの位置の画
素との類似性が最も高いとき通常は動きベクトル（０、
０）とするが、参照画素を読み出すアドレスに固定のオ
フセット値を加え（０、０）以外の点を中心に探索をす
ることも可能である。例えば水平・垂直アドレスに（
８、１）のオフセットを加えれば水平―８〜＋２４、垂
直―１５〜＋１７までの範囲を探索することになる。第
１の例では参照画像の各マクロブロックの図示した順番
と画面上のマクロブロックの位置が一致している。
ク１Ｂが位置的には対応し、水平垂直±１６画素（第１
のマクロブロックのみは水平０〜＋１６）の範囲を探索
している。通常は、参照マクロブロック２Ｂの位置の画
素との類似性が最も高いとき通常は動きベクトル（０、
０）とするが、参照画素を読み出すアドレスに固定のオ
フセット値を加え（０、０）以外の点を中心に探索をす
ることも可能である。例えば水平・垂直アドレスに（
８、１）のオフセットを加えれば水平―８〜＋２４、垂
直―１５〜＋１７までの範囲を探索することになる。第
１の例では参照画像の各マクロブロックの図示した順番
と画面上のマクロブロックの位置が一致している。
【０１０３】図４８の第２の例は上記のオフセット値を
マクロブロック毎に変化させた場合である。例えば符号
化マクロブロック２に対しては参照マクロブロック１
Ａ'、１Ｂ'、１Ｃ'、２Ａ'、２Ｂ'、２Ｃ'、３Ａ、３
Ｂ、３Ｃが用いられ、１Ａ'等は１Ａ、１Ｂ、１Ｃ、２
Ａ、２Ｂ、２Ｃとは異なる位置の画素であるため一般に
は再度読み出す必要がある。その結果、参照画像の読み
出し速度を第１の例と同じにした場合には、処理速度は
３分の１になってしまう。
マクロブロック毎に変化させた場合である。例えば符号
化マクロブロック２に対しては参照マクロブロック１
Ａ'、１Ｂ'、１Ｃ'、２Ａ'、２Ｂ'、２Ｃ'、３Ａ、３
Ｂ、３Ｃが用いられ、１Ａ'等は１Ａ、１Ｂ、１Ｃ、２
Ａ、２Ｂ、２Ｃとは異なる位置の画素であるため一般に
は再度読み出す必要がある。その結果、参照画像の読み
出し速度を第１の例と同じにした場合には、処理速度は
３分の１になってしまう。
【０１０４】図４８の第３の例はオフセット値を４マク
ロブロック毎に変えた例である。この例が図４７の回路
に相当する。第３の例では処理量は第１の例に比べ３分
の２になるが、オフセット値を変化させる単位を８マク
ロブロックにすれば１０分の８、１６マクロブロックに
すれば１８分の１６と例１に近づく。
ロブロック毎に変えた例である。この例が図４７の回路
に相当する。第３の例では処理量は第１の例に比べ３分
の２になるが、オフセット値を変化させる単位を８マク
ロブロックにすれば１０分の８、１６マクロブロックに
すれば１８分の１６と例１に近づく。
【０１０５】図４７に戻って説明を行う。入力した参照
画像１１（例えば図４８の例３の３Ａ〜Ｃ）あるいは２
１４はベクトル検出回路２４０１に入力されると同時に
メモリ４７０１―１、２、３のいずれか（例えば４７０
１―１）に格納される。一方、これと同時に、先の例で
はメモリ４７０１―２、３から格納されている画素のデ
ータが読み出されて（例えば図４８の例３の１Ａ〜Ｃ、
２Ａ〜Ｃ）入力参照画像１１あるいは２１４（例えば図
４８の例３の３Ａ〜Ｃ）と同時にベクトル検出回路２４
０１に入力される。一方符号化画像２０２（例えば図４
８の例３のマクロブロック２）は遅延回路４７０８にて
所定の時間（図４８の例では１マクロブロック分の時
間）遅延させた後、ベクトル検出回路２４０１に入力さ
れベクトルが求められる。求められた３つ（フレーム、
奇数フィールド、偶数フィールド）のベクトル２４１
０、２４１１、２４１２は出力されると同時に、それぞ
れ加算器４７０２、４７０４、４７０６に入力される。
これら加算器ではメモリ４７０３、４７０５、４７０７
に格納されている、同一符号化画面の別のマクロブロッ
クのベクトル値の加算結果４７１４、４７１５、４７１
６と水平、垂直成分毎に加算され、再びメモリ４７０
３、４７０５、４７０７にそれぞれ格納される。制御回
路４７５０は画面内のマクロブロックをいくつかのグル
ープに分割し、各グループ毎にメモリ４７０３、４７０
５、４７０７に領域を設け、これら領域にベクトル値の
加算結果を格納する。処理中のマクロブロックがあるグ
ループに属しているとき、制御回路４７５０は該当する
メモリのアドレス４７１３を出力し同一グループ内の全
てのマクロブロックのベクトル値を水平、垂直成分毎に
加算する。制御回路４７５０はこれらの加算結果４７１
０、４７１１、４７１２を各グループの最終マクロブロ
ックの処理終了時に読み出す。これらの加算結果をグル
ープ内のマクロブロックの数で割ると各グループの平均
ベクトルが得られる。
画像１１（例えば図４８の例３の３Ａ〜Ｃ）あるいは２
１４はベクトル検出回路２４０１に入力されると同時に
メモリ４７０１―１、２、３のいずれか（例えば４７０
１―１）に格納される。一方、これと同時に、先の例で
はメモリ４７０１―２、３から格納されている画素のデ
ータが読み出されて（例えば図４８の例３の１Ａ〜Ｃ、
２Ａ〜Ｃ）入力参照画像１１あるいは２１４（例えば図
４８の例３の３Ａ〜Ｃ）と同時にベクトル検出回路２４
０１に入力される。一方符号化画像２０２（例えば図４
８の例３のマクロブロック２）は遅延回路４７０８にて
所定の時間（図４８の例では１マクロブロック分の時
間）遅延させた後、ベクトル検出回路２４０１に入力さ
れベクトルが求められる。求められた３つ（フレーム、
奇数フィールド、偶数フィールド）のベクトル２４１
０、２４１１、２４１２は出力されると同時に、それぞ
れ加算器４７０２、４７０４、４７０６に入力される。
これら加算器ではメモリ４７０３、４７０５、４７０７
に格納されている、同一符号化画面の別のマクロブロッ
クのベクトル値の加算結果４７１４、４７１５、４７１
６と水平、垂直成分毎に加算され、再びメモリ４７０
３、４７０５、４７０７にそれぞれ格納される。制御回
路４７５０は画面内のマクロブロックをいくつかのグル
ープに分割し、各グループ毎にメモリ４７０３、４７０
５、４７０７に領域を設け、これら領域にベクトル値の
加算結果を格納する。処理中のマクロブロックがあるグ
ループに属しているとき、制御回路４７５０は該当する
メモリのアドレス４７１３を出力し同一グループ内の全
てのマクロブロックのベクトル値を水平、垂直成分毎に
加算する。制御回路４７５０はこれらの加算結果４７１
０、４７１１、４７１２を各グループの最終マクロブロ
ックの処理終了時に読み出す。これらの加算結果をグル
ープ内のマクロブロックの数で割ると各グループの平均
ベクトルが得られる。
【０１０６】同一符号化画面に対して次の連続する画面
からベクトル探索時にこれら平均ベクトルを各グループ
のオフセット値とする。制御回路４７５０は参照画像ア
ドレス４７６１を生成するときに、そのマクロブロック
が属するグループの平均ベクトルをオフセット値として
加えることにより実現できる。なお、符号化画像アドレ
ス４７６２は通常の処理時と同様に符号化画像のマクロ
ブロックを順次読み出すようアドレスを生成する。
からベクトル探索時にこれら平均ベクトルを各グループ
のオフセット値とする。制御回路４７５０は参照画像ア
ドレス４７６１を生成するときに、そのマクロブロック
が属するグループの平均ベクトルをオフセット値として
加えることにより実現できる。なお、符号化画像アドレ
ス４７６２は通常の処理時と同様に符号化画像のマクロ
ブロックを順次読み出すようアドレスを生成する。
【０１０７】同一符号化画面に対して次の連続する画面
からベクトル探索時にこれら平均ベクトルを各グループ
のオフセット値とすることにより、１画面に対するベク
トル探索範囲を狭くしても、広範囲のベクトルを求める
ことができる。具体的にはＩ、Ｂ、Ｂ、Ｐの順番に符号
化するとき、最初のＩピクチャから第１のＢピクチャの
ベクトルを求め、次に求めたベクトルのグループ毎の平
均ベクトルをオフセットとして、Ｉピクチャから第２の
Ｂピクチャのベクトル、第２のＢピクチャのベクトルを
オフセットとして、ＩピクチャからＰピクチャのベクト
ルを求める操作により、Ｐピクチャに対しては１回のベ
クトル探索範囲の水平垂直それぞれ３倍までの範囲の動
きに追随すること可能となる。
からベクトル探索時にこれら平均ベクトルを各グループ
のオフセット値とすることにより、１画面に対するベク
トル探索範囲を狭くしても、広範囲のベクトルを求める
ことができる。具体的にはＩ、Ｂ、Ｂ、Ｐの順番に符号
化するとき、最初のＩピクチャから第１のＢピクチャの
ベクトルを求め、次に求めたベクトルのグループ毎の平
均ベクトルをオフセットとして、Ｉピクチャから第２の
Ｂピクチャのベクトル、第２のＢピクチャのベクトルを
オフセットとして、ＩピクチャからＰピクチャのベクト
ルを求める操作により、Ｐピクチャに対しては１回のベ
クトル探索範囲の水平垂直それぞれ３倍までの範囲の動
きに追随すること可能となる。
【０１０８】各グループの画面内での形状は自由であ
り、分散していても構わないが、図４８の第３の例の項
で説明したように水平方向には数マクロブロック連続し
ていることが望ましい。具体的には水平は８以上で画面
水平マクロブロック数（４４あるいは４５）の整数分の
１あるいは２のベキ乗、具体的には８あるいは９あるい
は１１あるいは１６マクロブロックのうちいずれかと、
垂直１〜４マクロブロックのいずれかの組み合わせが回
路構成上およびメモリの読み出し速度の理由から特に好
ましい。
り、分散していても構わないが、図４８の第３の例の項
で説明したように水平方向には数マクロブロック連続し
ていることが望ましい。具体的には水平は８以上で画面
水平マクロブロック数（４４あるいは４５）の整数分の
１あるいは２のベキ乗、具体的には８あるいは９あるい
は１１あるいは１６マクロブロックのうちいずれかと、
垂直１〜４マクロブロックのいずれかの組み合わせが回
路構成上およびメモリの読み出し速度の理由から特に好
ましい。
【０１０９】グループ内のマクロブロック数が２のベキ
乗であると平均ベクトルの計算がシフト操作にて可能に
なり回路的に有利である。２のベキ乗個でない場合には
その数より大きい２のベキ乗で割っても構わない。例え
ば１つのグループが水平８マクロブロック、垂直３マク
ロブロックの時には、１グループあたり２４マクロブロ
ックであるが、平均値計算時に３２で割ってもかまわな
い。このとき、得られる平均ベクトルは正しい平均ベク
トルの４分の３の値になり、探索範囲も４分の３（先の
例のＰピクチャでは３＊３／４＝２.２５倍の範囲）に
なるが、グループ内の不規則な動き等によるベクトルの
影響を小さくする効果があり、実際の符号化時には動き
ベクトルの符号量が少なくなり高い画質が得られる場合
もある。
乗であると平均ベクトルの計算がシフト操作にて可能に
なり回路的に有利である。２のベキ乗個でない場合には
その数より大きい２のベキ乗で割っても構わない。例え
ば１つのグループが水平８マクロブロック、垂直３マク
ロブロックの時には、１グループあたり２４マクロブロ
ックであるが、平均値計算時に３２で割ってもかまわな
い。このとき、得られる平均ベクトルは正しい平均ベク
トルの４分の３の値になり、探索範囲も４分の３（先の
例のＰピクチャでは３＊３／４＝２.２５倍の範囲）に
なるが、グループ内の不規則な動き等によるベクトルの
影響を小さくする効果があり、実際の符号化時には動き
ベクトルの符号量が少なくなり高い画質が得られる場合
もある。
【０１１０】上記の説明ではグループの重複はないと仮
定していたが、グループを重複しても構わない。ただ
し、オフセットとして使用する平均ベクトルをどのグル
ープの平均値を用いるかは定めておかなければならな
い。グループ重複の例としては、例えば同一オフセット
値を用いるグループが水平８マクロブロック、垂直１マ
クロブロック、平均値計算に用いるグループが水平８マ
クロブロック、垂直３マクロブロック（上下１マクロブ
ロック）などがある。このような重複行うことにより、
オフセット値のベクトルの精度が高くなり、符号化の効
率も高まる。なお、平均ベクトル計算時に加重平均を用
いても構わない。上記の重複ブロック例で、上下のマク
ロブロックのベクトルは１／２の重みとして計算しても
構わない。なお、例えば上記の例の重複ブロックの処理
ではメモリ４７０３。４７０５、４７０７の読み出しお
よび加算器４７０２、４７０４、４７０４の処理に３倍
の処理速度が必要になる。
定していたが、グループを重複しても構わない。ただ
し、オフセットとして使用する平均ベクトルをどのグル
ープの平均値を用いるかは定めておかなければならな
い。グループ重複の例としては、例えば同一オフセット
値を用いるグループが水平８マクロブロック、垂直１マ
クロブロック、平均値計算に用いるグループが水平８マ
クロブロック、垂直３マクロブロック（上下１マクロブ
ロック）などがある。このような重複行うことにより、
オフセット値のベクトルの精度が高くなり、符号化の効
率も高まる。なお、平均ベクトル計算時に加重平均を用
いても構わない。上記の重複ブロック例で、上下のマク
ロブロックのベクトルは１／２の重みとして計算しても
構わない。なお、例えば上記の例の重複ブロックの処理
ではメモリ４７０３。４７０５、４７０７の読み出しお
よび加算器４７０２、４７０４、４７０４の処理に３倍
の処理速度が必要になる。
【０１１１】
【発明の効果】本発明によれば、画像の符号化効率をほ
とんど落すことなく回路各所の動作速度の低速化が図れ
るため、小型・低価格の画像符号化装置あるいは画像復
号化装置あるいは画像符号化復号化装置を実現すること
ができる。
とんど落すことなく回路各所の動作速度の低速化が図れ
るため、小型・低価格の画像符号化装置あるいは画像復
号化装置あるいは画像符号化復号化装置を実現すること
ができる。
【図１】従来の符号化装置を説明する図である。
【図２】従来のＭＣ／ＤＣＴ回路の詳細図である。
【図３】動き補償フレーム間予測の動作を説明する図で
ある。
ある。
【図４】従来の画像メモリ、参照画像メモリ、動き検出
回路の詳細図である。
回路の詳細図である。
【図５】図４の動き検出回路の動作タイミングチャート
である。
である。
【図６】従来の動きベクトル検出回路の詳細図である。
【図７】図６の動きベクトル検出回路の動作タイミング
チャートである。
チャートである。
【図８】従来の画像分割処理による画像符号化装置を説
明する図である。
明する図である。
【図９】従来の分割回路の詳細図である。
【図１０】従来の符号統合回路の詳細図である。
【図１１】本発明を適用した画像符号化装置を説明する
図である。
図である。
【図１２】本発明を適用した小符号化回路の詳細図であ
る。
る。
【図１３】本発明を適用した共有メモリ回路の詳細図で
ある。
ある。
【図１４】本発明を適用したメモリ管理回路の詳細図で
ある。
ある。
【図１５】本発明を適用したメモリ管理方式を説明する
図である。
図である。
【図１６】本発明を適用したＭＣ／ＤＣＴ回路の詳細図
である。
である。
【図１７】本発明を適用した画像復号化装置を説明する
図である。
図である。
【図１８】本発明を適用した符号分割回路の詳細図であ
る。
る。
【図１９】本発明を適用した小復号化回路の詳細図であ
る。
る。
【図２０】本発明を適用した画像統合回路の詳細図であ
る。
る。
【図２１】小符号化回路の変形例である。
【図２２】ＭＣ／ＤＣＴ回路の変形例である。
【図２３】図２２のフレームメモリ回路の詳細図であ
る。
る。
【図２４】図２２の動き検出回路の詳細図である。
【図２５】図２４の動きベクトル検出回路の詳細図であ
る。
る。
【図２６】図２５の検出回路の変形例である。
【図２７】図１１の画像符号化装置の変形例である。
【図２８】図２７の小符号化回路の詳細図である。
【図２９】図２８の符号制御回路の詳細図である。
【図３０】本発明を適用した符号量調整回路付きの小符
号化回路の詳細図である。
号化回路の詳細図である。
【図３１】符号量調整回路付きの小符号化回路の変形例
である。
である。
【図３２】図３０の符号量調整回路の詳細図である。
【図３３】図２３、２４のフレームメモリ回路及び動き
検出回路の変形例である。
検出回路の変形例である。
【図３４】図３３のフレームメモリ回路及び動き検出回
路の動作タイミングチャートである。
路の動作タイミングチャートである。
【図３５】図２２中の動き補償回路の詳細図である。
【図３６】図３５の動き補償回路の動作を説明する図で
ある。
ある。
【図３７】図３５の半画素回路の詳細図である。
【図３８】本発明を適用した符号量制御回路を備えた小
符号化回路を説明する図である。
符号化回路を説明する図である。
【図３９】図３８の符号量制御回路を備えた小符号化回
路の変形例である。
路の変形例である。
【図４０】図１１の共有メモリ回路の変形例を説明する
図である。
図である。
【図４１】図１１の共有メモリ回路の第２の変形例を説
明する図である。
明する図である。
【図４２】予測画像生成の簡略化法を説明する図であ
る。
る。
【図４３】本発明を適用した画像符号化復号化装置を説
明する図である。
明する図である。
【図４４】図１１の符号化装置の変形例である。
【図４５】図４４の小符号化回路の詳細図である。
【図４６】図４５の小共有メモリの詳細図である。
【図４７】図２５の動きベクトル検出回路の変形例であ
る。
る。
【図４８】図４７の動きベクトル検出の動作を説明する
図である。
図である。
２…入力画像、４…ＭＣ／ＤＣＴ回路、５…可変長符号
化回路、７…符号、８００…画像符号化装置、８０１…
画像分割回路、８０３…符号統合回路、１１０１…小符
号化回路、１１０２…共有メモリ回路、１７００…画像
復号化装置、１７０１…符号分割回路、１７０２…小画
像復号化回路、１７０３…画像合成回路、２２０１…フ
レームメモリ回路、２２０２…動き補償回路、２４０１
…動きベクトル検出回路、２８０１…符号制御回路、３
００１…符号調整回路、３８０１…符号量制御メモリ、
４３００…符号化復号化装置、４３０１…画像／符号分
割回路、４３０２…小符号化復号化回路、４３０３…画
像／符号合成回路。
化回路、７…符号、８００…画像符号化装置、８０１…
画像分割回路、８０３…符号統合回路、１１０１…小符
号化回路、１１０２…共有メモリ回路、１７００…画像
復号化装置、１７０１…符号分割回路、１７０２…小画
像復号化回路、１７０３…画像合成回路、２２０１…フ
レームメモリ回路、２２０２…動き補償回路、２４０１
…動きベクトル検出回路、２８０１…符号制御回路、３
００１…符号調整回路、３８０１…符号量制御メモリ、
４３００…符号化復号化装置、４３０１…画像／符号分
割回路、４３０２…小符号化復号化回路、４３０３…画
像／符号合成回路。
Claims (8)
- 【請求項１】入力画像を複数のブロックに分割し、既に
符号化された信号から再生した画像を用いて分割された
該ブロックの予測画像を生成し、該入力画像と該予測画
像の差分画像を生成し、該差分画像を符号化する画像符
号化装置において、入力画像を互いに隣接する領域どお
しが重なる領域を有する複数個（N個）の小画像に分割
する手段、分割された各小画像に対し先の予測画像生
成、符号化処理および画像の再生を実行するN個の符号
化処理部、各符号化処理部にて再生した画像を関連する
符号化処理部に配送する共有情報処理部、各符号化処理
部にて生成された符号列をN個以下の符号化列に変換す
る符号合成部を具備することを特徴とする画像符号化装
置。 - 【請求項２】請求項１に記載の画像符号化装置におい
て、１つの符号化処理部において生成された符号量を他
の符号化処理部に通知する手段、他の符号化処理部より
通知された符号量に応じて自らの発生する符号量を制御
する手段を具備することを特徴とする画像符号化装置。 - 【請求項３】インターレース走査構造を持つ画像を入力
画像とし、予測画像生成方法としてフィールド単位に動
き補償した予測画像とフレーム単位に動き補償した予測
画像とを切り替える方法を持つ請求項１に記載の画像符
号化装置において、フィールド単位に検出した動き補償
ベクトルからフレーム単位の動きベクトルを生成する手
段を具備することを特徴とする画像符号化装置。 - 【請求項４】請求項１に記載の画像符号化装置におい
て、２つの時刻とその時刻の間に発生する符号量を入力
する手段、指定された時間の間に発生した符号量を計測
する手段、該計測手段により計測された符号量が指定さ
れた符号量に一致しないときは符号量を増加あるいは削
減手段を具備することを特徴とする画像符号化装置。 - 【請求項５】請求項１に記載の画像符号化装置におい
て、画面内の重み係数を入力する手段、該重み係数度に
応じて符号量の画面内での配分を設定する手段、設定さ
れた符号量になるように発生符号量を制御する手段を具
備することを特徴とする画像符号化装置。 - 【請求項６】入力された符号を解読し、差分画像を生成
し、該入力符号にて別途指定された情報により既に復号
された画像から予測画像生成し、該差分画像と該予測画
像を加算して新たな復号画像を生成する画像復号化装置
において、入力符号を復号化したときの画像が互いに隣
接する領域と重なる領域を有する複数個（M個）の符号
に分割する手段、分割された符号に対し先の予測画像生
成および復号化化処理を実行するM個の復号化処理部、
各復号化処理部にて復号した画像を関連する復号化処理
部に配送する共有復号情報処理部、各復号化処理部にて
復号された画像を１つの画像に合成する画像合成部を具
備することを特徴とする画像復号化装置。 - 【請求項７】請求項６に記載の画像復号化装置におい
て、復号化処理の進捗量を算出する手段、得られた進捗
量と基準となる進捗量を比較する手段、進捗量が基準に
満たないときに処理を簡略化させる手段を具備すること
を特徴とする画像復号化装置。 - 【請求項８】請求項１および請求項６において画像の分
割数と符号の分割数を同じにし、それぞれの符号化処理
部、復号化処理部の機能を化ね備える処理手段を具備す
ることを特徴とする画像符号化復号化装置。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6170699A JPH0837662A (ja) | 1994-07-22 | 1994-07-22 | 画像符号化復号化装置 |
| US08/504,661 US5701160A (en) | 1994-07-22 | 1995-07-20 | Image encoding and decoding apparatus |
| CN95108968.4A CN1224271C (zh) | 1994-07-22 | 1995-07-21 | 图像编码译码装置 |
| CNB02101549XA CN100466744C (zh) | 1994-07-22 | 1995-07-21 | 帧间预测编码、译码装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6170699A JPH0837662A (ja) | 1994-07-22 | 1994-07-22 | 画像符号化復号化装置 |
Related Child Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2004177746A Division JP2004320804A (ja) | 2004-06-16 | 2004-06-16 | 可変長復号化回路及び方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0837662A true JPH0837662A (ja) | 1996-02-06 |
Family
ID=15909765
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP6170699A Pending JPH0837662A (ja) | 1994-07-22 | 1994-07-22 | 画像符号化復号化装置 |
Country Status (3)
| Country | Link |
|---|---|
| US (1) | US5701160A (ja) |
| JP (1) | JPH0837662A (ja) |
| CN (2) | CN100466744C (ja) |
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| CN104660976A (zh) * | 2013-11-19 | 2015-05-27 | 横河电机株式会社 | 缓慢变化检测系统 |
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|---|---|---|---|---|
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