JP4526836B2 - Card recognition system and new card recognition method - Google Patents

Card recognition system and new card recognition method Download PDF

Info

Publication number
JP4526836B2
JP4526836B2 JP2004056362A JP2004056362A JP4526836B2 JP 4526836 B2 JP4526836 B2 JP 4526836B2 JP 2004056362 A JP2004056362 A JP 2004056362A JP 2004056362 A JP2004056362 A JP 2004056362A JP 4526836 B2 JP4526836 B2 JP 4526836B2
Authority
JP
Japan
Prior art keywords
card
new
signal
new card
voltage
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Fee Related
Application number
JP2004056362A
Other languages
Japanese (ja)
Other versions
JP2004318835A (en
Inventor
斉 山本
和仁 秋山
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Ricoh Co Ltd
Original Assignee
Ricoh Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Ricoh Co Ltd filed Critical Ricoh Co Ltd
Priority to JP2004056362A priority Critical patent/JP4526836B2/en
Priority to US10/816,063 priority patent/US7363413B2/en
Priority to TW093108881A priority patent/TWI252401B/en
Priority to CNB2004100387487A priority patent/CN100409209C/en
Publication of JP2004318835A publication Critical patent/JP2004318835A/en
Priority to US12/072,593 priority patent/US7519756B2/en
Application granted granted Critical
Publication of JP4526836B2 publication Critical patent/JP4526836B2/en
Anticipated expiration legal-status Critical
Expired - Fee Related legal-status Critical Current

Links

Images

Description

本発明は、PCMCIAに準拠するPCカード及び新カードを認識するPCカード制御装置及びPCカード制御方法に関する。   The present invention relates to a PC card compliant with PCMCIA and a PC card control device and a PC card control method for recognizing a new card.

従来より、ノート型パソコン等の携帯型の情報端末に実装され、PCMCIAに準拠するPCカード制御装置が備えられている。当該PCカード制御装置は、名刺サイズのPCカードを取り扱うものであったが、近年、上記携帯型の情報端末の一層の小型化が進んだことから、PCカードよりも小型で、効率の良いバス形式(USB2.0、及び、PCIexpress等)を採用した新カードを用いる新カード制御装置が提案されている。   2. Description of the Related Art Conventionally, a PC card control device that is mounted on a portable information terminal such as a notebook personal computer and conforms to PCMCIA is provided. The PC card control device handles a business card size PC card. However, since the portable information terminal has been further miniaturized in recent years, it is smaller and more efficient than a PC card. A new card control device using a new card adopting a format (USB 2.0, PCI express, etc.) has been proposed.

しかし、PCカード制御装置の普及が進んだ現在、現行のPCカードが上記小型の新カードに完全に切り換わるには、ある程度の期間が必要であり、それまでの間は両タイプのカードが並存することになる。そこで、上記期間中は、PCカード及び新カード、両方のカードの使用を可能にするシステムが必要になる。   However, with the spread of PC card control devices, it takes a certain period of time for the current PC card to completely switch to the above-mentioned small new card. Until then, both types of cards coexist. Will do. Therefore, a system that enables use of both the PC card and the new card during the above period is required.

上記システムの実施形態としては、従来のPCカードの制御装置とは別に、新たに新カードの制御装置を追加する形態(以下、第1のケースという)、上記新カードの認識システムを追加する代わりに、新カードをPCカードに完全に変換する機能を備えたPCMCIAアクティブカードアダプタを利用する形態(以下、第2のケースという)、そして、新カードの信号ピンを対応するPCカードの信号ピンの配列に変換するPCMCIAパッシブカードアダプタと、システム内部において新カードの接続を認識し、新カード用のコントローラに接続する制御装置を用意する形態(以下、第3のケースという)の合計3つの形態が考えられる。   As an embodiment of the above system, in addition to the conventional PC card control device, a new card control device is added (hereinafter referred to as a first case), and the new card recognition system is added instead. In addition, a form using a PCMCIA active card adapter having a function of completely converting a new card into a PC card (hereinafter referred to as a second case), and an arrangement of signal pins of the corresponding PC card corresponding to the signal pins of the new card PCMCIA passive card adapter that converts to a card and a controller that recognizes the connection of the new card inside the system and connects to the controller for the new card (hereinafter referred to as a third case) are considered in total. .

上記第1のケースの場合、情報端末にカード用のコネクタを2つ備えることになり、カード認識システムの小型化が図りにくい。上記第2のケースの場合、使用者は、新カードの他に、高価で、大きく重いアクティブカードアダプタを携帯する必要が生じ、利用の便が悪い。そこで、以下、新カードの利用に際し、信号線の配線変換だけを行う小型軽量なパッシブカードアダプタを用いる第3のケースについて考察する。   In the case of the first case, two card connectors are provided in the information terminal, and it is difficult to reduce the size of the card recognition system. In the case of the second case, it is necessary for the user to carry an expensive, large and heavy active card adapter in addition to the new card. Therefore, in the following, a third case in which a small and lightweight passive card adapter that performs only signal line wiring conversion when using a new card will be considered.

図12は、PCMCIAに準拠するパッシブカードアダプタ201を利用して、新カード2を認識するPCカード制御装置50を備えるコンピュータシステム200を示す図である。当該コンピュータシステム200は、中央演算処理装置やメモリを実装したチップセット(マザーボードともいう)6の図示しないPCIバス・カード用のソケットに、PCカードコネクタ5を備えるPCカード制御装置50の拡張ボードを接続したものである。   FIG. 12 is a diagram showing a computer system 200 including a PC card control device 50 that recognizes the new card 2 by using a passive card adapter 201 compliant with PCMCIA. The computer system 200 includes an expansion board of a PC card control device 50 including a PC card connector 5 in a PCI bus card socket (not shown) of a chip set (also referred to as a mother board) 6 on which a central processing unit and a memory are mounted. Connected.

パッシブカードアダプタ201は、新カード2用のコネクタ3と、コンピュータ本体側に備えるPCカード(図12には、示されていない)用のコネクタ5への挿し込み口6とを備え、新カード2の信号ピンの配列をPCカードの信号ピンの配列に変換する。   The passive card adapter 201 includes a connector 3 for the new card 2 and an insertion port 6 to a connector 5 for a PC card (not shown in FIG. 12) provided on the computer main body side. The signal pin array is converted into a PC card signal pin array.

PCカード制御装置50は、カード検出部51、マルチプレクサ(図中、MUXと記す)53、当該マルチプレクサ53にPCカード・バスb1を介して接続されるPCMCIAコントローラ54、上記マルチプレクサ53にUSBバスb2を介して接続されるUSBホストコントローラ55、及び、カード検出部51とマルチプレクサ53に対応する信号線の接続されたPCカード用のコネクタ5とで構成される。上記USBコントローラ55は、USBバスb2に流れるデータをPCIバスのデータ形式に変換するものである。   The PC card controller 50 includes a card detection unit 51, a multiplexer (denoted as MUX in the figure) 53, a PCMCIA controller 54 connected to the multiplexer 53 via a PC card bus b1, and a USB bus b2 to the multiplexer 53. And a USB host controller 55 connected via a PC card connector 51 and a PC card connector 5 to which signal lines corresponding to the card detector 51 and the multiplexer 53 are connected. The USB controller 55 converts data flowing through the USB bus b2 into a PCI bus data format.

図示するように、チップセット6にUSBホストコントローラ6aが内蔵されているにもかかわらず、PCカード制御装置50内にUSBホストコントローラ55を設けてあるのは、PCカード制御装置50が、PCIバスb3を介してチップセット6に接続されており、新カードのデータ形式をPCIバス形式に一旦変換する必要があるためである。   As shown in the figure, the USB host controller 55 is provided in the PC card control device 50 even though the USB host controller 6a is built in the chip set 6 because the PC card control device 50 is connected to the PCI bus. This is because it is connected to the chip set 6 via b3 and it is necessary to once convert the data format of the new card to the PCI bus format.

カード検出部51は、コネクタ5に挿し込まれたカードがPCカードであるのか、又は、パッシブカードアダプタ201を利用して接続された新カード2であるのかを判別し、PCカードの接続時には、PCカード・バスb1を選択してコネクタ2とPCMCIAコントローラ54を接続し、新カード2の接続時には、USBバスb2を選択してコネクタ2とUSBホストコントローラ55とを接続する。   The card detection unit 51 determines whether the card inserted into the connector 5 is a PC card or a new card 2 connected using the passive card adapter 201. When the PC card is connected, The card bus b1 is selected to connect the connector 2 and the PCMCIA controller 54. When the new card 2 is connected, the USB bus b2 is selected to connect the connector 2 and the USB host controller 55.

上記PCカード制御装置50は、各コンピュータが、新カードのシステムに完全に移行するまでの過渡期に使用されるものである。このため、PCカード制御装置50の製品化にあたっては、より簡単な構成で、かつ、従来のPCカード制御装置を制御する上位のホスト(チップセット6に搭載されている中央演算処理装置)においても制御プログラムを変更することなく実施でき、更には、上記過渡期に使用されるものであっても別の新しい拡張カードが開発された場合には、上記新しいカードにも柔軟に対応できる拡張性を持つのが好ましい。   The PC card control apparatus 50 is used in a transition period until each computer completely shifts to a new card system. For this reason, when commercializing the PC card control device 50, the host computer (the central processing unit mounted on the chip set 6) having a simpler configuration and controlling the conventional PC card control device is also used. It can be implemented without changing the control program. Furthermore, when another new expansion card is developed even if it is used in the transition period, it can be expanded flexibly to support the new card. It is preferable to have.

パソコン側のPCIバスと、PCカード側のPCカードバスとの間を仲介するためのPCカード制御装置を扱ったものとして以下の特許文献1がある。
特開2000−259510号公報、「バス・ブリッジ回路、情報処理システム、及びカードバス・コントローラ」(請求項1、図6)
The following Patent Document 1 deals with a PC card control device for mediating between a PCI bus on the personal computer side and a PC card bus on the PC card side.
Japanese Patent Laid-Open No. 2000-259510, “Bus / Bridge Circuit, Information Processing System, and Card Bus Controller” (Claim 1, FIG. 6)

上記特許文献1には、ユーザーが直接的にアクセス不能な1次側(PCI)バスと、ユーザーが直接アクセス可能な2次側(PCMCIA)バスとの間に接続されるバスブリッジ(PCカード制御装置)に対して「パススルー」という特別なモードを実現して、そのバスブリッシを経由することなく、1次側バス上のトランザクションを非破壊的に検査できるシステムが開示されている。   Patent Document 1 discloses a bus bridge (PC card control device) connected between a primary side (PCI) bus that is not directly accessible by the user and a secondary side (PCMCIA) bus that is directly accessible by the user. ), A special mode called “pass-through” is realized and a transaction on the primary side bus can be inspected non-destructively without going through the bus bridge.

また、本願出願人により、チップセット6に搭載する中央演算処理装置によるソフトウェア処理、及び、専用に設けたハードウェア回路による処理によって、PCカードと、PCMCIAに準拠していない新カードの両方を認識するシステムが提案されている(特願2002−269935号)。   The applicant of the present application recognizes both a PC card and a new card that does not comply with PCMCIA through software processing by the central processing unit mounted on the chipset 6 and processing by a dedicated hardware circuit. Has been proposed (Japanese Patent Application No. 2002-269935).

図12に示すPCカード制御装置50は、PCカードのみを制御する装置に比べて、マルチプレクサ53だけでなく、USBバス形式のデータをPCIバスの形式に変換するUSBホストコントローラ55が追加されるため、回路が大型化し、かつ、複雑化する。   Compared to a device that controls only a PC card, the PC card control device 50 shown in FIG. 12 includes not only the multiplexer 53 but also a USB host controller 55 that converts USB bus format data into a PCI bus format. The circuit becomes larger and more complicated.

PCカードへの給電は、チップセット6に搭載されているホスト(CPU)側からのソフトウエアによる制御によって行われる。現行のPCMCIAカード1は、5v又は3.3vで駆動するものであるが、新カード2は、1.5vでも駆動される事が決まっている。このため、駆動電力の異なる新カード3に対応するには、新たな電源と当該電源を制御する制御プログラムが必要になる。   Power is supplied to the PC card by software control from the host (CPU) side mounted on the chip set 6. The current PCMCIA card 1 is driven at 5v or 3.3v, but the new card 2 is determined to be driven at 1.5v. Therefore, a new power source and a control program for controlling the power source are required to support the new card 3 with different driving power.

また、上記PCカード制御装置50では、PCカード・バスb1及びUSBバスb2の切り換えを行うのにマルチプレクサ(MUX)53を用いるが、動作信号の振幅が小さい新規格のバスであるUSB2.0の場合には、使用できないという問題を有する。   In the PC card control device 50, the multiplexer (MUX) 53 is used to switch between the PC card bus b1 and the USB bus b2. However, a new standard bus with a small operating signal amplitude is used for the USB 2.0. In some cases, it has a problem that it cannot be used.

本発明は、上述した課題を解決するためになされたものであり、より簡単な構成でUSB2.0やPCIexpress等の新規格のバスに対応した新カードに容易に対応できるPCカード制御装置及びPCカード制御方法を提供することを目的とする。   The present invention has been made to solve the above-described problems, and a PC card control device and a PC that can easily correspond to a new card compatible with a new standard bus such as USB 2.0 and PCI express with a simpler configuration. An object is to provide a card control method.

請求項1に記載のカード認識システムは、コネクタ(5)に接続されたカードの種類を認識し、認識したカード用の電圧を出力するPCカード制御装置(11)と、PWRGD信号の入力に応じて使用可能状態になる新カードであって、上記PCカード制御装置が出力できる電圧以外の電圧を用いる新カード(2)を、上記PCカード制御装置に接続するために、上記コネクタに着脱可能に取り付けられているパッシブカードアダプタ(1)と、を備えているカード認識システムであって、上記PCカード制御装置が、PCカード検出部(52)と、配線切換回路と、電源切換部(60)・第1パワースイッチ(62)と、を備えており、上記PCカード検出部が、新カードがパッシブカードアダプタに接続されたことを検出し、新カード検出信号を出力するものであり、上記配線切換回路が、新カード検出信号の入力に応じて、新カード用のバスに新カードを接続するように切り換えるスイッチ回路であり、上記電源切換部・第1パワースイッチが、新カード検出信号の入力に応じて、コネクタへと供給する電圧を、新カード以外のカード用の電圧から第1電圧へとスイッチ切換して出力するものであり、上記パッシブカードアダプタが、レギュレータ(63)と、第2パワースイッチ(64)と、パワーオンリセット(65)と、を備えており、上記レギュレータが、電源切換部・第1パワースイッチからの第1電圧とは別に、該第1電圧を新カードで用いる第2電圧に変換して新カードへと出力するものであり、上記第2パワースイッチが、カウンタ(64c)と、トランジスタスイッチ(64a、64b)と、を備えており、上記トランジスタスイッチが、PCカード制御装置から供給される第1電圧と、レギュレータから出力される新カード用の第2電圧と、の新カードへの供給を行うように、アダプタに新カードが接続された場合に切り換わる第2信号(PE2#)の入力に応じてオンに切り換わるものであり、上記カウンタが、上記第2信号(PE2#)の入力に応じてカウントを開始するものであり、且つ、予め定めたカウント値をカウントした場合に、上記PWRGD信号を新カードに出力するものであり、上記パワーオンリセットが、電源切換部・第1パワースイッチからの第1電圧の給電開始に応じて、カウンタにリセット信号を出力するものである、ことを特徴とする The card recognition system according to claim 1 recognizes the type of the card connected to the connector (5) and outputs a voltage for the recognized card according to the input of the PWRGD signal. A new card (2) that is ready to be used and uses a voltage other than the voltage that can be output by the PC card control device, so that it can be attached to and detached from the connector in order to connect to the PC card control device. A card recognition system comprising an attached passive card adapter (1), wherein the PC card control device comprises a PC card detection unit (52), a wiring switching circuit, a power switching unit (60), A first power switch (62), and the PC card detection unit detects that a new card is connected to the passive card adapter, and detects a new card. A switch circuit for switching the wiring switching circuit so as to connect the new card to the bus for the new card in response to the input of the new card detection signal. The power switch switches and outputs the voltage supplied to the connector from the voltage for the card other than the new card to the first voltage in response to the input of the new card detection signal. , A regulator (63), a second power switch (64), and a power-on reset (65), wherein the regulator is separate from the first voltage from the power supply switching unit / first power switch, The first voltage is converted into a second voltage used in the new card and output to the new card. The second power switch includes a counter (64c) and a transistor. To the new card of the first voltage supplied from the PC card control device and the second voltage for the new card output from the regulator. In response to an input of a second signal (PE2 #) that is switched when a new card is connected to the adapter, the counter is switched on, and the counter is configured to output the second signal (PE2 #). ) And the PWRGD signal is output to the new card when a predetermined count value is counted. A reset signal is output to the counter in response to the start of feeding of the first voltage from the first power switch .

請求項2に記載のカード認識システムは、請求項1に記載のカード認識システムであって、電源切換部・第1パワースイッチが、電源切換部(60)と、第1パワースイッチ(62)と、を備えており、上記電源切換部が、新カード検出信号の入力に応じて電源コントロール信号を出力し、上記第1パワースイッチが、電源コントロール信号に基づいて出力する電圧を切り換えるものであり、第1パワースイッチが、PCカード制御装置の外部に設けられている、ことを特徴とする。 A card recognition system according to a second aspect is the card recognition system according to the first aspect, wherein the power supply switching unit / first power switch includes a power supply switching unit (60), a first power switch (62), and The power switching unit outputs a power control signal in response to an input of a new card detection signal, and the first power switch switches a voltage to be output based on the power control signal. The first power switch is provided outside the PC card control device .

請求項3に記載のカード認識システムは、請求項1又は2に記載のカード認識システムであって、上記PCカード制御装置が、PCMCIAに準拠する装置である、ことを特徴とする。 A card recognition system according to a third aspect is the card recognition system according to the first or second aspect, wherein the PC card control device is a device compliant with PCMCIA .

請求項4に記載のカード認識システムは、請求項3に記載のシステムであって、上記PCカード制御装置が、PCMCIAコントローラ(54)を備えており、上記配線切換回路が、I/O回路(56a、56b)と、アナログスイッチ(57a、57b)と、を備えており、上記カード検出部が、PCカード認識部(52a)と、比較器(52b)と、レジスタ(52c)と、を備えており、上記PCカード認識部が、PCMCIAの規格に準拠したカードNo.テーブルを内蔵しており、PCMCIAに準拠した手順に従い接続されたカードの種類を表すカードNo.を特定するものであり、上記レジスタが、新カードのカードNo.を格納しており、上記比較器が、PCカード認識部によって特定されたカードNo.と、レジスタに格納されているカードNo.との比較を行い、一致する場合に新カード検出信号を出力するものであり、上記I/O回路がコネクタとPCMCIAコントローラとを接続しており、アナログスイッチがコネクタと新カード用バスとを接続しており、I/O回路とアナログスイッチとが、新カードの非検出時には、コネクタをPCMCIAコントローラとの間のみを接続し、新カード検出信号の入力時には、コネクタと新カード用バスとの間のみを接続する、ことを特徴とする。 A card recognition system according to a fourth aspect is the system according to the third aspect, wherein the PC card control device includes a PCMCIA controller (54), and the wiring switching circuit includes an I / O circuit ( 56a, 56b) and analog switches (57a, 57b), and the card detection unit includes a PC card recognition unit (52a), a comparator (52b), and a register (52c). The PC card recognition unit has a built-in card number table that conforms to the PCMCIA standard, and identifies the card number that indicates the type of card connected according to the procedure conforming to the PCMCIA. The register stores the card number of the new card, and the comparator stores the card number specified by the PC card recognition unit and the register. The card No. is compared and a new card detection signal is output if they match, the I / O circuit connects the connector and the PCMCIA controller, and the analog switch is for the connector and the new card. When the new card is not detected, the connector is connected only to the PCMCIA controller when the new card detection signal is input. It is characterized by connecting only to the bus .

請求項5に記載のカード認識システムは、請求項4に記載のカード認識システムであって、上記新カード検出信号が、Highレベルの信号であり、上記I/O回路が、2入力ANDゲート(56a−1)と、3ステートバッファ(56a−2)と、インバータ(56a−3)と、を備えており、上記2入力ANDゲートの一方の信号入力端子には、コネクタからのデータが入力され、残りの信号入力端子には、インバータを介して上記カード検出部が出力する信号が入力されており、出力端子がPCMCIAコントローラに接続されており、3ステートバッファが、PCMCIAコントローラからのデータをコネクタに出力するものであり、インバータによって反転された新カード検出信号の入力に応じてオフに切り換わり、上記アナログスイッチが、互いのソース及びドレインが接続された1対のNチャンネル型MOSFET(57a−1)とPチャンネル型MOSFET(57a−2)と、該Pチャンネル型MOSFETのゲートに検出信号の反転信号を入力するためのインバータ(57a−3)と、を備えており、新カード検出信号の入力に応じてオンに切り換わるものである、ことを特徴とする。 The card recognition system according to claim 5 is the card recognition system according to claim 4, wherein the new card detection signal is a high level signal, and the I / O circuit is a two-input AND gate ( 56a-1), a three-state buffer (56a-2), and an inverter (56a-3). Data from the connector is input to one signal input terminal of the two-input AND gate. The signal output from the card detection unit is input to the remaining signal input terminals via an inverter, the output terminal is connected to the PCMCIA controller, and the data from the PCMCIA controller is connected to the 3-state buffer. In response to the input of the new card detection signal inverted by the inverter, the analog switch is turned off. The switch has a pair of N-channel MOSFET (57a-1) and P-channel MOSFET (57a-2) whose source and drain are connected to each other, and an inverted signal of the detection signal at the gate of the P-channel MOSFET. And an inverter (57a-3) for input, which is turned on in response to an input of a new card detection signal .

請求項6に記載の新カード認識方法は、請求項1乃至5の何れか1つに記載のカード認識システムを用いて行う新カードの認識方法であって、新カードがパッシブカードアダプタに差し込まれたことを、PCカード検出部によって検出して新カード検出信号を出力させる工程と、上記新カード検出信号を配線切換回路に入力して配線をスイッチ切換させて、新カード用のバスに新カードを接続させる工程と、上記新カード検出信号を電源切換部・第1パワースイッチに入力して第1電圧を出力させる工程と、上記第1電圧をパワーオンリセットに入力して第2パワースイッチが備えているカウンタをリセットさせる工程と、第2パワースイッチにおいて、上記リセット後のカウンタのカウントを開始し、予め定めたカウント値をカウントした場合に、PWRGD信号を新カードに出力して新カードを使用可能にする工程と、を備えていることを特徴とする。A new card recognition method according to claim 6 is a new card recognition method performed using the card recognition system according to any one of claims 1 to 5, wherein the new card is inserted into a passive card adapter. This is detected by the PC card detection unit and a new card detection signal is output, and the new card detection signal is input to the wiring switching circuit and the wiring is switched to switch the new card to the bus for the new card. A step of connecting, a step of inputting the new card detection signal to the power switch / first power switch to output a first voltage, and a second power switch for inputting the first voltage to a power-on reset. Resetting the counter, and in the second power switch, the counter after the reset is started and a predetermined count value is counted. The case, characterized in that it comprises a step to enable the new card is output to the new card PWRGD signal.

請求項1乃至5に記載のカード認識システムは、新カード接続時、電源切り換え部・第1パワースイッチによって供給電圧を切り換えると共に、更に、予め定めたカウント値をカウントしてからPWRGD信号を出力することによって、迅速なバスへの接続と、新カードへの安定した給電と、を行うことができる。また、パッシブカードを取り外すことによってPCカード制御装置で用いることのできる従来のカードを使用することができる。 The card recognition system according to any one of claims 1 to 5, wherein when a new card is connected, the supply voltage is switched by the power switching unit / first power switch, and a PWRGD signal is output after counting a predetermined count value. As a result, quick connection to the bus and stable power supply to the new card can be performed. Moreover, the conventional card which can be used with a PC card control apparatus can be used by removing a passive card.

請求項6に記載のカード認識方法は、新カード接続時、新カード用のバスに配線のスイッチ切換を行った後に、PWRGD信号を出力するためのカウントを開始するため、迅速なバスへの接続と、新カードへの安定した給電と、を行うことができる。In the card recognition method according to claim 6, when a new card is connected, after switching the wiring to the bus for the new card, the count for outputting the PWRGD signal is started. And stable power supply to the new card.

(1)実施の形態1
図1は、実施形態1に係るPCカード制御装置11を備えるコンピュータシステム100の構成図である。上記従来技術の欄で説明した図12に示すPCカード制御装置50を備えるコンピュータシステム200およびパッシブカードアダプタ201の構成要素と同じものについては、同じ参照番号を付してある。
(1) Embodiment 1
FIG. 1 is a configuration diagram of a computer system 100 including a PC card control device 11 according to the first embodiment. The same components as those of the computer system 200 and the passive card adapter 201 including the PC card control device 50 shown in FIG.

コンピュータシステム100は、ホストとして機能する中央演算処理装置やメモリを実装したチップセット6が備えるPCIバスb3及びUSBバスb5の拡張ボード用のソケットに、PCカードコネクタ5を備えるPCカード制御装置11の拡張ボードを接続したものである。   The computer system 100 includes a central processing unit that functions as a host and a PC card controller 11 that includes a PC card connector 5 in a socket for an expansion board of a PCI bus b3 and a USB bus b5 provided in a chip set 6 mounted with a memory. An expansion board is connected.

なお、PCカード制御装置11は、1チップのICに集積化しても良い。この場合、装置11自体の小型化の他に、チップセット6に上記拡張用ボードのソケットを用いずに別の小型のIC用ソケットを用いて実装することが可能になり、数の限られた拡張ボード用のソケットの有効利用を図ることができる。   The PC card control device 11 may be integrated on a one-chip IC. In this case, in addition to the miniaturization of the device 11 itself, it is possible to mount the chip set 6 using another small IC socket without using the socket of the expansion board, and the number is limited. Effective use of the socket for the expansion board can be achieved.

PCカード制御装置11は、カード検出部52、PCMCIAコントローラ54、I/O回路56、及び、アナログスイッチ(図中、ASWと記す)57で構成されている。ここで、アナログスイッチとは、メカニカルなリレーと同様の特性を持ち、小振幅で高い周波数の信号、例えば、USB2.0の規格に準拠して用いられる信号を正確に伝播しうるスイッチのことを意味する。カード検出部52は、コネクタ5に接続されたカードが新カード2であるのか否かを表すカード検出信号を、I/O回路56及びアナログスイッチ57に出力する。なお、本図では、カードの種類に応じて供給する電源電圧を切り換える回路(電源切り換え部60、パワースイッチ62,64)については示していない。当該電源の切り換え回路については、後に図4を参照しつつ説明する。   The PC card control device 11 includes a card detection unit 52, a PCMCIA controller 54, an I / O circuit 56, and an analog switch (indicated as ASW in the figure) 57. Here, an analog switch is a switch that has the same characteristics as a mechanical relay and can accurately propagate a signal with a small amplitude and a high frequency, for example, a signal used in conformity with the USB 2.0 standard. means. The card detection unit 52 outputs a card detection signal indicating whether or not the card connected to the connector 5 is the new card 2 to the I / O circuit 56 and the analog switch 57. In the figure, the circuit (power supply switching unit 60, power switches 62 and 64) for switching the power supply voltage to be supplied according to the card type is not shown. The power supply switching circuit will be described later with reference to FIG.

PCMCIAに準拠したパッシブカードアダプタ1は、新カード2用のコネクタ3と、コンピュータ本体側に備えるPCカード用のコネクタ5への挿し込み口1aとを備え、新カード2の信号ピンの配列をPCカードの信号ピンの配列に変換する。   The PCMCIA-compliant passive card adapter 1 includes a connector 3 for a new card 2 and an insertion port 1a into a connector 5 for a PC card provided on the computer main body side, and the signal card array of the new card 2 is changed to a PC card. To an array of signal pins.

カード検出用の信号(CD1#、CD2#、VS1#、VS2#:各信号の表記はPCMCIAに準拠する)を伝送する4本の制御ラインL1の一端は、カード検出部52に接続され、他端は、PCMCIAコネクタ5の内の4つのピンを通じて、当該コネクタ5に挿入されたパッシブカードアダプタ1側の雌のコネクタ1aの内の対応する4つのピン接続穴にそれぞれ電気的に接続されている。   One end of four control lines L1 for transmitting card detection signals (CD1 #, CD2 #, VS1 #, VS2 #: the notation of each signal conforms to PCMCIA) is connected to the card detection unit 52 and others. The ends are electrically connected to the corresponding four pin connection holes in the female connector 1a on the passive card adapter 1 side inserted into the connector 5 through the four pins in the PCMCIA connector 5, respectively.

データラインL2の一端は、コネクタ5を介して、パッシブカードアダプタ1又はPCカードが備える複数のピンに接続され、他端は、PCMCIAバス上のデータを扱うI/O回路56を介してPCMCIAコントローラ54に接続される。また、データラインL2は、途中で分岐してアナログスイッチ57を介してチップセット6よりのUSBバスにも接続されている。   One end of the data line L2 is connected to a plurality of pins of the passive card adapter 1 or the PC card via the connector 5, and the other end is connected to the PCMCIA controller 54 via the I / O circuit 56 that handles data on the PCMCIA bus. Connected to. Further, the data line L2 branches off in the middle and is also connected to the USB bus from the chipset 6 via the analog switch 57.

I/O回路56は、Lowレベルのカード検出信号の入力に応じてイネーブルになる回路であり、より詳しくは、後に参照する図4に示すとおり、2個のI/O回路56a,56bで構成される。   The I / O circuit 56 is a circuit that is enabled in response to the input of a low level card detection signal. More specifically, the I / O circuit 56 includes two I / O circuits 56a and 56b as shown in FIG. Is done.

図2は、I/O回路56aの構成を示す図である。I/O回路56aは、2入力ANDゲート56a−1、3ステートバッファ56a−2、インバータ56a−3、トランジスタ56a−4、及び、抵抗56a−5で構成される。ANDゲート56a−1は、コネクタ5から接続パッド56a−pに印加されるデータをPCMCIAコントローラ54に出力するためのゲートであり、一方の信号入力端子には、上記接続パッド56a−pからの信号が入力され、残りの信号入力端子には、インバータ56a−3を介してカード検出信号が入力されている。3ステートバッファ56a−2は、PCMCIAコントローラ54からのデータを接続パッド56a−pに出力するためのバッファ回路であり、インバータ56a−3により反転されたカード検出信号がHighレベルのときにオンに切り換わる。 FIG. 2 is a diagram showing a configuration of the I / O circuit 56a. The I / O circuit 56a includes a two-input AND gate 56a -1 , a 3-state buffer 56a -2 , an inverter 56a -3 , a transistor 56a -4 , and a resistor 56a -5 . The AND gate 56a -1 is a gate for outputting data applied from the connector 5 to the connection pads 56a -p to the PCMCIA controller 54. One signal input terminal includes the connection pads 56a -p. The card detection signal is input to the remaining signal input terminals via the inverter 56a -3 . The 3-state buffer 56a -2 is a buffer circuit for outputting data from the PCMCIA controller 54 to the connection pads 56a -p . When the card detection signal inverted by the inverter 56a -3 is at a high level, Switch on.

また、アナログスイッチ57は、Highレベルのカード検出信号に応じてオンに切り換わるスイッチであり、後に参照する図4に示す通り2個のアナログスイッチ57a,57bで構成される。   The analog switch 57 is a switch that is turned on in response to a high level card detection signal, and includes two analog switches 57a and 57b as shown in FIG.

図3は、アナログスイッチ57aの構成を示す図である。アナログスイッチ57aは、互いのソース及びドレインが接続された1対のNチャンネル型MOSFET57a−1及びPチャンネル型MOSFET57a−2と、FET57a−2のゲートに検出信号の反転信号を入力するためのインバータ57a−3とで構成される。 FIG. 3 is a diagram showing the configuration of the analog switch 57a. The analog switch 57a inputs a pair of N-channel MOSFET 57a -1 and P-channel MOSFET 57a -2 whose sources and drains are connected to each other and an inverted signal of the detection signal to the gate of the FET 57a -2. Inverter 57a -3 .

再び図1を参照する。カード検出部52は、コネクタ5に接続されたカードの種類を特定し、接続されたカードがPCカードの場合、Lowレベルのカード検出信号を出力し、接続されたカードが新カード2の場合、Highレベルのカード検出信号(新カード検出信号)を出力する。   Refer to FIG. 1 again. The card detection unit 52 identifies the type of the card connected to the connector 5, outputs a low level card detection signal when the connected card is a PC card, and when the connected card is the new card 2, A high level card detection signal (new card detection signal) is output.

PCカードの接続時、I/O回路56は、コネクタ5とPCMCIAコントローラ54の間のデータラインをイネーブルにし、アナログスイッチ57をオフとする。結果として、コネクタ5とPCMCIAコントローラ54を接続するデータラインが形成される。この場合、PCカードより読み出されたデータは、データラインL2、I/O回路56、及び、PCカード・バスb4を介してPCMCIAコントローラ54に出力された後、当該PCMCIAコントローラ54からPCIバスb3を介してチップセット6に出力される。PCIバスb3及びI/O回路56は、双方向のものであり、チップセット6からのデータは、逆のルートでPCカードに出力される。   When the PC card is connected, the I / O circuit 56 enables the data line between the connector 5 and the PCMCIA controller 54 and turns off the analog switch 57. As a result, a data line connecting the connector 5 and the PCMCIA controller 54 is formed. In this case, the data read from the PC card is output to the PCMCIA controller 54 via the data line L2, the I / O circuit 56, and the PC card bus b4, and then from the PCMCIA controller 54 to the PCI bus b3. Is output to the chip set 6 via The PCI bus b3 and the I / O circuit 56 are bidirectional, and data from the chipset 6 is output to the PC card through the reverse route.

他方、新カードの接続時、I/O回路56は、コネクタ5とPCMCIAコントローラ54の間のデータラインをディスイネーブルにし、アナログスイッチ57をオンとする。結果として、コネクタ5とUSBバスb5を接続するデータラインが形成される。即ち、この場合、当該新カード2より読み出されたデータは、データラインL2、アナログスイッチ57、及び、USBバスb5を介して、直接チップセット6が備えるUSBホストコントローラ6aに出力される。USBバスb5及びアナログスイッチ57は、双方向のものであり、チップセット6からのデータは、逆のルートで新カード2に出力される。   On the other hand, when a new card is connected, the I / O circuit 56 disables the data line between the connector 5 and the PCMCIA controller 54 and turns on the analog switch 57. As a result, a data line connecting the connector 5 and the USB bus b5 is formed. That is, in this case, the data read from the new card 2 is directly output to the USB host controller 6a included in the chipset 6 via the data line L2, the analog switch 57, and the USB bus b5. The USB bus b5 and the analog switch 57 are bidirectional, and data from the chipset 6 is output to the new card 2 through the reverse route.

図4は、PCカード制御装置11及びパッシブカードアダプタ1の内部構成をより詳細に示す図である。本図には、図1には示していなかったカードの種類に応じて供給電源を切り換える回路を示してある。また、本図において、リード信号(IORD#)およびライト信号(IOWR#)を伝えるラインは、図1中のデータラインL2に相当する。リード信号(IORD#)の線の一端は、カードアダプタ9内のコネクタ5のUSB_DP(プラス)のピンに接続され、他端は、I/O回路56aの信号入力端に接続される。ライト信号(IOWR#)の線の一端は、カードアダプタ9内のコネクタ5のUSB_DM(マイナス)のピンに接続され、他端は、I/O回路56bの信号入力端に接続されている。   FIG. 4 is a diagram showing the internal configuration of the PC card control device 11 and the passive card adapter 1 in more detail. This figure shows a circuit for switching the power supply in accordance with the type of card not shown in FIG. In this figure, the line for transmitting the read signal (IORD #) and the write signal (IOWR #) corresponds to the data line L2 in FIG. One end of the read signal (IORD #) line is connected to the USB_DP (plus) pin of the connector 5 in the card adapter 9, and the other end is connected to the signal input end of the I / O circuit 56a. One end of the line of the write signal (IOWR #) is connected to the USB_DM (minus) pin of the connector 5 in the card adapter 9, and the other end is connected to the signal input end of the I / O circuit 56b.

カード検出部52は、PCカード識別部52a、比較器52b、及び、レジスタ52cで構成される。   The card detection unit 52 includes a PC card identification unit 52a, a comparator 52b, and a register 52c.

PCカード識別部52aは、PCMCIAの規格に準拠したカードNo.テーブルを内蔵しており、PCMCIAに準拠した手順に従い接続されたカードの種類(バス幅、駆動電圧等)を表すカードNo.を特定する。PCMCIAの規格に準拠したPCカード識別部52aは、ソフトウェア処理を利用する物、及び、ハードウェア回路だけで構成される物が既に種々提案されている(例えば、本願出願人による特願2002−269935を参照)。比較器52bは、PCカード識別部52aにより特定されたカードNo.と、レジスタ52cに格納している新カードのカードNo.との比較を行い、一致する場合には、Highレベルの新カード検出信号を出力する。   The PC card identification unit 52a has a card number compliant with the PCMCIA standard. A card number indicating a type of a card (bus width, drive voltage, etc.) connected in accordance with a procedure conforming to PCMCIA. Is identified. As the PC card identification unit 52a compliant with the PCMCIA standard, various types of products that use software processing and those composed only of hardware circuits have already been proposed (for example, Japanese Patent Application No. 2002-269935 by the applicant of the present application). See). The comparator 52b is a card No. identified by the PC card identification unit 52a. And the card number of the new card stored in the register 52c. If they match, a high level new card detection signal is output.

PCカード及びカードアダプタ1内において、上記4つのピン接続穴は、カードの種類、即ち、PCカードであるのか新カード2であるのかの別、PCカードである場合には駆動電圧等の別に、任意の二つのピン接続穴が相互に接続され、そして、任意の1つのピン接続穴が接地されるなどして、それぞれ固有の接続がなされている。   In the PC card and card adapter 1, the four pin connection holes are optional depending on the type of card, that is, whether it is a PC card or a new card 2, or in the case of a PC card, depending on the drive voltage, etc. The two pin connection holes are connected to each other, and any one pin connection hole is grounded.

以下、PCMCIAの規格に準拠したPCカード識別部52aが実行する処理内容を、より詳しく説明する。PCカード識別部52aは、コネクタ5へのカード接続に伴うカード検出用の信号のCD1#及びCD2#の電位レベルの変化よりカードの接続を検出し、VS1#の電位を約1msの期間、Highレベルに切り換える。そして、上記VS1#の電位切り換えの後、約0.8msのタイミングでCD2#、CD1#、VS2#及び、VS1#の電位状態をラッチ(レジスタに保存)する。引き続き、PCカード識別部52aは、VS2#の電位を約1msの期間、Highレベルに切り換える。VS2#の電位切り換え後、約0.8msのタイミングでCD2#、CD1#、VS2#、及び、VS1#の電位状態をラッチ(レジスタに保存)する。PCカード識別部52aは、PCMCIAに準拠したカードNo.テーブルを参照しつつ、上記2つのタイミングでラッチした各4ビット、合計8ビットの信号の組み合わせに該当するカードNo.を特定し、特定したカードNo.の情報を、比較器52a及びホストに向けて出力する。   Hereinafter, the processing content executed by the PC card identification unit 52a compliant with the PCMCIA standard will be described in more detail. The PC card identification unit 52a detects the connection of the card based on the change in the potential level of the CD1 # and CD2 # of the card detection signal accompanying the card connection to the connector 5, and sets the potential of VS1 # to High for a period of about 1 ms. Switch to level. Then, after switching the potential of VS1 #, the potential states of CD2 #, CD1 #, VS2 #, and VS1 # are latched (stored in a register) at a timing of about 0.8 ms. Subsequently, the PC card identification unit 52a switches the potential of VS2 # to the high level for a period of about 1 ms. After switching the potential of VS2 #, the potential states of CD2 #, CD1 #, VS2 #, and VS1 # are latched (stored in a register) at a timing of about 0.8 ms. The PC card identification unit 52a has a card number compliant with PCMCIA. Referring to the table, the card No. corresponding to the combination of signals of 4 bits each latched at the above two timings and a total of 8 bits. And the identified card No. Is output to the comparator 52a and the host.

カード検出部52から出力される信号がHighレベルの場合、I/O回路56a,56bがディスイネーブルとなり、アナログスイッチ57a,57bがオンに切り換わり、コネクタ5とUSBバスb5を接続する。他方、カード検出部52から出力される信号がLowレベルの場合、I/O回路56a,56bがイネーブル、アナログスイッチ57a,57bがオフとなり、コネクタ5とPCMCIAコントローラ54を接続する。   When the signal output from the card detection unit 52 is at a high level, the I / O circuits 56a and 56b are disabled, the analog switches 57a and 57b are turned on, and the connector 5 and the USB bus b5 are connected. On the other hand, when the signal output from the card detection unit 52 is at the low level, the I / O circuits 56a and 56b are enabled, the analog switches 57a and 57b are turned off, and the connector 5 and the PCMCIA controller 54 are connected.

上述するように、実施の形態1に係るPCカード制御装置11は、図12に示した従来のPCカード制御装置51が備えていたマルチプレクサ53及びUSBホストコントローラ55の代わりに、I/O回路56a,56b及びアナログスイッチ57a,57bを設けたものである。USBホストコントローラ55を除去することにより、回路規模の小型化及び低コスト化を図ることができる。また、しきい値の高いトランジスタで構成されるマルチプレクサを利用せずに、図2に示した構成のアナログスイッチ57a,57bを用いることで、USB2.0に準拠するバスに流れる±0.4Vといった振幅レベルの小さい信号にも十分に対処することができる。   As described above, the PC card control device 11 according to the first embodiment is different from the multiplexer 53 and the USB host controller 55 provided in the conventional PC card control device 51 shown in FIG. , 56b and analog switches 57a, 57b are provided. By removing the USB host controller 55, the circuit scale can be reduced and the cost can be reduced. Further, by using the analog switches 57a and 57b having the configuration shown in FIG. 2 without using a multiplexer configured with a transistor having a high threshold, ± 0.4V flowing through a bus compliant with USB 2.0. A signal with a small amplitude level can be sufficiently dealt with.

電源切り換え部60は、2ビットデータを保持するレジスタ60a,60b、ORゲート61b、及び、ANDゲート61aで構成される。レジスタ60a,60bは、チップセット6(ホスト)より送り返されてくるレジスタ選択信号に基づいて、共にHighレベルのVcc3.3EN#信号及びVcc5EN#信号、HighレベルのVcc3.3EN#信号とLowレベルのVcc5EN#信号、又は、LowレベルのVcc3.3EN#信号とHighレベルのVcc5EN#信号の何れかの組み合わせの電源コントロール信号を出力する。   The power supply switching unit 60 includes registers 60a and 60b that hold 2-bit data, an OR gate 61b, and an AND gate 61a. The registers 60a and 60b are both high-level Vcc3.3EN # signal and Vcc5EN # signal, high-level Vcc3.3EN # signal and low-level signal based on the register selection signal sent back from the chipset 6 (host). A power supply control signal of any combination of a Vcc5EN # signal or a combination of a Low level Vcc3.3EN # signal and a High level Vcc5EN # signal is output.

2入力ORゲート61bは、一方の信号入力端子にレジスタ60aの出力が入力され、他方の信号入力端子にカード検出部52の出力するカード検出信号が入力される。2入力ANDゲート61aは、一方の信号入力端子にレジスタ60bの出力が入力され、他方の信号入力端子にカード検出部52の出力するカード検出信号の反転信号が入力される。   In the 2-input OR gate 61b, the output of the register 60a is input to one signal input terminal, and the card detection signal output from the card detection unit 52 is input to the other signal input terminal. In the 2-input AND gate 61a, the output of the register 60b is input to one signal input terminal, and the inverted signal of the card detection signal output from the card detection unit 52 is input to the other signal input terminal.

カード検出信号がHighレベルの場合、ANDゲート61aはLowレベルのVcc3.3EN#信号を出力し、ORゲート61bはHighレベルのVcc5EN#信号を出力する。他方、カード検出信号がLowレベルの場合、ANDゲート61aからはレジスタ60bの出力がVcc3.3EN#信号として出力され、ORゲート61bからはレジスタ60aの出力がVcc5EN#信号として出力される。   When the card detection signal is at a high level, the AND gate 61a outputs a low-level Vcc3.3EN # signal, and the OR gate 61b outputs a high-level Vcc5EN # signal. On the other hand, when the card detection signal is at the Low level, the output of the register 60b is output as the Vcc3.3EN # signal from the AND gate 61a, and the output of the register 60a is output as the Vcc5EN # signal from the OR gate 61b.

PCカード制御装置11の外部(つまりパソコンPC側)に設けられたパワースイッチ62は、例えば、それぞれ3.3v,5vの電源が入力されている2個のLowアクティブなスイッチで構成される。パワースイッチ62は、電源切り換え部60から、HighレベルのVcc3.3EN#信号とLowレベルのVcc5EN#信号が入力される場合、Vcc=5vを出力し、LowレベルのVcc3.3EN#信号とHighレベルのVcc5EN#信号が入力される場合、Vcc=3.3vを出力する。   The power switch 62 provided outside the PC card control device 11 (that is, on the personal computer PC side) is composed of, for example, two low active switches to which 3.3v and 5v power is input, respectively. When the high level Vcc3.3EN # signal and the low level Vcc5EN # signal are input from the power supply switching unit 60, the power switch 62 outputs Vcc = 5v, and the low level Vcc3.3EN # signal and the high level. When Vcc5EN # signal is input, Vcc = 3.3v is output.

上述するように、電源切り換え部60及びパワースイッチ62は、カード検出部52からの新カード検出信号の入力に応じて、コネクタ5への供給電圧を変換する電圧変換回路として機能する。   As described above, the power supply switching unit 60 and the power switch 62 function as a voltage conversion circuit that converts the supply voltage to the connector 5 in response to the input of a new card detection signal from the card detection unit 52.

なお、パワースイッチ62を、PCカード制御装置11に内蔵する実施の形態も考えられる。   An embodiment in which the power switch 62 is built in the PC card control device 11 is also conceivable.

パッシブカードアダプタ1には、パワースイッチ62より供給された電圧3.3vを、新カード用に、更に、1.5vに降下させるレギュレータ63、1.5v及び3.3vの電圧を新カード2に供給するパワースイッチ(第2パワースイッチ)64と、当該パワースイッチ64に対してパワーオン時にリセット信号を出力するパワーオンリセット65とで構成される。   The passive card adapter 1 supplies the voltage 3.3v supplied from the power switch 62 to the new card 2, and further supplies the regulator 63, 1.5v and 3.3v voltages to the new card 2 for dropping to 1.5v. And a power-on reset 65 that outputs a reset signal to the power switch 64 when the power is turned on.

パワースイッチ64は、2個のトランジスタスイッチ64a,64bと、1個のカウンタ64cとで構成される。トランジスタスイッチ64a,64bは、コネクタ5へのカードの接続に伴うPE2#信号の立ち下がりに応じてオンに切り換わる。図5のタイムチャートに示すように、カウンタ64cは、PE2#がLowレベルに切り換わってから所定のカウント数だけカウントを行い、カウント終了に伴いHighレベルのPWRGD信号を出力する。   The power switch 64 includes two transistor switches 64a and 64b and one counter 64c. The transistor switches 64a and 64b are turned on in response to the fall of the PE2 # signal accompanying the connection of the card to the connector 5. As shown in the time chart of FIG. 5, the counter 64c counts a predetermined count after PE2 # switches to the Low level, and outputs a High level PWRGD signal when the count ends.

コネクタ5より新カード2が取り外されると、PE2#の電位が、LowレベルからHighレベルに変化し、これにより、パワースイッチ64からの電源の供給が停止されると共に、PWRGDの信号出力が停止される。   When the new card 2 is removed from the connector 5, the potential of PE2 # changes from the low level to the high level, whereby the power supply from the power switch 64 is stopped and the PWRGD signal output is stopped. The

パッシブカードアダプタ1は、アダプタ内にレギュレータ63を備えたことにより、PCカード制御装置側での回路構成を少なくし、かつ、更に、別の駆動電圧を要求するカードが出現しても、パッシブカードアダプタ内の回路を変更するだけで容易に対処することができるという利点を持つ。   Since the passive card adapter 1 includes the regulator 63 in the adapter, the circuit configuration on the PC card control device side is reduced, and even if a card that requires another drive voltage appears, the passive card adapter 1 This has the advantage that it can be easily handled by simply changing the circuit.

(2)カード認識処理
図6は、上記構成のPCカード制御装置11のカード検出部52及び当該カード検出52からの情報に基づいてチップセット6に搭載される中央演算処理装置の実行するカード制御処理全般の流れを説明するための図である。まず、コネクタ5にPCカード又はパッシブカードアダプタ1が接続されたことをカード検出用の信号(CD1#,CD2#)の電位変化により検出した場合(ステップS11)、カード検出部52において接続されたカードがPCカードであるのか、又は、パッシブカードアダプタ1であるのかの判断を行う(ステップS12)。ここで、接続されたカードがパッシブカードアダプタ1である場合(ステップS12でYES)、カード検出部52の出力するカード検出信号に基づいて、電源を切換えるための電源コントロール信号(Vcc3.3EN#信号及びVcc5EN#信号)の設定を行い(ステップS13)、パワースイッチ62を切り換えて、PCMCIAコネクタに電源Vcc=3.3vを供給する(ステップS14)。パッシブカードアダプタ1に新カード2が接続されるのを待機する(ステップS15でNO)。
(2) Card Recognition Processing FIG. 6 shows card control executed by the central processing unit mounted on the chip set 6 based on the information from the card detection unit 52 and the card detection 52 of the PC card control device 11 having the above configuration. It is a figure for demonstrating the flow of the whole process. First, when it is detected that the PC card or the passive card adapter 1 is connected to the connector 5 by a change in the potential of the card detection signal (CD1 #, CD2 #) (step S11), the card connected in the card detection unit 52 Is a PC card or a passive card adapter 1 (step S12). Here, when the connected card is the passive card adapter 1 (YES in step S12), a power control signal (Vcc3.3EN # signal and Vcc3.3EN # signal for switching the power source based on the card detection signal output from the card detection unit 52) Vcc5EN # signal) is set (step S13), the power switch 62 is switched, and the power supply Vcc = 3.3v is supplied to the PCMCIA connector (step S14). It waits for the new card 2 to be connected to the passive card adapter 1 (NO in step S15).

PE2#信号がHighレベルからLowレベルに切り換わることによって、パッシブカードアダプタ1のコネクタ3に新カード2が接続されたことが検出された場合(ステップS15でYES)、パッシブカードアダプタ1内で、Vcc=3.3v及びVcc=1.5vが用意され、当該新カード2への電源Vcc=3.3v及びVcc=1.5vの供給が開始される(ステップS16)。パワースイッチ64に内蔵するカウンタの終了に伴い、新カード2に対してPWRGD信号がセットされ(ステップS17)、新カード2が使用可能状態になる(ステップS18)。   When it is detected that the new card 2 is connected to the connector 3 of the passive card adapter 1 by switching the PE2 # signal from the high level to the low level (YES in step S15), Vcc = 3.3v and Vcc = 1.5v are prepared, and supply of power Vcc = 3.3v and Vcc = 1.5v to the new card 2 is started (step S16). With the end of the counter built in the power switch 64, the PWRGD signal is set for the new card 2 (step S17), and the new card 2 becomes ready for use (step S18).

他方、接続されたカードがPCカードの場合、通常のPCMCIAに準拠したカード制御処理が実行される。この場合、カード検出部52は、内部で所定のフラグを設定し(ステップS19)、ホストとして機能するチップセット6に内蔵されている中央演算処理装置(フローチャート中では単にホストと記す)に対して割り込み処理を要求する(ステップS20)。ホストとして機能する中央演算処理装置は、カード検出部52から送られてくる情報に基づいて接続されたPCカードの種類(バス幅、駆動電圧)を認識する(ステップS21)。ホストとして機能する中央演算処理装置により電源コントロール信号(Vcc3.3EN#,Vcc5EN#)の設定が行われ(ステップS22)、パワースイッチ62の切り換えが行われ、PCMCIAコネクタに電源Vcc=3.3v及びVcc=1.5vが供給され(ステップS23)、PCカードが使用可能状態になる(ステップS24)。   On the other hand, when the connected card is a PC card, card control processing compliant with normal PCMCIA is executed. In this case, the card detection unit 52 internally sets a predetermined flag (step S19), and the central processing unit (simply referred to as a host in the flowchart) built in the chip set 6 functioning as a host. An interrupt process is requested (step S20). The central processing unit functioning as a host recognizes the type (bus width, drive voltage) of the connected PC card based on the information sent from the card detection unit 52 (step S21). A power supply control signal (Vcc3.3EN #, Vcc5EN #) is set by the central processing unit functioning as a host (step S22), the power switch 62 is switched, and the power supply Vcc = 3.3v and the PCMCIA connector are switched. Vcc = 1.5v is supplied (step S23), and the PC card is ready for use (step S24).

以上のように、従来のPCMCIAカード1に対しては、図中、※1で示すステップS21、S22において、パワースイッチ62は、ホストとして機能する中央演算処理装置からのコマンドによって電源制御されるが、新カード2に対応したパッシブカードアダプタ1に対しては、図中、※2で示すステップS13〜S14において、ホストを介さずに、カード検出部52より出力されるカード検出号によって、パワースイッチ62が直接的に制御される。また、新カード2へは、図中、※3で示すステップS15〜S17にて、パッシブカードアダプタ1内のパワースイッチ64により直接電源制御が行われる。   As described above, for the conventional PCMCIA card 1, in step S21 and S22 indicated by * 1 in the drawing, the power switch 62 is power-controlled by a command from the central processing unit functioning as a host. For the passive card adapter 1 corresponding to the new card 2, the power switch 62 is switched according to the card detection number output from the card detection unit 52 without going through the host in steps S13 to S14 indicated by * 2 in the figure. Is directly controlled. Further, for the new card 2, direct power control is performed by the power switch 64 in the passive card adapter 1 in steps S15 to S17 indicated by * 3 in the figure.

従来のPCカード制御装置50であれば、コネクタ5にパッシブカードアダプタ1が挿入された場合、カード検出部50からの通知を受けてホストがパッシブカードアダプタ1に対する制御処理を行うと共に、パワースイッチ62をソフトウェア制御する必要があった。この場合、当然、新カードに対応するように制御プログラムを変更する必要がある。これに対して、本発明に係わるPCカード制御装置11を装着した場合、カード検出部52から出力されるカード検出信号によってパワースイッチ62が直接制御されるので、ホストの実行する制御プログラム自体が不要になると共に、処理の高速化が図られる。   In the case of the conventional PC card control device 50, when the passive card adapter 1 is inserted into the connector 5, the host performs a control process for the passive card adapter 1 upon receiving a notification from the card detection unit 50, and the power switch 62 is set to software. There was a need to control. In this case, naturally, it is necessary to change the control program so as to correspond to the new card. On the other hand, when the PC card control device 11 according to the present invention is installed, the power switch 62 is directly controlled by the card detection signal output from the card detection unit 52, so that the control program executed by the host is unnecessary. At the same time, the processing speed is increased.

(3)他の実施の形態
図7は、実施の形態2に係るPCカード制御装置12を備えるコンピュータシステム(図示せず)の上記PCカード制御装置12と、対応するパッシブカードアダプタ1’の構成を示す図である。PCカード制御装置12は、上記実施の形態1に係るパッシブカードアダプタ1が備えていたパワースイッチ64に相当する切換回路(第2パワースイッチ)66をPCカード制御装置11の内部に取り込んだものである。PCカード制御装置12と同じ構成物には、同じ参照番号を付してここでの重複した説明を省く。
(3) Other Embodiments FIG. 7 shows the configuration of the PC card control device 12 of a computer system (not shown) including the PC card control device 12 according to the second embodiment and the corresponding passive card adapter 1 ′. FIG. The PC card control device 12 incorporates a switching circuit (second power switch) 66 corresponding to the power switch 64 provided in the passive card adapter 1 according to the first embodiment into the PC card control device 11. . The same components as those of the PC card control device 12 are denoted by the same reference numerals, and redundant description is omitted here.

切換回路66は、2入力ANDゲート66a、インバータ66b、及び、カウンタ66cで構成される。ANDゲート66aの一方の信号入力端子には、PE2#信号が反転入力され、残りの信号入力端子にはカード検出信号が入力される。ANDゲート66aの出力端子は、インバータ66bを介して、カウンタ66cのイネーブル端子に接続される。また、ANDゲート66aの出力は、電源切り換え部60のANDゲート61aの一方の信号入力端子に入力されると共に、及び、ORゲート61bの信号入力端子に反転入力される。   The switching circuit 66 includes a 2-input AND gate 66a, an inverter 66b, and a counter 66c. The PE2 # signal is inverted and input to one signal input terminal of the AND gate 66a, and the card detection signal is input to the remaining signal input terminals. The output terminal of the AND gate 66a is connected to the enable terminal of the counter 66c via the inverter 66b. The output of the AND gate 66a is input to one signal input terminal of the AND gate 61a of the power supply switching unit 60, and inverted and input to the signal input terminal of the OR gate 61b.

実施の形態2に係るPCカード制御装置12の上記切換回路66以外の構成は、電源切り換え部60の構成を含み、上述した実施の形態1に示す同じ参照番号の構成物と同じである。例えば、パッシブカードアダプタ1’は、アダプタ内にレギュレータ63を備えたことにより、PCカード制御装置側での回路構成を少なくし、かつ、更に、別の駆動電圧を要求するカードが出現しても、パッシブカードアダプタ内の回路を変更するだけで容易に対処することができるという利点を持つ。   The configuration other than the switching circuit 66 of the PC card control device 12 according to the second embodiment includes the configuration of the power supply switching unit 60, and is the same as the configuration with the same reference number shown in the first embodiment. For example, the passive card adapter 1 ′ includes the regulator 63 in the adapter, thereby reducing the circuit configuration on the PC card control device side, and even if a card that requires another drive voltage appears. There is an advantage that it can be easily dealt with only by changing the circuit in the passive card adapter.

図8は、図6に示すフローチャートを図7の実施例に従って示したフローチャートである。図6に示したフローチャートと同じ処理には同じステップ番号を付して表し、ここでの重複した説明は省く。   FIG. 8 is a flowchart showing the flowchart shown in FIG. 6 according to the embodiment of FIG. The same processes as those in the flowchart shown in FIG. 6 are denoted by the same step numbers, and redundant description is omitted here.

コネクタ5に接続されたカードがパッシブカードアダプタ1の場合(ステップS12でYES)、当該パッシブカードアダプタ1のコネクタ3に新カード2が挿し込まれるのを待機する(ステップS30でNO)。新カード2が挿し込まれた場合(ステップS30でYES)、カード検出部52の出力するカード検出信号に基づいて、電源を切換えるための電源コントロール信号(Vcc3.3EN#信号及びVcc5EN#信号)の設定が行われ(ステップS31)、これによりパワースイッチ62の切り換えが行われ、PCMCIAコネクタに電源Vcc=3.3v及びVcc=1.5vが供給される(ステップS32)。切換回路66に内蔵されているカウンタ66cが終了するのを待ってから、PWRGD信号を新カード2に出力し(ステップS33)、新カード2を使用可能状態にする(ステップS34)。   When the card connected to the connector 5 is the passive card adapter 1 (YES in step S12), it waits for the new card 2 to be inserted into the connector 3 of the passive card adapter 1 (NO in step S30). When a new card 2 is inserted (YES in step S30), a power control signal (Vcc3.3EN # signal and Vcc5EN # signal) for switching power based on the card detection signal output from the card detection unit 52 Setting is performed (step S31), thereby switching the power switch 62 and supplying the power Vcc = 3.3v and Vcc = 1.5v to the PCMCIA connector (step S32). After waiting for the counter 66c built in the switching circuit 66 to end, the PWRGD signal is output to the new card 2 (step S33), and the new card 2 is made available (step S34).

図9は、実施の形態3に係るPCカード制御装置13を備えたコンピュータ101の構成を示す図である。当該実施形態は、実施の形態1のPCカード制御装置11が内蔵していたアナログスイッチ57をコンピュータ内に内蔵した点が異なる。その他の構成及び動作については実施の形態1に係るPCカード制御装置11及びパッシブカードアダプタ1と同じである。   FIG. 9 is a diagram illustrating a configuration of a computer 101 including the PC card control device 13 according to the third embodiment. This embodiment is different in that the analog switch 57 incorporated in the PC card control device 11 of the first embodiment is incorporated in the computer. Other configurations and operations are the same as those of the PC card control device 11 and the passive card adapter 1 according to the first embodiment.

なお、図7を用いて説明した実施の形態2に係るPCカード制御装置12と、当該PCカード制御装置12に対応するパッシブカードアダプタ1’についても、同じ実施形態が考えられる。以下の実施形態についても同じである。   The same embodiment can be considered for the PC card control device 12 according to the second embodiment described with reference to FIG. 7 and the passive card adapter 1 ′ corresponding to the PC card control device 12. The same applies to the following embodiments.

図10は、実施の形態4に係るPCカード制御装置14を備えたコンピュータ102の構成を示す図である。当該実施形態は、実施の形態1のPCカード制御装置11が備えていたアナログスイッチ57の代わりに、同じ働きをするUSBハブ58を用意したことを特徴とする。USBハブ58として、既製部品を使用できるので安価なPCカード制御装置14を実現できる。   FIG. 10 is a diagram illustrating a configuration of the computer 102 including the PC card control device 14 according to the fourth embodiment. This embodiment is characterized in that a USB hub 58 having the same function is prepared instead of the analog switch 57 provided in the PC card control device 11 of the first embodiment. Since an off-the-shelf component can be used as the USB hub 58, an inexpensive PC card control device 14 can be realized.

図11は、本発明の第4の実施形態を示したPCカード制御装置15を備えたコンピュータ103の構成を示す図である。当該コンピュータ103は、上記実施の形態4のコンピュータ102がPCカード制御装置14に内蔵していたUSBハブ58を外側に設けたものである。PCカード制御装置15は、図12に示した従来のPCカード制御装置50からマルチプレクサ53、USBホストコントローラ55を削除して、代わりに、I/O回路56のみを追加すればよいので、回路変更は少なく、安価に製造することができる。   FIG. 11 is a diagram illustrating a configuration of a computer 103 including the PC card control device 15 according to the fourth embodiment of the present invention. The computer 103 is provided with a USB hub 58 provided outside the PC card control device 14 in the computer 102 of the fourth embodiment. The PC card control device 15 has only to add the I / O circuit 56 instead of the multiplexer 53 and the USB host controller 55 from the conventional PC card control device 50 shown in FIG. Can be manufactured inexpensively.

なお、上述した各実施の形態のPCカード制御装置11,12,13,14,15は、新カード2がUSBバスを採用するが、代わりにPCIexpressバス等のその他の新規のバス方式を採用するものでもよい。   In the PC card control apparatuses 11, 12, 13, 14, and 15 of the above-described embodiments, the new card 2 employs a USB bus, but instead employs another new bus system such as a PCI express bus. It may be a thing.

また、実施の形態においては、PCMCIAに準拠したPCカードを制御する装置を取り上げたが、PCMCIA以外の規格に準拠したカードを扱う制御装置に対してであっても、新カードを認識して所定の検出信号を出力するカード検出部52と同様に機能する検出部を備え、当該検出部の出力に基づいて使用するバスや電源回路の切換を行うスイッチ類を用意すれば、これらの制御装置に対しても、本発明のPCカード制御装置を適用することができる。   Further, in the embodiment, an apparatus for controlling a PC card conforming to PCMCIA is taken up. However, even for a control apparatus that handles a card conforming to a standard other than PCMCIA, a new card is recognized and predetermined. If the controller which functions similarly to the card detection part 52 which outputs this detection signal is provided, and switches which switch the bus used and the power supply circuit based on the output of the detection part are prepared, these control devices In contrast, the PC card control device of the present invention can be applied.

実施の形態1に係るPCカード制御装置を備えたコンピュータの構成を示す図である。1 is a diagram illustrating a configuration of a computer including a PC card control device according to Embodiment 1. FIG. I/O回路の構成を示す図である。It is a figure which shows the structure of an I / O circuit. アナログスイッチの構成を示す図である。It is a figure which shows the structure of an analog switch. 図1に示したPCカード制御装置の詳細な構成を示す図である。It is a figure which shows the detailed structure of the PC card control apparatus shown in FIG. パッシブカードアダプタ内における信号のタイムチャートである。It is a time chart of the signal in a passive card adapter. 実施の形態1に係るPCカード制御装置がPCカード及び新カードを認識する際の動作順序を説明するためのフローチャートである。4 is a flowchart for explaining an operation sequence when the PC card control device according to the first embodiment recognizes a PC card and a new card. 実施の形態2に係るPCカード制御装置の詳細な構成を示す図である。It is a figure which shows the detailed structure of the PC card control apparatus which concerns on Embodiment 2. FIG. 実施の形態2に係るPCカード制御装置がPCカード及び新カードを認識する際の動作順序を説明するためのフローチャートである。It is a flowchart for demonstrating the operation | movement order when the PC card control apparatus which concerns on Embodiment 2 recognizes a PC card and a new card. 実施の形態3に係るPCカード制御装置の詳細な構成を示す図である。It is a figure which shows the detailed structure of the PC card control apparatus which concerns on Embodiment 3. FIG. 実施の形態4に係るPCカード制御装置の詳細な構成を示す図である。It is a figure which shows the detailed structure of the PC card control apparatus which concerns on Embodiment 4. FIG. 実施の形態5に係るPCカード制御装置の詳細な構成を示す図である。It is a figure which shows the detailed structure of the PC card control apparatus which concerns on Embodiment 5. FIG. 従来のPCカード制御装置を備えたコンピュータの構成を示す図である。It is a figure which shows the structure of the computer provided with the conventional PC card control apparatus.

符号の説明Explanation of symbols

1,1’ パッシブカードアダプタ、2 新カード、3,5 コネクタ、11,12,13,14,15 PCカード制御装置、6 チップセット、6a USBホストコントローラ、52 カード検出部、54 PCMCIAコントローラ、56,56a,56b I/O回路、57,57a,57b アナログスイッチ、100,101,102,103 コンピュータ。
1, 1 'passive card adapter, 2 new card, 3, 5 connector, 11, 12, 13, 14, 15 PC card controller, 6 chipset, 6a USB host controller, 52 card detection unit, 54 PCMCIA controller, 56, 56a, 56b I / O circuit, 57, 57a, 57b Analog switch, 100, 101, 102, 103 Computer.

Claims (6)

コネクタ(5)に接続されたカードの種類を認識し、認識したカード用の電圧を出力するPCカード制御装置(11)と、PWRGD信号の入力に応じて使用可能状態になる新カードであって、上記PCカード制御装置が出力できる電圧以外の電圧を用いる新カード(2)を、上記PCカード制御装置に接続するために、上記コネクタに着脱可能に取り付けられているパッシブカードアダプタ(1)と、を備えているカード認識システムであって、A PC card controller (11) for recognizing the type of card connected to the connector (5) and outputting a voltage for the recognized card; and a new card that is ready for use in response to an input of a PWRGD signal. A passive card adapter (1) detachably attached to the connector for connecting a new card (2) using a voltage other than the voltage that can be output by the PC card control device to the PC card control device; A card recognition system comprising:
上記PCカード制御装置が、PCカード検出部(52)と、配線切換回路と、電源切換部(60)・第1パワースイッチ(62)と、を備えており、The PC card control device includes a PC card detection unit (52), a wiring switching circuit, a power supply switching unit (60) and a first power switch (62),
上記PCカード検出部が、新カードがパッシブカードアダプタに接続されたことを検出し、新カード検出信号を出力するものであり、The PC card detection unit detects that a new card is connected to the passive card adapter, and outputs a new card detection signal.
上記配線切換回路が、新カード検出信号の入力に応じて、新カード用のバスに新カードを接続するように切り換えるスイッチ回路であり、The wiring switching circuit is a switch circuit that switches to connect a new card to a bus for a new card in response to an input of a new card detection signal.
上記電源切換部・第1パワースイッチが、新カード検出信号の入力に応じて、コネクタへと供給する電圧を、新カード以外のカード用の電圧から第1電圧へとスイッチ切換して出力するものであり、In response to the input of a new card detection signal, the power supply switching unit / first power switch switches the voltage supplied to the connector from the voltage for cards other than the new card to the first voltage and outputs it. And
上記パッシブカードアダプタが、レギュレータ(63)と、第2パワースイッチ(64)と、パワーオンリセット(65)と、を備えており、The passive card adapter includes a regulator (63), a second power switch (64), and a power-on reset (65),
上記レギュレータが、電源切換部・第1パワースイッチからの第1電圧とは別に、該第1電圧を新カードで用いる第2電圧に変換して新カードへと出力するものであり、The regulator converts the first voltage into a second voltage used in the new card separately from the first voltage from the power supply switching unit / first power switch and outputs the second voltage to the new card.
上記第2パワースイッチが、カウンタ(64c)と、トランジスタスイッチ(64a、64b)と、を備えており、The second power switch includes a counter (64c) and transistor switches (64a, 64b),
上記トランジスタスイッチが、PCカード制御装置から供給される第1電圧と、レギュレータから出力される新カード用の第2電圧と、の新カードへの供給を行うように、アダプタに新カードが接続された場合に切り換わる第2信号(PE2#)の入力に応じてオンに切り換わるものであり、The new card is connected to the adapter so that the transistor switch supplies the first voltage supplied from the PC card controller and the second voltage for the new card output from the regulator to the new card. Is switched on in response to the input of the second signal (PE2 #) that switches when
上記カウンタが、上記第2信号(PE2#)の入力に応じてカウントを開始するものであり、且つ、予め定めたカウント値をカウントした場合に、上記PWRGD信号を新カードに出力するものであり、The counter starts counting in response to the input of the second signal (PE2 #), and outputs the PWRGD signal to the new card when it counts a predetermined count value. ,
上記パワーオンリセットが、電源切換部・第1パワースイッチからの第1電圧の給電開始に応じて、カウンタにリセット信号を出力するものである、The power-on reset is to output a reset signal to the counter in response to the start of feeding the first voltage from the power supply switching unit / first power switch.
ことを特徴とするカード認識システム。A card recognition system characterized by that.
電源切換部・第1パワースイッチが、電源切換部(60)と、第1パワースイッチ(62)と、を備えており、The power source switching unit / first power switch includes a power source switching unit (60) and a first power switch (62).
上記電源切換部が、新カード検出信号の入力に応じて電源コントロール信号を出力し、The power switching unit outputs a power control signal in response to the input of a new card detection signal,
上記第1パワースイッチが、電源コントロール信号に基づいて出力する電圧を切り換えるものであり、第1パワースイッチが、PCカード制御装置の外部に設けられている、The first power switch switches a voltage to be output based on a power control signal, and the first power switch is provided outside the PC card control device.
請求項1に記載のカード認識システム。The card recognition system according to claim 1.
上記PCカード制御装置が、PCMCIAに準拠する装置である、The PC card control device is a device conforming to PCMCIA.
請求項1又は2に記載のカード認識システム。The card recognition system according to claim 1 or 2.
上記PCカード制御装置が、PCMCIAコントローラ(54)を備えており、The PC card control device includes a PCMCIA controller (54),
上記配線切換回路が、I/O回路(56a、56b)と、アナログスイッチ(57a、57b)と、を備えており、The wiring switching circuit includes an I / O circuit (56a, 56b) and an analog switch (57a, 57b).
上記カード検出部が、PCカード認識部(52a)と、比較器(52b)と、レジスタ(52c)と、を備えており、The card detection unit includes a PC card recognition unit (52a), a comparator (52b), and a register (52c).
上記PCカード認識部が、PCMCIAの規格に準拠したカードNo.テーブルを内蔵しており、PCMCIAに準拠した手順に従い接続されたカードの種類を表すカードNo.を特定するものであり、The PC card recognition unit has a built-in card number table that conforms to the PCMCIA standard, and identifies a card number that indicates the type of card connected according to the procedure conforming to the PCMCIA.
上記レジスタが、新カードのカードNo.を格納しており、The above register stores the card number of the new card,
上記比較器が、PCカード認識部によって特定されたカードNo.と、レジスタに格納されているカードNo.との比較を行い、一致する場合に新カード検出信号を出力するものであり、The comparator compares the card No. specified by the PC card recognition unit with the card No. stored in the register, and outputs a new card detection signal if they match.
上記I/O回路がコネクタとPCMCIAコントローラとを接続しており、アナログスイッチがコネクタと新カード用バスとを接続しており、I/O回路とアナログスイッチとが、新カードの非検出時には、コネクタをPCMCIAコントローラとの間のみを接続し、新カード検出信号の入力時には、コネクタと新カード用バスとの間のみを接続する、The I / O circuit connects the connector and the PCMCIA controller, the analog switch connects the connector and the bus for the new card, and when the I / O circuit and the analog switch do not detect the new card, Connect the connector only to the PCMCIA controller, and connect only the connector and the new card bus when inputting the new card detection signal.
請求項3に記載のカード認識システム。The card recognition system according to claim 3.
上記新カード検出信号が、Highレベルの信号であり、The new card detection signal is a high level signal,
上記I/O回路が、2入力ANDゲート(56a−1)と、3ステートバッファ(56a−2)と、インバータ(56a−3)と、を備えており、The I / O circuit includes a 2-input AND gate (56a-1), a 3-state buffer (56a-2), and an inverter (56a-3).
上記2入力ANDゲートの一方の信号入力端子には、コネクタからのデータが入力され、残りの信号入力端子には、インバータを介して上記カード検出部が出力する信号が入力されており、出力端子がPCMCIAコントローラに接続されており、Data from the connector is input to one signal input terminal of the two-input AND gate, and a signal output from the card detection unit is input to the remaining signal input terminals via an inverter. Is connected to the PCMCIA controller,
3ステートバッファが、PCMCIAコントローラからのデータをコネクタに出力するものであり、インバータによって反転された新カード検出信号の入力に応じてオフに切り換わり、The 3-state buffer outputs data from the PCMCIA controller to the connector, and switches off in response to the input of the new card detection signal inverted by the inverter.
上記アナログスイッチが、互いのソース及びドレインが接続された1対のNチャンネル型MOSFET(57a−1)とPチャンネル型MOSFET(57a−2)と、該Pチャンネル型MOSFETのゲートに検出信号の反転信号を入力するためのインバータ(57a−3)と、を備えており、新カード検出信号の入力に応じてオンに切り換わるものである、The analog switch includes a pair of N-channel MOSFET (57a-1) and P-channel MOSFET (57a-2) whose sources and drains are connected to each other, and an inversion of a detection signal at the gate of the P-channel MOSFET. An inverter (57a-3) for inputting a signal, and is turned on in response to an input of a new card detection signal.
請求項4に記載のカード認識システム。The card recognition system according to claim 4.
請求項1乃至5の何れか1つに記載のカード認識システムを用いて行う新カード認識方法であって、A new card recognition method using the card recognition system according to any one of claims 1 to 5,
新カードがパッシブカードアダプタに差し込まれたことを、PCカード検出部によって検出して新カード検出信号を出力させる工程と、  A step of detecting by a PC card detection unit that a new card has been inserted into the passive card adapter and outputting a new card detection signal;
上記新カード検出信号を配線切換回路に入力して配線をスイッチ切換させて、新カード用のバスに新カードを接続させる工程と、  Inputting the new card detection signal into the wiring switching circuit, switching the wiring, and connecting the new card to the bus for the new card;
上記新カード検出信号を電源切換部・第1パワースイッチに入力して第1電圧を出力させる工程と、  Inputting the new card detection signal to the power supply switching unit / first power switch to output a first voltage;
上記第1電圧をパワーオンリセットに入力して第2パワースイッチが備えているカウンタをリセットさせる工程と、  Inputting the first voltage to a power-on reset to reset a counter included in the second power switch;
第2パワースイッチにおいて、上記リセット後のカウンタのカウントを開始し、予め定めたカウント値をカウントした場合に、PWRGD信号を新カードに出力して新カードを使用可能にする工程と、  In the second power switch, starting counting of the counter after the reset and counting a predetermined count value, outputting a PWRGD signal to the new card and enabling the new card;
を備えていることを特徴とする新カード認識方法。A new card recognition method characterized by comprising:
JP2004056362A 2003-03-31 2004-03-01 Card recognition system and new card recognition method Expired - Fee Related JP4526836B2 (en)

Priority Applications (5)

Application Number Priority Date Filing Date Title
JP2004056362A JP4526836B2 (en) 2003-03-31 2004-03-01 Card recognition system and new card recognition method
US10/816,063 US7363413B2 (en) 2003-03-31 2004-03-31 Method and apparatus for controlling connections of PC cards and a passive-card-adapting card used for connecting one of the PC cards to the apparatus
TW093108881A TWI252401B (en) 2003-03-31 2004-03-31 A method and apparatus for controlling connections of PC cards and a passive-card-adapting card used for connecting one of the PC cards to the apparatus
CNB2004100387487A CN100409209C (en) 2003-03-31 2004-03-31 Method and apparatus for controlling connection of personal computer card and passive card adaptive card
US12/072,593 US7519756B2 (en) 2003-03-31 2008-02-27 Method and apparatus for controlling connections of PC cards and a passive-card-adapting card used for connecting one of the PC cards to the apparatus

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
JP2003094915 2003-03-31
JP2004056362A JP4526836B2 (en) 2003-03-31 2004-03-01 Card recognition system and new card recognition method

Publications (2)

Publication Number Publication Date
JP2004318835A JP2004318835A (en) 2004-11-11
JP4526836B2 true JP4526836B2 (en) 2010-08-18

Family

ID=33478665

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2004056362A Expired - Fee Related JP4526836B2 (en) 2003-03-31 2004-03-01 Card recognition system and new card recognition method

Country Status (1)

Country Link
JP (1) JP4526836B2 (en)

Families Citing this family (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP4870717B2 (en) * 2008-04-25 2012-02-08 株式会社リコー Power switch IC control method

Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH03276382A (en) * 1990-03-26 1991-12-06 Mitsubishi Electric Corp Terminal equipment for portable type semiconductor memory device
JPH08180149A (en) * 1994-12-21 1996-07-12 Nec Corp Device connection system
JP2001307025A (en) * 2000-04-21 2001-11-02 Toshiba Corp I/o device and electronic equipment

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH03276382A (en) * 1990-03-26 1991-12-06 Mitsubishi Electric Corp Terminal equipment for portable type semiconductor memory device
JPH08180149A (en) * 1994-12-21 1996-07-12 Nec Corp Device connection system
JP2001307025A (en) * 2000-04-21 2001-11-02 Toshiba Corp I/o device and electronic equipment

Also Published As

Publication number Publication date
JP2004318835A (en) 2004-11-11

Similar Documents

Publication Publication Date Title
US7519756B2 (en) Method and apparatus for controlling connections of PC cards and a passive-card-adapting card used for connecting one of the PC cards to the apparatus
JP4438846B2 (en) Card type peripheral device
KR20050011407A (en) Memory card, connector for Universal Serial Bus and Universal Serial Bus connection system
CN110543651B (en) Functional circuit board module
JP2000222073A (en) Adaptive pci slot
US7818469B2 (en) USB device and peripheral device changing functional module to activate in accordance with descriptor
JP4113750B2 (en) PC card control device and computer system including this PC card control device
JP2002073522A (en) Memory card bridge
US7039826B2 (en) Circuit for controlling the clock supplied to a state controller in a data transfer control device according to states of first and second devices
US7076683B2 (en) Clock control circuit for controlling an oscillation circuit in a data transfer control device according to states of a first device and a second device
JP4526836B2 (en) Card recognition system and new card recognition method
JP4526837B2 (en) Card recognition system
JP4411104B2 (en) Passive card adapter
JPH08123583A (en) Device for determining inner state
US20060095626A1 (en) Multifunction adapter
JP2006279273A (en) Interface circuit
US7409484B2 (en) Integrated circuit having reduced pin count
US20070106830A1 (en) System and method to access storage inside an inactive computing device
JP2007226696A (en) Pci express expansion card
US7634609B2 (en) Data transmission coordinating method
JP4713122B2 (en) Card controller
KR100631731B1 (en) Interface device and method of notebook PC
EP1679609A1 (en) Multifunction adapter
KR20010063912A (en) Apparatus for converting master and slave mode
KR20010063803A (en) Multimedia Card(MMC) To Support The Video Codec Function

Legal Events

Date Code Title Description
A621 Written request for application examination

Free format text: JAPANESE INTERMEDIATE CODE: A621

Effective date: 20060825

A977 Report on retrieval

Free format text: JAPANESE INTERMEDIATE CODE: A971007

Effective date: 20090723

A131 Notification of reasons for refusal

Free format text: JAPANESE INTERMEDIATE CODE: A131

Effective date: 20090825

A521 Written amendment

Free format text: JAPANESE INTERMEDIATE CODE: A523

Effective date: 20091026

TRDD Decision of grant or rejection written
A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

Effective date: 20100525

A01 Written decision to grant a patent or to grant a registration (utility model)

Free format text: JAPANESE INTERMEDIATE CODE: A01

A61 First payment of annual fees (during grant procedure)

Free format text: JAPANESE INTERMEDIATE CODE: A61

Effective date: 20100602

FPAY Renewal fee payment (event date is renewal date of database)

Free format text: PAYMENT UNTIL: 20130611

Year of fee payment: 3

R150 Certificate of patent or registration of utility model

Free format text: JAPANESE INTERMEDIATE CODE: R150

LAPS Cancellation because of no payment of annual fees