JPH1186586A - シフトレジスタ装置および表示装置 - Google Patents

シフトレジスタ装置および表示装置

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JPH1186586A
JPH1186586A JP9238695A JP23869597A JPH1186586A JP H1186586 A JPH1186586 A JP H1186586A JP 9238695 A JP9238695 A JP 9238695A JP 23869597 A JP23869597 A JP 23869597A JP H1186586 A JPH1186586 A JP H1186586A
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Japan
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signal
transistor
shift register
stage
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JP9238695A
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Hiroyuki Hebiguchi
広行 蛇口
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Frontec Inc
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FURONTETSUKU KK
Frontec Inc
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Abstract

(57)【要約】 【課題】 静電気や電磁波等のノイズがあっても誤動作
しにくいシフトレジスタおよびこのシフトレジスタの採
用により表示不良が発生する恐れのない表示装置を提供
する。 【解決手段】 シフトレジスタの各ステージにおいて
は、前段のステージの出力Ｇi-1 が入力される入力トラ
ンジスタ１の出力電極に出力トランジスタ２の制御電極
とクランピングトランジスタ３が接続されている。ま
た、出力トランジスタ２の出力電極にプルダウン抵抗４
が接続され、出力トランジスタ２の制御電極と出力電極
との間にキャパシタ５が挿入されている。そして、クロ
ック信号ＣＫＢが出力トランジスタ２に入力され、２段
後のクロック信号の反転信号ＣＫＤ’がクランピングト
ランジスタ３に入力される構成となっている。

Description

【発明の詳細な説明】
【０００１】
【発明の属する技術分野】本発明は、例えば液晶ディス
プレイ等の表示装置に設置して走査信号を与えるシフト
レジスタ装置、およびそのシフトレジスタ装置を用いた
表示装置に関するものである。
【０００２】
【従来の技術】例えばアクティブマトリクス形の液晶表
示装置においては、映像信号線（ソース線）と走査信号
線（ゲート線）が格子状に設けられ、これら配線の交点
に各画素の液晶を駆動する薄膜トランジスタ等のスイッ
チング素子が設けられている。そして、複数の走査信号
線に、これら信号線を順々に走査して一つの走査信号線
上の全てのスイッチング素子を一時的に導通状態にする
走査信号が与えられる一方、複数の映像信号線には、こ
の走査に同期して映像信号が供給されるようになってい
る。
【０００３】この際、複数の走査信号線に対して走査信
号を順次供給する役目を果たすのがシフトレジスタであ
る。図５、図６は従来のシフトレジスタの一例を説明す
るための図である。このシフトレジスタは多段のステー
ジを有しているが、図５はステージ３段分の回路図、図
６はタイミングチャートを示すものである。図５に示す
ように、各ステージｉ−１，ｉ，ｉ＋１は４つのトラン
ジスタと１つのキャパシタの組み合わせで構成されてお
り、この構成にしたことでこれらトランジスタに余剰な
ストレスが掛からず、トランジスタの特性が劣化しにく
いという利点を得ている。一つのステージｉに着目する
と、前段のステージｉ−１の出力Ｇi-1 にダイオード接
続された入力トランジスタ５１が接続され、入力トラン
ジスタ５１の出力電極に出力トランジスタ５２の制御電
極およびクランピングトランジスタ５３が接続されてい
る。また、出力トランジスタ５２の出力電極にプルダウ
ントランジスタ５４が接続されるとともに、出力トラン
ジスタ５２の制御電極と出力電極との間にキャパシタ５
５が挿入されている。
【０００４】上記構成のシフトレジスタにおいては、図
５に示すように、位相がシフトした複数のクロック信号
ＣＫＡ，ＣＫＢ，ＣＫＣが各ステージｉ−１，ｉ，ｉ＋
１の出力トランジスタ５２に入力され、一つのステージ
のクランピングトランジスタ５３の制御電極には２段後
のステージの出力が入力されるようになっている。した
がって、図５中に破線で囲んだステージｉにおいて、図
６に示すように、その前段の出力Ｇi-1 が"High"レベル
の時に入力トランジスタ５１は"ON"となって出力トラン
ジスタ５２の制御電極の電位Ｖbi（制御信号）が立ち上
がり、その状態では出力トランジスタ５２が"ON"となる
ので、出力トランジスタ５２に入力されるクロック信号
ＣＫＢが"High"レベルになると当該ステージの出力Ｇi
が"High"レベルとなって出力される。その後、２段後の
ステージの出力Ｇi+2 が"High"レベルになり、これがク
ランピングトランジスタ５３の制御電極に入力される
と、クランピングトランジスタ５３が"ON"となるため、
出力トランジスタ５２の制御電極の電位Ｖbiが立ち下が
る。このようにして、各ステージｉ−１，ｉ，ｉ＋１か
ら出力Ｇi-1，Ｇi，Ｇi+1 が順次出力されていくこと
で、例えば液晶表示装置の走査回路に用いることができ
る。
【０００５】
【発明が解決しようとする課題】しかしながら、上記構
成のシフトレジスタにおいて、図５にＶbiとして示した
節点は、図５、図６を見れば明らかなように、入力トラ
ンジスタ５１に入力される出力Ｇi-1 またはクランピン
グトランジスタ５３に入力される出力Ｇi+2 が"High"レ
ベルとなっている時のみ、低インピーダンスで電源に接
続され、その以外の時間ではＶbi を充放電するトラン
ジスタは全て"OFF"（高インピーダンス）であるため、
フローティングの状態になっている。例えばこのシフト
レジスタを走査線が４８０本のＶＧＡディスプレイのゲ
ートスキャンに用いる場合、低インピーダンスになる時
間は２／４８０、フローティングになる時間は４７８／
４８０（約９９．６％）であり、ほとんどの時間で節点
Ｖbiはフローティングの状態である。
【０００６】フローティングになっている時間は、シフ
トレジスタ本来の機能からして当該ステージｉの出力Ｇ
i が"Low"レベルを出力し続けるようにＶbiは"Low"レベ
ルの電位を維持しなければならない。ところが、この従
来のシフトレジスタの構成ではＶbiがフローティングに
なっているため、静電気や電磁波等のノイズを拾ってＶ
biが出力トランジスタ５２の閾値を越えると、本来はＧ
iが"Low"レベルを出力すべき時に"High"レベルを出力す
るという重大な誤動作を引き起こす。しかも、この構成
ではノイズによってＶbiの電位が一旦上昇すると、フロ
ーティングになっている期間は電位が上昇した状態が保
持される（図６中に破線ａで示す）ため、本来出てはな
らない出力パルス（図６に破線ｂで示す）がクロックの
周期で繰り返し出力されるため、非常に大きな悪影響を
及ぼすことになる。したがって、例えばこのシフトレジ
スタをディスプレイのゲートスキャンに用いた場合、本
来書き換えないはずのタイミングで画像信号が書き換え
られてしまうため、著しい表示不良として認識される、
という問題が懸念されていた。
【０００７】本発明は、上記の課題を解決するためにな
されたものであって、静電気や電磁波等のノイズがあっ
ても誤動作しにくいシフトレジスタ装置、およびこのシ
フトレジスタ装置の採用により表示不良が発生する恐れ
のない表示装置を提供することを目的とする。
【０００８】
【課題を解決するための手段】上記の目的を達成するた
めに、本発明のシフトレジスタ装置は、位相が順次異な
った複数のクロック信号を生成する手段と、上記クロッ
ク信号数より多い数のステージであって各々のステージ
から出力信号を発生するカスケード接続された複数のス
テージとから構成され、上記各々のステージが、前段の
ステージからの出力信号を制御信号として入力させ、こ
の制御信号を保持し且つ上記複数のクロック信号の相応
するクロック信号を入力させたときに上記出力信号を出
力するスイッチング素子と、上記相応するクロック信号
に対して異なる位相のクロック信号に対応して、上記ス
イッチング素子からの出力信号の出力後にこのスイッチ
ング素子からの出力信号の発生を抑制するよう上記制御
信号を抑圧するクランピング素子とを有することを特徴
とするものである。
【０００９】本発明のシフトレジスタ装置の場合、各ス
テージにおいて、スイッチング素子に前段のステージか
らの出力信号が制御信号として入力され、この制御信号
が保持され且つ上記複数のクロック信号の相応するクロ
ック信号が入力されたときに出力信号を出力する。その
後、クランピング素子が、当該ステージの相応するクロ
ック信号とは異なる位相のクロック信号に対応してスイ
ッチング素子の制御信号を抑圧し、それ以降のスイッチ
ング素子からの出力信号の発生を抑制する。
【００１０】すなわち、本発明の場合、制御信号を抑圧
する機能を持つクランピング素子を備えたことにより、
静電気や電磁波等のノイズによってトランジスタ素子の
制御電極に電荷がたまり、制御信号のレベルが変化する
ことがあっても、クランピング素子に当該ステージのス
イッチング素子に入力されるクロック信号とは異なる位
相のクロック信号が入力される度にトランジスタ素子の
制御電極にたまった電荷が逃げ、制御信号を抑圧する構
成となっている。換言すると、トランジスタ素子の制御
信号が当該ステージのクランピング素子の作用によって
定期的に"Low"レベルにリフレッシュされるため、従来
のシフトレジスタのように、静電気や電磁波等のノイズ
により出力トランジスタの制御電極の電位が出力トラン
ジスタの閾値を越え、出力トランジスタが"Low" レベル
を出力すべき時に"High"レベルを出力するというような
誤動作が生じることがない。
【００１１】なお、クランピング素子を作用させる信号
として、ただ単に当該ステージのスイッチング素子に入
力されるクロック信号と異なる位相のクロック信号とい
うだけでなく、異なる位相であって且つ当該ステージの
次後段ないし前段のステージに入力されるクロック信号
を用いるとよい。その場合、クロック信号発生用電源の
鋭いオン／オフ波形を反映したシャープな出力信号波形
を得ることができる。
【００１２】また、上記スイッチング素子が、前段のス
テージからの出力信号を入力させるとともに相応するク
ロック信号を入力させて出力信号を発生させるトランジ
スタ素子と、前段のステージからの出力信号を制御信号
として電位保持する容量とを有する構成とすることがで
きる。
【００１３】そして、上記容量を、上記トランジスタ素
子の制御電極と出力電極との間に形成することができ
る。その構成とした場合、その容量はブートストラップ
容量として機能し、上記トランジスタ素子の駆動力を向
上させることができる。
【００１４】また、前記出力トランジスタの出力電極に
プルダウン素子を接続してもよい。その構成とした場
合、出力の波形を急峻にするなどインピーダンスをコン
トロールすることができる。
【００１５】さらに、上記クランピング素子を、少なく
とも一つのダイオード素子もしくはダイオード接続され
たトランジスタ素子で構成することができる。また、当
該ステージから前段のステージに電荷が逆流することを
抑制するダイオード素子もしくはダイオード接続された
トランジスタ素子を有する構成とするとよい。
【００１６】また、本発明の表示装置は、上記のシフト
レジスタ装置を有することを特徴とするものである。本
発明によれば、ディスプレイをスキャンする際に用いる
シフトレジスタ装置に、本来出てはならない出力パルス
がクロックの周期で繰り返し出力される等の動作不良が
生じることがないため、表示装置において本来書き換え
ないはずのタイミングで画像信号が書き換えられてしま
う等の表示不良が発生するのを防止することができる。
【００１７】
【発明の実施の形態】以下、本発明の一実施の形態を図
１ないし図４を参照して説明する。図１ないし図３は本
実施の形態のシフトレジスタを説明するための図であ
り、このシフトレジスタは、位相が順次異なった複数の
クロック信号を生成する手段と、カスケード接続された
複数のステージとから構成されている。そのうち、図１
はステージ１段分の回路構成図、図２はカスケード接続
されたステージ４段分の回路構成図を示すものである。
また、図３はそのタイミングチャートである。
【００１８】図１に示すように、各ステージは３つのト
ランジスタ、１つのキャパシタ、１つの抵抗の組み合わ
せで構成されている。前段のステージの出力にダイオー
ド接続されたトランジスタからなる入力トランジスタ１
が接続され、入力トランジスタ１の出力電極に出力トラ
ンジスタ２（トランジスタ素子）の制御電極およびダイ
オード接続されたトランジスタからなるクランピングト
ランジスタ３（クランピング素子）が接続されている。
なお、この入力トランジスタ１は当該ステージから前段
のステージに電荷が逆流することを抑制するためのもの
である。
【００１９】そして、出力トランジスタ２の出力電極に
プルダウン抵抗４（プルダウン素子）が接続されるとと
もに、出力トランジスタ２の制御電極と出力電極との間
にキャパシタ５（容量）が挿入されている。このキャパ
シタ５は、出力トランジスタ２の制御信号を電位保持す
るための容量となり、ブートストラップ容量として機能
するものである。なお、ここではクランピング素子とし
てダイオード接続されたトランジスタを用いたが、この
構成に代えてダイオードそのものを用いてもよい。
【００２０】上記構成のステージを有する本実施の形態
のシフトレジスタは、４相のクロックで駆動する場合の
例であり、図２および図３に示すように、位相が順次シ
フトした４相のクロック信号ＣＫＡ，ＣＫＢ，ＣＫＣ，
ＣＫＤが各ステージｉ−１，ｉ，ｉ＋１，ｉ＋２の出力
トランジスタ２に入力されるとともに、任意のステージ
のクランピングトランジスタ３には２段後のステージに
入力されるクロック信号を反転させた信号ＣＫＡ’、Ｃ
ＫＢ’、ＣＫＣ’、ＣＫＤ’が入力されるようになって
いる。すなわち、図２中に破線で囲んだステージｉにつ
いて見ると、出力トランジスタ２にはクロック信号ＣＫ
Ｂが入力されるが、クランピングトランジスタ３には２
段後のステージに入力されるクロック信号ＣＫＤを反転
させた信号ＣＫＤ’が入力される。
【００２１】そこで、図２中に破線で囲んだステージｉ
において、図３に示すように、その前段の出力Ｇi-1
が"High"レベルの時に入力トランジスタ１は"ON"（順方
向）となって出力トランジスタ２の制御電極の電位Ｖbi
（制御信号）が立ち上がり、その状態では出力トランジ
スタ２が"ON"となるので、出力トランジスタ２に入力さ
れるクロック信号ＣＫＢが"High"レベルになると出力Ｇ
i が"High"レベルとなって出力される。なお、出力トラ
ンジスタ２の制御電極が出力Ｇi にキャパシタ５を介し
て接続されており、キャパシタ５がブートストラップ容
量として機能することによって、制御信号（Ｖbi）の波
形は出力Ｇi の立ち上がりに同期して凸型となる。その
後、クランピングトランジスタ３に入力される反転信号
ＣＫＤ’が"Low" レベルになると、クランピングトラン
ジスタ３が"ON"（順方向）となるため、出力トランジス
タ２の制御信号Ｖbiが立ち下がり、制御信号Ｖbiは次に
前段の出力Ｇi-1 が"High"レベルになるまでこの状態が
保持される。同様にして、各ステージｉ−１，ｉ，ｉ＋
１，ｉ＋２から出力Ｇi-1、Ｇi、Ｇi+1、Ｇi+2が順次出
力される。
【００２２】従来のシフトレジスタにおいては、出力ト
ランジスタの制御電極はほとんどの時間でフローティン
グの状態になっていたため、制御信号Ｖbiが静電気や電
磁波等のノイズを拾って出力トランジスタの閾値を越え
ると、本来は出力Ｇiが"Low"レベルを出力すべき時に"H
igh"レベルを次々と出力してしまうという問題があっ
た。これに対して、本実施の形態のシフトレジスタにお
いては、クランピングトランジスタ３に２段後のクロッ
ク信号の反転信号が入力される構成となっているため、
この反転信号が"Low" レベルになる度にクランピングト
ランジスタ３が"ON"となり、出力トランジスタ２の制御
信号Ｖbiがリフレッシュされる。すなわち、出力トラン
ジスタ２の制御信号Ｖbiはクロックの周期でリフレッシ
ュされることになる。
【００２３】この構成により、静電気や電磁波等のノイ
ズによって出力トランジスタ２の制御電極に電荷がたま
ることがあっても、その電荷はクロックの周期でクラン
ピングトランジスタ３を通じて逃げ、定期的に"Low" レ
ベルにリフレッシュされるため、ノイズにより制御信号
Ｖbiが上昇しても出力トランジスタ２の閾値に到達する
前にリフレッシュされれば全く悪影響はなく、仮に閾値
を越えたとしてもクロックの周期を越えて誤動作するこ
とはない。いずれにしても、本実施の形態のシフトレジ
スタによれば、ノイズによる誤動作の悪影響を従来に比
べて格段に低減することができる。
【００２４】なお、出力トランジスタ２の制御信号Ｖbi
をより確実にリフレッシュするために、２段後のクロッ
ク信号の反転信号ＣＫＤ’の"Low"レベルは、通常の"Lo
w"レベルよりもさらにトランジスタの閾値分程度深く降
下させることが望ましい。その場合、反転信号ＣＫＤ’
をマイナス方向に平行にレベルシフトするだけでもよ
い。
【００２５】そして、本実施の形態ではクランピングト
ランジスタ３を定期的に"ON"状態とする手段として、出
力トランジスタ２への入力に用いているクロック信号の
反転信号を用いているため、クロック信号発生用電源の
鋭いオン／オフ波形を反映したシャープな出力信号波形
を得ることができる。さらに、クロック信号を反転させ
るための回路さえ備えればクランピングトランジスタ３
を駆動するための独自のクロック信号を生成する回路を
備える必要がなく、回路構成を簡単化することができ
る。
【００２６】また、本実施の形態の場合、出力トランジ
スタ２の制御電極と出力電極との間にキャパシタ５を挿
入し、このキャパシタ５がブートストラップ容量として
機能する構成としたため、出力トランジスタ２の駆動力
が向上し、当該ステージｉに入力されるクロック信号Ｃ
ＫＢのパルスに応答して出力Ｇi のパルスがより確実に
出力されるようになっている。また、ブートストラップ
としての効果を確実に得るためには、２段後のクロック
信号の反転信号ＣＫＤ’を制御信号Ｖbiの波形にならっ
て凸型にすることが望ましい。
【００２７】ところで、制御信号をクロックでリフレッ
シュし、ノイズ耐性を高める方法としては、上記の構成
の他に、図７に示したように、クランピング素子６をダ
イオード接続していないトランジスタで構成するという
方法もある。この方法でもノイズ耐性だけを見れば、図
８に示したように、本実施の形態の同様の効果が得られ
るが、クロックラインをクランピングトランジスタ６の
制御電極に接続しなければならないため、負荷容量が大
きくなり、大きな電流供給能力を持ったクロック発生用
の電源が必要になることで消費電力が増大する、また、
クロックラインの配線抵抗を低減するために配線幅が太
くなることで回路の占有面積が大きくなる、等の問題が
ある。これに対して、本実施の形態の構成によれば、ク
ロックラインがクランピングトランジスタ３の制御電極
には接続されないため、負荷容量が小さくなり、上記の
問題を解消する点とノイズ耐性の向上を両立させること
ができる。
【００２８】図４は、本実施の形態のシフトレジスタを
備えた液晶表示装置（表示装置）の回路構成を示すもの
である。図４に示すように、この液晶表示装置１０は、
映像信号線（ソース線）と走査信号線（ゲート線）が格
子状に設けられ、これら配線の交点に各画素の液晶を駆
動する薄膜トランジスタが設けられたＴＦＴ−ＬＣＤ部
１１と、ソース線とゲート線をそれぞれ駆動するソース
線駆動回路１２、ゲート線駆動回路１３と、これら駆動
回路１２、１３に対して電源電圧および映像信号、走査
信号をそれぞれ供給する電源部１４、信号制御部１５か
ら構成されている。
【００２９】上記回路構成の液晶表示装置１０におい
て、ソース線駆動回路１２、ゲート線駆動回路１３の双
方にシフトレジスタが用いられている。例えば、ゲート
線駆動回路１３中のシフトレジスタによるゲートスキャ
ンの動作について説明すると、各ゲート線にゲート線駆
動用トランジスタが接続されており、これらトランジス
タはゲート線駆動回路１３中のシフトレジスタによって
上から下に順次一つずつ１走査期間だけ導通状態になる
ように駆動される。その結果、水平同期信号に同期して
任意のゲート線に接続されたゲート線駆動用トランジス
タが導通状態になると、このゲート線に接続された全て
の薄膜トランジスタが導通状態になる。このようにし
て、各ソース線上の画像信号である電荷が各画素電極の
容量に蓄積される。
【００３０】本実施の形態の液晶表示装置１０は上記の
ようなノイズ耐性に優れたシフトレジスタを備えている
ため、本来書き換えないはずのタイミングで画像信号が
書き換えられる等の表示不良が発生することがなく、信
頼性の高いものとすることができる。
【００３１】なお、本発明の技術範囲は上記実施の形態
に限定されるものではなく、本発明の趣旨を逸脱しない
範囲において種々の変更を加えることが可能である。例
えば上記実施の形態では、シャープな出力信号波形を
得、回路構成を簡単化するためにクランピングトランジ
スタ３を定期的に駆動させる信号としてクロック信号の
反転信号を用いたが、特にシャープな出力信号波形を
得、回路構成を簡単化するという効果を求めないのであ
れば、クランピングトランジスタ３を定期的に駆動させ
る"Low"レベルを持った信号を生成する回路を別個に備
えてもよい。また、上記実施の形態は４相のクロック信
号ＣＫＡ，ＣＫＢ，ＣＫＣ，ＣＫＤを用いる例で説明し
たが、用いるクロック信号の数はこれに限るものではな
い。また、４相以上のクロック信号を用い、上記実施の
形態と同様のクランピングトランジスタ３を用いる場
合、クランピングトランジスタに入力する反転信号には
当該ステージの２段以上後から前段までのステージのい
ずれかのクロック信号の反転信号を用いるようにすれば
問題ない。さらに、プルダウン素子として抵抗以外の他
の素子を用いてもよいし、このプルダウン素子を各ステ
ージの基本構成要素として設けるのではなく、基本構成
の外側に設けてもよい。
【００３２】
【発明の効果】以上、詳細に説明したように、本発明の
シフトレジスタ装置においては、制御信号を抑圧するク
ランピング素子を備えたことにより、静電気や電磁波等
のノイズによってトランジスタ素子の制御電極に電荷が
たまり、制御信号のレベルが変化することがあっても、
クランピング素子にスイッチング素子に入力されるクロ
ック信号とは異なる位相のクロック信号が入力される度
にトランジスタ素子の制御電極にたまった電荷が逃げ、
制御信号を抑圧する構成となっている。すなわち、トラ
ンジスタ素子の制御信号が当該ステージのクランピング
素子の作用により定期的に"Low" レベルにリフレッシュ
されるため、従来のシフトレジスタのように、静電気や
電磁波等のノイズにより出力トランジスタの制御電極の
電位が出力トランジスタの閾値を越え、出力トランジス
タが"Low"レベルを出力すべき時に"High"レベルを出力
する、というような誤動作が生じるのを防止することが
できる。
【００３３】また、本発明の表示装置によれば、ディス
プレイをスキャンする際に用いるシフトレジスタ装置に
本来出てはならない出力パルスがクロックの周期で繰り
返し出力される等の動作不良が生じることがないため、
本来書き換えないはずのタイミングで画像信号が書き換
えられてしまう等の表示不良が発生するのを防止するこ
とができる。
【図面の簡単な説明】
【図１】 本発明の一実施の形態であるシフトレジスタ
のステージ１段分の回路構成図である。
【図２】 同、シフトレジスタのステージ４段分の回路
構成図である。
【図３】 同、シフトレジスタのタイミングチャートで
ある。
【図４】 同、シフトレジスタを備えた液晶表示装置の
回路構成図である。
【図５】 従来のシフトレジスタのステージ３段分の回
路構成図である。
【図６】 同、シフトレジスタのタイミングチャートで
ある。
【図７】 制御信号をクロックでリフレッシュしてノイ
ズ耐性を高めたシフトレジスタの一例であって、ステー
ジ３段分の回路構成図である。
【図８】 同、シフトレジスタのタイミングチャートで
ある。
【符号の説明】
１ 入力トランジスタ ２ 出力トランジスタ（トランジスタ素子） ３ クランピングトランジスタ（クランピング素子） ４ プルダウン抵抗（プルダウン素子） ５ キャパシタ（容量） １０ 液晶表示装置（表示装置）

Claims (7)

    【特許請求の範囲】
  1. 【請求項１】 位相が順次異なった複数のクロック信号
    を生成する手段と、前記クロック信号数より多い数のス
    テージであって各々のステージから出力信号を発生する
    カスケード接続された複数のステージとから構成され、 前記各々のステージが、前段のステージからの出力信号
    を制御信号として入力させ、該制御信号を保持し且つ前
    記複数のクロック信号の相応するクロック信号を入力さ
    せたときに前記出力信号を出力するスイッチング素子
    と、前記相応するクロック信号に対して異なる位相のク
    ロック信号に対応して、前記スイッチング素子からの出
    力信号の出力後に該スイッチング素子からの出力信号の
    発生を抑制するよう前記制御信号を抑圧するクランピン
    グ素子とを有することを特徴とするシフトレジスタ装
    置。
  2. 【請求項２】 前記スイッチング素子が、前記前段のス
    テージからの出力信号を入力させるとともに前記相応す
    るクロック信号を入力させて出力信号を発生させるトラ
    ンジスタ素子と、前記前段のステージからの出力信号を
    制御信号として電位保持する容量とを有することを特徴
    とする請求項１に記載のシフトレジスタ装置。
  3. 【請求項３】 前記容量が、前記トランジスタ素子の制
    御電極と該トランジスタ素子の出力電極との間に形成さ
    れたことを特徴とする請求項２に記載のシフトレジスタ
    装置。
  4. 【請求項４】 前記トランジスタ素子の出力電極にプル
    ダウン素子が接続されていることを特徴とする請求項３
    に記載のシフトレジスタ装置。
  5. 【請求項５】 前記クランピング素子が、少なくとも一
    つのダイオード素子もしくはダイオード接続されたトラ
    ンジスタ素子で構成されたことを特徴とする請求項１に
    記載のシフトレジスタ装置。
  6. 【請求項６】 当該ステージから前記前段のステージに
    電荷が逆流することを抑制するダイオード素子もしくは
    ダイオード接続されたトランジスタ素子を有することを
    特徴とする請求項１に記載のシフトレジスタ装置。
  7. 【請求項７】 請求項１に記載のシフトレジスタ装置を
    有することを特徴とする表示装置。
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