JPH08272337A - Display control circuit - Google Patents

Display control circuit

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Publication number
JPH08272337A
JPH08272337A JP7425795A JP7425795A JPH08272337A JP H08272337 A JPH08272337 A JP H08272337A JP 7425795 A JP7425795 A JP 7425795A JP 7425795 A JP7425795 A JP 7425795A JP H08272337 A JPH08272337 A JP H08272337A
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JP
Japan
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circuit
liquid crystal
display
potential
voltage
Prior art date
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Application number
JP7425795A
Other languages
Japanese (ja)
Inventor
Koujirou Wakayoshi
功士郎 若吉
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Seiko Epson Corp
Original Assignee
Seiko Epson Corp
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Filing date
Publication date
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Publication of JPH08272337A publication Critical patent/JPH08272337A/en
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Abstract

PURPOSE: To continuously transfer a command from a CPU side without caring for a charge-up period of a capacitor for compensating a display limit due to power of an integrated power source circuit and to dissolve display malfunction immediately after a liquid crystal power source circuit is turned on. CONSTITUTION: In a display control circuit of an LCD driver IC incorporating the liquid crystal power source circuit, a liquid crystal driving voltage 15 and the grounded voltage 10 are divided into plural potential 11-14. Respective divided voltages are connected to V/F circuits 110, and their outputs are sent to a comparator circuit 103, and the output signal 204 of the circuit 103 and a display on-command signal sent from the CPU are ANDed. A voltage selection circuit 108 fixes respective supply potential to an output driver circuit to the grounded level while until a display on-signal is inputted when a liquid crystal power source on-command is executed, and supplies prescribed potential to the output driver circuit 109 simultaneously when the display on-signal 205 is inputted, and performs operation control of a liquid crystal display device 114.

Description

【発明の詳細な説明】Detailed Description of the Invention

【0001】[0001]

【産業上の利用分野】この発明は、液晶電源回路を内蔵
したLCDドライバICの表示制御回路に関する。
BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a display control circuit of an LCD driver IC containing a liquid crystal power supply circuit.

【0002】[0002]

【従来の技術】近年の傾向としてLCDドライバIC
は、高付加価値化のため、CR発振回路、表示用RA
M、液晶電源回路といった周辺回路を内蔵するものが設
計されている。液晶電源回路については、従来は外部電
源を使用していたため、液晶表示装置に合った電源を選
択できたが、液晶電源回路を内蔵したLCDドライバI
Cの場合、内蔵する電源回路の能力によって表示能力に
限界があるため、必ずしも液晶表示装置に合った電力を
供給できない可能性がある。これを補うために、通常は
図6に示す従来例のように液晶表示用電位21(V
1),22(V2),23(V3),24(V4)と1
0(VDDグランド)の間に各々321(コンデンサ
C)を接続し、LCDドライバICに内蔵している液晶
電源回路の能力を越える電力が消費された時にこのチャ
ージアップされたコンデンサCより各電位を供給するよ
うにしている。
2. Description of the Related Art As a recent trend, an LCD driver IC
Is a CR oscillator circuit and a display RA for added value.
M, a liquid crystal power supply circuit and other peripheral circuits are designed. Regarding the liquid crystal power supply circuit, conventionally, an external power supply was used, so that a power supply suitable for the liquid crystal display device could be selected. However, the LCD driver I incorporating the liquid crystal power supply circuit
In the case of C, the display capability is limited by the capability of the built-in power supply circuit, and therefore it may not always be possible to supply power suitable for the liquid crystal display device. To compensate for this, normally, as in the conventional example shown in FIG.
1), 22 (V2), 23 (V3), 24 (V4) and 1
Each 321 (capacitor C) is connected between 0 (VDD ground), and when the power exceeding the capacity of the liquid crystal power supply circuit built in the LCD driver IC is consumed, each potential is charged from the charged capacitor C. I am trying to supply it.

【0003】液晶電源内蔵のLCDドライバICの場
合、コンデンサCに対して液晶電源回路をオンすると同
時にチャージアップを開始するため、液晶電源回路をオ
ンしてからある一定時間はコンデンサCのチャージアッ
プ期間としてV1,V2,V3,V4の電圧値は例えば
図7のように不安定となる。図7によれば、電源回路オ
ン後出力電圧が安定するまでの安定化時間が必要とな
り、初期状態ではV1>V2>V3>V4の関係も成り
立たない。
In the case of an LCD driver IC with a built-in liquid crystal power supply, since the liquid crystal power supply circuit for the capacitor C is turned on and charge-up is started at the same time, the charge-up period of the capacitor C is maintained for a certain period after the liquid crystal power supply circuit is turned on. As a result, the voltage values of V1, V2, V3 and V4 become unstable as shown in FIG. 7, for example. According to FIG. 7, a stabilization time is required until the output voltage stabilizes after the power supply circuit is turned on, and the relationship of V1>V2>V3> V4 does not hold in the initial state.

【0004】図7の場合、21(V1),22(V
2),23(V3),24(V4)の電圧が安定するま
での期間は、110(V/F回路)の能力と321(外
付けコンデンサC)により決まるため、設計段階での設
計値のずれや製造バラツキ、外付けコンデンサCの容量
値、使用環境によってV1,V2,V3,V4の波形は
影響を受け、一定ではない。
In the case of FIG. 7, 21 (V1), 22 (V
2), the period until the voltage of 23 (V3), 24 (V4) stabilizes is determined by the capability of 110 (V / F circuit) and 321 (external capacitor C), so The waveforms of V1, V2, V3 and V4 are not constant because they are affected by deviations, manufacturing variations, the capacitance value of the external capacitor C, and the usage environment.

【0005】また図1に示す様に、114(液晶表示装
置)は108(電圧セレクト回路)により10(VD
D),21(V1),22(V2),23(V3),2
4(V4),15(V5)の電位を選択することによっ
て表示データの点滅を制御しているため、このチャージ
アップ期間にCPUから表示ONコマンドが実行される
と、液晶表示装置へ供給されるV1,V2,V3,V4
電圧が不安定なことより、出力データが正常に液晶表示
装置上に表示されず、一般的にコンデンサCへチャージ
アップが十分行なわれるまでの期間、液晶表示装置は正
常な画面を表示できないこともある。
Further, as shown in FIG. 1, 114 (liquid crystal display device) is 10 (VD) by 108 (voltage select circuit).
D), 21 (V1), 22 (V2), 23 (V3), 2
Since the blinking of the display data is controlled by selecting the potential of 4 (V4) and 15 (V5), when the display ON command is executed from the CPU during this charge-up period, it is supplied to the liquid crystal display device. V1, V2, V3, V4
Since the voltage is unstable, the output data is not normally displayed on the liquid crystal display device, and in general, the liquid crystal display device may not display a normal screen until the capacitor C is sufficiently charged up. is there.

【0006】従来対策の一例としては、CPU側より転
送するコマンドのタイミングを液晶電源回路ONコマン
ド実行から表示ONコマンド実行までの期間をコンデン
サCのチャージアップ期間よりも若干長く設定し、ソフ
ト的に対応していた。
As an example of conventional measures, the timing of the command transferred from the CPU side is set to be slightly longer than the charge-up period of the capacitor C from the execution of the liquid crystal power supply circuit ON command to the execution of the display ON command, so that the software is used. It corresponded.

【0007】[0007]

【発明が解決しようとする課題】上記の従来の方法で
は、コンデンサCの値やLCDドライバICの製造バラ
ツキにより、電源ONコマンドと表示ONコマンドの入
力遅延タイミングが変動するため、マージンを持ちなが
ら最短となるようタイミングを個別に設定するか、また
は人が動作遅延の違和感を感じない時間(数百mS程
度)に一律に設定しなければならないため、コマンド遅
延時間の設定に気を使ったり、CPU側から連続してコ
マンドを転送できず無駄な時間を消費する等の問題があ
った。
In the above-mentioned conventional method, the input delay timing of the power ON command and the display ON command fluctuates due to variations in the value of the capacitor C and manufacturing of the LCD driver IC. Since the timing must be set individually so that it does not feel uncomfortable with the operation delay (several hundreds of ms), it is necessary to pay attention to the command delay time setting and CPU There was a problem that commands could not be continuously transferred from the side and wasteful time was consumed.

【0008】本発明の目的は、コンデンサCの値や製造
バラツキに対してチャージアップする期間を気にせず、
CPU側から連続してコマンドを転送でき、かつ液晶電
源回路ON直後の液晶表示装置の表示誤動作を解消する
液晶電源回路内蔵LCDドライバICの表示制御回路を
提供することにある。
The object of the present invention is not to worry about the value of the capacitor C and the period of charge-up due to manufacturing variations,
It is an object of the present invention to provide a display control circuit of an LCD driver IC with a built-in liquid crystal power supply circuit, which can continuously transfer commands from the CPU side and eliminates a display malfunction of the liquid crystal display device immediately after the liquid crystal power supply circuit is turned on.

【0009】[0009]

【課題を解決するための手段】液晶表示装置を表示する
ための表示制御回路において、前記液晶表示装置に複数
の電位を供給する電源電圧発生回路を有し、前記複数の
電位を検出する検出回路と、前記検出回路の出力と前記
液晶表示装置にデータを表示するのを許可する表示許可
信号との論理をとる論理回路とを備え、前記論理回路の
出力により前記液晶表示装置への電位の供給が制御され
ることを特徴とする。
In a display control circuit for displaying a liquid crystal display device, there is provided a power supply voltage generating circuit for supplying a plurality of potentials to the liquid crystal display device, and a detection circuit for detecting the plurality of potentials. And a logic circuit that takes the logic of the output of the detection circuit and a display permission signal that permits display of data on the liquid crystal display device, and supply of a potential to the liquid crystal display device by the output of the logic circuit. Is controlled.

【0010】さらに検出回路は、基準電圧と前記複数の
電位とを比較する比較回路を有することを特徴とする。
Further, the detection circuit is characterized by having a comparison circuit for comparing a reference voltage with the plurality of potentials.

【0011】あるいは検出回路は、前記複数の電位相互
の電位を比較する比較回路を有することを特徴とする。
Alternatively, the detection circuit has a comparison circuit for comparing the potentials of the plurality of potentials.

【0012】[0012]

【実施例】以下、本発明のLCDドライバICの表示制
御回路の実施例について図面に基づき説明する。
DETAILED DESCRIPTION OF THE PREFERRED EMBODIMENT An embodiment of a display control circuit of an LCD driver IC of the present invention will be described below with reference to the drawings.

【0013】図1は本発明のLCDドライバICの表示
制御回路の一実施例である。外部電源、またはIC内部
で昇圧回路および電圧調整回路等により発生した液晶電
源電圧15(V5)と、10(グランドレベルVDD)
を301,302(抵抗素子R,R’)により分圧し、
液晶表示装置の特性に合った11(V1),12(V
2),13(V3),14(V4)の電圧値を生成す
る。ここで、前記抵抗素子R,R’はポリシリコンやト
ランジスタのオン抵抗を利用してもよく、各抵抗値の整
合がとれることが表示レベルの安定化となる。前記抵抗
素子R,R’により分圧したV1,V2,V3,V4電
位を基準電圧として各々に110(V/F回路)を設け
る。前記V/F回路は、数10kHz程度の表示用クロ
ックを用いているため応答時間は早くある必要はない
が、液晶表示装置を表示するため許容電流は大きい方が
表示面積の大きな液晶表示装置には有利であり、電流供
給能力が高ければ321(外付けコンデンサC)の容量
値は小さくてすむため、液晶電源回路ON時のコンデン
サCのチャージアップ期間は短くて済む。ただし、消費
電流の増大となるため個々のLCDドライバICのター
ゲットに対しサイズを設計する必要がある。
FIG. 1 shows an embodiment of the display control circuit of the LCD driver IC of the present invention. Liquid crystal power supply voltage 15 (V5) and 10 (ground level VDD) generated by an external power supply or a booster circuit, a voltage adjusting circuit, etc. inside the IC
Is divided by 301 and 302 (resistive elements R and R '),
11 (V1), 12 (V) that match the characteristics of the liquid crystal display device
2), voltage values of 13 (V3) and 14 (V4) are generated. Here, the resistance elements R and R'may use the on resistance of polysilicon or a transistor, and the display level is stabilized by matching the resistance values. 110 (V / F circuit) is provided for each of the V1, V2, V3 and V4 potentials divided by the resistance elements R and R'as reference voltages. Since the V / F circuit uses a display clock of about several tens of kHz, it does not have to have a fast response time, but a liquid crystal display device displays a liquid crystal display device having a larger allowable current and a larger display area. If the current supply capacity is high, the capacitance value of 321 (external capacitor C) can be small, so that the charge-up period of the capacitor C when the liquid crystal power supply circuit is ON can be short. However, since the current consumption increases, it is necessary to design the size for the target of each LCD driver IC.

【0014】前記110(V/F回路)の各出力の一つ
は108(電圧セレクト回路)へ、一つは103(コン
パレータ回路)へ、もう一つは209(外部出力端子)
へ各々接続する。
One of the outputs of the 110 (V / F circuit) is to 108 (voltage select circuit), one is to 103 (comparator circuit), and the other is 209 (external output terminal).
Connect to each.

【0015】209(外部出力端子)へは、321(外
付けコンデンサC)を接続する。前記321(外付けコ
ンデンサC)の目的は、液晶表示装置の電力が前記11
0(V/F回路)の能力を越えた場合に電力を補うため
に設けるものであり、容量値は液晶表示装置の容量によ
り個々に設定される。中小容量の液晶表示装置の場合、
C=0.01〜10μF程度を選択する。
A reference numeral 321 (external capacitor C) is connected to 209 (external output terminal). The purpose of the 321 (external capacitor C) is to increase the power of the liquid crystal display device to the
It is provided to supplement the electric power when the capacity of 0 (V / F circuit) is exceeded, and the capacitance value is individually set by the capacitance of the liquid crystal display device. For small and medium capacity LCDs,
C = about 0.01 to 10 μF is selected.

【0016】前記103(コンパレータ回路)は、図2
にコンパレート回路の第一の実施例を示す。図2におい
て、前記10(VDD)と15(V5)間に抵抗素子3
11(r1),312(r2),313(r3),31
4(r4),315(r5)を設け分圧し、31(V
1’),32(V2’),33(V3’),34(V
4’)の各電圧値を得る。ここで、抵抗素子r1,r
2,r3,r4,r5は、前記抵抗素子R,R’と整合
をとるために抵抗素子R,R’と同一構造の抵抗素子と
する。
The 103 (comparator circuit) is shown in FIG.
The first embodiment of the comparator circuit is shown in FIG. In FIG. 2, the resistance element 3 is provided between the 10 (VDD) and 15 (V5).
11 (r1), 312 (r2), 313 (r3), 31
4 (r4) and 315 (r5) are provided and the voltage is divided to 31 (V
1 '), 32 (V2'), 33 (V3 '), 34 (V
4 ') Each voltage value is obtained. Here, the resistance elements r1 and r
2, r3, r4, and r5 are resistance elements having the same structure as the resistance elements R and R'for matching with the resistance elements R and R '.

【0017】前記V1’,V2’,V3’,V4’電位
は各々前記21(V1),22(V2),23(V
3),24(V4)電位とコンパレートするため、各々
にコンパレート回路を設け、V1とV1’,V2とV
2’,V3とV3’,V4とV4’を比較し、(V1>
V1’)*(V2>V2’)*(V3>V3’)*(V
4>V4’)となったとき論理が真となるよう、各コン
パレート回路の出力を112(4入力AND回路)の各
入力端子へ接続する。
The V1 ', V2', V3 'and V4' potentials are 21 (V1), 22 (V2) and 23 (V, respectively).
3) and 24 (V4) potentials, a comparator circuit is provided for each of them, and V1 and V1 ′, V2 and V are provided.
2 ', V3 and V3', V4 and V4 'are compared, and (V1>
V1 ') * (V2>V2') * (V3> V3 ') * (V
The output of each comparator circuit is connected to each input terminal of 112 (four-input AND circuit) so that the logic becomes true when 4> V4 ′).

【0018】ここで、前記各抵抗素子の抵抗値は、製造
バラツキに影響されずV1≧V1’,V2≧V2’,V
3≧V3’,V4≧V4’の関係が保てるよう設定する
必要がある。例えば図1においてR=R’とした場合、
r1<R,r2=r3=r4=R,r5>R,r1+r
5=2・Rと設定すればよい。
Here, the resistance value of each of the resistance elements is not affected by manufacturing variations, and V1 ≧ V1 ′, V2 ≧ V2 ′, V
It is necessary to set so that the relationship of 3 ≧ V3 ′ and V4 ≧ V4 ′ can be maintained. For example, when R = R 'in FIG.
r1 <R, r2 = r3 = r4 = R, r5> R, r1 + r
It is sufficient to set 5 = 2 · R.

【0019】r1とRの抵抗値の差は製造バラツキを考
慮したものであるが、同一チップ上に同一構造で形成す
る抵抗素子であれば、各抵抗値の整合はとりやすく、必
要以上にr1とRの差を持たせる必要はない。
The difference between the resistance values of r1 and R is due to manufacturing variations. However, if the resistance elements are formed on the same chip with the same structure, it is easy to match the resistance values, and r1 is more than necessary. It is not necessary to have a difference between R and R.

【0020】r1<Rの抵抗値の差によるV1,V2,
V3,V4のコンパレート回路による判定レベルへの影
響を考えた場合、V1,V2,V3,V4の各電圧値は
100%立ち上がる必要はなく、V1,V2,V3,V
4電位の順位がほぼ保たれていれば液晶表示装置は誤動
作表示は起こさないため、V1,V2,V3,V4の電
位は最終値の90%程度で十分である。よって、r1=
0.9・R程度に設定できる。
V1, V2 due to the difference in the resistance value of r1 <R
Considering the influence of the comparator circuit of V3 and V4 on the judgment level, it is not necessary for each voltage value of V1, V2, V3 and V4 to rise 100%, and V1, V2, V3 and V4
If the order of the four potentials is substantially maintained, the liquid crystal display device does not cause malfunction display, and therefore the potentials of V1, V2, V3, and V4 may be about 90% of the final value. Therefore, r1 =
It can be set to about 0.9 · R.

【0021】次に、図1において104(CPU)より
201(外部データバス)を介して転送された表示ON
コマンドは105(CPUインタフェース)を介し、内
部データバスを介して106(デコーダ)により203
(表示ONコマンド信号)を発生する。該203(表示
ONコマンド信号)と、前記103(コンパレート回
路)により生成された出力204とを、107(2入力
AND回路)により論理積をとる。液晶電源回路ONコ
マンド実施後、21(V1),22(V2),23(V
3),24(V4)電位レベルが103(コンパレート
回路)により真となったとき、203(表示ONコマン
ド信号)との論理積により、107(AND回路)より
205(表示ON信号レベル)が108(電圧セレクト
回路)に送られる。
Next, in FIG. 1, the display ON is transferred from 104 (CPU) via 201 (external data bus).
Commands are sent via 105 (CPU interface) and via internal data bus by 106 (decoder).
(Display ON command signal) is generated. The 203 (display ON command signal) and the output 204 generated by the 103 (comparator circuit) are logically ANDed by 107 (2-input AND circuit). After executing the liquid crystal power supply circuit ON command, 21 (V1), 22 (V2), 23 (V
3), When the potential level of 24 (V4) becomes true by 103 (comparator circuit), 205 (display ON signal level) is output from 107 (AND circuit) by the logical product with 203 (display ON command signal). 108 (voltage select circuit).

【0022】前記108(電圧セレクト回路)は、前記
各電圧値10(VDD),21(V1),22(V
2),23(V3),24(V4),15(V5)を2
06(表示クロック信号)に同期して、また表示データ
の有無によって各電圧レベルを109(出力ドライバ回
路)に選択的に供給する。加えて、108(電圧セレク
ト回路)においては、液晶電源ONコマンド実行時に2
05(表示ON信号)が入力されるまでの期間、出力ド
ライバ回路への各供給電位は10(VDD)レベルと
し、液晶表示装置が誤表示しないよう各電位を固定して
いる。205(表示ON信号)が入力されると同時に1
09(出力ドライバ回路)へ所定の電位を供給し、11
4(液晶表示装置)の動作が可能となる。
The 108 (voltage select circuit) has the voltage values 10 (VDD), 21 (V1) and 22 (V).
2), 23 (V3), 24 (V4), 15 (V5) 2
Each voltage level is selectively supplied to 109 (output driver circuit) in synchronization with 06 (display clock signal) and depending on the presence or absence of display data. In addition, in 108 (voltage select circuit), when the liquid crystal power ON command is executed, 2
Until the input of 05 (display ON signal), each potential supplied to the output driver circuit is set to 10 (VDD) level, and each potential is fixed so that the liquid crystal display device does not erroneously display. 1 when 205 (display ON signal) is input
09 (output driver circuit) is supplied with a predetermined potential,
4 (liquid crystal display device) can be operated.

【0023】以上のような第一の実施例では、V1,V
2,V3,V4電位の各々のV/F回路出力部にコンパ
レート回路を設けたが、クリティカルな電位が設計段階
で明確になっていれば、V1,V2,V3,V4電位す
べてにコンパレート回路を設ける必要はなく、クリティ
カルな電位のV/F回路出力に一カ所のみ設けても同様
の効果を得られ、チップサイズの小型化になる。この場
合、コンパレート回路部の抵抗素子r1,r2,r3,
r4,r5は第一の実施例と同一である。
In the first embodiment as described above, V1, V
Although a comparator circuit was provided at each V / F circuit output section of 2, V3 and V4 potentials, if the critical potential was clarified at the design stage, it would be compared to all V1, V2, V3 and V4 potentials. It is not necessary to provide a circuit, and the same effect can be obtained even if the V / F circuit output of the critical potential is provided at only one place, and the chip size can be reduced. In this case, the resistance elements r1, r2, r3 of the comparator circuit section
r4 and r5 are the same as in the first embodiment.

【0024】また、図1におけるコンパレート回路の第
二の実施例として図4を示す。
FIG. 4 shows a second embodiment of the comparator circuit in FIG.

【0025】コンパレート回路の第一の実施例では、V
1,V2,V3,V4が各々設定の電圧まで達すること
に着眼点を置いて回路を構成したが、図4に示す第二の
実施例においては、液晶電源回路により発生した各電位
V1,V2,V3,V4間で比較し、V1>V2>V3
>V4の関係が成り立つ場合に表示可能状態としてい
る。
In the first embodiment of the comparator circuit, V
1, V2, V3, V4 has been constructed by focusing on the fact that each voltage reaches the set voltage. In the second embodiment shown in FIG. 4, the potentials V1, V2 generated by the liquid crystal power supply circuit are set. , V3 and V4 are compared, V1>V2> V3
When the relationship of> V4 is established, it is in a displayable state.

【0026】図4にコンパレート回路の第二の実施例を
示す。図4において、1つの111(コンパレート回
路)には基準電位を21(V1)、入力電位を22(V
2)とし、V2>V1の関係が成り立つ場合Hレベルを
出力、1つのコンパレート回路には基準電位を22(V
2)、入力電位を23(V3)とし、V3>V2の場合
Hレベルを出力、1つのコンパレート回路には基準電位
を23(V3)、入力電位を24(V4)とし、V4>
V3の場合Hレベルを出力させ、(V1>V2)*(V
2>V3)*(V3>V4)となったとき論理が真とな
るよう、各コンパレート回路の出力を113(3入力A
ND回路)の各入力端子へ接続する。
FIG. 4 shows a second embodiment of the comparator circuit. In FIG. 4, one 111 (comparator circuit) has a reference potential of 21 (V1) and an input potential of 22 (V).
2), the H level is output when the relationship of V2> V1 is established, and the reference potential is 22 (V
2), the input potential is set to 23 (V3), the H level is output when V3> V2, the reference potential is set to 23 (V3) and the input potential is set to 24 (V4) for one comparator circuit, and V4>
In case of V3, H level is output and (V1> V2) * (V
The output of each comparator circuit is set to 113 (3 inputs A) so that the logic becomes true when 2> V3) * (V3> V4).
ND circuit) to each input terminal.

【0027】103(コンパレート回路ブロック)以外
の接続・動作は、コンパレート回路の第一の実施例と同
一である。
The connection and operation other than 103 (comparator circuit block) are the same as those in the first embodiment of the comparator circuit.

【0028】コンパレート回路の第二の実施例では、V
1>V2>V3>V4の関係が成り立つ場合、表示誤動
作は起きにくいことに、着眼点を置き回路を構成してい
る。
In a second embodiment of the comparator circuit, V
When the relationship of 1>V2>V3> V4 is established, the display malfunction is less likely to occur, and the circuit is configured with a focus on it.

【0029】この場合、各V/F出力電圧が設定電圧V
1,V2,V3,V4に達しない状態で表示可能状態と
なるが、実際には表示誤動作には至らないため問題とは
ならない。
In this case, each V / F output voltage is equal to the set voltage V
The display becomes possible without reaching 1, V2, V3, V4, but this does not cause a problem because a display malfunction does not actually occur.

【0030】[0030]

【発明の効果】以上説明したようにこの発明によれば、
液晶駆動のための複数の電位間に接続されたコンデンサ
Cの容量値によらず、表示ONコマンド実行後最短時間
で液晶表示装置が表示可能状態となる。また、同一チッ
プ上でコンパレート回路を形成するため、製造バラツキ
や環境の変化にもにほとんど影響を受けず確実に動作
し、表示誤動作を解消できる。
As described above, according to the present invention,
Regardless of the capacitance value of the capacitor C connected between the plurality of potentials for driving the liquid crystal, the liquid crystal display device becomes ready for display in the shortest time after execution of the display ON command. Further, since the comparator circuit is formed on the same chip, it can operate reliably without being affected by manufacturing variations and environmental changes, and display malfunctions can be eliminated.

【0031】CPUとのインタフェースにおいては、C
PU側でのコマンド出力待ち状態による無駄な時間をな
くし、連続してコマンドを転送できる効果を有する。
In the interface with the CPU, C
This has the effect of eliminating wasted time due to the command output waiting state on the PU side and being able to transfer commands continuously.

【図面の簡単な説明】[Brief description of drawings]

【図1】本発明の一実施例であるLCDドライバICの
液晶電源回路と表示制御回路の回路図。
FIG. 1 is a circuit diagram of a liquid crystal power supply circuit and a display control circuit of an LCD driver IC that is an embodiment of the present invention.

【図2】コンパレート回路の第一の実施例を示す回路
図。
FIG. 2 is a circuit diagram showing a first embodiment of a comparator circuit.

【図3】コンパレート回路の第一の実施例での液晶電源
回路オン後のV1,V2,V3,V4電位推移図。
FIG. 3 is a potential transition diagram of V1, V2, V3, and V4 after the liquid crystal power supply circuit is turned on in the first embodiment of the comparator circuit.

【図4】コンパレート回路の第二の実施例を示す回路
図。
FIG. 4 is a circuit diagram showing a second embodiment of a comparator circuit.

【図5】コンパレート回路の第二の実施例での液晶電源
回路オン後のV1,V2,V3,V4電位推移図。
FIG. 5 is a potential transition diagram of V1, V2, V3, and V4 after the liquid crystal power supply circuit is turned on in the second embodiment of the comparator circuit.

【図6】従来の液晶電源回路の回路図。FIG. 6 is a circuit diagram of a conventional liquid crystal power supply circuit.

【図7】液晶電源回路オン後のV1,V2,V3,V4
電位推移図。
FIG. 7 shows V1, V2, V3 and V4 after the liquid crystal power supply circuit is turned on.
Potential transition diagram.

【符号の説明】[Explanation of symbols]

10はVDD(グランド)、11は分圧電位V1、12
は分圧電位V2、13は分圧電位V3、14は分圧電位
V4、15はV5(液晶電源電圧)、21はV/F回路
出力電位V1、22はV/F回路出力電位V2、23は
V/F回路出力電位V3、24はV/F回路出力電位V
4、31はコンパレータ基準電位V1、32はコンパレ
ータ基準電位V2、33はコンパレータ基準電位V3、
34はコンパレータ基準電位V4、101は分圧回路、
102はV/F回路ブロック、103はコンパレート回
路ブロック、104はCPU、105はCPUインタフ
ェース、106はコマンドデコーダ、107は2入力A
ND、108は電圧セレクト回路ブロック、109は出
力ドライバ回路ブロック、110はV/F回路、111
はコンパレート回路、112は4入力AND、113は
3入力AND、114は液晶表示装置、115は基準電
圧回路、201は外部データバス、202は内部データ
バス、203は表示ONコマンド信号、204はコンパ
レート回路出力信号、205は表示ON/OFF信号、
206は表示タイミング用クロック信号、207は出力
ドライバ供給電位、208は液晶表示駆動電圧、209
は外部出力端子、301は分割抵抗R、302は分割抵
抗R’、311は分割抵抗r1、312は分割抵抗r
2、313は分割抵抗r3、314は分割抵抗r4、3
15は分割抵抗r5、321は外付けコンデンサC。
10 is VDD (ground), 11 is divided potential V1, 12
Is a divided potential V2, 13 is a divided potential V3, 14 is a divided potential V4, 15 is V5 (liquid crystal power supply voltage), 21 is a V / F circuit output potential V1, 22 is a V / F circuit output potential V2, 23 Is V / F circuit output potential V3, 24 is V / F circuit output potential V
4, 31 are comparator reference potentials V1, 32 are comparator reference potentials V2, 33 are comparator reference potentials V3,
34 is a comparator reference potential V4, 101 is a voltage dividing circuit,
102 is a V / F circuit block, 103 is a comparator circuit block, 104 is a CPU, 105 is a CPU interface, 106 is a command decoder, and 107 is a 2-input A.
ND, 108 is a voltage select circuit block, 109 is an output driver circuit block, 110 is a V / F circuit, 111
Is a comparator circuit, 112 is a 4-input AND, 113 is a 3-input AND, 114 is a liquid crystal display device, 115 is a reference voltage circuit, 201 is an external data bus, 202 is an internal data bus, 203 is a display ON command signal, and 204 is Comparator circuit output signal, 205 is a display ON / OFF signal,
Reference numeral 206 is a display timing clock signal, 207 is an output driver supply potential, 208 is a liquid crystal display drive voltage, 209
Is an external output terminal, 301 is a dividing resistor R, 302 is a dividing resistor R ', 311 is a dividing resistor r1, 312 is a dividing resistor r.
2, 313 are division resistors r3, 314 are division resistors r4, 3
Reference numeral 15 is a dividing resistor r5, and 321 is an external capacitor C.

Claims (3)

【特許請求の範囲】[Claims] 【請求項1】液晶表示装置を表示するための表示制御回
路において、前記液晶表示装置に複数の電位を供給する
電源電圧発生回路を有し、 前記複数の電位を検出する検出回路と、前記検出回路の
出力と前記液晶表示装置にデータを表示するのを許可す
る表示許可信号との論理をとる論理回路とを備え、前記
論理回路の出力により前記液晶表示装置への電位の供給
が制御されることを特徴とする表示制御回路。
1. A display control circuit for displaying a liquid crystal display device, comprising a power supply voltage generation circuit for supplying a plurality of potentials to the liquid crystal display device, a detection circuit for detecting the plurality of potentials, and the detection circuit. A logic circuit that takes the logic of an output of the circuit and a display permission signal that permits display of data on the liquid crystal display device is provided, and supply of a potential to the liquid crystal display device is controlled by the output of the logic circuit. A display control circuit characterized by the above.
【請求項2】前記検出回路は、基準電圧と前記複数の電
位とを比較する比較回路を有することを特徴とする請求
項1記載の表示制御回路。
2. The display control circuit according to claim 1, wherein the detection circuit has a comparison circuit that compares a reference voltage with the plurality of potentials.
【請求項3】前記検出回路は、前記複数の電位相互の電
位を比較する比較回路を有することを特徴とする請求項
1記載の表示制御回路。
3. The display control circuit according to claim 1, wherein the detection circuit has a comparison circuit for comparing the potentials of the plurality of potentials.
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Cited By (4)

* Cited by examiner, † Cited by third party
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JP2001166726A (en) * 1999-12-10 2001-06-22 Sharp Corp Display device and driver to be used for the device
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WO2004047068A1 (en) * 2002-11-21 2004-06-03 Toshiba Matsushita Display Technology Co., Ltd. Voltage generator circuit
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