JPH0125353Y2 - - Google Patents
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- Publication number
- JPH0125353Y2 JPH0125353Y2 JP1983026924U JP2692483U JPH0125353Y2 JP H0125353 Y2 JPH0125353 Y2 JP H0125353Y2 JP 1983026924 U JP1983026924 U JP 1983026924U JP 2692483 U JP2692483 U JP 2692483U JP H0125353 Y2 JPH0125353 Y2 JP H0125353Y2
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- JP
- Japan
- Prior art keywords
- alarm
- latch
- stop switch
- logic
- input
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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- 206010041349 Somnolence Diseases 0.000 description 2
- 238000010586 diagram Methods 0.000 description 1
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- Electric Clocks (AREA)
Description
【考案の詳細な説明】
従来の目覚し時計はアラームを止めるスイツチ
が一つしかないので、すつかり目を覚まさなくて
も手探でアラームを止めることができる。[Detailed explanation of the invention] Conventional alarm clocks have only one switch to turn off the alarm, so you can turn off the alarm without having to wake up.
本考案は上記の欠点を除去することを目的とす
る。 The present invention aims to eliminate the above drawbacks.
本考案は目覚し時計に複数個のアラーム停止ス
イツチ１を設け、そのスイツチを指定する表示器
を設け、その表示器が一定時間たとえば0.5秒だ
け表示し、順次そのアラーム停止スイツチを指定
する情報が変更表示され、その表示器が指定する
アラーム停止スイツチ１のタイミングを取つて１
つだけ押した時にアラームが停止するようにした
目覚し時計で、以下実施例を示す図面に基いて説
明すると、表示器は７セグメント表示器９や発光
ダイオード６を用い、７セグメント表示器９の時
はアラーム停止スイツチに番号を打ち、発光ダイ
オード６の時はアラーム停止スイツチ１に各一個
ずつ発光ダイオード６を併設する。 In the present invention, an alarm clock is provided with a plurality of alarm stop switches 1, and a display device for specifying the switches is provided.The display device displays for a certain period of time, for example, 0.5 seconds, and the information specifying the alarm stop switch is sequentially changed. is displayed, and the alarm stop switch 1 is set at the timing specified by the display.
This is an alarm clock that stops the alarm when only one button is pressed.The following explanation will be given based on the drawings showing the embodiment. A number is stamped on the alarm stop switch, and when a light emitting diode 6 is used, one light emitting diode 6 is attached to each alarm stop switch 1.
パルス発生装置３のパルスをＴフリツプフロツ
プ８でカウントしそのカウント出力を７セグメン
トドライバ４又は、デマルチプレクサ５のセレク
ト入力に入力する。７セグメントドライバ４は７
セグメント表示器９に接続する。デマルチプレク
サ５のデーター入力はアースし、出力には発光ダ
イオード６を接続してプラス電源につなぐ。 Pulses from the pulse generator 3 are counted by a T flip-flop 8, and the count output is inputted to a 7-segment driver 4 or a select input of a demultiplexer 5. 7 segment driver 4 is 7
Connect to segment display 9. The data input of the demultiplexer 5 is grounded, and the output is connected to a light emitting diode 6 and connected to a positive power source.
アラームスイツチ１８は時計内のスイツチでア
ラームを鳴らしたい時になるとスイツチが入るの
で、常時オフであるから１１２は理論「０」でバ
ツフア２６でＲ−Ｓラツチ２０とＲ−Ｓラツチ２
５をリセツトし、Ｒ−Ｓラツチ２２をセツトして
Ｒ−Ｓラツチ２２のが論理「０」でトランジス
タ２７が作動せず、リレー２３とアラーム７も作
動しないのでアラームが鳴らない。 Alarm switch 18 is a switch inside the clock and is turned on when you want to sound the alarm, so it is always off, so 112 is theoretically "0" and buffer 26 is connected to R-S latch 20 and R-S latch 2.
5 and sets the R-S latch 22. Since the R-S latch 22 is logic "0" and the transistor 27 is not activated, the relay 23 and the alarm 7 are also not activated, so the alarm does not sound.
アラームスイツチ１８がオンになるとＲ−Ｓラ
ツチ２５はすでにリセツトされているのでAND
ゲート２４の出力１１３が論理「１」になつてＲ
−Ｓラツチ２５をセツトしＲ−Ｓラツチ２２をリ
セツトする。Ｒ−Ｓラツチ２２のが論理「１」
となる。 When the alarm switch 18 is turned on, the R-S latch 25 has already been reset, so the AND
The output 113 of the gate 24 becomes logic “1” and R
-S latch 25 is set and R-S latch 22 is reset. R-S latch 22 is logic “1”
becomes.
アラームセツトスイツチ１７がオンであると
ANDゲート１９を通つてＲ−Ｓラツチ２０はセ
ツトされるので１１０は論理「０」になるのでＲ
−Ｓラツチ２２はセツトされないのでアラームを
鳴らす。 If alarm set switch 17 is on
Since R-S latch 20 is set through AND gate 19, 110 becomes logic "0", so R
-S latch 22 is not set, so an alarm sounds.
アラームセツトスイツチ１７がオフであるとＲ
−Ｓラツチ２０はセツトされずＲ−Ｓラツチ２０
のの論理は「１」で１１０は論理「１」で１１
１も論理「１」でありＲ−Ｓラツチ２２はセツト
されるのでアラームが鳴らない。 If the alarm set switch 17 is off, R
-S latch 20 is not set and R-S latch 20
The logic of 'is 1' and 110 is the logic '1' which is 11
1 is also a logic "1" and the R-S latch 22 is set, so the alarm does not sound.
アラームセツトスイツチ１７とアラームスイツ
チ１８がともにオンであるとＲ−Ｓラツチ２０を
セツトするのでアラームが鳴つた後にアラームセ
ツトスイツチ１７をオフにしてもアラームは止ま
らない。 If both the alarm set switch 17 and the alarm switch 18 are on, the R-S latch 20 is set, so even if the alarm set switch 17 is turned off after the alarm sounds, the alarm will not stop.
Ｒ−Ｓラツチ１１をリセツト状態にしておくと
１００は論理「１」になる。ここでアラーム停止
スイツチ１を押すと１０３が論理「１」になる。
ANDゲート１０の出力は論理「０」になる。だ
からアラーム停止スイツチ１を一回押した後は何
回押しても１０１は論理「１」にはならないの
で、連続して１つのアラーム停止スイツチ１をオ
ン，オフとくり返してそのアラーム停止スイツチ
１に表示器が指定した時にアラームが停止してし
まうことを防ぐ。 With R-S latch 11 in the reset state, 100 becomes a logic "1". If alarm stop switch 1 is pressed here, 103 becomes logic "1".
The output of AND gate 10 will be a logic "0". Therefore, after pressing alarm stop switch 1 once, 101 will not become logic "1" no matter how many times you press it, so you can repeatedly turn one alarm stop switch 1 on and off, and the alarm will be displayed on that alarm stop switch 1. Prevents the alarm from stopping when the device specifies it.
Ｔフリツプフロツプ８のカウント出力をデマル
チプレクサ／マルチプレクサ１２のセレクト入力
に入力する。デマルチプレクサ／マルチプレクサ
１２のｘ出力にはＴフリツプフロツプ８のカウン
ト出力の指定するアラーム停止スイツチ１の出力
のみが出力される。Ｙ入力はプラス電源に継が
れ、Ｙ０〜３出力は指定されたピンのみが論理
「１」になる。 The count output of T flip-flop 8 is input to the select input of demultiplexer/multiplexer 12. Only the output of the alarm stop switch 1 designated by the count output of the T flip-flop 8 is output to the x output of the demultiplexer/multiplexer 12. The Y input is connected to the positive power supply, and only the designated pins of the Y0-3 outputs become logic "1".
XOに入力するＲ−Ｓラツチ１１のリセツトへ
Ｙ１の出力が入力され、Ｘ１に入力するＲ−Ｓラ
ツチ１１のリセツトへＹ２の出力が入力され、Ｘ
２に入力するＲ−Ｓラツチ１１のリセアトへＹ３
の出力が入力され、Ｘ３に入力するＲ−Ｓラツチ
１１のリセツトへＹ０の出力が入力される。 The output of Y1 is input to the reset of the R-S latch 11 input to XO, the output of Y2 is input to the reset of the R-S latch 11 input to X1, and the output of Y2 is input to the reset of the R-S latch 11 input to X1.
2 to reset the R-S latch 11 Y3
The output of Y0 is input to the reset of the R-S latch 11 which is input to X3.
Ｙ０〜３出力はバツフアー１３を通つてAND
ゲート１４へ入力される。ここで、指定されたピ
ンにつながつた１０４だけ論理「０」になる。だ
から、指定されたアラーム停止スイツチ１を押し
て１０２を論理「１」にしても１０６は論理
「０」である。しかし、指定されていないピンと
つながつた１０４は論理「１」であるので、指定
されていないアラーム停止スイツチ１を押すと１
０６は論理「１」になる。 Y0~3 output is ANDed through buffer 13
It is input to gate 14. Here, only 104 connected to the designated pin becomes logic "0". Therefore, even if the designated alarm stop switch 1 is pressed to set 102 to logic "1", 106 remains logic "0". However, since 104 connected to an unspecified pin is logic "1", if you press the unspecified alarm stop switch 1, the alarm will turn 1.
06 becomes logic "1".
ANDゲート１４の出力はNORゲート１５に入
力され１０７は論理「０」になる。よつて、Ｒ−
Ｓラツチ２２がセツトされずアラームは停止しな
いので、複数のアラーム停止スイツチ１を複数個
同時に押してアラームを停止させることはできな
い。 The output of AND gate 14 is input to NOR gate 15 and 107 becomes logic "0". Therefore, R-
Since the S latch 22 is not set and the alarm does not stop, the alarm cannot be stopped by pressing a plurality of alarm stop switches 1 at the same time.
本考案は、上記のようなことから所期の目的を
有効に達成したもので、特に、表示器に時々刻々
と変更表示される情報に対応するアラーム停止ス
イツチをタイミングを取りながら、１つだけ１回
押すことによつて目覚し時計のアラームを停止さ
せることが出来る。このことによつて寝惚け眼で
は、タイミングを取るのが難しく、目覚めていな
ければアラームの停止が出来ないので自然に目覚
めて来る。 The present invention has effectively achieved the intended purpose based on the above-mentioned factors.In particular, by timing the alarm stop switch corresponding to the information that is constantly changing and displayed on the display, only one alarm stop switch can be activated. By pressing once, you can stop the alarm clock alarm. Due to this, it is difficult to get the timing right when you are sleepy-eyed, and you cannot stop the alarm unless you are awake, so you will wake up naturally.
また、表示はたえず変化して表示されているの
で、長年使用しても寝惚け眼では、うまくタイミ
ングを取るという馴れは生じにくいので、目覚し
の効果はなくならない。 In addition, since the display constantly changes, even after many years of use, it is difficult for sleepy eyes to get used to getting the timing right, so the effect of the alarm does not disappear.
さらに、アラーム停止スイツチを多く設けるこ
とにより表示と該スイツチのタイミングの難易度
は高くなり目覚しの効果も大きくなる。 Furthermore, by providing a large number of alarm stop switches, the display and timing of the switches becomes more difficult and the alarm effect becomes greater.
このように完全に目を覚まさなければ目覚し時
計のアラームは停止出来ないという大きな効果を
奏する。 This has the great effect of not being able to stop the alarm clock unless you completely wake up.
図は本考案の実施例を示す構成図である。
３……パルス発生装置、４……７セグメントド
ライバー、５……デマルチプレクサ、７……アラ
ーム、９……７セグメント表示器、１２……デマ
ルチプレクサ／マルチプレクサ。
The figure is a configuration diagram showing an embodiment of the present invention. 3... Pulse generator, 4... 7 segment driver, 5... Demultiplexer, 7... Alarm, 9... 7 segment display, 12... Demultiplexer/multiplexer.
Claims (1)
対応する表示器を設け、該表示器に上記アラーム
停止スイツチを指定する情報を一定時間順次変更
出力する手段と、該表示器の指定する情報と上記
アラーム停止スイツチの出力が一致した時のみア
ラームを停止する手段を設けたことを特徴とする
目覚し時計。 A required number of alarm stop switches and display devices corresponding to the switches are provided, means for sequentially changing and outputting information specifying the alarm stop switch for a certain period of time on the display device, and a means for sequentially changing and outputting information specifying the alarm stop switch on the display device, and displaying the information specified by the display device and the alarm stop switch. An alarm clock characterized by having a means for stopping an alarm only when the outputs of the switches match.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2692483U JPS59134094U (en) | 1983-02-24 | 1983-02-24 | alarm clock |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2692483U JPS59134094U (en) | 1983-02-24 | 1983-02-24 | alarm clock |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS59134094U JPS59134094U (en) | 1984-09-07 |
| JPH0125353Y2 true JPH0125353Y2 (en) | 1989-07-28 |
Family
ID=30157825
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2692483U Granted JPS59134094U (en) | 1983-02-24 | 1983-02-24 | alarm clock |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59134094U (en) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0453597Y2 (en) * | 1987-01-14 | 1992-12-16 |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS585690A (en) * | 1981-07-01 | 1983-01-13 | Sharp Corp | Electronic timepiece with alarm |
-
1983
- 1983-02-24 JP JP2692483U patent/JPS59134094U/en active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS585690A (en) * | 1981-07-01 | 1983-01-13 | Sharp Corp | Electronic timepiece with alarm |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS59134094U (en) | 1984-09-07 |
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