JP5855453B2 - In-vehicle memory processor - Google Patents

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Description

本発明は、自動車などの車両に搭載される車載用記憶処理装置に関する。   The present invention relates to an in-vehicle storage processing device mounted on a vehicle such as an automobile.

自動車のエンジンやブレーキの制御において、制御に必要なデータは、たとえば、電子制御ユニット(ECU)に内蔵されたRAMに一時的に保持される。RAMに保持されているデータにエラー(異常)が生じると、制御が不安定になったり、最悪の場合には、制御が不能になったりする。たとえば、エンジンやブレーキの制御が不安定または不能になると、自動車の安全な走行に影響が出る。そのため、自動車では、データのエラーに対するフェイルセーフが重要である。   In the control of automobile engines and brakes, data necessary for control is temporarily stored in, for example, a RAM built in an electronic control unit (ECU). If an error (abnormality) occurs in the data held in the RAM, the control becomes unstable, or the control becomes impossible in the worst case. For example, if the control of the engine or brake becomes unstable or impossible, safe driving of the automobile is affected. Therefore, fail-safe against data errors is important in automobiles.

データのエラーを検出する手法として、たとえば、データをRAMに書き込む際に、互いに隣り合うアドレスの2つの記憶領域に同一のデータを書き込むか、または、互いに隣り合うアドレスの2つの記憶領域に本来のデータと本来のデータを反転させたミラーデータとを書き込み、データを使用する際に、その2つの記憶領域に記憶されているデータを比較することにより、それらのデータが正常であるか異常であるかを判定する手法がある。   As a method for detecting a data error, for example, when data is written in a RAM, the same data is written in two storage areas at addresses adjacent to each other, or the original data is written in two storage areas at addresses adjacent to each other. When data is written and mirror data obtained by inverting the original data and the data is used, the data stored in the two storage areas are compared to determine whether the data is normal or abnormal There is a method to determine whether.

特開2006−163811号公報JP 2006-163811 A

しかしながら、RAMにデータを書き込むプログラムとは別のプログラムの暴走により、互いに隣り合うアドレスの2つの記憶領域に記憶されているデータの書換えが行われるおそれがある。このような書換えが行われると、もはやデータのエラーを検出することはできない。   However, there is a possibility that data stored in two storage areas at addresses adjacent to each other may be rewritten due to runaway of a program different from the program that writes data to the RAM. When such rewriting is performed, data errors can no longer be detected.

本発明の目的は、データのエラーを確実に検出することができる、車載用記憶処理装置を提供することである。   An object of the present invention is to provide an in-vehicle storage processing device capable of reliably detecting data errors.

前記の目的を達成するため、本発明に係る車載用記憶処理装置は、複数の記憶領域を有する記憶媒体と、車両に搭載された機器を制御するための第1プログラムの実行時に、前記第1プログラムで使用されるデータと当該データの正常/異常を判定するための判定用のデータとを1組として、その組をなすデータを前記記憶領域に書き込み、当該記憶領域から少なくとも1個の前記記憶領域を隔てた前記記憶領域に当該組をなすデータと同一のデータを書き込む第1書込み手段と、車両に搭載された機器を制御するための第2プログラムの実行時に、前記第2プログラムで使用されるデータと当該データの正常/異常を判定するための判定用のデータとを1組として、その組をなすデータを前記記憶領域に書き込み、当該記憶領域に連続する前記記憶領域に当該組をなすデータと同一のデータを書き込む第2書込み手段とを含む。 In order to achieve the above object, an in-vehicle storage processing device according to the present invention includes a storage medium having a plurality of storage areas and a first program for controlling a device mounted on a vehicle. Data used in the program and data for determination for determining normality / abnormality of the data are set as one set, and the data constituting the set is written to the storage area, and at least one of the storages from the storage area Used in the second program when executing the first writing means for writing the same data as the data forming the set in the storage area separated from the area and the second program for controlling the device mounted on the vehicle. that data and the data for determining for determining the normal / abnormal of the data as one set, the write data constituting the set in the storage area, contiguous to the storage area Serial and a second writing means for writing the data of the same data constituting the assembled in a storage area.

車両に搭載された機器を制御するための第1プログラムの実行時には、第1プログラムで使用されるデータと当該データの正常/異常を判定するための判定用のデータとを1組として、その組をなすデータが互いに少なくとも1個の記憶領域を隔てた記憶領域に書き込まれる。 When the first program for controlling equipment mounted on the vehicle is executed, the data used in the first program and the determination data for determining normality / abnormality of the data are regarded as one set. Are written in storage areas that are separated from each other by at least one storage area .

一方、車両に搭載された機器を制御するための第2プログラムの実行時には、第2プログラムで使用されるデータと当該データの正常/異常を判定するための判定用のデータとを1組として、その組をなすデータが互いに連続する記憶領域に書き込まれる。 On the other hand, when executing the second program for controlling the device mounted on the vehicle, the data used in the second program and the determination data for determining normality / abnormality of the data are taken as one set. The data forming the set is written in storage areas that are continuous with each other.

そのため、第2プログラムが暴走して、第1プログラムで使用されるデータまたはそのデータと組をなす判定用のデータが記憶されている記憶領域が書き換えられた場合、その記憶領域に書き込まれたデータと組をなすデータは、当該記憶領域に連続する記憶領域に書き込まれる。したがって、第2プログラムが暴走しても、第1プログラムで使用されるデータまたはそのデータと組をなす判定用のデータの両方が書き換えられることを防止できる。 Therefore, when the second program runs away and the storage area in which the data used in the first program or the data for determination that is paired with that data is stored is rewritten, the data written in the storage area The data paired with is written in a storage area continuous with the storage area. Therefore, even if the second program runs out of control, it is possible to prevent both the data used in the first program or the data for determination forming a pair with the data from being rewritten.

また、第1プログラムが暴走して、第2プログラムで使用されるデータまたはそのデータと組をなす判定用のデータが記憶されている記憶領域が書き換えられた場合、その記憶領域に書き込まれたデータと組をなすデータは、当該記憶領域から少なくとも1個の記憶領域を隔てた記憶領域に書き込まれる。したがって、第1プログラムが暴走しても、第2プログラムで使用されるデータまたはそのデータと組をなす判定用のデータの両方が書き換えられることを防止できる。 In addition, when the first program runs out of control and the storage area storing the data used in the second program or the data for determination that is paired with the data is rewritten, the data written in the storage area The data paired with is written in a storage area that is separated from the storage area by at least one storage area . Therefore, even if the first program runs away, it is possible to prevent both the data used in the second program or the data for determination forming a pair with the data from being rewritten.

よって、第1プログラムで使用されるデータが記憶される記憶領域およびその記憶領域から少なくとも1個の記憶領域を隔てた記憶領域からデータを読み出して、それらのデータを比較することにより、データのエラーを確実に検出することができる。 Therefore, by reading data from a storage area in which data used in the first program is stored and a storage area that is separated from the storage area by at least one storage area, and comparing the data, data errors Can be reliably detected.

また、第2プログラムで使用されるデータが記憶される記憶領域およびその記憶領域に連続する記憶領域からデータを読み出して、それらのデータを比較することにより、データのエラーを確実に検出することができる。 In addition, it is possible to reliably detect data errors by reading data from a storage area in which data used in the second program is stored and a storage area continuous with the storage area and comparing the data. it can.

記憶領域に対するデータの書込みおよび読出しを行うマイクロコンピュータに記憶領域を監視するハードウエアを追加することによっても、データのエラーの検出が可能になる。しかしながら、そのハードウエアを追加すると、マイクロコンピュータのコストが高くつく。   Data errors can also be detected by adding hardware for monitoring the storage area to a microcomputer that writes and reads data to and from the storage area. However, adding the hardware increases the cost of the microcomputer.

本発明の構成では、記憶領域を監視するハードウエアが不要であるので、コストアップを抑制することができる。   In the configuration of the present invention, hardware for monitoring the storage area is unnecessary, so that an increase in cost can be suppressed.

本発明によれば、安価な構成で、データのエラーを確実に検出することができる。そして、データのエラーを確実に検出できるので、データのエラーに対するフェイルセーフを確実に実行することができる。   According to the present invention, it is possible to reliably detect data errors with an inexpensive configuration. Since a data error can be reliably detected, fail-safe against the data error can be reliably executed.

図1は、本発明の一実施形態に係る電子制御ユニットの構成を示すブロック図である。FIG. 1 is a block diagram showing a configuration of an electronic control unit according to an embodiment of the present invention. 図2は、プログラムAの実行時におけるRAMへのデータの書込みの一例を示す図である。FIG. 2 is a diagram illustrating an example of writing data to the RAM when the program A is executed. 図3は、プログラムBの実行時におけるRAMへのデータの書込みの一例を示す図である。FIG. 3 is a diagram illustrating an example of writing data to the RAM when the program B is executed. 図4は、プログラムBの暴走時におけるRAMへのデータの書込みの一例を示す図である。FIG. 4 is a diagram illustrating an example of writing data to the RAM when the program B runs out of control. 図5は、RAMに記憶されているデータの不所望な書換えの他の例を示す図である。FIG. 5 is a diagram illustrating another example of undesired rewriting of data stored in the RAM.

以下では、本発明の実施の形態について、添付図面を参照しつつ詳細に説明する。   Hereinafter, embodiments of the present invention will be described in detail with reference to the accompanying drawings.

図1は、本発明の一実施形態に係る電子制御ユニットの構成を示すブロック図である。   FIG. 1 is a block diagram showing a configuration of an electronic control unit according to an embodiment of the present invention.

電子制御ユニット1は、自動車などの車両に搭載されたエンジンやバッテリなどの機器を制御するためのものである。電子制御ユニット1は、CPU2、ROM3およびRAM4を含む。ROM3には、機器の制御のためのプログラムAおよびプログラムBが格納されている。RAM4は、CPU2がプログラムAおよびプログラムBを実行する際に、データを一時的に保存するワークエリアを提供する。   The electronic control unit 1 is for controlling equipment such as an engine and a battery mounted on a vehicle such as an automobile. The electronic control unit 1 includes a CPU 2, a ROM 3 and a RAM 4. The ROM 3 stores programs A and B for device control. The RAM 4 provides a work area for temporarily storing data when the CPU 2 executes the program A and the program B.

図2は、プログラムAの実行時におけるRAMへのデータの書込みの一例を示す図である。   FIG. 2 is a diagram illustrating an example of writing data to the RAM when the program A is executed.

RAM4は、行列状に配置された複数のメモリセル(記憶領域)41を有している。各メモリセル41には、行アドレスおよび列アドレスが割り当てられている。行アドレスおよび列アドレスの指定により、各メモリセル41が特定され、その特定されたメモリセル41に対するデータの書込みおよび読出しを行うことができる。   The RAM 4 has a plurality of memory cells (storage areas) 41 arranged in a matrix. Each memory cell 41 is assigned a row address and a column address. By specifying the row address and the column address, each memory cell 41 is specified, and data can be written to and read from the specified memory cell 41.

CPU2によるプログラムAの実行時には、たとえば、図2に示されるように、RAM4の複数のメモリセル41にデータが書き込まれる。   When the program A is executed by the CPU 2, for example, as shown in FIG. 2, data is written into the plurality of memory cells 41 of the RAM 4.

すなわち、行アドレス「01」および列アドレス「01」のメモリセル41に、識別データである「キーワード1」が書き込まれる。行アドレス「02」および列アドレス「01」のメモリセル41に、プログラムAで使用される「データ1」が書き込まれる。行アドレス「03」および列アドレス「01」のメモリセル41に、識別データである「キーワード2」が書き込まれる。   That is, “keyword 1”, which is identification data, is written into the memory cell 41 at the row address “01” and the column address “01”. “Data 1” used in the program A is written into the memory cell 41 having the row address “02” and the column address “01”. “Keyword 2”, which is identification data, is written into the memory cell 41 at the row address “03” and the column address “01”.

また、行アドレス「01」および列アドレス「04」のメモリセル41に、行アドレス「01」および列アドレス「01」のメモリセル41に書き込まれたデータと同一の「キーワード1」が書き込まれる。行アドレス「02」および列アドレス「04」のメモリセル41に、行アドレス「02」および列アドレス「01」のメモリセル41に書き込まれたデータと同一の「データ1」が書き込まれる。行アドレス「03」および列アドレス「04」のメモリセル41に、行アドレス「03」および列アドレス「01」のメモリセル41に書き込まれたデータと同一の「キーワード2」が書き込まれる。   Further, the same “keyword 1” as the data written in the memory cell 41 with the row address “01” and the column address “01” is written into the memory cell 41 with the row address “01” and the column address “04”. “Data 1”, which is the same as the data written in the memory cell 41 at the row address “02” and the column address “01”, is written into the memory cell 41 at the row address “02” and the column address “04”. The same “keyword 2” as the data written in the memory cell 41 at the row address “03” and the column address “01” is written into the memory cell 41 at the row address “03” and the column address “04”.

このように、CPU2によるプログラムAの実行時には、2つの同一のデータがそれぞれ行方向に間隔を空けた2つのメモリセル41に書き込まれる。また、プログラムAで使用される「データ1」がメモリセル41に書き込まれるとともに、そのメモリセル41に対して列方向の両側に連続するメモリセル41に、それぞれ識別データである「キーワード1」および「キーワード2」が書き込まれる。   As described above, when the program A is executed by the CPU 2, two identical data are written in the two memory cells 41 spaced apart in the row direction. In addition, “data 1” used in the program A is written in the memory cell 41, and “keyword 1” as identification data and the memory cell 41 continuous on both sides in the column direction with respect to the memory cell 41, respectively. “Keyword 2” is written.

図3は、プログラムBの実行時におけるRAMへのデータの書込みの一例を示す図である。   FIG. 3 is a diagram illustrating an example of writing data to the RAM when the program B is executed.

CPU2によるプログラムBの実行時には、たとえば、図3に示されるように、RAM4の複数のメモリセル41にデータが書き込まれる。   When the program B is executed by the CPU 2, data is written into the plurality of memory cells 41 of the RAM 4, for example, as shown in FIG. 3.

すなわち、行アドレス「03」および列アドレス「02」のメモリセル41に、プログラムBで使用される「データ2」が書き込まれる。また、行アドレス「03」および列アドレス「03」のメモリセル41に、行アドレス「03」および列アドレス「02」のメモリセル41に書き込まれたデータと同一の「データ2」が書き込まれる。   That is, “data 2” used in the program B is written into the memory cell 41 at the row address “03” and the column address “02”. Further, the same “data 2” as the data written in the memory cell 41 at the row address “03” and the column address “02” is written into the memory cell 41 at the row address “03” and the column address “03”.

このように、CPU2によるプログラムBの実行時には、2つの同一のデータがそれぞれ行方向に連続する2つのメモリセル41に書き込まれる。   As described above, when the program B is executed by the CPU 2, two identical data are written in two memory cells 41 that are continuous in the row direction.

図4は、プログラムBの暴走時におけるRAMへのデータの書込みの一例を示す図である。   FIG. 4 is a diagram illustrating an example of writing data to the RAM when the program B runs out of control.

プログラムBの暴走により、プログラムAで使用される「データ1」が記憶されているメモリセル41に他のデータが書き込まれることがある。   Due to the runaway of the program B, other data may be written in the memory cell 41 in which “data 1” used in the program A is stored.

たとえば、図4に示されるように、行アドレス「02」および列アドレス「01」のメモリセル41に記憶されている「データ1」がプログラムBで使用される「データ2」が書き換えられることがある。   For example, as shown in FIG. 4, “data 2” used in program B may be rewritten by “data 1” stored in memory cell 41 at row address “02” and column address “01”. is there.

この場合、プログラムBにおけるデータの書込み形式に従って、行アドレス「02」および列アドレス「01」のメモリセル41に対して行方向に連続するメモリセル41,つまり行アドレス「02」および列アドレス「02」のメモリセル41に、行アドレス「02」および列アドレス「01」のメモリセル41に書き込まれた「データ2」と同一の「データ2」が書き込まれる。   In this case, according to the data write format in the program B, the memory cells 41 continuous in the row direction with respect to the memory cells 41 with the row address “02” and the column address “01”, that is, the row address “02” and the column address “02” The same “data 2” as the “data 2” written in the memory cell 41 at the row address “02” and the column address “01” is written into the memory cell 41 at “”.

しかしながら、行アドレス「02」および列アドレス「04」のメモリセル41に記憶されている「データ1」は書き換えられない。   However, “data 1” stored in the memory cell 41 at the row address “02” and the column address “04” cannot be rewritten.

よって、プログラムBの暴走により、行アドレス「02」および列アドレス「01」のメモリセル41に記憶されている「データ1」がプログラムBで使用される「データ2」に書き換えられても、行アドレス「02」および列アドレス「01」のメモリセル41から読み出される「データ2」と行アドレス「02」および列アドレス「04」のメモリセル41から読み出される「データ1」とが不一致であるから、少なくとも一方のメモリセル41に記憶されているデータが異常であると判定することができる。   Therefore, even if “data 1” stored in the memory cell 41 at the row address “02” and the column address “01” is rewritten to “data 2” used in the program B due to the runaway of the program B, the row “Data 2” read from the memory cell 41 at the address “02” and the column address “01” and “Data 1” read from the memory cell 41 at the row address “02” and the column address “04” are inconsistent. It can be determined that the data stored in at least one of the memory cells 41 is abnormal.

図5は、RAMに記憶されているデータの不所望な書換えの他の例を示す図である。   FIG. 5 is a diagram illustrating another example of undesired rewriting of data stored in the RAM.

たとえば、図5に示されるように、プログラムAが使用する「データ1」が記憶されているメモリセル41、つまり行アドレス「02」および列アドレス「01」のメモリセル41を含む広い範囲において、各メモリセル41に記憶されているデータが「データ3」に書き換えられる事態が想定される。   For example, as shown in FIG. 5, in a wide range including the memory cell 41 storing “data 1” used by the program A, that is, the memory cell 41 having the row address “02” and the column address “01”. It is assumed that data stored in each memory cell 41 is rewritten to “data 3”.

この事態が生じた場合、行アドレス「01」および列アドレス「01」のメモリセル41に記憶されている「キーワード1」および行アドレス「03」および列アドレス「01」のメモリセル41に記憶されている「キーワード2」も「データ3」に書き換えられてしまう。   When this situation occurs, the “keyword 1” stored in the memory cell 41 at the row address “01” and the column address “01” and the memory cell 41 at the row address “03” and the column address “01” are stored. "Keyword 2" is also rewritten to "Data 3".

したがって、プログラムAが使用する「データ1」が記憶されているべきメモリセル、つまり行アドレス「02」および列アドレス「01」のメモリセル41に対して列方向の両側に連続するメモリセル41に記憶領域に記憶されているデータがそれぞれ「キーワード1」および「キーワード2」でないことから、行アドレス「02」および列アドレス「01」のメモリセル41に記憶されている「データ3」は異常データであると判定することができる。   Therefore, the memory cell 41 that is used by the program A and that should store “data 1”, that is, the memory cell 41 that is continuous on both sides in the column direction with respect to the memory cell 41 with the row address “02” and the column address “01”. Since the data stored in the storage area is not “keyword 1” and “keyword 2”, respectively, “data 3” stored in the memory cell 41 at the row address “02” and the column address “01” is abnormal data. It can be determined that

RAM4を監視するハードウエアを備えるマイクロコンピュータをECU1に採用することによっても、RAM4に記憶されているデータのエラーの検出が可能になる。しかしながら、そのようなマイクロコンピュータをECU1に採用すると、ECU1のコストが高くつく。   By adopting a microcomputer equipped with hardware for monitoring the RAM 4 in the ECU 1, it is possible to detect an error in the data stored in the RAM 4. However, when such a microcomputer is employed in the ECU 1, the cost of the ECU 1 is high.

RAM4を監視するハードウエアを備えていない安価なマイクロコンピュータをECU1に採用することができながら、RAM4に記憶されているデータのエラーを確実に検出することができる。そして、データのエラーを確実に検出できるので、ECU1では、データのエラーに対するフェイルセーフを確実に実行することができる。   While an inexpensive microcomputer that does not include hardware for monitoring the RAM 4 can be employed in the ECU 1, an error in the data stored in the RAM 4 can be reliably detected. Since the data error can be reliably detected, the ECU 1 can reliably execute fail-safe against the data error.

以上、本発明の実施形態について説明したが、本発明は、他の形態で実施することもできる。   As mentioned above, although embodiment of this invention was described, this invention can also be implemented with another form.

たとえば、行方向または列方向に連続する複数のメモリセル41に同一または異なるデータが書き込まれ、その複数のメモリセル41に対してその連続方向の両側に連続するメモリセル41にそれぞれ識別データである「キーワード1」および「キーワード2」が書き込まれてもよい。   For example, the same or different data is written in a plurality of memory cells 41 that are continuous in the row direction or the column direction, and the identification data is respectively stored in the memory cells 41 that are continuous on both sides of the plurality of memory cells 41 in the continuous direction. “Keyword 1” and “Keyword 2” may be written.

その他、前述の構成には、特許請求の範囲に記載された事項の範囲で種々の設計変更を施すことが可能である。   In addition, various design changes can be made to the above-described configuration within the scope of the matters described in the claims.

1 ECU(車載用記憶処理装置)
2 CPU(第1書込み手段、第2書込み手段)
4 RAM(記憶媒体)
41 メモリセル(記憶領域)
1 ECU (in-vehicle storage processing device)
2 CPU (first writing means, second writing means)
4 RAM (storage media)
41 Memory cell (storage area)

Claims (1)

複数の記憶領域を有する記憶媒体と、
車両に搭載された機器を制御するための第1プログラムの実行時に、前記第1プログラムで使用されるデータと当該データの正常/異常を判定するための判定用のデータとを1組として、その組をなすデータを前記記憶領域に書き込み、当該記憶領域から少なくとも1個の前記記憶領域を隔てた前記記憶領域に当該組をなすデータと同一のデータを書き込む第1書込み手段と、
車両に搭載された機器を制御するための第2プログラムの実行時に、前記第2プログラムで使用されるデータと当該データの正常/異常を判定するための判定用のデータとを1組として、その組をなすデータを前記記憶領域に書き込み、当該記憶領域に連続する前記記憶領域に当該組をなすデータと同一のデータを書き込む第2書込み手段とを含む、車載用記憶処理装置。
A storage medium having a plurality of storage areas;
During the execution of the first program for controlling a device mounted on a vehicle, and data as a set for determination for determining normality / abnormality of the data and the data used by the first program, the A first writing means for writing a set of data to the storage area and writing the same data as the set of data to the storage area separated from the storage area by at least one storage area;
During the execution of the second program for controlling a device mounted on a vehicle, and data as a set for determination for determining normality / abnormality of the data and the data used by the second program, the A vehicle-mounted storage processing device, comprising: second writing means for writing data forming a set in the storage area and writing the same data as the data forming the set in the storage area continuous to the storage area.
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