CN116909984A - 使用虚拟化数据迭代器对神经网络进行数据处理性能增强 - Google Patents

使用虚拟化数据迭代器对神经网络进行数据处理性能增强 Download PDF

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Abstract

本申请涉及使用虚拟化数据迭代器对神经网络进行数据处理性能增强的系统、方法、计算机可读存储介质。使用虚拟化硬件迭代器,由NN/DNN处理的数据可以被遍历并且被配置为优化操作的数目以及存储器利用率,以增强NN/DNN的整体性能。可操作地,迭代器控制器可以生成用于由NN/DNN执行的指令,指令表示一个或多个期望的迭代器操作类型并执行一个或多个迭代器操作。可以根据所选择的迭代器操作来将数据迭代,并将数据通信到NN/DD的一个或多个神经元处理器来进行处理并输出到目标存储器。迭代器操作可以应用于并行的各种数据量(例如,二进制大对象)或相同容量的多个切片。

Description

使用虚拟化数据迭代器对神经网络进行数据处理性能增强
本申请为发明名称为“使用虚拟化数据迭代器对神经网络进行数据处理性能增强”的原中国发明专利申请的分案申请。原申请的申请号为201880025504.5、PCT申请号为PCT/US2018/026353,原申请的申请日为2018年4月6日、PCT国际申请进入国家阶段日为2019年10月16日。
背景技术
在人工神经网络(NN)中,神经元是用于对大脑中的生物神经元进行建模的基本单元。人工神经元的模型包括输入向量和权重向量的内积,权重向量被添加到应用非线性的偏置。对于深度神经网络(DNN)(例如,如示例性DNN模块所表示的),神经元可以被紧密地映射到人工神经元。
在跨NN或DNN处理数据时,执行示例性处理操作的控制器需要对大量数据进行迭代,以应用可以影响整体NN或DNN性能的特定操作,从而导致关键时延而损害期望的所述处理目标(例如,标识示例性输入数据中的对象和/或对象特征,图像、声音、地理坐标等)。通常地,现有NN和DNN在执行各种操作时花费可避免的处理时间(例如,每秒浮点/定点操作(GFlops/s))和存储器空间(例如,每秒传递的字节数(GBytes/s))。具体地,当前实践不标识输入/数据的关键特征和/或向NN或DNN的协作组件提供关于如何最好地处理这样的输入数据来避免这样的性能问题的指令。与NN或DNN中的低效数据处理相关联的性能影响包括NN或DNN的本地和外部存储器组件之间的低效管理。这样的低效数据管理需要附加的、通常可以避免的计算/神经处理器操作,从而对整体NN/DNN性能进一步施压。
更有利的NN/DNN将部署一个或多个虚拟化硬件迭代器,一个或多个虚拟化硬件迭代器可操作地允许NN/DNN组件、能够指定数据的维度来进行迭代并向NN/DNN组件提供一个或多个指令来将数据迭代。为了支持附加的扩展,可以将硬件迭代器部署为交替/同时运行的单个/多个实例,和/或可以表征数据来允许并行处理操作。
关于这些考虑和其他考虑,呈现了本文所公开的内容。
发明内容
本文所描述的技术提供了在示例性神经网络(NN)和/或深度神经网络(DNN)环境中利用的一个或多个硬件迭代器的虚拟化,其中迭代器(例如,表示为示例性NN和/或DNN环境的迭代器控制器组件)可操作地允许改进整体性能并优化存储器管理的数据处理。在一个说明性实现中,示例性DNN环境可以包括一个或多个处理块(例如,计算机处理单元-CPU)、存储器控制器、高带宽结构(例如,在示例性DNN模块和DNN环境的协作组件之间传递数据和/或数据元素的数据总线)、迭代器控制器、操作控制器,以及DNN模块。在说明性实现中,示例性DNN模块可以包括示例性DNN状态控制器、描述符列表控制器(DLC)、dMA(DDMA)、DMA流激活(DSA)、操作控制器、加载控制器和存储控制器。
在一个说明性操作中,NN/DNN环境的操作控制器可操作地将大量数据迭代,以应用一个或多个期望的数据处理操作(例如,卷积、最大池化、标量乘/加、求和、完全连接等)。在说明性操作中,参与用户可以指定正在迭代的数据的维度以及关于如何迭代数据以供NN/DNN计算环境使用的配置。说明性地,本文描述的迭代器可以在交替运行的多个实例中可操作地执行,以适应一个或多个输入数据和/或单个输入数据的一个或多个部分的并行处理。说明性地,可以将迭代器的内部状态保存到专用协作存储器中,以供示例性迭代器控制器使用,以在将数据迭代以由示例性NN/DNN环境的神经元处理器进行处理时生成指令。
在一个说明性实现中,将由NN/DNN环境处理的数据可以表示为二进制大对象(blob)。通常,二进制大对象表示存储器中需要进行迭代的数据。每个二进制大对象可以维持由各种维度(例如,宽度、高度、信道数目、内核数目和其他可用维度单位)限定的逻辑映射形状。在一个说明性操作中,迭代器可遍历多维二进制大对象(例如,如逻辑数据映射限定)或这样的二进制大对象的较小N维度切片,其中N是维度数(例如,对于表示具有宽度、高度和信道数目的图像的3D二进制大对象,N=3)。在遍历二进制大对象时,迭代器控制器可以生成一个或多个指令,一个或多个指令包括但不限于:用于将数据从源存储器加载到(多个)处理单元(例如,神经元处理器)的加载指令、或用于将由(多个)处理单元产生的数据存储到目标存储器(例如,NN/DNN环境的协作存储器组件)的存储指令。在说明性操作中,迭代器控制器能够同时产生读取/写入多个数据的指令。
说明性地,迭代器控制器可以暴露若干操作(操作类型)以供NN/DNN环境执行,操作包括但不限于:初始化控制,允许跨越特定二进制大对象实例的迭代;填充控制,允许从当前位置处的示例性二进制大对象的数据提取;跳过控制,可以在不提取任何数据的情况下,允许内部数据指针的推进;二进制大对象结束标志,允许向参与用户通信完成二进制大对象遍历;重置控制,可以允许在第一数据位置处处理二进制大对象;保存控制,可以允许将迭代器控制器的内部状态存储到外部存储器位置以供将来重用;以及恢复控制,可以允许存储在协作外部存储器上的内部状态被恢复来供NN/DNN环境使用。根据处理数据的需要,可以由NN/DNN环境来实现和执行附加控制和/或标志。
在一个说明性操作中,迭代器控制器可以使用一个或多个所选择的遍历模式向NN/DNN环境提供指令来遍历二进制大对象存储器,遍历模式可以特定于每个迭代器控制器操作并且可以由迭代器控制器进行进一步配置。在说明性操作中,迭代器控制器可以允许在由所存储的内部状态描述的位置处读取/写入数据以及随后的数据处理。可以从存储器读取数据/向存储器写入数据的顺序可以异步,并且可以取决于迭代器控制器操作类型和针对特定操作类型的配置数据。此外,实现每个层类型的操作控制器利用一个或多个迭代器类型,以从存储器提取数据来进行处理,并且然后在处理完成之后将数据保存到存储器。
此外,迭代器控制器可以允许相同迭代器操作类型的多个实例被执行。在一个说明性操作中,多个迭代器操作类型可以被并行地执行,可操作地通过在存储器中存储/检索迭代器操作类型的状态来实现。作为对NN/DNN环境性能的进一步增强,当使用相同迭代器类型的单个实例时,迭代器可以被配置为跳过保存/恢复操作并返回到初始状态。
在一个说明性操作中,示例性迭代器控制器可以提供执行二进制大对象迭代器操作类型的指令(即,二进制大对象迭代器)。在说明性操作中,二进制大对象迭代器可以具有一个或多个指令来遍历部分连续数据的区块中的二进制大对象,和/或具有一个或多个指令来遍历用于与一个或多个神经元处理器通信的命名容量。容量可以表示需要由n个神经元处理二进制大对象来产生n个输出值的数据。该数据可以是连续的并且可以顺序处理,或也可以是不连续的并且可以多次处理。
由二进制大对象迭代器读取的数据可以被通信到一个或多个神经元处理器来进行处理。可操作地,神经元处理器可以维持先进先出(FIFO)总线,在FIFO总线中,神经元处理器可以可操作地接收它将处理的数据。二进制大对象迭代器可以通过在每个神经元处理器FIFO中放置选定量(例如,等量)的值来通信所遍历的二进制大对象数据,以允许将二进制大对象数据分配到n个神经元处理器FIFO中。
特定于迭代器控制器操作类型的填充命令,二进制大对象迭代器可以从协作存储器读取多个二进制大对象容量宽度的数据行,并且对于每个容量行,它可以将从一个或多个神经元处理器映射的值分布到相应神经元处理器FIFO。可以读取相同容量行上的数据,然后将其分布到多个神经元处理器FIFO。
特定于具有宽度不是容量宽度的倍数的二进制大对象,可操作地,迭代器控制器可以提供指令来处理可以跨越容量宽度行中的多个行的容量。在一个说明性操作中,由迭代器控制器提供的指令允许二进制大对象迭代器使用多个容量宽度行跨越操作来遍历二进制大对象。
在一个说明性操作中,二进制大对象迭代器可以允许在运行时向二进制大对象动态地添加填充容量。操作控制器可以指定在二进制大对象的每个维度上使用多少填充,并且类似于二进制大对象迭代器存在于协作物理存储器中,二进制大对象迭代器可以跟踪该填充容量。然后填充可以用于下一操作。
在一个说明性操作中,示例性迭代器控制器可以提供执行输出迭代器操作类型的指令(例如,输出迭代器)。在一个说明性操作中,输出迭代器可以将由一个或多个神经元处理器产生的数据存储到输出二进制大对象中。输出迭代器可以被配置有输出二进制大对象的维度和产生数据的n个神经元处理器,以生成用于将经处理的数据存储到目标存储器中的一个或多个指令。说明性地,输出迭代器可以写入完整二进制大对象或仅写入二进制大对象的某些部分。
应当理解,尽管关于系统进行了描述,但是上述主题还可以实现为计算机控制的装置、计算机进程、计算系统、或者诸如计算机可读介质和/或专用芯片组的制品。通过阅读以下详细描述和对相关附图的回顾,这些特征和各种其他特征将显而易见。提供本发明内容是为了以简化的形式介绍一些概念,这些概念将在下面的具体实施方式中进一步描述。
本发明内容不旨在标识所要求保护的主题的关键特征或必要特征,也不旨在将本发明内容用于限制所要求保护的主题的范围。此外,所要求保护的主题不限于解决在本公开的任何部分中提到的任何缺点或所有缺点的实现。
附图说明
参考附图描述了具体实现。在附图中,附图标记的最左边(多个)数字标识首次出现附图标记的图。不同图中的相同附图标记表示相似或相同的项。对多个项中的各个项的参考可以使用具有字母序列的字母的附图标记来指代每个单独的项。对项的通用参考可以使用不具有字母序列的特定附图标记。
图1图示了根据本文所描述的系统和方法的示例性神经网络计算环境的框图。
图2图示了利用一个或多个虚拟化硬件迭代器的示例性神经网络环境的框图。
图3图示了根据本文所描述的系统和方法的说明性逻辑数据映射中表示的示例性输入数据的框图。
图4图示了在说明性逻辑数据映射中表示的示例性输入数据的框图,示出了使用说明性n个滑动窗口来操作,以跨越说明性逻辑数据映射的一个或多个行。
图5图示了根据本文所描述的系统和方法的、在说明性逻辑数据映射中表示的示例性输入数据的框图,示出了使用说明性n个滑动窗口来操作,以跨越说明性逻辑数据映射的一个或多个行,从而允许数据填充作为处理增强。
图6是根据本文所描述的系统和方法的、用于在说明性神经网络计算环境中进行处理的数据迭代的说明性过程的流程图。
图7是根据本文所描述的系统和方法的、用于在说明性神经网络计算环境中利用所选择的逻辑数据映射协议进行处理的数据迭代的说明性过程的流程图,逻辑数据映射协议可操作来提供数据填充和经跨越的滑动窗口。
图8示出了能够执行本文所描述的方法的计算机的说明性计算机架构的附加细节。
图9示出了根据本文所描述的系统和方法协作的说明性计算设备的附加细节。
具体实施方式
以下详细描述描述了提供在示例性神经网络(NN)和/或深度神经网络(DNN)环境中使用的一个或多个硬件迭代器的虚拟化的技术。通常,迭代器(例如,被表示为示例性NN和/或DNN环境的迭代器控制器组件)可操作地允许改进整体性能并优化存储器管理的数据处理。在一个说明性实现中,示例性DNN环境可以包括一个或多个处理块(例如,计算机处理单元CPU)、存储器控制器、高带宽结构(例如,在示例性DNN模块和DNN环境的协作组件之间传递数据和/或数据元素的数据总线)、迭代器控制器、操作控制器和DNN模块。在说明性实现中,示例性DNN模块可以包括示例性DNN状态控制器、描述符列表控制器(DLC)、dMA(DDMA)、DMA流激活(DSA)、操作控制器、加载控制器和存储控制器。
在说明性操作中,NN/DNN环境的操作控制器可操作地将大量数据迭代,以应用一个或多个期望的数据处理操作(例如,卷积、最大池化、标量乘加、求和、完全连接等)。在说明性操作中,参与用户可以指定正在迭代的数据维度以及用于迭代数据以供NN/DNN计算环境使用的配置。说明性地,本文所描述的迭代器可以在独立地运行的多个实例中可操作地执行,以适应一个或多个输入数据和/或单个输入数据的一个或多个部分的并行处理。说明性地,迭代器的内部状态可以被保存到专用协作存储器中,以供示例性迭代器控制器使用,以在将数据迭代来由示例性NN/DNN环境的神经元处理器进行处理时生成指令。
在一个说明性实现中,将由NN/DNN环境处理的数据可以表示为二进制大对象。通常地,二进制大对象表示存储器中需要进行迭代的数据。每个二进制大对象可以维持由各种维度(例如,宽度、高度、信道数目、内核数目和其他可用维度单位)限定的逻辑映射形状。在一个说明性操作中,迭代器可遍历多维二进制大对象(例如,如由逻辑数据映射限定)或这样的二进制大对象的较小N维度切片,其中N是维度数(例如,对于表示具有宽度、高度和信道数的图像的3D二进制大对象,N=3)。在遍历二进制大对象时,迭代器控制器可以生成一个或多个指令,一个或多个指令包括但不限于:用于将数据从源存储器加载到(多个)处理单元(例如,神经元处理器)的加载指令、或用于将由(多个)处理单元产生的数据存储到目标存储器(例如,NN/DNN环境的协作存储器组件)的存储指令。在说明性操作中,迭代器控制器能够同时产生读取/写入多个数据的指令。
说明性地,迭代器控制器可以暴露若干操作(操作类型)以供NN/DNN环境执行,操作包括但不限于:初始化控制,允许跨越特定二进制大对象实例的迭代;填充控制,允许从当前位置处的示例性二进制大对象的数据提取;跳过控制,可以在不提取任何数据的情况下,允许内部数据指针的推进;二进制大对象结束标志,允许向参与用户通信完成二进制大对象遍历;重置控制,可以允许在第一数据位置处处理二进制大对象;保存控制,可以允许将迭代器控制器的内部状态存储到外部存储器位置以供将来重用;以及恢复控制,可以允许存储在协作外部存储器上的内部状态被恢复来供NN/DNN环境使用。根据处理数据的需要,可以由NN/DNN环境来实现和执行附加控制和/或标志。
在一个说明性操作中,迭代器控制器可以使用一个或多个所选择的遍历模式向NN/DNN环境提供指令来遍历二进制大对象存储器,遍历模式可以特定于每个迭代器控制器操作并且可以由迭代器控制器进行进一步配置。在说明性操作中,迭代器控制器可以允许在由所存储的内部状态描述的位置处读取/写入数据以及随后的数据处理。可以从存储器读取数据/向存储器写入数据的顺序可以异步,并且可以取决于迭代器控制器操作类型和针对所提供的操作类型的配置数据。此外,实现每个层类型的操作控制器利用一个或多个迭代器类型,以从存储器提取数据来进行处理,并且然后在处理完成之后将数据保存到存储器。
此外,迭代器控制器可以允许相同迭代器操作类型的多个实例被执行。在一个说明性操作中,多个迭代器操作类型可以被并行地执行,可操作地通过在存储器中存储/检索迭代器操作类型的状态来实现。作为对NN/DNN环境性能的进一步增强,当使用相同迭代器类型的单个实例时,迭代器可以被配置为跳过保存/恢复操作并返回到初始状态。
在一个说明性操作中,示例性迭代器控制器可以提供执行二进制大对象迭代器操作类型的指令(即,二进制大对象迭代器)。在说明性操作中,二进制大对象迭代器可以具有一个或多个指令来遍历部分连续数据的区块中的二进制大对象,和/或具有一个或多个指令来遍历用于与一个或多个神经元处理器通信的命名容量。容量可以表示需要由n个神经元处理二进制大对象来产生n个输出值的数据。该数据可以是连续的并且可以顺序处理,或也可以是不连续的并且可以多次处理。
由二进制大对象迭代器读取的数据可以被通信到一个或多个神经元处理器来进行处理。可操作地,神经元处理器可以维持先进先出(FIFO)总线,在FIFO总线中,神经元处理器可以可操作地接收它将处理的数据。二进制大对象迭代器可以通过在每个神经元处理器FIFO中放置选定量(例如,等量)的值来通信所遍历的二进制大对象数据(还被称为“所遍历的二进制大对象数据”或“所选择的数据”),以允许将二进制大对象数据分配到n个神经元处理器FIFO中。在一些配置中,本文所公开的技术可以包括处理一个或多个指令以根据一个或多个迭代器操作类型和一个或多个初始化参数来选择所加载的数据的一个或多个部分,然后将所加载的数据的一个或多个部分通信到神经网络环境的一个或多个处理组件。出于说明性目的,所加载的数据的一个或多个部分在本文中也称为“所遍历的二进制大对象数据”或“所选择的数据”。
特定于迭代器控制器操作类型的填充命令,二进制大对象迭代器可以从协作存储器读取多个二进制大对象容量宽度的数据行,并且对于每个容量行,它可以将从一个或多个神经元处理器映射的值分布到相应神经元处理器FIFO。可以读取相同容量行上的数据,然后将其分布到多个神经元处理器FIFO。
特定于具有宽度不是容量宽度的倍数的二进制大对象,可操作地,迭代器控制器可以提供指令来处理可以跨越容量宽度行中的多个行的容量。在一个说明性操作中,由迭代器控制器提供的指令允许二进制大对象迭代器使用多个容量宽度行跨越操作来遍历二进制大对象。
在一个说明性操作中,二进制大对象迭代器可以允许在运行时向二进制大对象动态地添加填充容量。操作控制器可以指定在二进制大对象的每个维度上使用多少填充,并且类似于二进制大对象迭代器存在于协作物理存储器中,二进制大对象迭代器可以跟踪该填充容量。然后填充可以用于下一操作。
在一个说明性操作中,示例性迭代器控制器可以提供执行输出迭代器操作类型的指令(例如,输出迭代器)。输出迭代器可以将由一个或多个神经元处理器产生的数据存储到输出二进制大对象中。输出迭代器可以被配置有输出二进制大对象的维度和产生数据的n个神经元处理器,以生成用于将经处理的数据存储到目标存储器中的一个或多个指令。说明性地,输出迭代器可以写入完整二进制大对象或仅写入二进制大对象的某些部分。
神经网络背景
在人工神经网络中,神经元是用于对大脑中的生物神经元进行模拟的基本单元。人工神经元的模型可以包括输入向量和权重向量的内积,权重向量被添加到偏置并且应用了非线性。相比之下,示例性DNN模块中的神经元(例如,图1中的105)紧密地映射到人工神经元。
说明性地,DNN模块可以被认为是超标量处理器。可操作地,它可以将一个或多个指令分派给被称为神经元的多个执行单元。执行单元可以是“同时分派同时完成”,其中每个执行单元与所有其他执行单元同步。DNN模块可以被分类为SIMD(单指令流、多数据流)架构。
转向图1的示例性DNN环境100,DNN模块105具有存储器子系统,存储器子系统具有唯一的L1和L2高速缓存结构。这些高速缓存结构不是常规的高速缓存,而是专门针对神经处理而设计。为了方便,这些高速缓存结构采用了反映其预期目的的名称。作为示例,L2高速缓存125(A)可以说明性地维持1兆字节(1MB)的存储容量,具有高速专用接口以16GBps操作。L1高速缓存可以在内核和激活数据之间维持8KB的存储容量分配。L1高速缓存可以被称为行缓冲器,且L2高速缓存被称为BaSRAM。
DNN模块可以是仅召回(recall-only)的神经网络,并且以编程方式支持各种网络结构。网络训练可以在服务器场或数据中心中被离线执行,DNN模块不执行任何训练功能。训练的结果是可以被称为权重或内核的参数集合。这些参数表示可应用于输入的转换函数,其结果是分类或语义标记的输出。
在一个说明性操作中,DNN模块可以接受平面数据作为输入。输入不仅限于图像数据,只要所呈现的数据是均匀的平面格式,DNN就可以对其进行操作。
DNN模块在对应于神经网络的层的层描述符列表上操作。说明性地,层描述符列表可以由DNN模块处理为指令。这些描述符可以从存储器预获取到DNN模块中并按顺序执行。
通常地,可以存在两个主要种类的层描述符:1)存储器到存储器移动描述符,以及2)操作描述符。存储器到存储器移动描述符可用于将数据从主存储器移出到本地高速缓存或从本地高速缓存移入到主存储器,以供操作描述符使用。存储器到存储器移动描述符遵循与操作描述符不同的执行管线。存储器到存储器移动描述符的目标管线可以是内部DMA引擎,而操作描述符的目标管线可以是神经元处理元件。操作描述符能够进行许多不同的层操作。
DNN的输出也是数据二进制大对象。输出可以可选地流式传输到本地高速缓存或流式传输到主存储器。DNN模块可以在软件允许的范围内预获取数据。软件可以通过在描述符之间使用屏蔽和设置相关性来控制预获取。具有相关性集合的描述符将被阻止前进,直到满足相关性。
现在转向图1,示例性神经网络环境100可以包括各种协作组件,协作组件包括DNN模块105、高速缓冲存储器125(A)、低带宽结构110、桥接组件115、高带宽结构120、SOC 130、PCIE“端点”135、泰思立达(Tensilica)节点140、存储器控制器145、LPDDR4存储器105和输入数据源102。此外,如图所示,DNN模块105还可以包括若干组件,若干组件包括预获取105(A)、DMA 105(B)、寄存器接口105(D)、加载/存储单元105(C)、层控制器105(D)、保存/恢复组件105(E)和神经元105(F)。可操作地,示例性DNN环境100可以根据所选择的规范来处理数据,其中DNN模块执行如本文所述的一个或多个功能。
图2图示了可操作以采用一个或多个虚拟化硬件迭代器作为数据处理的一部分的示例性神经网络环境200。如图所示,示例性神经网络环境200(这里也称为计算设备或计算设备环境)包括一个或多个操作控制器230,一个或多个操作控制器230与一个或多个迭代器控制器220协作来提供用于执行的一个或多个命令。一个或多个迭代器控制器220说明性地操作来生成借助示例性结构215通信到协作存储器组件210以及一个或多个神经元处理器205的指令。神经网络环境结构可以是能够传递各种数据的数据总线。此外,如图所示,一个或多个迭代器控制器220可以与迭代器状态存储器225可操作地协作,以保存和恢复迭代器状态存储器数据(未示出)。
在说明性操作中,示例性神经网络环境200可以根据图6和图7中描述的过程可操作地处理数据。具体到图2中描述的组件,这些组件仅仅是说明性的,因为本领域一般技术人员将理解图6和图7中描述的、将由图2中所示的组件之外的其他组件执行的处理。
此外,如图2所示,示例性神经网络环境可以可选地包括一个或多个硬件迭代器(如虚线所示),一个或多个硬件迭代器可以说明性地操作,以对输入数据(未示出)进行迭代来供一个或多个神经元处理器205处理。本领域技术人员可以理解,示例性的一个或多个硬件迭代器的这样的可选包括技术仅仅是说明性的,因为本文所公开的系统和方法描述的发明构思在没有任何硬件迭代器的情况下可以在示例性神经网络环境200中操作。
图3图示了用于示例性输入数据的示例逻辑数据映射300。如图所示,数据305可以被表示为具有特定维度和容量340的数据,维度和容量340包括信道计数310、高度315和宽度320。根据本文描述的系统和方法,数据305可以被协作的n个神经元330分配和准备用于处理,使得第一部分a可以被通信到第一神经元、第二部分b可以被通信到第二神经元等,直到n个部分被通信到n个神经元。
在一个说明性操作中,数据305的各部分可以基于由示例性神经网络环境(例如,图2的200)的协作控制器组件提供的一个或多个指令,使用n个滑动窗口/内核325被确定。进一步如图所示,可以使用由示例性神经网络环境(例如,图2的200)的协作操作控制器组件提供的一个或多个初始化参数,将输入数据部分a、b、c和d寻址到物理存储器325。
图4图示了示例性输入数据(未示出)的示例性逻辑数据映射400。示例性逻辑数据映射400包括第一行410(利用对角线标记图示)和第二行420(由虚线图示)。每个映射行可以包括若干滑动窗口(例如,针对第一行410的430、440和450以及针对第二行420的460、470和480)。附加地,如图所示,逻辑数据映射400示出了滑动窗口跨越输入数据的数据维度边界(例如,跨越第一行410和第二行420)的能力。由于可以更有效地准备更多数据以用于协作神经网络处理组件(例如,图2的205)的后续处理,这样的能力允许提高性能。
图5类似于图4,并且呈现图5来描述本文所描述的系统和方法允许使用填充来进一步增强示例性神经网络环境(例如,图1的100和图2的200)的性能特性的能力。如图所示,(未示出的示例性输入数据的)逻辑数据映射500可以包括跨越一个或多个行(例如,510和520)的各种滑动窗口(530、540、550、560、570和580)。附加地,逻辑数据映射500还可以包括填充580。
在一个说明性操作中,在示例性神经网络环境(图1的100或图2的200)的运行时间,填充580可以被动态地添加。图2的操作控制器235可以指定将在图3中所示的输入数据(例如,二进制大对象)的每个维度(例如,整体称为容量340)上使用的填充量,并且神经网络环境(例如,迭代器控制器指令)可以可操作地构造数据量,就像填充物理地存在于存储器中。在添加填充的情况下,还可以在迭代器输出位置中通过示例性神经网络环境(例如,迭代器控制器指令)来生成默认值。
图6是利用虚拟化硬件迭代器来增强神经网络环境的性能的说明性过程600的流程图。如图所示,处理开始于框605,在框605处,从神经网络计算环境的一个或多个协作组件接收一个或多个初始化参数。然后处理进行到框610,在框610处,从神经网络计算环境的一个或多个协作组件接收一个或多个数据处理命令。说明性地,示例性处理命令可以包括迭代器操作类型。在框615处,根据所选择的逻辑数据映射协议(LDMP)在所选择的相关联的存储器地址处读取输入数据,并且生成内部状态数据,内部状态数据表示读入数据的一个或多个特性。从那里,处理进行到框620,在框620处,用于关联读入数据的一个或多个部分以进行处理的一个或多个指令被生成。然后,在框625处,读入数据的一个或多个相关联的部分被通信到神经网络计算环境的一个或多个协作处理神经元。然后在框630处,内部状态被更新来指示读入数据的一个或多个部分已经被通信到神经元进行处理。然后在框635处检查被执行,以确定是否存在神经网络环境处理所需的附加输入数据。如果检查指示不存在附加数据,则处理在框640处终止。如果附加数据需要神经网络环境处理,则处理返回到框610并从那里继续。
在一个说明性操作中,可以通过向存储器内数据提供逻辑映射来将硬件迭代器虚拟化。使用描述数据物理存储器寻址、维度和容量的参数来计算映射。附加地,关于如何遍历逻辑数据映射的指令被生成,以允许基于正在由神经网络神经元执行的操作以及数据的维度和容量描述对将由神经网络神经元准备进行处理的数据进行有效加载(即,从/到存储器)。
图7是利用一个或多个虚拟化硬件迭代器来增强NN/DNN环境的性能的说明性过程700的流程图。如图所示,处理开始于框705,在框705处,从神经网络环境的协作组件(例如,操作控制器)接收一个或多个初始化参数,其中一个或多个初始化参数可以包括表示输入数据的维度的数据。处理然后进行到框710,在框710处,使用所接收的一个或多个初始化参数来标识输入数据的一个或多个物理地址。然后在框715处,使用所选择的逻辑数据映射协议(LDMP)读入(例如,加载)输入数据。说明性地,在框715,逻辑数据映射协议可以利用滑动窗口(如图3所描绘的)将输入数据的一个或多个部分与所接收的初始化参数相关联(例如,读入),以将输入数据整理为一个或多个部分用于后续处理。此外,LDMP可以允许跨越的窗口和逻辑数据填充作为准备用于处理的输入数据的一部分。
然后,处理进行到框720,在框720处,表示输入数据的经整理的一个或多个部分的内部状态被生成。从那里,一个或多个指令被生成来指示神经网络环境的协作存储器控制器组件对输入数据准备用于在框725处进行处理的一个或多个部分的存储器存储进行处理。然后处理进行到框730,在框730处,将输入数据的所准备的一个或多个部分通信到神经网络环境的一个或多个协作处理组件(例如,神经元处理器)来进行处理。
说明性地,并且如图3所描绘的,示例性逻辑数据映射协议可操作地将二维平面文件类型数据渲染为多维表征数据,使得输入数据可以在视觉上表示为具有特定高度、宽度、深度(例如,信道数目)、深度切片(例如,内核数目)的二进制大对象。该逻辑数据映射允许使用滑动窗口来将用于迭代操作的输入数据的一个或多个数据元素相关联。说明性地,滑动窗口可以跨越两个逻辑映射的输入数据宽度行。
然后在框735处执行检查来确定是否存在将处理的附加输入数据(即,作为迭代操作的一部分)。如果不存在附加输入数据,则处理在框740处终止。然而,如果附加输入数据需要迭代操作,则处理然后返回到框710并从那里继续。
图8中图示的计算机架构800包括:中央处理单元802(“CPU”)、系统存储器804(包括随机存取存储器806(“RAM”)和只读存储器(“ROM”)808)以及将存储器804耦合到CPU 802的系统总线810。例如在启动期间,包括有助于在计算机架构800内的元件之间传递信息的基本例程的基本输入/输出系统可以存储在ROM 808中。计算机800还包括用于存储操作系统814、其他数据和一个或多个应用程序的大容量存储设备812。
大容量存储设备812利用连接到总线810的大容量存储控制器(未示出)连接到CPU802。大容量存储设备812及其相关联的计算机可读介质为计算机架构800提供非易失性存储。虽然本文中包括的计算机可读介质的描述指代大容量存储设备(例如,固态驱动、硬盘、CD-ROM驱动),但是本领域技术人员应理解,计算机可读介质可以是可由计算机架构800访问的任何可用计算机存储介质或通信介质。
通信介质包括计算机可读指令、数据结构、程序模块或经调制的数据信号(例如,载波或其他传输机制)中的其他数据,并且包括任何传递介质。术语“经调制的数据信号”表示以对信号中的信息进行编码的方式来改变或设置其一个或多个特性的信号。作为示例而非限制,通信介质包括诸如有线网络或直接有线连接的有线介质,以及诸如声学、射频、红外和其他无线介质的无线介质。上述任何组合也应包括在计算机可读介质的范围内。
作为示例而非限制,计算机存储介质可包括以用于存储诸如计算机可读指令、数据结构、程序模块或其他数据的信息的任何方法或技术实现的易失性和非易失性、可移动和不可移动介质。例如,计算机存储介质包括但不限于RAM、ROM、EPROM、EEPROM、闪存或其他固态存储器技术、CD-ROM、数字通用盘(“DVD”)、HD-DVD、BLU-RAY、或其他光学存储装置、磁带盒、磁带、磁盘存储装置或其他磁存储设备或可用于存储期望信息并且可由计算机架构800访问的任何其他介质。处于保护的目的,短语“计算机存储介质”、“计算机可读存储介质”及其变型不包括波、信号和/或其他暂时性和/或无形通信介质本身。
根据各种技术,计算机架构800可以使用借助网络820和/或另一网络(未示出)到远程计算机的逻辑连接在联网环境中操作。计算机架构800可以借助连接到总线810的网络接口单元816连接到网络820。应当理解,网络接口单元816也可以用于连接到其他类型的网络和远程计算机系统。计算机架构800还可以包括输入/输出控制器818,用于接收和处理来自若干其他设备(包括键盘、鼠标或电子笔(图8中未示出))的输入。类似地,输入/输出控制器818可以向显示屏、打印机或其他类型的输出设备(在图8中也未示出)提供输出。还应当理解,经由借助网络接口单元816到网络820的连接,计算架构可以使得DNN模块105能够与计算环境100通信。
应当理解,本文所描述的软件组件可以在被加载到CPU 802和/或DNN模块105中并被执行时,可以将CPU 802和/或DNN模块105和整个计算机架构800从通用计算设备变换为旨在促进本文所呈现的功能的专用计算系统。CPU 802和/或DNN模块105可以由任何数量的晶体管或其他分立电路元件和/或芯片组(可以单独地或共同地呈现任何数量的状态)构造。更具体地,响应于包含在本文所公开的软件模块内的可执行指令,CPU 802和/或DNN模块105可以作为有限状态机进行操作。这些计算机可执行指令可以通过指定CPU 802如何在状态之间转换来对CPU 802进行转换,从而对构成CPU 802的晶体管或其他分立硬件元件进行变换。
对本文所呈现的软件模块进行编码还可以对本文所呈现的计算机可读介质的物理结构进行变换。在本说明书的不同实现中,物理结构的特定变换取决于各种因素。这样的因素的示例包括但不限于:用于实现计算机可读介质的技术、计算机可读介质是否被表征为主存储装置或辅助存储装置等。例如,如果计算机可读介质被实现为基于半导体的存储器,则可以通过对半导体存储器的物理状态进行变换而将本文所公开的软件编码在计算机可读介质上。例如,软件可以对构成半导体存储器的晶体管、电容器或其他分立电路元件的状态进行变换。软件还可以对这样的组件的物理状态进行变换,以在其上存储数据。
作为另一示例,本文所公开的计算机可读介质可以使用磁或光技术来实现。在这样的实现中,当在其中对软件进行编码时,本文所呈现的软件可以对磁或光介质的物理状态进行变换。这些变换可以包括改变给定磁介质内特定位置的磁特性。这些变换还可以包括改变给定光介质内特定位置的物理特征或特性,以改变那些位置的光特性。在不脱离本说明书的范围和精神的情况下,前述示例仅用于促进该讨论,物理介质的其他变换是可能的。
鉴于以上所述,应当理解,在计算机架构800中发生许多类型的物理变换,以存储并执行本文所呈现的软件组件。还应理解,计算机架构800可以包括其他类型的计算设备(包括手持式计算机、嵌入式计算机系统、个人数字助手以及本领域技术人员已知的其他类型的计算设备)。还预期计算机架构800可以不包括图8中所示的所有组件、可以包括未在图8中明确示出的其他组件或可以使用与图8中所示的架构完全不同的架构。
如上所述,计算系统800可以被部署为计算机网络的一部分。通常,以上对计算环境的描述适用于在网络环境中部署的服务器计算机和客户端计算机。
图9图示了具有服务器的示例性说明性联网计算环境900,服务器经由通信网络与客户端计算机通信,其中可以采用本文所描述的装置和方法。如图9所示,(多个)服务器905可以经由通信网络820(可以是固定有线或无线LAN、WAN、内联网、外联网、对等网络、虚拟专用网络、因特网、蓝牙通信网络、专有低压通信网络或其他通信网络中的任一个或组合)与若干客户端计算设备(例如,平板个人计算机910、移动电话915、电话920、(多个)个人计算机801、个人数字助理925、智能电话手表/个人目标跟踪器(例如,苹果手表、三星、FitBit等)930和智能手机935)互连。在通信网络820是因特网的网络环境中,例如,(多个)服务器905可以是可操作以经由若干已知协议(例如,超文本传输协议(HTTP)、文件传输协议(FTP)、简单对象访问协议(SOAP)或无线应用协议(WAP))中的任一个来处理数据并从客户端计算环境801、910、915、920、925、930和935通信数据且向客户端计算环境801、910、915、920、925、930和935通信数据的专用计算环境服务器。附加地,联网计算环境900可以利用各种数据安全协议(例如,安全套接层协议(“SSL”)或加密软体协议(“PGP”))。客户端计算环境801、810、815、820、825、830和835中的每一个可以配备有计算环境805,计算环境805可操作来支持一个或多个计算应用程序或终端会话(例如,web浏览器(未示出)或其他图形用户界面(未示出)或移动桌面环境(未示出)),以获得对服务器计算环境(一个或多个)905的访问。
(多个)服务器905可以通信地耦合到其他计算环境(未示出)并且接收关于参与用户的交互/资源网络的数据。在说明性操作中,用户(未示出)可以与在客户端计算环境上运行的计算应用程序交互来获得期望的数据和/或计算应用程序。数据和/或计算应用可以存储在服务器计算环境(一个或多个)905上,并借助客户端计算环境901、910、915、920、925、930和935通过示例性通信网络820通信到协作用户。参与用户(未示出)可以请求访问整体地或部分地容纳在(多个)服务器计算环境905上的特定数据和应用程序。这些数据可以在客户端计算环境801、910、915、920、925、930、935和(多个)服务器计算环境905之间通信,以进行处理和存储。(多个)服务器计算环境905可以托管用于数据和应用程序的生成、认证、加密和通信的计算应用程序、进程和小应用程序,并且可以与其他服务器计算环境(未示出)、第三方服务提供商(未示出)、网络附加存储(NAS)和存储区域网络(SAN)协作来实现应用程序/数据交易。
示例条款
鉴于以下条款,可以考虑本文所呈现的公开内容。
示例条款A,用于在神经网络环境中使用一个或多个虚拟化硬件迭代器来增强数据处理的系统,该系统包括:至少一个处理器;以及与至少一个处理器通信的至少一个存储器(210),该至少一个存储器(210)具有存储在其上的计算机可读指令,当计算机可读指令由至少一个处理器执行时,使得至少一个处理器:从神经网络环境的协作控制器组件接收一个或多个初始化参数,初始化参数包括表示将由所述神经网络环境处理的数据的维度的数据;从神经网络环境的协作存储器组件加载数据;从神经网络环境的协作控制器组件接收一个或多个指令,以根据一个或多个迭代器操作类型和一个或多个初始化参数来遍历所加载的数据;以及将所遍历的数据作为一个或多个部分通信到神经网络环境的一个或多个处理组件。
示例条款B,根据示例条款A所述的系统,其中计算机可读指令还使得至少一个处理器将所遍历的数据分成相等的部分,以通信到一个或多个处理组件。
示例条款C,根据示例条款A和B所述的系统,其中计算机可读指令还使得至少一个处理器根据由所接收的一个或多个初始化参数限定的选择数据量来遍历数据,包括数据的所述参数包括数据高度、数据宽度、信道数目和内核数目。
示例条款D,根据示例条款A至C所述的系统,其中计算机可读指令还所述至少一个处理器利用一个或多个滑动窗口来遍历所述数据,窗口可操作来选择数据量的一个或多个数据元素,作为通信到所述一个或多个处理组件的所述一个或多个部分。
示例条款E,根据示例条款A至D所述的系统,其中计算机可读指令还使得至少一个处理器使用跨越数据量的两个或更多个行宽度的一个或多个滑动窗口来遍历所加载的数据。
示例条款F,根据示例条款A至E所述的系统,其中计算机可读指令还使得至少一个处理器将一个或多个数据填充插入到所加载的数据。
示例条款G,根据示例条款A至F所述的系统,其中计算机可读指令还使得至少一个处理器生成表示由一个或多个神经处理器处理的数据的数据输出量,根据由所述神经网络环境的协作控制器组件接收的一个或多个指令来生成输出量。
示例条款H,计算机实现的方法,包括:从神经网络环境的协作控制器组件接收一个或多个初始化参数,初始化参数包括表示数据维度的数据作为数据量,数据维度包括高度、宽度、信道数目和内核数目中的任一个;从神经网络环境的协作存储器组件加载数据;从神经网络环境的协作控制器组件接收一个或多个指令,以根据一个或多个迭代器操作类型和一个或多个初始化参数来遍历所加载的数据,加载数据的遍历利用在数据量上操作的一个或多个滑动窗口;以及将所遍历的数据作为一个或多个部分通信到所述神经网络环境的一个或多个处理组件。
示例条款I,根据条款H所述的计算机实现的方法,还包括:遍历所加载的数据来生成所遍历的数据的相等部分,用于与一个或多个处理组件进行通信。
示例条款J,根据条款H和I所述的计算机实现的方法,其中滑动窗口可操作,以跨越所述数据量的两个或更多个宽度行。
示例条款K,根据条款H至J所述的计算机实现的方法,还包括:将填充子容量插入到所加载的数据中。
示例条款L,根据条款H至K所述的计算机实现的方法,其中填充子容量由从协作控制器组件接收的一个或多个指令以及由所接收的一个或多个初始化参数来限定。
示例条款M,根据条款H至L所述的计算机实现的方法,还包括:针对由神经环境的一个或多个处理组件处理的数据来生成并输出数据量,输出数据量由从协作控制器组件接收的一个或多个指令限定。
示例条款N,根据条款H至M所述的计算机实现的方法,还包括:丢弃所生成的输出数据量的一个或多个部分。
示例条款O,根据条款H至N所述的计算机实现的方法,将所加载的数据的遍历位置作为内部状态数据存储在所述神经网络环境的协作存储器组件中。
示例条款P,计算机可读存储介质,具有存储在其上的计算机可执行指令,当计算机可执行指令由计算设备的一个或多个处理器执行时,使得计算设备的一个或多个处理器:从神经网络环境的协作控制器组件接收一个或多个初始化参数,一个或多个初始化参数包括表示将由所述神经网络环境处理的数据的维度的数据,数据的所述维度包括表示数据量的数据,一个或多个初始化参数包括待处理的数据的物理存储器寻址;利用一个或多个初始化参数,从神经网络环境的协作存储器组件加载数据,协作存储器组件可操作地耦合到神经网络环境的一个或多个处理组件;从神经网络环境的协作控制器组件接收一个或多个指令,以根据一个或多个迭代器操作类型和所述一个或多个初始化参数遍历所加载的数据,指令包括存储表示遍历所加载的数据的所述内部状态的数据的一个或多个指令;以及将所遍历的数据作为一个或多个部分通信到所述神经网络环境的所述一个或多个处理组件。
示例条款Q,根据条款P所述的计算机可读存储介质,其中指令还使得计算设备的一个或多个处理器:将内部状态数据存储在神经网络环境的协作存储器组件中。
示例条款R,根据条款P和Q所述的计算机可读存储介质,其中指令还使得计算设备的一个或多个处理器将附加数据量插入到所加载的数据。
示例条款S,根据条款P至R所述的计算机可读存储介质,其中指令还使得计算设备的一个或多个处理器生成表示由神经网络环境的一个或多个处理组件处理的数据的输出数据量。
示例条款T,根据条款P至S所述的计算机可读存储介质,其中指令还使得计算设备的一个或多个处理器:利用所加载的数据的逻辑数据映射来遍历所加载的数据,遍历所加载的数据包括将一个或多个滑动窗口应用于所述逻辑数据映射,以将所加载的数据的一部分与一个或多个物理存储器地址相关联。
结论
最后,尽管以结构特征和/或方法动作专用的语言描述了各种技术,但是应理解,所附表示中限定的主题不必限于所描述的特定特征或动作。相反,公开了特定特征和动作作为实现所要求保护的主题的示例形式。

Claims (20)

1.一种系统,包括:
至少一个处理器;
至少一个硬件迭代器,被配置为执行用于一个或多个数据迭代功能的并行处理的多个实例;以及
与所述至少一个处理器通信的至少一个存储器,所述至少一个存储器具有存储在其上的计算机可读指令,当所述计算机可读指令由所述至少一个处理器执行时,使得所述系统:
接收一个或多个初始化参数,所述初始化参数包括表示将由神经网络环境处理的数据的维度的数据;
从所述神经网络环境的存储器组件加载所述数据;
接收一个或多个指令,以根据一个或多个迭代器操作类型和所述一个或多个初始化参数并且使用一个或多个所选择的遍历模式来遍历加载的所述数据;
对所述一个或多个指令进行处理,以根据一个或多个迭代器操作类型和所述一个或多个初始化参数选择加载的所述数据的一个或多个部分;以及
将加载的所述数据的所述一个或多个部分通信到所述神经网络环境的一个或多个处理组件,
其中所述硬件迭代器使用向所述存储器组件中的所述数据的逻辑映射被虚拟化,所述逻辑映射使用指示所述数据的物理存储器寻址、维度和容量的参数被确定。
2.根据权利要求1所述的系统,其中加载的所述数据的所述一个或多个部分是相等部分。
3.根据权利要求1所述的系统,其中所述计算机可读指令还使得所述系统根据由接收的所述一个或多个初始化参数限定的选择数据量来遍历所述数据,所述参数包括包含以下的数据:数据高度、数据宽度、信道数目、内核数目和一个或多个其他数据描述符。
4.根据权利要求3所述的系统,其中所述计算机可读指令还使得所述系统利用一个或多个滑动窗口遍历所述数据,所述滑动窗口可操作来选择所述数据量的一个或多个数据元素作为通信到所述一个或多个处理组件的所述一个或多个部分。
5.根据权利要求4所述的系统,其中所述计算机可读指令还使得所述系统使用一个或多个滑动窗口来遍历加载的所述数据,所述一个或多个滑动窗口跨越加载的所述数据的数据维度边界。
6.根据权利要求1所述的系统,其中所述计算机可读指令还使得所述系统将一个或多个数据填充插入到加载的所述数据。
7.根据权利要求1所述的系统,其中所述计算机可读指令还使得所述系统生成表示由所述神经网络环境的一个或多个神经处理器处理的数据的数据的输出量,所述输出量根据由所述神经网络环境的控制器组件接收的一个或多个指令被生成。
8.一种用于在计算设备中使用迭代器的增强数据处理的计算机实现的方法,所述迭代器被配置为执行用于一个或多个数据迭代功能的并行处理的多个实例,所述方法包括:
从所述计算设备的存储器组件加载数据;
接收一个或多个初始化参数,所述初始化参数指示所述数据的维度作为数据量,所述数据量包括高度、宽度、信道数目、内核数目、或者一个或多个其他数据描述符中的任一个;
接收一个或多个指令,以根据一个或多个迭代器操作类型和所述一个或多个初始化参数并且使用一个或多个所选择的遍历模式来遍历加载的所述数据;
对所述一个或多个指令进行处理,以根据一个或多个迭代器操作类型和所述一个或多个初始化参数选择加载的所述数据的一个或多个部分;以及
将加载的所述数据的所述一个或多个部分通信到所述计算设备的一个或多个处理组件,
其中所述迭代器使用向所述存储器组件中的所述数据的逻辑映射被虚拟化,所述逻辑映射使用指示所述数据的物理存储器寻址、维度和容量的参数被确定。
9.根据权利要求8所述的计算机实现的方法,其中加载的所述数据的所述一个或多个部分是相等部分。
10.根据权利要求8所述的计算机实现的方法,其中加载的所述数据的所述遍历利用可操作以跨越所述数据的数据维度边界的一个或多个滑动窗口。
11.根据权利要求8所述的计算机实现的方法,还包括:
将填充子量插入加载的所述数据中。
12.根据权利要求11所述的计算机实现的方法,其中所述填充子量由接收的所述一个或多个指令以及由接收的所述一个或多个初始化参数来限定。
13.根据权利要求8所述的计算机实现的方法,还包括:
针对由所述一个或多个处理组件处理的数据,生成输出数据量,所述输出数据量由接收的所述一个或多个指令限定。
14.根据权利要求13所述的计算机实现的方法,还包括:
丢弃所生成的所述输出数据量的一个或多个部分。
15.根据权利要求8所述的计算机实现的方法,还包括:将加载的所述数据的遍历位置作为内部状态数据存储在所述计算设备的存储器组件中。
16.一种计算机可读存储介质,具有存储在其上的计算机可执行指令,当所述计算机可执行指令由计算设备的一个或多个处理器执行时,使得所述计算设备:
实例化迭代器,所述迭代器被配置为执行用于一个或多个数据迭代功能的并行处理的多个实例;
接收一个或多个初始化参数,所述初始化参数包括表示待处理的数据的维度的数据,所述数据的所述维度包括表示所述数据的容量的数据,所述一个或多个初始化参数包括待处理的所述数据的物理存储器寻址;
利用所述一个或多个初始化参数加载所述数据;
接收一个或多个指令,以根据一个或多个迭代器操作类型和所述一个或多个初始化参数并且使用一个或多个所选择的遍历模式来遍历加载的所述数据;
对所述一个或多个指令进行处理,以根据所述一个或多个迭代操作类型和所述一个或多个初始化参数选择加载的所述数据的一个或多个部分;以及
将加载的所述数据的所述一个或多个部分通信到一个或多个处理组件;
其中所述迭代器使用向所述数据的逻辑映射被虚拟化,所述逻辑映射使用指示所述数据的物理存储器寻址、维度和容量的参数被确定。
17.根据权利要求16所述的计算机可读存储介质,其中所述一个或多个指令包括用于存储表示加载的所述数据的所述遍历的内部状态的数据的指令,其中所述计算机可执行指令还使得所述计算设备:
将所述内部状态数据存储在所述计算设备的存储器组件中。
18.根据权利要求17所述的计算机可读存储介质,其中所述计算机可执行指令还使得所述计算设备:
将附加数据量插入到加载的所述数据。
19.根据权利要求16所述的计算机可读存储介质,其中所述计算机可执行指令还使得所述计算设备:
生成表示由所述一个或多个处理组件处理的数据的输出数据量。
20.根据权利要求16所述的计算机可读存储介质,其中所述计算机可执行指令还使得所述计算设备:
利用加载的所述数据的逻辑数据映射来遍历加载的所述数据,加载的所述数据的所述遍历包括将一个或多个滑动窗口应用于所述逻辑数据映射,以将加载的所述数据的一部分与一个或多个物理存储器地址相关联。
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Families Citing this family (120)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US8515052B2 (en) 2007-12-17 2013-08-20 Wai Wu Parallel signal processing system and method
US10635969B2 (en) * 2016-10-14 2020-04-28 International Business Machines Corporation Core utilization optimization by dividing computational blocks across cores
US10248906B2 (en) 2016-12-28 2019-04-02 Intel Corporation Neuromorphic circuits for storing and generating connectivity information
US10795836B2 (en) 2017-04-17 2020-10-06 Microsoft Technology Licensing, Llc Data processing performance enhancement for neural networks using a virtualized data iterator
US11164071B2 (en) * 2017-04-18 2021-11-02 Samsung Electronics Co., Ltd. Method and apparatus for reducing computational complexity of convolutional neural networks
EP3657398A1 (en) * 2017-05-23 2020-05-27 Shanghai Cambricon Information Technology Co., Ltd Weight quantization method for a neural network and accelerating device therefor
CN110502330A (zh) * 2018-05-16 2019-11-26 上海寒武纪信息科技有限公司 处理器及处理方法
US11514355B2 (en) * 2017-06-28 2022-11-29 General Electric Company Flat representation of machine learning model
JP7074777B2 (ja) * 2017-11-20 2022-05-24 シャンハイ カンブリコン インフォメーション テクノロジー カンパニー リミテッド タスク並列処理方法、装置、システム、記憶媒体およびコンピュータ機器
EP3489865B1 (en) * 2017-11-22 2021-01-06 Commissariat à l'énergie atomique et aux énergies alternatives A stdp-based learning method for a network having dual accumulator neurons
US10747844B2 (en) * 2017-12-12 2020-08-18 Tesla, Inc. Systems and methods for converting a matrix input to a vectorized input for a matrix processor
US11995448B1 (en) * 2018-02-08 2024-05-28 Marvell Asia Pte Ltd Method and apparatus for performing machine learning operations in parallel on machine learning hardware
US12112175B1 (en) 2018-02-08 2024-10-08 Marvell Asia Pte Ltd Method and apparatus for performing machine learning operations in parallel on machine learning hardware
US10970080B2 (en) 2018-02-08 2021-04-06 Marvell Asia Pte, Ltd. Systems and methods for programmable hardware architecture for machine learning
KR20190097930A (ko) * 2018-02-13 2019-08-21 삼성전자주식회사 채널 별 메모리 용량을 조절하는 메모리 장치 및 이를 포함하는 메모리 시스템
US10948966B1 (en) * 2018-03-07 2021-03-16 Facebook, Inc. Systems and methods for optimizing power usage for systems within quality-of-service constraints
US11126362B2 (en) * 2018-03-14 2021-09-21 International Business Machines Corporation Migrating storage data
CN109313673A (zh) * 2018-04-17 2019-02-05 深圳鲲云信息科技有限公司 网络模型的运行方法及相关产品
US10404276B1 (en) * 2018-04-27 2019-09-03 Nicira, Inc. Stable variable-length order-preserving encoding scheme
US20190340490A1 (en) * 2018-05-04 2019-11-07 Apple Inc. Systems and methods for assigning tasks in a neural network processor
US10997510B1 (en) 2018-05-22 2021-05-04 Marvell Asia Pte, Ltd. Architecture to support tanh and sigmoid operations for inference acceleration in machine learning
US11016801B1 (en) 2018-05-22 2021-05-25 Marvell Asia Pte, Ltd. Architecture to support color scheme-based synchronization for machine learning
US10360654B1 (en) * 2018-05-25 2019-07-23 Intel Corporation Software scoreboard information and synchronization
US10657087B2 (en) * 2018-05-31 2020-05-19 Toshiba Memory Corporation Method of out of order processing of scatter gather lists
US11561833B1 (en) * 2018-06-28 2023-01-24 Amazon Technologies, Inc. Allocation and placement of resources for network computation
EP3821346A1 (en) * 2018-08-09 2021-05-19 Huawei Technologies Co., Ltd. Device and method for compacting compressed and uncompressed data blocks
US12020146B2 (en) 2018-08-23 2024-06-25 Samsung Electronics Co., Ltd. Electronic device and operating method thereof of processing neural network model by using plurality of processors
US11966583B2 (en) * 2018-08-28 2024-04-23 Cambricon Technologies Corporation Limited Data pre-processing method and device, and related computer device and storage medium
DE102019114808A1 (de) * 2018-09-21 2020-03-26 Samsung Electronics Co., Ltd. Mit einer Speichervorrichtung kommunizierende Datenverarbeitungsvorrichtung und Datenverarbeitungsverfahren
US11295205B2 (en) * 2018-09-28 2022-04-05 Qualcomm Incorporated Neural processing unit (NPU) direct memory access (NDMA) memory bandwidth optimization
CN109359732B (zh) * 2018-09-30 2020-06-09 阿里巴巴集团控股有限公司 一种芯片及基于其的数据处理方法
CN116541647A (zh) * 2018-10-09 2023-08-04 华为技术有限公司 运算加速器、处理方法及相关设备
US20200117981A1 (en) * 2018-10-11 2020-04-16 International Business Machines Corporation Data representation for dynamic precision in neural network cores
KR102720879B1 (ko) * 2018-11-05 2024-10-24 한국전자통신연구원 신경망 제어 장치 및 방법
KR20200053886A (ko) 2018-11-09 2020-05-19 삼성전자주식회사 뉴럴 프로세싱 유닛, 뉴럴 프로세싱 시스템, 및 어플리케이션 시스템
CN109669774B (zh) * 2018-11-14 2020-12-08 新华三技术有限公司成都分公司 硬件资源的量化方法、编排方法、装置及网络设备
US11663001B2 (en) * 2018-11-19 2023-05-30 Advanced Micro Devices, Inc. Family of lossy sparse load SIMD instructions
KR102107077B1 (ko) * 2018-11-20 2020-05-06 주식회사 아나패스 컨볼루션 신경망 추론에서 컨볼루션 연산을 수행하기 위한 라인 단위 메모리 관리 방법 및 그 추론 장치
US10990525B2 (en) * 2018-12-12 2021-04-27 Mipsology SAS Caching data in artificial neural network computations
US11342933B2 (en) 2018-12-14 2022-05-24 Advanced Micro Devices, Inc. Lossy significance compression with lossy restoration
CN109657788A (zh) * 2018-12-18 2019-04-19 北京中科寒武纪科技有限公司 数据处理方法、装置及相关产品
CN109740735B (zh) * 2018-12-29 2020-12-29 百度在线网络技术(北京)有限公司 多神经网络输出方法及装置、服务器、计算机可读介质
CN109922007B (zh) * 2019-01-15 2022-04-01 西安仙农电子科技有限公司 一种基于卷积神经网络的负载均衡方法
CN111488114B (zh) * 2019-01-28 2021-12-21 北京灵汐科技有限公司 一种可重构的处理器架构及计算设备
US11625554B2 (en) 2019-02-04 2023-04-11 International Business Machines Corporation L2-nonexpansive neural networks
US11687783B2 (en) * 2019-02-04 2023-06-27 International Business Machines Corporation L2-nonexpansive neural networks
US11521014B2 (en) 2019-02-04 2022-12-06 International Business Machines Corporation L2-nonexpansive neural networks
US11036545B2 (en) * 2019-03-15 2021-06-15 Intel Corporation Graphics systems and methods for accelerating synchronization using fine grain dependency check and scheduling optimizations based on available shared memory space
CN111767078B (zh) * 2019-04-02 2024-08-06 上海寒武纪信息科技有限公司 数据运行方法、装置和相关产品
CN111782577B (zh) 2019-04-04 2023-03-24 安徽寒武纪信息科技有限公司 数据处理装置及方法以及相关产品
CN109992225B (zh) * 2019-04-04 2022-02-22 中科寒武纪科技股份有限公司 数据输出方法及相关装置
KR20200119164A (ko) * 2019-04-09 2020-10-19 한국전자통신연구원 정보 처리 장치 및 그것에 포함된 신경망 연산 장치의 동작 방법
KR20200129957A (ko) * 2019-05-10 2020-11-18 삼성전자주식회사 피처맵 데이터에 대한 압축을 수행하는 뉴럴 네트워크 프로세서 및 이를 포함하는 컴퓨팅 시스템
US10504005B1 (en) * 2019-05-10 2019-12-10 Capital One Services, Llc Techniques to embed a data object into a multidimensional frame
US11204745B2 (en) * 2019-05-23 2021-12-21 Xilinx, Inc. Dataflow graph programming environment for a heterogenous processing system
US11175898B2 (en) * 2019-05-31 2021-11-16 Apple Inc. Compiling code for a machine learning model for execution on a specialized processor
KR20200139909A (ko) 2019-06-05 2020-12-15 삼성전자주식회사 전자 장치 및 그의 연산 수행 방법
AU2020298244A1 (en) * 2019-06-18 2022-01-20 Qualcomm Incorporated Optimizing machine learning model performance
US11403097B2 (en) * 2019-06-26 2022-08-02 Intel Corporation Systems and methods to skip inconsequential matrix operations
US11461622B2 (en) * 2019-06-28 2022-10-04 Amazon Technologies, Inc. Dynamic code loading for multiple executions on a sequential processor
US11630770B2 (en) * 2019-07-11 2023-04-18 Meta Platforms Technologies, Llc Systems and methods for reading and writing sparse data in a neural network accelerator
US20210081806A1 (en) * 2019-09-13 2021-03-18 Latent AI, Inc. Using a runtime engine to facilitate dynamic adaptation of deep neural networks for efficient processing
US10915811B1 (en) 2019-09-18 2021-02-09 International Business Machines Corporation Intercalation cells for multi-task learning
US11475283B2 (en) * 2019-10-24 2022-10-18 Apple Inc. Multi dimensional convolution in neural network processor
KR20210053384A (ko) 2019-11-01 2021-05-12 삼성전자주식회사 스토리지 장치 및 스토리지 장치의 동작 방법
US11513799B2 (en) 2019-11-04 2022-11-29 Apple Inc. Chained buffers in neural network processor
KR20210065605A (ko) * 2019-11-27 2021-06-04 한국전자통신연구원 선인출 정보를 이용한 메모리 제어 방법 및 장치
CN111091184B (zh) * 2019-12-19 2022-03-22 浪潮(北京)电子信息产业有限公司 一种深度神经网络的量化方法、装置、电子设备及介质
CN111162792A (zh) * 2019-12-19 2020-05-15 深圳市航天泰瑞捷电子有限公司 一种电力负荷数据的压缩方法及装置
US11620516B2 (en) * 2019-12-23 2023-04-04 Arm Limited Specializing neural networks for heterogeneous systems
CN111178490B (zh) 2019-12-31 2021-08-24 北京百度网讯科技有限公司 数据输出方法、获取方法、装置和电子设备
CN111126589B (zh) * 2019-12-31 2022-05-20 昆仑芯(北京)科技有限公司 神经网络数据处理装置、方法和电子设备
KR102399197B1 (ko) 2020-01-17 2022-05-18 경희대학교 산학협력단 이상치 인지 근사적 코딩을 수행하는 전자 장치 그리고 그것의 동작 방법
US11023400B1 (en) 2020-01-20 2021-06-01 International Business Machines Corporation High performance DMA transfers in host bus adapters
US12072806B2 (en) * 2020-01-22 2024-08-27 Alibaba Group Holding Limited Compression and decompression module in a cache controller for reducing off-chip data traffic
KR102498066B1 (ko) * 2020-02-20 2023-02-10 한국과학기술원 딥러닝 강화학습 가속기
KR20210108749A (ko) 2020-02-26 2021-09-03 삼성전자주식회사 가속기, 가속기의 동작 방법 및 이를 포함한 가속기 시스템
CN111431539B (zh) * 2020-03-04 2023-12-08 嘉楠明芯(北京)科技有限公司 一种神经网络数据的压缩方法、装置及计算机可读存储介质
CN111290979B (zh) * 2020-03-23 2021-08-17 优刻得科技股份有限公司 数据传输方法、装置及系统
CN111522643B (zh) * 2020-04-22 2024-06-25 杭州迪普科技股份有限公司 基于fpga的多队列调度方法、装置、计算机设备及存储介质
CN113592082A (zh) * 2020-04-30 2021-11-02 意法半导体股份有限公司 用于从人工神经网络分配中间数据的设备和方法
KR20210136476A (ko) * 2020-05-07 2021-11-17 삼성전자주식회사 쿼드 트리 방법의 파라미터들을 이용하여 압축하는 장치 및 방법
US12015526B2 (en) * 2020-05-26 2024-06-18 Synopsys, Inc. Mixed-precision neural networks
GB202008299D0 (en) 2020-06-02 2020-07-15 Imagination Tech Ltd Manipulation of data in a memory
JP2023530471A (ja) * 2020-06-18 2023-07-18 インターデジタル ヴイシー ホールディングス フランス,エスエーエス ディープニューラルネットワークを符号化/復号するためのシステム及び方法
CN111723053A (zh) * 2020-06-24 2020-09-29 北京航天数据股份有限公司 一种数据的压缩方法及装置、解压方法及装置
US11275701B2 (en) * 2020-06-24 2022-03-15 Qualcomm Incorporated Secure timer synchronization between function block and external SOC
US20220004399A1 (en) * 2020-07-03 2022-01-06 Mediatek Inc. Dynamic loading neural network inference at dram/on-bus sram/serial flash for power optimization
CN111884658A (zh) * 2020-07-09 2020-11-03 上海兆芯集成电路有限公司 数据解压缩方法、数据压缩方法及卷积运算装置
US11720404B2 (en) * 2020-07-16 2023-08-08 Samsung Electronics Co., Ltd. Systems and methods for arbitrating access to a shared resource
EP4184392A4 (en) * 2020-07-17 2024-01-10 Sony Group Corporation NEURONAL NETWORK PROCESSING APPARATUS, INFORMATION PROCESSING APPARATUS, INFORMATION PROCESSING SYSTEM, ELECTRONIC INSTRUMENT, NEURONAL NETWORK PROCESSING METHOD AND PROGRAM
CN111858058A (zh) * 2020-07-24 2020-10-30 成都成信高科信息技术有限公司 基于并行计算的sgd负载均衡方法、装置及存储介质
FR3113158B1 (fr) * 2020-08-03 2024-04-05 Commissariat Energie Atomique Architecture de calcul systolique pour la mise en œuvre de réseaux de neurones artificiels traitant plusieurs types de convolutions
JP6835285B1 (ja) * 2020-09-15 2021-02-24 富士電機株式会社 データ圧縮方法、データ圧縮装置、データ圧縮プログラム、データ伸長方法、データ伸長装置およびデータ伸長プログラム
US11470004B2 (en) * 2020-09-22 2022-10-11 Advanced Micro Devices, Inc. Graded throttling for network-on-chip traffic
US12113712B2 (en) 2020-09-25 2024-10-08 Advanced Micro Devices, Inc. Dynamic network-on-chip throttling
US20220121937A1 (en) * 2020-10-21 2022-04-21 Samsung Electronics Co., Ltd. System and method for dynamic quantization for deep neural network feature maps
JP2022094508A (ja) 2020-12-15 2022-06-27 富士通株式会社 演算処理装置、演算処理方法および演算処理プログラム
TWI745227B (zh) * 2021-02-01 2021-11-01 國立陽明交通大學 用於進行原始服務端與外地服務端之間的第三方認證的通訊系統及方法
KR102298766B1 (ko) * 2021-02-15 2021-09-07 주식회사 딥이티 타겟 디바이스에 대한 딥러닝 모델 변환 장치 및 방법
US20220351032A1 (en) * 2021-04-28 2022-11-03 Arm Limited Memory for Artificial Neural Network Accelerator
US20220383121A1 (en) * 2021-05-25 2022-12-01 Applied Materials, Inc. Dynamic activation sparsity in neural networks
US11256987B1 (en) * 2021-06-02 2022-02-22 SambaNova Systems, Inc. Memory efficient dropout, with reordering of dropout mask elements
JP2023018365A (ja) 2021-07-27 2023-02-08 富士通株式会社 情報処理プログラム、情報処理方法及び情報処理装置
US20230053575A1 (en) * 2021-08-18 2023-02-23 Cisco Technology, Inc. Partitioning and placement of models
US20230079975A1 (en) * 2021-09-10 2023-03-16 Arm Limited Power management for system-on-chip
US12112200B2 (en) 2021-09-13 2024-10-08 International Business Machines Corporation Pipeline parallel computing using extended memory
KR20240110594A (ko) * 2021-11-01 2024-07-15 엘지전자 주식회사 피쳐 부호화/복호화 방법, 장치 및 비트스트림을 저장한 기록 매체
KR102700292B1 (ko) * 2021-11-26 2024-08-29 건국대학교 산학협력단 신경망 가속기의 통신 특성을 동적으로 재구성하는 프로세서 장치, 및 그의 구동 방법
EP4191476A1 (en) * 2021-12-01 2023-06-07 Nokia Technologies Oy Machine learning accelerator
US11816364B2 (en) * 2022-01-13 2023-11-14 Microsoft Technology Licensing, Llc Performance evaluation of an application based on detecting degradation caused by other computing processes
CN114466082B (zh) * 2022-01-29 2024-01-09 上海阵量智能科技有限公司 数据压缩、数据解压方法、系统及人工智能ai芯片
US11720252B1 (en) * 2022-03-04 2023-08-08 Microsoft Technology Licensing, Llc Method and apparatus for compressing and decompressing sparse data sets
US20230350678A1 (en) * 2022-04-28 2023-11-02 Qualcomm Incorporated Instruction Set Architecture for Neural Network Quantization and Packing
WO2023250093A1 (en) * 2022-06-22 2023-12-28 Brainchip, Inc. Method and system for implementing temporal convolution in spatiotemporal neural networks
KR20240002346A (ko) * 2022-06-29 2024-01-05 삼성전자주식회사 Ai 부호화/복호화를 이용하여 영상을 처리하는 전자 장치 및 그 제어 방법
KR20240007495A (ko) * 2022-07-08 2024-01-16 리벨리온 주식회사 뉴럴 코어, 이를 포함하는 뉴럴 프로세싱 장치 및 뉴럴 프로세싱 장치의 데이터 로드 방법
CN115309349B (zh) * 2022-10-12 2023-01-20 深圳鲲云信息科技有限公司 深度学习的稀疏数据存储方法、计算机设备和存储介质
US11983128B1 (en) * 2022-12-16 2024-05-14 Amazon Technologies, Inc. Multidimensional and multiblock tensorized direct memory access descriptors
US12132502B1 (en) * 2023-10-09 2024-10-29 Qualcomm Incorporated Packet-based universal bit-field masking coding using configurable sparsity information

Family Cites Families (195)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4298954A (en) 1979-04-30 1981-11-03 International Business Machines Corporation Alternating data buffers when one buffer is empty and another buffer is variably full of data
JPH0642237B2 (ja) 1983-12-28 1994-06-01 株式会社日立製作所 並列処理装置
US5056015A (en) * 1988-03-23 1991-10-08 Du Pont Pixel Systems Limited Architectures for serial or parallel loading of writable control store
EP0334624A3 (en) * 1988-03-23 1993-03-31 Du Pont Pixel Systems Limited Microcoded computer system
EP0340901A3 (en) * 1988-03-23 1992-12-30 Du Pont Pixel Systems Limited Access system for dual port memory
JP2703010B2 (ja) 1988-12-23 1998-01-26 株式会社日立製作所 ニユーラルネツト信号処理プロセツサ
US5369773A (en) 1991-04-26 1994-11-29 Adaptive Solutions, Inc. Neural network using virtual-zero
US5357597A (en) * 1991-06-24 1994-10-18 International Business Machines Corporation Convolutional expert neural system (ConExNS)
US5487153A (en) 1991-08-30 1996-01-23 Adaptive Solutions, Inc. Neural network sequencer and interface apparatus
WO1993014459A1 (en) 1992-01-17 1993-07-22 Caelum Research Corporation Modular parallel processing system
JPH06195322A (ja) 1992-10-29 1994-07-15 Hitachi Ltd 汎用型ニューロコンピュータとして用いられる情報処理装置
JP2938711B2 (ja) 1993-05-10 1999-08-25 松下電器産業株式会社 並列計算機
US5859990A (en) 1995-12-29 1999-01-12 Intel Corporation System for transferring data segments from a first storage device to a second storage device using an alignment stage including even and odd temporary devices
US5933654A (en) 1996-09-24 1999-08-03 Allen-Bradley Company, Llc Dynamic buffer fracturing by a DMA controller
US6006325A (en) * 1996-12-19 1999-12-21 Institute For The Development Of Emerging Architectures, L.L.C. Method and apparatus for instruction and data serialization in a computer processor
US6547364B2 (en) * 1997-07-12 2003-04-15 Silverbrook Research Pty Ltd Printing cartridge with an integrated circuit device
KR100258355B1 (ko) * 1997-12-26 2000-06-01 김영환 8 비트 병렬 셀 단위 인터리버
US6307867B1 (en) 1998-05-14 2001-10-23 Telefonaktiebolaget Lm Ericsson (Publ) Data transmission over a communications link with variable transmission rates
US6654761B2 (en) * 1998-07-29 2003-11-25 Inxight Software, Inc. Controlling which part of data defining a node-link structure is in memory
JP2000059227A (ja) 1998-08-07 2000-02-25 Matsushita Electric Ind Co Ltd 符号化/復号化装置、及び符号化/復号化方法
JP2000261416A (ja) * 1999-03-09 2000-09-22 Nec Eng Ltd 二重化データ転送回路
US6785239B1 (en) 1999-06-01 2004-08-31 Cisco Technology, Inc. Reducing delays in a communication network using a re-fragmentation pipeline
JP2001188767A (ja) 1999-12-28 2001-07-10 Fuji Xerox Co Ltd ニューラルネットワーク演算装置及びニューラルネットワークの演算方法
US6424737B1 (en) 2000-01-24 2002-07-23 Sony Corporation Method and apparatus of compressing images using localized radon transforms
WO2001069411A2 (en) 2000-03-10 2001-09-20 Arc International Plc Memory interface and method of interfacing between functional entities
GB2382899B (en) 2000-12-29 2003-12-17 Zarlink Semiconductor Ltd A data queue system
JP2002259939A (ja) * 2001-03-05 2002-09-13 Kitakiyuushiyuu Techno Center:Kk 連想メモリーベースコンピュータ
US6990079B2 (en) 2001-06-08 2006-01-24 International Business Machines Corporation Optimizing fragment sizes in frame relay networks
US7012893B2 (en) 2001-06-12 2006-03-14 Smartpackets, Inc. Adaptive control of data packet size in networks
US7106968B2 (en) 2001-07-06 2006-09-12 Optix Networks Inc. Combined SONET/SDH and OTN architecture
US6954744B2 (en) * 2001-08-29 2005-10-11 Honeywell International, Inc. Combinatorial approach for supervised neural network learning
US6836767B2 (en) 2001-10-03 2004-12-28 International Business Machines Corporation Pipelined hardware implementation of a neural network circuit
US6961719B1 (en) * 2002-01-07 2005-11-01 The United States Of America As Represented By The Administrator Of The National Aeronautics And Space Administration Hybrid neural network and support vector machine method for optimization
US7245627B2 (en) 2002-04-23 2007-07-17 Mellanox Technologies Ltd. Sharing a network interface card among multiple hosts
US7539608B1 (en) 2002-05-10 2009-05-26 Oracle International Corporation Techniques for determining effects on system performance of a memory management parameter
US7020207B1 (en) * 2002-12-02 2006-03-28 Hitachi, Ltd. Video error concealment mechanism for block based video decompression
US7444637B2 (en) 2003-02-18 2008-10-28 Microsoft Corporation Systems and methods for scheduling coprocessor resources in a computing system
US7137021B2 (en) * 2003-05-15 2006-11-14 International Business Machines Corporation Power saving in FPU with gated power based on opcodes and data
GB0313986D0 (en) * 2003-06-17 2003-07-23 Zarlink Semiconductor Inc Data memory extension for use in double buffered TDM switches
WO2005057400A1 (ja) 2003-12-09 2005-06-23 Matsushita Electric Industrial Co., Ltd. 電子装置、その制御方法、ホスト装置及びその制御方法
US20050125797A1 (en) * 2003-12-09 2005-06-09 International Business Machines Corporation Resource management for a system-on-chip (SoC)
US7480640B1 (en) * 2003-12-16 2009-01-20 Quantum Leap Research, Inc. Automated method and system for generating models from data
US7376853B2 (en) 2004-03-15 2008-05-20 Canon Kabushiki Kaisha Network apparatus, method for controlling the same, and program for the same
US7284075B2 (en) 2004-03-23 2007-10-16 Intel Corporation Inbound packet placement in host memory
US7644239B2 (en) * 2004-05-03 2010-01-05 Microsoft Corporation Non-volatile memory cache performance improvement
US9143393B1 (en) * 2004-05-25 2015-09-22 Red Lambda, Inc. System, method and apparatus for classifying digital data
US20050289253A1 (en) * 2004-06-24 2005-12-29 Edirisooriya Samantha J Apparatus and method for a multi-function direct memory access core
US7363397B2 (en) 2004-08-26 2008-04-22 International Business Machines Corporation System and method for DMA controller with multi-dimensional line-walking functionality
US20060050693A1 (en) * 2004-09-03 2006-03-09 James Bury Building data packets for an advanced switching fabric
US20060100997A1 (en) * 2004-10-27 2006-05-11 Wall Gary C Data caching
US8190796B2 (en) * 2004-11-02 2012-05-29 Standard Microsystems Corporation Hardware supported peripheral component memory alignment method
CN1790918A (zh) 2004-12-17 2006-06-21 中国科学院半导体研究所 基于虚拟信源和神经网络的无损数据压缩方法
US20060143401A1 (en) * 2004-12-27 2006-06-29 Jacob Doweck Method and apparatus for prefetching based on cache fill buffer hits
EP1701249A1 (en) * 2005-03-11 2006-09-13 Interuniversitair Microelektronica Centrum Vzw Ultra low power ASIP (Application-Domain specific Instruction-set Processor) microcomputer
US7793040B2 (en) * 2005-06-01 2010-09-07 Microsoft Corporation Content addressable memory architecture
US7747070B2 (en) * 2005-08-31 2010-06-29 Microsoft Corporation Training convolutional neural networks on graphics processing units
CN101401100B (zh) * 2006-03-14 2012-10-10 国际商业机器公司 通过确定输入数据中的模式进行数据挖掘
RU2419226C2 (ru) * 2006-03-31 2011-05-20 Квэлкомм Инкорпорейтед Управление памятью для высокоскоростного управления доступом к среде
US9542642B2 (en) 2006-04-06 2017-01-10 Samuel F. Wood Packet data neural network system and method
US7764710B1 (en) * 2006-04-25 2010-07-27 Altera Corporation Method and apparatus for processing communication protocol frame input
US7620784B2 (en) * 2006-06-09 2009-11-17 Microsoft Corporation High speed nonvolatile memory device using parallel writing among a plurality of interfaces
US8718065B2 (en) 2006-08-15 2014-05-06 Broadcom Corporation Transmission using multiple physical interface
US7496707B2 (en) 2006-08-22 2009-02-24 International Business Machines Corporation Dynamically scalable queues for performance driven PCI express memory traffic
US20080091868A1 (en) * 2006-10-17 2008-04-17 Shay Mizrachi Method and System for Delayed Completion Coalescing
US8249171B2 (en) 2006-11-10 2012-08-21 Texas Instruments Incorporated MPEG-2 transport stream packet synchronizer
US20080168013A1 (en) * 2006-12-05 2008-07-10 Paul Cadaret Scalable pattern recognition system
KR101532951B1 (ko) * 2006-12-06 2015-07-09 론지튜드 엔터프라이즈 플래시 에스.에이.알.엘. 고-용량, 비-휘발성 스토리지를 위한 캐시로서의 솔리드-스테이트 스토리지 장치, 시스템 및 방법
WO2008067676A1 (en) 2006-12-08 2008-06-12 Medhat Moussa Architecture, system and method for artificial neural network implementation
CN101221541B (zh) * 2007-01-09 2011-04-20 张立军 用于soc的可编程通信控制器
US7620749B2 (en) * 2007-01-10 2009-11-17 International Business Machines Corporation Descriptor prefetch mechanism for high latency and out of order DMA device
US8190834B2 (en) 2007-06-15 2012-05-29 Emc Corporation Process for contiguously streaming data from a content addressed storage system
JP5184824B2 (ja) * 2007-06-15 2013-04-17 キヤノン株式会社 演算処理装置及び方法
US7822951B2 (en) 2007-08-01 2010-10-26 Advanced Micro Devices, Inc. System and method of load-store forwarding
US8200992B2 (en) * 2007-09-24 2012-06-12 Cognitive Electronics, Inc. Parallel processing computer systems with reduced power consumption and methods for providing the same
CN101183873B (zh) 2007-12-11 2011-09-28 广州中珩电子科技有限公司 一种基于bp神经网络的嵌入式系统数据压缩解压缩方法
US8244953B1 (en) 2007-12-18 2012-08-14 Emc Corporation System and method for faster data retrieval from tape media
US8244721B2 (en) * 2008-02-13 2012-08-14 Microsoft Corporation Using related users data to enhance web search
US7730244B1 (en) * 2008-03-27 2010-06-01 Xilinx, Inc. Translation of commands in an interconnection of an embedded processor block core in an integrated circuit
US8201166B2 (en) * 2008-04-30 2012-06-12 Hewlett-Packard Development Company, L.P. Virtualization platform configured with virtual connect control
GB0811057D0 (en) 2008-06-17 2008-07-23 Univ Ulster Artificial neural network architecture
US8566515B2 (en) * 2009-01-12 2013-10-22 Maxim Integrated Products, Inc. Memory subsystem
US20100180100A1 (en) 2009-01-13 2010-07-15 Mavrix Technology, Inc. Matrix microprocessor and method of operation
US8392687B2 (en) * 2009-01-21 2013-03-05 Micron Technology, Inc. Solid state memory formatting
JP5458629B2 (ja) * 2009-03-31 2014-04-02 ブラザー工業株式会社 ノード装置、ノード処理プログラム及び検索方法
US20100257174A1 (en) 2009-04-02 2010-10-07 Matthew Dino Minuti Method for data compression utilizing pattern-analysis and matching means such as neural networks
US20100281192A1 (en) 2009-04-30 2010-11-04 Novafora, Inc. Apparatus and method for transferring data within a data processing system
EP2259214B1 (en) 2009-06-04 2013-02-27 Honda Research Institute Europe GmbH Implementing a neural associative memory based on non-linear learning of discrete synapses
GB2484416B (en) * 2009-06-26 2015-02-25 Intel Corp Optimizations for an unbounded transactional memory (utm) system
US8442927B2 (en) 2009-07-30 2013-05-14 Nec Laboratories America, Inc. Dynamically configurable, multi-ported co-processor for convolutional neural networks
US8316194B2 (en) * 2009-12-15 2012-11-20 Intel Corporation Mechanisms to accelerate transactions using buffered stores
US20110153877A1 (en) * 2009-12-23 2011-06-23 King Steven R Method and apparatus to exchange data via an intermediary translation and queue manager
WO2011085934A1 (en) * 2010-01-18 2011-07-21 Xelerated Ab A packet buffer comprising a data section and a data description section
US8713260B2 (en) 2010-04-02 2014-04-29 Intel Corporation Adaptive block pre-fetching method and system
US8549506B2 (en) * 2010-04-27 2013-10-01 Microsoft Corporation Resumable methods
US8965819B2 (en) * 2010-08-16 2015-02-24 Oracle International Corporation System and method for effective caching using neural networks
US8701099B2 (en) * 2010-11-02 2014-04-15 International Business Machines Corporation Accelerating generic loop iterators using speculative execution
US9300321B2 (en) * 2010-11-05 2016-03-29 University of Maribor Light detection and ranging (LiDAR)data compression and decompression methods and apparatus
US8515882B2 (en) 2010-11-18 2013-08-20 International Business Machines Corporation Efficient storage of individuals for optimization simulation
CN102480337B (zh) 2010-11-30 2016-04-13 国际商业机器公司 无线电软件系统以及用于其的解码装置和方法
US8966413B2 (en) * 2011-02-17 2015-02-24 The Board Of Trustees Of The Leland Stanford Junior University System and method for a chip generator
US8892488B2 (en) * 2011-06-01 2014-11-18 Nec Laboratories America, Inc. Document classification with weighted supervised n-gram embedding
WO2012170904A2 (en) * 2011-06-10 2012-12-13 Bytemobile, Inc. Adaptive bitrate management on progressive download with indexed media files
CN102332162A (zh) 2011-09-19 2012-01-25 西安百利信息科技有限公司 基于人工神经网络的医学图像兴趣区自动识别和分级压缩方法
US9015092B2 (en) * 2012-06-04 2015-04-21 Brain Corporation Dynamically reconfigurable stochastic learning apparatus and methods
US9326075B2 (en) 2011-10-07 2016-04-26 Cochlear Limited Flexible protocol for an implanted prosthesis
US9235799B2 (en) * 2011-11-26 2016-01-12 Microsoft Technology Licensing, Llc Discriminative pretraining of deep neural networks
US9141166B2 (en) * 2011-12-13 2015-09-22 Intel Corporation Method, apparatus, and system for energy efficiency and energy conservation including dynamic control of energy consumption in power domains
CN102523452B (zh) 2011-12-29 2014-12-17 西安空间无线电技术研究所 图像转换压缩传输方法
CN102609222B (zh) * 2012-02-13 2015-03-25 山东华芯半导体有限公司 基于命令描述符的闪存控制方法
US9128925B2 (en) * 2012-04-24 2015-09-08 Freescale Semiconductor, Inc. System and method for direct memory access buffer utilization by setting DMA controller with plurality of arbitration weights associated with different DMA engines
US9509632B2 (en) * 2012-04-25 2016-11-29 Empire Technology Development Llc Workload prediction for network-based computing
US9703500B2 (en) * 2012-04-25 2017-07-11 International Business Machines Corporation Reducing power consumption by migration of data within a tiered storage system
US9015096B2 (en) * 2012-05-30 2015-04-21 Qualcomm Incorporated Continuous time spiking neural network event-based simulation that schedules co-pending events using an indexable list of nodes
US9432489B2 (en) * 2012-06-05 2016-08-30 Intel Corporation Systems and methods for processing encoded data streams
US9159020B2 (en) * 2012-09-14 2015-10-13 International Business Machines Corporation Multiplexing physical neurons to optimize power and area
US20160013773A1 (en) * 2012-11-06 2016-01-14 Pavel Dourbal Method and apparatus for fast digital filtering and signal processing
WO2014085975A1 (zh) * 2012-12-04 2014-06-12 中国科学院半导体研究所 可动态重构的多级并行单指令多数据阵列处理系统
DE112012007063B4 (de) 2012-12-26 2022-12-15 Intel Corp. Zusammenfügen von benachbarten Sammel-/Streuoperationen
WO2014116712A1 (en) * 2013-01-22 2014-07-31 Samplify Systems, Inc. Data compression and decompression using simd instructions
US10909137B2 (en) 2014-10-06 2021-02-02 Fisher-Rosemount Systems, Inc. Streaming data for analytics in process control systems
CN104050200B (zh) 2013-03-15 2017-12-08 伊姆西公司 用于数据拷贝的方法和装置
US9760346B2 (en) * 2013-05-31 2017-09-12 Microsoft Technology Licensing, Llc Deeply parallel source code compilation
US9053015B2 (en) 2013-06-17 2015-06-09 Topcon Positioning Systems, Inc. NAND flash memory interface controller with GNSS receiver firmware booting capability
CA2924375A1 (en) * 2013-09-19 2015-03-26 Sysomos L.P. Systems and methods for actively composing content for use in continuous social communication
US9280465B2 (en) * 2013-10-08 2016-03-08 Globalfoundries Inc. Techniques for moving checkpoint-based high-availability log and data directly from a producer cache to a consumer cache
US20150286873A1 (en) * 2014-04-03 2015-10-08 Bruce L. Davis Smartphone-based methods and systems
US9286171B2 (en) * 2013-12-12 2016-03-15 International Business Machines Corporation Priming failover of stateful offload adapters
GB2521828A (en) * 2013-12-23 2015-07-08 Sony Corp Data encoding and decoding
US20160350250A1 (en) * 2013-12-23 2016-12-01 Intel Corporation Input output data alignment
US9851771B2 (en) 2013-12-28 2017-12-26 Intel Corporation Dynamic power measurement and estimation to improve memory subsystem power performance
US10097372B2 (en) * 2014-01-09 2018-10-09 Ciena Corporation Method for resource optimized network virtualization overlay transport in virtualized data center environments
EP2896428B1 (fr) * 2014-01-16 2016-11-09 Sorin CRM SAS Ensemble de réseau de neurones pour l'évaluation et l'adaptation d'une thérapie antitachycardique par un défibrillateur implantable
US10339447B2 (en) * 2014-01-23 2019-07-02 Qualcomm Incorporated Configuring sparse neuronal networks
US9563369B2 (en) * 2014-04-14 2017-02-07 Microsoft Technology Licensing, Llc Fine-grained bandwidth provisioning in a memory controller
JP6328787B2 (ja) * 2014-04-15 2018-05-23 インテル・コーポレーション 複数の連想メモリを用いた神経形態学的グラフ圧縮の方法、システム、及びコンピュータプログラム製品
US9219499B2 (en) 2014-05-16 2015-12-22 Robert Bosch Gmbh Run time compression method for a vehicle communication bus
US9892125B1 (en) * 2014-05-23 2018-02-13 MapD Technologies, Inc. Method for logging update queries
US9959142B2 (en) * 2014-06-17 2018-05-01 Mediatek Inc. Dynamic task scheduling method for dispatching sub-tasks to computing devices of heterogeneous computing system and related computer readable medium
BR112017003893A8 (pt) * 2014-09-12 2017-12-26 Microsoft Corp Rede dnn aluno aprendiz via distribuição de saída
US9990307B1 (en) 2014-10-29 2018-06-05 Netronome Systems, Inc. Split packet transmission DMA engine
EP3035249B1 (en) 2014-12-19 2019-11-27 Intel Corporation Method and apparatus for distributed and cooperative computation in artificial neural networks
EP3035204B1 (en) * 2014-12-19 2018-08-15 Intel Corporation Storage device and method for performing convolution operations
US10223635B2 (en) 2015-01-22 2019-03-05 Qualcomm Incorporated Model compression and fine-tuning
CN104573064B (zh) * 2015-01-23 2017-12-08 四川中科腾信科技有限公司 一种大数据环境下的数据处理方法
US10234930B2 (en) * 2015-02-13 2019-03-19 Intel Corporation Performing power management in a multicore processor
CA2923600A1 (en) * 2015-03-12 2016-09-12 Staples, Inc. Review sentiment analysis
WO2016149944A1 (zh) * 2015-03-26 2016-09-29 北京旷视科技有限公司 用于识别人脸的方法、系统和计算机程序产品
US9378044B1 (en) * 2015-03-28 2016-06-28 Vmware, Inc. Method and system that anticipates deleterious virtual-machine state changes within a virtualization layer
US9928144B2 (en) * 2015-03-30 2018-03-27 Commvault Systems, Inc. Storage management of data using an open-archive architecture, including streamlined access to primary data originally stored on network-attached storage and archived to secondary storage
FR3035243B1 (fr) * 2015-04-20 2018-06-29 Commissariat A L'energie Atomique Et Aux Energies Alternatives Placement d'une tache de calcul sur un processeur fonctionnellement asymetrique
US9965824B2 (en) * 2015-04-23 2018-05-08 Google Llc Architecture for high performance, power efficient, programmable image processing
US20160328644A1 (en) 2015-05-08 2016-11-10 Qualcomm Incorporated Adaptive selection of artificial neural networks
US20160335119A1 (en) 2015-05-12 2016-11-17 minds.ai inc Batch-based neural network system
US10083395B2 (en) * 2015-05-21 2018-09-25 Google Llc Batch processing in a neural network processor
CN106203619B (zh) * 2015-05-29 2022-09-13 三星电子株式会社 数据优化的神经网络遍历
US9595002B2 (en) * 2015-05-29 2017-03-14 Sas Institute Inc. Normalizing electronic communications using a vector having a repeating substring as input for a neural network
US20160350653A1 (en) * 2015-06-01 2016-12-01 Salesforce.Com, Inc. Dynamic Memory Network
US20160358069A1 (en) * 2015-06-03 2016-12-08 Samsung Electronics Co., Ltd. Neural network suppression
CN106250981B (zh) * 2015-06-10 2022-04-01 三星电子株式会社 减少存储器访问和网络内带宽消耗的脉冲神经网络
US20160378491A1 (en) 2015-06-26 2016-12-29 Microsoft Technology Licensing, Llc Determination of target location for transfer of processor control
US10275001B2 (en) 2015-06-26 2019-04-30 Intel Corporation Thermal throttling of electronic devices
US20160379109A1 (en) * 2015-06-29 2016-12-29 Microsoft Technology Licensing, Llc Convolutional neural networks on hardware accelerators
US11244225B2 (en) 2015-07-10 2022-02-08 Samsung Electronics Co., Ltd. Neural network processor configurable using macro instructions
CN108140131B (zh) 2015-10-04 2021-09-14 艾腾怀斯股份有限公司 用于将卷积网络应用于空间数据的系统和方法
US11029949B2 (en) * 2015-10-08 2021-06-08 Shanghai Zhaoxin Semiconductor Co., Ltd. Neural network unit
CN106485321B (zh) * 2015-10-08 2019-02-12 上海兆芯集成电路有限公司 具有架构神经网络执行单元的处理器
US10471594B2 (en) * 2015-12-01 2019-11-12 Kindred Systems Inc. Systems, devices, and methods for the distribution and collection of multimodal data associated with robots
CN105488563A (zh) * 2015-12-16 2016-04-13 重庆大学 面向深度学习的稀疏自适应神经网络、算法及实现装置
US10007519B2 (en) * 2015-12-22 2018-06-26 Intel IP Corporation Instructions and logic for vector bit field compression and expansion
US11232085B2 (en) * 2016-01-07 2022-01-25 Amazon Technologies, Inc. Outlier detection for streaming data
CN107609642B (zh) * 2016-01-20 2021-08-31 中科寒武纪科技股份有限公司 计算装置和方法
US10565207B2 (en) * 2016-04-12 2020-02-18 Hsilin Huang Method, system and program product for mask-based compression of a sparse matrix
CN106203624B (zh) * 2016-06-23 2019-06-21 上海交通大学 基于深度神经网络的矢量量化系统及方法
CN106204468B (zh) * 2016-06-27 2019-04-26 深圳市未来媒体技术研究院 一种基于ReLU卷积神经网络的图像去噪方法
US10528864B2 (en) * 2016-08-11 2020-01-07 Nvidia Corporation Sparse convolutional neural network accelerator
WO2018058452A1 (zh) * 2016-09-29 2018-04-05 北京中科寒武纪科技有限公司 一种执行人工神经网络运算的装置和方法
US10296292B2 (en) * 2016-10-20 2019-05-21 Advanced Micro Devices, Inc. Dynamic variable precision computation
CN106530200B (zh) 2016-10-23 2020-01-07 深圳大学 一种基于深度学习模型的隐写图像检测方法及系统
US9959498B1 (en) 2016-10-27 2018-05-01 Google Llc Neural network instruction set architecture
CN106529670B (zh) * 2016-10-27 2019-01-25 中国科学院计算技术研究所 一种基于权重压缩的神经网络处理器、设计方法、芯片
US10067710B2 (en) * 2016-11-23 2018-09-04 Advanced Micro Devices, Inc. Detecting buffer overflows in general-purpose GPU applications
US20180164866A1 (en) * 2016-12-13 2018-06-14 Qualcomm Incorporated Low-power architecture for sparse neural network
US10037490B2 (en) * 2016-12-13 2018-07-31 Google Llc Performing average pooling in hardware
US10169296B2 (en) * 2016-12-30 2019-01-01 Intel Corporation Distributed matrix multiplication for neural networks
US10417364B2 (en) 2017-01-04 2019-09-17 Stmicroelectronics International N.V. Tool to create a reconfigurable interconnect framework
US10096134B2 (en) * 2017-02-01 2018-10-09 Nvidia Corporation Data compaction and memory bandwidth reduction for sparse neural networks
US10333549B1 (en) * 2017-03-08 2019-06-25 iDensify LLC System and components for encoding integers
US10909447B2 (en) 2017-03-09 2021-02-02 Google Llc Transposing neural network matrices in hardware
US10795836B2 (en) 2017-04-17 2020-10-06 Microsoft Technology Licensing, Llc Data processing performance enhancement for neural networks using a virtualized data iterator
US10671349B2 (en) * 2017-07-24 2020-06-02 Tesla, Inc. Accelerated mathematical engine
US20190081637A1 (en) * 2017-09-08 2019-03-14 Nvidia Corporation Data inspection for compression/decompression configuration and data type determination
KR20190066473A (ko) * 2017-12-05 2019-06-13 삼성전자주식회사 뉴럴 네트워크에서 컨볼루션 연산을 처리하는 방법 및 장치
US12014505B2 (en) * 2019-01-31 2024-06-18 Samsung Electronics Co., Ltd. Method and apparatus with convolution neural network processing using shared operand
US11671111B2 (en) * 2019-04-17 2023-06-06 Samsung Electronics Co., Ltd. Hardware channel-parallel data compression/decompression
CN112465129B (zh) * 2019-09-09 2024-01-09 上海登临科技有限公司 片内异构人工智能处理器

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Publication number Publication date
SG11201909175XA (en) 2019-11-28
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KR102663557B1 (ko) 2024-05-03
WO2018194940A1 (en) 2018-10-25
CN110520870B (zh) 2023-07-14
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WO2018194994A2 (en) 2018-10-25
US20180300634A1 (en) 2018-10-18
EP3612942B1 (en) 2021-03-03
CL2019002864A1 (es) 2020-03-06
US20180300607A1 (en) 2018-10-18
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EP3612991B1 (en) 2023-12-13
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US11010315B2 (en) 2021-05-18
CN110546610A (zh) 2019-12-06
WO2018194996A1 (en) 2018-10-25
CN110520853B (zh) 2023-08-15
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KR20190141694A (ko) 2019-12-24
US20180300617A1 (en) 2018-10-18
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CN110506260B (zh) 2023-09-22
MX2023008178A (es) 2023-11-28
EP3612989A1 (en) 2020-02-26
CN110520909B (zh) 2021-03-19
US10628345B2 (en) 2020-04-21
EP3612991A1 (en) 2020-02-26
EP3612933B1 (en) 2024-09-04
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CN110520909A (zh) 2019-11-29
EP3613026B1 (en) 2021-05-26
US10795836B2 (en) 2020-10-06
US20180300606A1 (en) 2018-10-18
EP3612945A1 (en) 2020-02-26
JP2020517014A (ja) 2020-06-11
RU2767447C2 (ru) 2022-03-17
EP3612942A1 (en) 2020-02-26
US20180300614A1 (en) 2018-10-18
CN110546611A (zh) 2019-12-06
CN110546654A (zh) 2019-12-06
CN118153639A (zh) 2024-06-07
EP3612947A1 (en) 2020-02-26
IL269888B (en) 2022-04-01
WO2018194998A1 (en) 2018-10-25
EP3612948A1 (en) 2020-02-26
AU2018256212B2 (en) 2022-08-11
CN110506260A (zh) 2019-11-26
US10963403B2 (en) 2021-03-30
WO2018194846A1 (en) 2018-10-25
US11722147B2 (en) 2023-08-08
EP3612946B1 (en) 2023-12-06
AU2018256212A1 (en) 2019-09-19
CN110546628B (zh) 2023-10-20
US20180300613A1 (en) 2018-10-18
US11182667B2 (en) 2021-11-23
US11750212B2 (en) 2023-09-05
WO2018194851A1 (en) 2018-10-25
CN110582785A (zh) 2019-12-17
CA3056660A1 (en) 2018-10-25
CN110520856B (zh) 2023-03-31
CN110582785B (zh) 2024-02-27
CN110678843A (zh) 2020-01-10
WO2018194939A1 (en) 2018-10-25
BR112019021541A2 (pt) 2020-05-12
WO2018194847A1 (en) 2018-10-25
US11176448B2 (en) 2021-11-16
CN110537194B (zh) 2023-07-07
WO2018194848A1 (en) 2018-10-25
CN110520857A (zh) 2019-11-29
US20180300616A1 (en) 2018-10-18

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