JPH08288881A - 自動利得制御方式 - Google Patents
自動利得制御方式Info
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- JPH08288881A JPH08288881A JP7089127A JP8912795A JPH08288881A JP H08288881 A JPH08288881 A JP H08288881A JP 7089127 A JP7089127 A JP 7089127A JP 8912795 A JP8912795 A JP 8912795A JP H08288881 A JPH08288881 A JP H08288881A
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- amplifier
- gain control
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Abstract
(57)【要約】
【目的】過大な入力信号に対する応答の遅れを改善した
自動利得制御方式を提供すること。 【構成】受信信号を増幅する可変利得増幅器の出力信号
の値と目標基準値との差を積分する積分回路を備え、積
分回路の出力信号が利得制御信号として同増幅器に供給
される自動利得制御方式に、受信機を構成する回路が過
大な受信信号によって起こす飽和を検出する手段と、飽
和が検出された場合に前記積分回路の値を増幅器を所定
の低利得にする値に強制的に入れ替える手段を付加す
る。前記積分回路の出力の利得制御信号が、送信信号を
増幅する可変利得増幅器の利得制御端子に供給されてい
ることが望ましい。また、基地局から送信電力の増減の
指示を示す制御ビットが送信された場合は、送信電力制
御補正信号を発生させ、送信用増幅器に供給されるＡＧ
Ｃ信号に同補正信号を加えることが望ましい。
自動利得制御方式を提供すること。 【構成】受信信号を増幅する可変利得増幅器の出力信号
の値と目標基準値との差を積分する積分回路を備え、積
分回路の出力信号が利得制御信号として同増幅器に供給
される自動利得制御方式に、受信機を構成する回路が過
大な受信信号によって起こす飽和を検出する手段と、飽
和が検出された場合に前記積分回路の値を増幅器を所定
の低利得にする値に強制的に入れ替える手段を付加す
る。前記積分回路の出力の利得制御信号が、送信信号を
増幅する可変利得増幅器の利得制御端子に供給されてい
ることが望ましい。また、基地局から送信電力の増減の
指示を示す制御ビットが送信された場合は、送信電力制
御補正信号を発生させ、送信用増幅器に供給されるＡＧ
Ｃ信号に同補正信号を加えることが望ましい。
Description
【０００１】
【産業上の利用分野】本発明は、無線通信システムにお
いて使用する自動利得制御方式、特に移動無線の端末に
適用して好適な自動利得制御方式に関するものである。
いて使用する自動利得制御方式、特に移動無線の端末に
適用して好適な自動利得制御方式に関するものである。
【０００２】
【従来の技術】図４は、移動無線の端末において使用さ
れている従来の自動利得制御方式の一例を示す。受信し
た無線周波信号を周波数変換することによって得た中間
周波信号（以下「ＩＦ信号」と表記）は、受信用可変利
得増幅器１において増幅された後、受信用ミキサ３によ
り、発振器２からのローカル信号と混合されてベースバ
ンド信号となる。このベースバンド信号は、Ａ／Ｄ変換
器４によりディジタル信号に変換された後、データ復調
系に供給される。一方、送信用データ（ベースバンド信
号）は、送信用ミキサ１７により、発振器１６からのキ
ャリア信号と混合されてＩＦ信号となる。このＩＦ信号
は、送信用可変利得増幅器１８において増幅された後、
無線周波信号に周波数変換されてアンテナから送信され
る。
れている従来の自動利得制御方式の一例を示す。受信し
た無線周波信号を周波数変換することによって得た中間
周波信号（以下「ＩＦ信号」と表記）は、受信用可変利
得増幅器１において増幅された後、受信用ミキサ３によ
り、発振器２からのローカル信号と混合されてベースバ
ンド信号となる。このベースバンド信号は、Ａ／Ｄ変換
器４によりディジタル信号に変換された後、データ復調
系に供給される。一方、送信用データ（ベースバンド信
号）は、送信用ミキサ１７により、発振器１６からのキ
ャリア信号と混合されてＩＦ信号となる。このＩＦ信号
は、送信用可変利得増幅器１８において増幅された後、
無線周波信号に周波数変換されてアンテナから送信され
る。
【０００３】受信用増幅器１及び送信用増幅器１８の利
得は、Ｄ／Ａ変換器１１から供給される自動利得制御信
号（以下「ＡＧＣ信号」という）によって制御される。
このＡＧＣ信号は、Ａ／Ｄ変換器４の出力信号(ベース
バンド信号)のレベルを検出器５を用いて検出すること
によって生成する。検出器５の出力信号（以下「受信レ
ベル検出信号」という）は、低域フィルタ６により不要
な高周波成分が除去された後、比較器８に供給され、予
め設定した目標基準発生器７の目標基準値と比較され
る。比較器８の出力値は、加算器９及び遅延器１０から
なる積分回路２６で積分され、更にリミッタ２２によっ
て積分値が設定した値を超えないように制限された後、
Ｄ／Ａ変換器１１に供給される。このＤ／Ａ変換器は、
積分回路２６の出力値をアナログ信号に変換し、ＡＧＣ
信号として受信用増幅器１及び送信用増幅器１８に供給
する。
得は、Ｄ／Ａ変換器１１から供給される自動利得制御信
号（以下「ＡＧＣ信号」という）によって制御される。
このＡＧＣ信号は、Ａ／Ｄ変換器４の出力信号(ベース
バンド信号)のレベルを検出器５を用いて検出すること
によって生成する。検出器５の出力信号（以下「受信レ
ベル検出信号」という）は、低域フィルタ６により不要
な高周波成分が除去された後、比較器８に供給され、予
め設定した目標基準発生器７の目標基準値と比較され
る。比較器８の出力値は、加算器９及び遅延器１０から
なる積分回路２６で積分され、更にリミッタ２２によっ
て積分値が設定した値を超えないように制限された後、
Ｄ／Ａ変換器１１に供給される。このＤ／Ａ変換器は、
積分回路２６の出力値をアナログ信号に変換し、ＡＧＣ
信号として受信用増幅器１及び送信用増幅器１８に供給
する。
【０００４】積分回路２６の遅延器１０は、繰り返し利
得制御の１周期に相当する遅延時間だけ加算器９の出力
値を保存して同加算器にフィードバックするレジスタ回
路によって構成されている。従って、受信レベル検出信
号の値が目標基準値と一致しない場合は、両者の差に相
当する値が比較器８から出力される結果、当該差値に遅
延器１０の蓄積値を加算した積分値が積分回路２６から
出力され、当該積分値に相当するレベルのＡＧＣ信号が
Ｄ／Ａ変換器１１から発生する。繰り返し利得制御の結
果、受信レベル検出信号の値が目標基準値と一致した場
合は、比較器８の出力値が零となる結果、遅延器１０の
蓄積値のみが積分回路２６の出力となって、当該蓄積値
に相当するレベルでＡＧＣ信号が安定する。
得制御の１周期に相当する遅延時間だけ加算器９の出力
値を保存して同加算器にフィードバックするレジスタ回
路によって構成されている。従って、受信レベル検出信
号の値が目標基準値と一致しない場合は、両者の差に相
当する値が比較器８から出力される結果、当該差値に遅
延器１０の蓄積値を加算した積分値が積分回路２６から
出力され、当該積分値に相当するレベルのＡＧＣ信号が
Ｄ／Ａ変換器１１から発生する。繰り返し利得制御の結
果、受信レベル検出信号の値が目標基準値と一致した場
合は、比較器８の出力値が零となる結果、遅延器１０の
蓄積値のみが積分回路２６の出力となって、当該蓄積値
に相当するレベルでＡＧＣ信号が安定する。
【０００５】前記従来技術によれば、移動端末が基地局
の近くに存在して受信電波が強い場合には、受信用ＩＦ
信号増幅器及び送信用ＩＦ信号増幅器の利得が小さくな
るよに制御し、移動端末が基地局から遠くに存在して受
信電波が弱い場合には、これらの増幅器の利得が大きく
なるように制御することにより、円滑な双方向通信を行
なうことが可能となる。
の近くに存在して受信電波が強い場合には、受信用ＩＦ
信号増幅器及び送信用ＩＦ信号増幅器の利得が小さくな
るよに制御し、移動端末が基地局から遠くに存在して受
信電波が弱い場合には、これらの増幅器の利得が大きく
なるように制御することにより、円滑な双方向通信を行
なうことが可能となる。
【０００６】しかし、前記従来技術は、増幅器やＡ／Ｄ
変換器等の受信機を構成する回路が飽和する程度の極端
に強い電波を受信した場合、当該受信機の後段側に設け
た検出器によっては、受信ＩＦ信号（受信用ＩＦ信号増
幅器の入力信号）のレベルを正確に検出することができ
ないため、ＡＧＣ信号が必要なレベルに到達するまでの
時間が長くなって、利得制御の応答速度が著しく低下す
るという点で問題がある。
変換器等の受信機を構成する回路が飽和する程度の極端
に強い電波を受信した場合、当該受信機の後段側に設け
た検出器によっては、受信ＩＦ信号（受信用ＩＦ信号増
幅器の入力信号）のレベルを正確に検出することができ
ないため、ＡＧＣ信号が必要なレベルに到達するまでの
時間が長くなって、利得制御の応答速度が著しく低下す
るという点で問題がある。
【０００７】なお、利得制御の応答遅れは、移動端末が
電波の陰から急に現れた場合に顕著となる。この場合
は、受信電波の減衰量が突然大きく減少する結果、送信
用ＩＦ増幅器の利得が適正な値に安定するまでの間、送
信電力が過大のまま推移し、他の通信に妨害を与えると
いう好ましくない障害が発生する。この障害は、精密な
送信電力制御が必要な符号分割多重方式（ＣＤＭＡ）の
移動通信の場合、特に深刻である。
電波の陰から急に現れた場合に顕著となる。この場合
は、受信電波の減衰量が突然大きく減少する結果、送信
用ＩＦ増幅器の利得が適正な値に安定するまでの間、送
信電力が過大のまま推移し、他の通信に妨害を与えると
いう好ましくない障害が発生する。この障害は、精密な
送信電力制御が必要な符号分割多重方式（ＣＤＭＡ）の
移動通信の場合、特に深刻である。
【０００８】図５は、図４に例示した自動利得制御方式
において、受信用ＩＦ信号増幅器が飽和する程度の高レ
ベルのＩＦ信号と同増幅器が飽和しない程度の低レベル
のＩＦ信号を２０ｍｓごとに交互に同増幅器に供給し、
ＡＧＣ信号の立ち上がり波形を測定した結果を示す。同
図から明らかなように、高レベルのＩＦ信号を供給した
場合は、ＡＧＣ信号の立ち上がり時間が極端に長くなっ
ており、その分だけ利得制御の応答速度が低下している
ことが分かる。
において、受信用ＩＦ信号増幅器が飽和する程度の高レ
ベルのＩＦ信号と同増幅器が飽和しない程度の低レベル
のＩＦ信号を２０ｍｓごとに交互に同増幅器に供給し、
ＡＧＣ信号の立ち上がり波形を測定した結果を示す。同
図から明らかなように、高レベルのＩＦ信号を供給した
場合は、ＡＧＣ信号の立ち上がり時間が極端に長くなっ
ており、その分だけ利得制御の応答速度が低下している
ことが分かる。
【０００９】
【発明が解決しようとする課題】本発明の目的は、従来
技術の前記問題点を解決し、過大な入力信号に対する応
答の遅れを改善した自動利得制御方式を提供することに
ある。
技術の前記問題点を解決し、過大な入力信号に対する応
答の遅れを改善した自動利得制御方式を提供することに
ある。
【００１０】
【課題を解決するための手段】本発明の前記課題は、過
大な受信信号により受信機を構成する回路が飽和したこ
とを検出する手段と、飽和が検出された場合に積分回路
の積分値を増幅器を所定の低利得にする値に強制的に入
れ替える手段を付加した利得制御方式によって解決する
ことができる。増幅器が繰り返し利得制御の一周期で一
気に低利得に設定されるので、飽和を解消するのに要し
ていた時間が短縮されるからである。
大な受信信号により受信機を構成する回路が飽和したこ
とを検出する手段と、飽和が検出された場合に積分回路
の積分値を増幅器を所定の低利得にする値に強制的に入
れ替える手段を付加した利得制御方式によって解決する
ことができる。増幅器が繰り返し利得制御の一周期で一
気に低利得に設定されるので、飽和を解消するのに要し
ていた時間が短縮されるからである。
【００１１】増幅器が所定の低利得になって目標に近づ
くので、積分値の強制入れ替え後は利得の不足分を再調
整すればよく、ＡＧＣ信号が安定する時間が短縮され
る。更に、送信電力の過大が一周期で解消されるので、
他の通信への妨害を回避することができる。
くので、積分値の強制入れ替え後は利得の不足分を再調
整すればよく、ＡＧＣ信号が安定する時間が短縮され
る。更に、送信電力の過大が一周期で解消されるので、
他の通信への妨害を回避することができる。
【００１２】
【実施例】以下、本発明に係る自動利得制御装置を図面
に示した実施例を参照して更に詳細に説明する。
に示した実施例を参照して更に詳細に説明する。
【００１３】＜実施例１＞図１に本発明の第１の実施例
を示す。本実施例は、可変利得増幅器１の出力端子から
一巡して増幅器１のＡＧＣ信号入力に至る前記した通常
の利得制御方式の制御系に、飽和基準発生器１２、比較
器１３、セレクタ１５及び最大値発生器１４からなる飽
和制御回路２７を付加したものである。
を示す。本実施例は、可変利得増幅器１の出力端子から
一巡して増幅器１のＡＧＣ信号入力に至る前記した通常
の利得制御方式の制御系に、飽和基準発生器１２、比較
器１３、セレクタ１５及び最大値発生器１４からなる飽
和制御回路２７を付加したものである。
【００１４】図１において、比較器１３の入力端子を比
較器８の受信レベル検出信号が供給される入力端子に接
続した。比較器１３の他方の入力端子に飽和基準発生器
１２を接続した。発生器１２は、受信レベル検出信号が
飽和と判定される飽和基準値を出力するもので、メモリ
を用いて構成し、メモリに飽和基準値を書き込んでい
る。比較器１３は、受信レベル検出信号の値が飽和基準
値以上であれば、“１”を出力し、飽和基準値未満であ
れば“０”を出力するもので、これによって増幅器、Ａ
／Ｄ変換器等の受信機を構成する回路の飽和が検出され
る。
較器８の受信レベル検出信号が供給される入力端子に接
続した。比較器１３の他方の入力端子に飽和基準発生器
１２を接続した。発生器１２は、受信レベル検出信号が
飽和と判定される飽和基準値を出力するもので、メモリ
を用いて構成し、メモリに飽和基準値を書き込んでい
る。比較器１３は、受信レベル検出信号の値が飽和基準
値以上であれば、“１”を出力し、飽和基準値未満であ
れば“０”を出力するもので、これによって増幅器、Ａ
／Ｄ変換器等の受信機を構成する回路の飽和が検出され
る。
【００１５】比較器１３の出力の端子をセレクタ１５の
制御端子に接続した。セレクタ１５は、出力端子２４を
二つの入力端子２５ａ，２５ｂのいずれかに接続するス
イッチ動作をするものである。出力端子２４に遅延器１
０の入力端子を接続し、入力端子２５ａにリミッタ２２
の出力端子を接続し、入力端子２５ｂに最大値発生器１
４を接続した。
制御端子に接続した。セレクタ１５は、出力端子２４を
二つの入力端子２５ａ，２５ｂのいずれかに接続するス
イッチ動作をするものである。出力端子２４に遅延器１
０の入力端子を接続し、入力端子２５ａにリミッタ２２
の出力端子を接続し、入力端子２５ｂに最大値発生器１
４を接続した。
【００１６】発生器１４は、増幅器１を最小の利得（所
定の低利得）にするＡＧＣ信号のレベルに相当する値、
即ち最大値を出力するもので、メモリを用いて構成し、
メモリに最大値を書き込んでいる。なお、本実施例で
は、ＡＧＣ信号のレベルが大きい程、増幅器１の利得が
低下するように設計している。リミッタ２２は、積分値
が同最大値を超えないように制限するものである。
定の低利得）にするＡＧＣ信号のレベルに相当する値、
即ち最大値を出力するもので、メモリを用いて構成し、
メモリに最大値を書き込んでいる。なお、本実施例で
は、ＡＧＣ信号のレベルが大きい程、増幅器１の利得が
低下するように設計している。リミッタ２２は、積分値
が同最大値を超えないように制限するものである。
【００１７】飽和が生じて比較器１３の出力が“１”に
なったときに、セレクタ１５の出力端子２４が発生器１
４側の入力端子２５ｂに接続される。これによって、遅
延器１０（レジスタ回路）の値は、最大値に強制的に入
れ替わる。１周期後にその値が出力され、加算器９にお
いて比較器８の出力値が加算されるが、リミッタ２２で
制限を受け、Ｄ／Ａ変換器１１に供給される。Ｄ／Ａ変
換器１１から増幅器１の利得を最小にするＡＧＣ信号が
増幅器１，１８に供給される。
なったときに、セレクタ１５の出力端子２４が発生器１
４側の入力端子２５ｂに接続される。これによって、遅
延器１０（レジスタ回路）の値は、最大値に強制的に入
れ替わる。１周期後にその値が出力され、加算器９にお
いて比較器８の出力値が加算されるが、リミッタ２２で
制限を受け、Ｄ／Ａ変換器１１に供給される。Ｄ／Ａ変
換器１１から増幅器１の利得を最小にするＡＧＣ信号が
増幅器１，１８に供給される。
【００１８】以上によって、飽和が検出された場合に増
幅器１は、１周期で一気に最小利得になり飽和が解消さ
れる。また、増幅器１８も低利得になって低電力の送信
ＩＦ信号を出力する。飽和が解消されると、比較器１３
の出力が“０”になって、セレクタ１５の出力端子２４
は、リミッタ２２側の入力端子２５ａに接続され、飽和
制御回路２７の接続が断たれる。以降は、通常の利得制
御の動作が実行され、一旦最小利得になった増幅器１を
目標の利得にする再調整が行なわれる。
幅器１は、１周期で一気に最小利得になり飽和が解消さ
れる。また、増幅器１８も低利得になって低電力の送信
ＩＦ信号を出力する。飽和が解消されると、比較器１３
の出力が“０”になって、セレクタ１５の出力端子２４
は、リミッタ２２側の入力端子２５ａに接続され、飽和
制御回路２７の接続が断たれる。以降は、通常の利得制
御の動作が実行され、一旦最小利得になった増幅器１を
目標の利得にする再調整が行なわれる。
【００１９】図２に本実施例のＡＧＣ信号の波形を示
す。図５に示した場合と同様に、増幅器１に２０ｍｓご
とに交互に、増幅器１が飽和する程の高レベルのＩＦ信
号と飽和しない程度の低レベルのＩＦ信号を供給して、
ＡＧＣ信号の立ち上がり波形を測定したものである。同
図から明らかのように、高レベルのＩＦ信号を供給した
場合に、ＡＧＣ信号の立ち上がり時間が著しく短くなっ
ており、利得制御の応答速度が大幅に改善されているこ
とが分かる。
す。図５に示した場合と同様に、増幅器１に２０ｍｓご
とに交互に、増幅器１が飽和する程の高レベルのＩＦ信
号と飽和しない程度の低レベルのＩＦ信号を供給して、
ＡＧＣ信号の立ち上がり波形を測定したものである。同
図から明らかのように、高レベルのＩＦ信号を供給した
場合に、ＡＧＣ信号の立ち上がり時間が著しく短くなっ
ており、利得制御の応答速度が大幅に改善されているこ
とが分かる。
【００２０】＜実施例２＞ディジタル信号を伝送する無
線通信システムにおいて、基地局が端末に対して送信電
力を制御する方式を採用する例がある。このようなシス
テムでは通常、ディジタル信号のビット列の所定の時間
位置に、端末の送信電力の増減を指示する制御ビットが
挿入される。制御ビットは、移動無線の端末の送信電力
を基地局で監視していて低すぎたり高すぎたりする場合
に挿入される。なお、制御ビットを挿入する時間位置
は、端末ごとに決められていて、自端末に対する制御ビ
ットを取出すことができる。
線通信システムにおいて、基地局が端末に対して送信電
力を制御する方式を採用する例がある。このようなシス
テムでは通常、ディジタル信号のビット列の所定の時間
位置に、端末の送信電力の増減を指示する制御ビットが
挿入される。制御ビットは、移動無線の端末の送信電力
を基地局で監視していて低すぎたり高すぎたりする場合
に挿入される。なお、制御ビットを挿入する時間位置
は、端末ごとに決められていて、自端末に対する制御ビ
ットを取出すことができる。
【００２１】本実施例は、このようなシステムに本発明
を適用したものである。図３に示すように、復調器１９
に送信電力制御部２０を接続し、送信電力制御部２０を
加算器２１の一方の入力端子に接続した。加算器２１の
他方の入力端子にＡＧＣ信号を供給する配線を接続し
た。加算器２１の出力端子を送信用増幅器１８の制御端
子に接続した。
を適用したものである。図３に示すように、復調器１９
に送信電力制御部２０を接続し、送信電力制御部２０を
加算器２１の一方の入力端子に接続した。加算器２１の
他方の入力端子にＡＧＣ信号を供給する配線を接続し
た。加算器２１の出力端子を送信用増幅器１８の制御端
子に接続した。
【００２２】復調器１９は、Ａ／Ｄ変換器４の出力のベ
ースバンド信号を復調して元のビット列を再生する。送
信電力制御部２０は、同ビット列の中から制御ビットの
有無を検出する。制御ビットが送信電力増加要求を示す
とき、送信電力補正信号を減少させ、送信電力を大きく
する。逆に、制御ビットが送信電力減少要求を示すと
き、送信電力補正信号を増加させ、送信電力を小さくす
る。加算器２１は、ＡＧＣ信号に同送信電力補正信号を
加算した信号を送信用増幅器１８に供給する。
ースバンド信号を復調して元のビット列を再生する。送
信電力制御部２０は、同ビット列の中から制御ビットの
有無を検出する。制御ビットが送信電力増加要求を示す
とき、送信電力補正信号を減少させ、送信電力を大きく
する。逆に、制御ビットが送信電力減少要求を示すと
き、送信電力補正信号を増加させ、送信電力を小さくす
る。加算器２１は、ＡＧＣ信号に同送信電力補正信号を
加算した信号を送信用増幅器１８に供給する。
【００２３】このようにして、増幅器１８の利得は、基
地局からの制御が加わることによって、飽和時には実施
例１の場合よりも更に強く下げられるとともに、定常的
にはより正確な送信電力の制御が可能となる。
地局からの制御が加わることによって、飽和時には実施
例１の場合よりも更に強く下げられるとともに、定常的
にはより正確な送信電力の制御が可能となる。
【００２４】以上に説明した実施例１，２に対して、次
のような構成を採用することが可能である。
のような構成を採用することが可能である。
【００２５】可変利得増幅器１，１８を、利得可変範
囲が狭い増幅器又は利得が一定の増幅器に可変減衰器を
組み合わせた構成とする。可変減衰器は、例えば複数の
減衰器とバイパススイッチの縦続接続で構成し、各バイ
パススイッチをＡＧＣ信号で制御する。一例として、そ
れぞれ３２ｄＢ，１６ｄＢ，８ｄＢ，４ｄＢ，２ｄＢ，
１ｄＢの減衰量をもつ６個の減衰器と、それ等をバイパ
スする６個のバイパススイッチを６ｂｉｔのＡＧＣ信号
で制御することで、１ｄＢ刻みで０ｄＢから６３ｄＢの
減衰量を可変できる。この場合、例えば３２ｄＢ，４ｄ
Ｂ，２ｄＢの減衰器をバイパスすると２５ｄＢの減衰量
が得られる。
囲が狭い増幅器又は利得が一定の増幅器に可変減衰器を
組み合わせた構成とする。可変減衰器は、例えば複数の
減衰器とバイパススイッチの縦続接続で構成し、各バイ
パススイッチをＡＧＣ信号で制御する。一例として、そ
れぞれ３２ｄＢ，１６ｄＢ，８ｄＢ，４ｄＢ，２ｄＢ，
１ｄＢの減衰量をもつ６個の減衰器と、それ等をバイパ
スする６個のバイパススイッチを６ｂｉｔのＡＧＣ信号
で制御することで、１ｄＢ刻みで０ｄＢから６３ｄＢの
減衰量を可変できる。この場合、例えば３２ｄＢ，４ｄ
Ｂ，２ｄＢの減衰器をバイパスすると２５ｄＢの減衰量
が得られる。
【００２６】図１，２では、ＡＧＣ信号を増幅器１に
供給するようにしたが、受信機においては増幅器１のほ
か、無線周波信号用の増幅器、或いは受信ＩＦ信号用の
その他の増幅器に供給するように接続することが可能で
ある。
供給するようにしたが、受信機においては増幅器１のほ
か、無線周波信号用の増幅器、或いは受信ＩＦ信号用の
その他の増幅器に供給するように接続することが可能で
ある。
【００２７】送信側の利得制御は、送信ベースバンド
信号（図３の右端下の送信データ）を増幅する増幅器
（図示せず）の利得を制御するようにしても同じ効果を
得ることができる。
信号（図３の右端下の送信データ）を増幅する増幅器
（図示せず）の利得を制御するようにしても同じ効果を
得ることができる。
【００２８】飽和レベルを検出する手段として、図１
では比較器１３を用いたが、Ａ／Ｄ変換器４のオーバフ
ローフラグにより飽和を検出することが可能である。オ
ーバフローフラグは、Ａ／Ｄ変換器４の入力信号が変換
範囲の最上位ビット又は最下位ビットに達したときに発
生するものであるから、飽和を検出する信号として利用
することができる。オーバフローフラグを利用する場合
は、セレクタ１５の制御端子に接続していた比較器１３
の接続を外し、代わってＡ／Ｄ変換器４のオーバフロー
フラグの出力端子を接続する。
では比較器１３を用いたが、Ａ／Ｄ変換器４のオーバフ
ローフラグにより飽和を検出することが可能である。オ
ーバフローフラグは、Ａ／Ｄ変換器４の入力信号が変換
範囲の最上位ビット又は最下位ビットに達したときに発
生するものであるから、飽和を検出する信号として利用
することができる。オーバフローフラグを利用する場合
は、セレクタ１５の制御端子に接続していた比較器１３
の接続を外し、代わってＡ／Ｄ変換器４のオーバフロー
フラグの出力端子を接続する。
【００２９】Ａ／Ｄ変換器４の出力端子から、Ｄ／Ａ
変換器１１の入力端子に至る信号処理を、ディジタル信
号処理プロセッサ（ＤＳＰ）を用いて、ソフトウェアで
実現することが可能である。信号レベル検出器５等の各
回路の機能は、プログラム化して、ＣＰＵ（中央処理装
置）で実行させることができる。
変換器１１の入力端子に至る信号処理を、ディジタル信
号処理プロセッサ（ＤＳＰ）を用いて、ソフトウェアで
実現することが可能である。信号レベル検出器５等の各
回路の機能は、プログラム化して、ＣＰＵ（中央処理装
置）で実行させることができる。
【００３０】上記実施例では、Ａ／Ｄ変換器、Ｄ／Ａ
変換器及び各ディジタル回路を用いてディジタル信号処
理により実施したが、これをアナログ信号処理で実施す
ることが可能である。信号レベル検出器、低域フィル
タ、比較器、加算器、遅延器及びリミッタは、同じ機能
のアナログ回路で実現可能であり、セレクタは、スイッ
チ回路、目標基準、飽和基準及び最大値の各発生器は、
所定の値に設定した電圧を発生する回路に置き換えるこ
とで実現可能である。
変換器及び各ディジタル回路を用いてディジタル信号処
理により実施したが、これをアナログ信号処理で実施す
ることが可能である。信号レベル検出器、低域フィル
タ、比較器、加算器、遅延器及びリミッタは、同じ機能
のアナログ回路で実現可能であり、セレクタは、スイッ
チ回路、目標基準、飽和基準及び最大値の各発生器は、
所定の値に設定した電圧を発生する回路に置き換えるこ
とで実現可能である。
【００３１】
【発明の効果】本発明によれば、僅かなハードウェア又
は処理の増加で、過大な入力に対する自動利得制御の応
答速度を著しく改善することができる。また、本発明の
ＡＧＣ信号を送信電力の制御に用いることで、送信側の
自動利得制御の遅れが大幅に改善され、他の移動端末に
重大な悪影響を与える過大な送信電力の発生を防止する
ことができる。
は処理の増加で、過大な入力に対する自動利得制御の応
答速度を著しく改善することができる。また、本発明の
ＡＧＣ信号を送信電力の制御に用いることで、送信側の
自動利得制御の遅れが大幅に改善され、他の移動端末に
重大な悪影響を与える過大な送信電力の発生を防止する
ことができる。
【図１】本発明に係る自動利得制御方式の第１の実施例
を説明するための回路構成図。
を説明するための回路構成図。
【図２】第１の実施例の応答特性を示す曲線図。
【図３】本発明の第２の実施例を説明するための回路構
成図。
成図。
【図４】従来の可変利得制御方式を説明するための回路
構成図。
構成図。
【図５】図４の装置の応答特性を示す曲線図
１，１８…可変利得増幅器 ４…Ａ／Ｄ変換器 ５…信号レベル検出器 ７…目標基準発生器 ８，１３…比較器 ９，２１…加算器 １０…遅延器 １１…Ｄ／Ａ変換器 １２…飽和基準発生器 １４…最大値発生器 １５…セレクタ ２０…送信電力制御部 ２６…積分回路 ２７…飽和制御回路
Claims (3)
- 【請求項１】受信信号を増幅する可変利得増幅器の出力
信号の値と目標基準値との差を積分する積分回路を備
え、積分回路の出力信号が利得制御信号として同増幅器
に供給されて増幅器の出力信号の値が目標基準値と一致
するように機能する自動利得制御方式において、受信機
を構成する回路が過大な受信信号によって起こす飽和を
検出する手段を備え、飽和が検出された場合に前記積分
回路の値を前記増幅器を所定の低利得にする値に強制的
に入れ替える手段が付加されていることを特徴とする自
動利得制御方式。 - 【請求項２】前記積分回路の出力の利得制御信号が、送
信信号を増幅する可変利得増幅器の利得制御端子に供給
されていることを特徴とする請求項１に記載の自動利得
制御方式。 - 【請求項３】基地局から送られる送信電力増減の指示を
表わす制御ビットを抽出して電力制御補正信号を発生さ
せる送信電力制御部と、同補正信号と前記積分回路の出
力の利得制御信号とを加算する加算器を備え、加算器の
出力端子が送信用増幅器の利得制御端子に接続されてい
ることを特徴とする請求項２に記載の自動利得制御方
式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7089127A JPH08288881A (ja) | 1995-04-14 | 1995-04-14 | 自動利得制御方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7089127A JPH08288881A (ja) | 1995-04-14 | 1995-04-14 | 自動利得制御方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH08288881A true JPH08288881A (ja) | 1996-11-01 |
Family
ID=13962226
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7089127A Pending JPH08288881A (ja) | 1995-04-14 | 1995-04-14 | 自動利得制御方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH08288881A (ja) |
Cited By (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2003079580A1 (fr) * | 2002-03-20 | 2003-09-25 | Matsushita Electric Industrial Co., Ltd. | Procede pour controler la generation de donnees de commande de puissance d'emission, procede de controle de la caracteristique d'un circuit recepteur sur la base de donnees de debordement, et systeme de communication amcr |
| WO2005048627A1 (ja) * | 2003-11-14 | 2005-05-26 | Matsushita Electric Industrial Co., Ltd. | 送信装置及び利得制御方法 |
| WO2006075516A1 (ja) * | 2005-01-11 | 2006-07-20 | Advantest Corporation | 信号伝送システム、信号出力回路基板、信号受信回路基板、信号出力方法、及び信号受信方法 |
| WO2008050391A1 (fr) * | 2006-10-23 | 2008-05-02 | Panasonic Corporation | Appareil de réception de signal radio |
| JP2012186833A (ja) * | 2003-03-14 | 2012-09-27 | Interdigital Technology Corp | タイムスロット式データ伝送のための機能強化された自動利得制御機構 |
| US9564963B2 (en) | 1995-06-30 | 2017-02-07 | Interdigital Technology Corporation | Automatic power control system for a code division multiple access (CDMA) communications system |
-
1995
- 1995-04-14 JP JP7089127A patent/JPH08288881A/ja active Pending
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