JPH05308529A - Image encoder - Google Patents
Image encoderInfo
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- JPH05308529A JPH05308529A JP3096683A JP9668391A JPH05308529A JP H05308529 A JPH05308529 A JP H05308529A JP 3096683 A JP3096683 A JP 3096683A JP 9668391 A JP9668391 A JP 9668391A JP H05308529 A JPH05308529 A JP H05308529A
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- image
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- Image Processing (AREA)
- Compression Of Band Width Or Redundancy In Fax (AREA)
Abstract
Description
【0001】[0001]
【産業上の利用分野】本発明は画像符号化装置、特に階
調(色)を有するイメージや写真及び解像を有する文字
や線画の混在する画像を符号化する画像符号化装置に関
する。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to an image coding apparatus, and more particularly to an image coding apparatus for coding an image having a gradation (color), a photograph, and a mixed image of characters and line drawings having a resolution.
【0002】[0002]
【従来の技術】写真等の中間調画像をメモリに記憶する
のに必要な記憶容量は(画素数)×(階調ビット数)×
(色数)となり、特に高品位なカラー画像を記憶するた
めには膨大な記憶容量が必要であった。このため、各種
の情報量圧縮方式が提案され、情報量を圧縮した後、メ
モリに記憶することにより、メモリ容量の削減が図られ
ている。2. Description of the Related Art The storage capacity required to store a halftone image such as a photograph in a memory is (number of pixels) × (number of gradation bits) ×
(Number of colors), and a particularly large storage capacity is required to store a high-quality color image. For this reason, various information amount compression methods have been proposed, and the information capacity is compressed and then stored in a memory to reduce the memory capacity.
【0003】図10は、一般的な圧縮画像記憶方式のブ
ロック構成図である。入力端子41からはイメージ、文
字等が混在した画像信号が入力される。入力された画像
信号は、ブロック化回路42において、例えば8×8の
ブロック単位で読み込まれ、離散的コサイン変換(DC
T)回路43にて直交変換される。次に、直交変換され
た画像信号は量子化回路44に入力され、Qテーブル4
5によって量子化される。量子化された画像信号は可変
長符号化回路46にて可変長符号化された後、圧縮画像
として画像メモリ47に格納される。FIG. 10 is a block diagram of a general compressed image storage system. An image signal in which images, characters, and the like are mixed is input from the input terminal 41. The input image signal is read in the block formation circuit 42 in units of, for example, 8 × 8 blocks, and the discrete cosine transform (DC
T) The circuit 43 performs orthogonal transformation. Next, the orthogonally transformed image signal is input to the quantization circuit 44, and the Q table 4
Quantized by 5. The quantized image signal is variable-length coded by the variable-length coding circuit 46 and then stored in the image memory 47 as a compressed image.
【0004】さらに、画像メモリ47に格納された圧縮
画像は、不図示の出力デバイス同期信号と同期を取りな
がら可変長復号化回路48にて可変長復号化され、逆量
子化回路49において逆量子化され、離散的コサイン逆
変換回路50によって離散的コサイン逆変換され、ラス
ター化回路51によってラスター化された後、伸長され
た画像信号として出力端子52から不図示の出力デバイ
ス、例えばページプリンタに出力される。Further, the compressed image stored in the image memory 47 is variable-length decoded by the variable-length decoding circuit 48 in synchronization with an output device synchronizing signal (not shown), and inverse-quantized by the inverse quantization circuit 49. After being converted into a discrete cosine inverse transform circuit 50, the discrete cosine inverse transform circuit 50 performs the discrete cosine inverse transform, and the rasterization circuit 51 rasterizes it, and then outputs the expanded image signal from an output terminal 52 to an output device (not shown) such as a page printer. To be done.
【0005】なお、上述したブロック化、符号化等の画
像圧縮プロセスは、例えばJPEG(Joint Photograph
ic Experts Group)にて、カラー静止画符号化国際標準
方式として提案されているADCT(Adaptive Discret
e Cosine Transform)のベースラインシステムの方式等
である。The image compression process such as the above-mentioned block formation and encoding is performed by, for example, JPEG (Joint Photograph).
ic Experts Group) has proposed ADCT (Adaptive Discret) as an international standard for color still image coding.
e Cosine Transform) baseline system.
【0006】[0006]
【発明が解決しようとしている課題】しかしながら、上
記従来例では、解像を有する文字や線画の場合、解像力
等が低下し、文字・線画の品位が劣化するという欠点が
あった。However, in the above-mentioned conventional example, in the case of a character or a line drawing having a resolution, there is a drawback that the resolution or the like is lowered and the quality of the character or the line drawing is deteriorated.
【0007】つまり、文字や線画では、その品位を保存
する必要があった。In other words, it is necessary to preserve the quality of characters and line drawings.
【0008】本発明は、上記欠点に鑑みてなされたもの
であり、圧縮プロセスを用いた装置において、文字や線
画、特に例えばコンピュータ等で人工的に作成した文字
や線画の再現性を向上させた画像符号化装置を提供する
ことを目的とする。The present invention has been made in view of the above-mentioned drawbacks, and in a device using a compression process, the reproducibility of characters and line drawings, particularly characters and line drawings artificially created by, for example, a computer is improved. An object is to provide an image coding device.
【0009】[0009]
【課題を解決するための手段】上記目的を達成するため
に、本発明の画像符号化装置は以下の構成からなる。即
ち、多値画像と線画の混在する画像を符号化する画像符
号化装置であって、多値画像と線画の混在する画像のヒ
ストグラムを算出する算出手段と、該算出手段で算出さ
れたヒストグラムに基づいて前記画像の線画部を抽出す
る抽出手段と、該抽出手段で抽出された線画部と該線画
部以外の部分とで異なる符号化を行なう符号化手段とを
有する。In order to achieve the above object, the image coding apparatus of the present invention has the following configuration. That is, an image encoding device that encodes an image in which a multi-valued image and a line drawing are mixed, a calculation unit that calculates a histogram of an image in which a multi-valued image and a line drawing are mixed, and a histogram calculated by the calculation unit. Based on the line drawing portion of the image, the extracting means extracts the line drawing portion, and the line drawing portion extracted by the extracting means and the encoding means for performing different encoding on the portion other than the line drawing portion.
【0010】また好ましくは、前記各手段は、ブロック
単位で行なうことを特徴とする。Further, preferably, each of the above-mentioned means is performed in block units.
【0011】更に好ましくは、前記抽出手段は、抽出し
た線画部を他の画像データで置換する置換手段を備える
ことを特徴とする。More preferably, the extracting means includes a replacing means for replacing the extracted line drawing portion with other image data.
【0012】[0012]
【実施例】以下、図面を参照して本発明に係る好適な一
実施例を詳細に説明する。 <第1の実施例>図1及び図2は、第1の実施例での画
像符号化装置の構成を示すブロック図である。まず、図
1を参照して画像情報の入力からそれぞれのメモリへ格
納までのプロセスについて述べる。DETAILED DESCRIPTION OF THE PREFERRED EMBODIMENT A preferred embodiment of the present invention will be described in detail below with reference to the drawings. <First Embodiment> FIGS. 1 and 2 are block diagrams showing the arrangement of an image coding apparatus according to the first embodiment. First, the process from input of image information to storage in each memory will be described with reference to FIG.
【0013】入力端子1からはホストコンピュータ等よ
り出力される自然画像等の多値画像と文字や線画が混在
する画像情報が入力される。ここで、入力された画像情
報はブロック化回路2によって8×8画素のブロックに
ブロック化され、バッファ3に蓄えられる。バッファ3
に蓄えられた画像情報は、ヒストグラム算出回路5にお
いて全64画素データのヒストグラムが算出され、ヒス
トグラムの頻度が最大となる画素データが抽出色判定回
路6に伝送される。ヒストグラム算出回路5における処
理のため、1ブロックの画像情報は、1ブロック遅延回
路4においてスキャン時間分だけ遅延され、抽出色判定
回路6に伝送される。そして、抽出色判定回路6におい
て、入力された画像情報は1画素ずつ入力されたヒスト
グラムの頻度が最大となる画素データと比較され、一致
した場合、該当する画素を“1”にし、ビットマップデ
ータ符号化回路7に伝送される。しかし、一致しなかっ
た場合は、該当する画素を“0”にし、ビットマップデ
ータ符号化回路7に伝送される。ビットマップデータ符
号化回路7に伝送された2値の画像データはビットマッ
プデータ符号化回路7によって可逆符号化され、ビット
マップメモリ8に格納される。From the input terminal 1, image information in which a multi-valued image such as a natural image output from a host computer and characters and line drawings are mixed is input. Here, the input image information is divided into blocks of 8 × 8 pixels by the blocking circuit 2 and stored in the buffer 3. Buffer 3
The histogram calculation circuit 5 calculates the histogram of all 64 pixel data of the image information stored in, and the pixel data having the maximum histogram frequency is transmitted to the extraction color determination circuit 6. Due to the processing in the histogram calculation circuit 5, one block of image information is delayed by the scan time in the one block delay circuit 4 and transmitted to the extracted color determination circuit 6. Then, in the extraction color judgment circuit 6, the inputted image information is compared with the pixel data having the maximum frequency of the histogram inputted pixel by pixel, and if they coincide with each other, the corresponding pixel is set to “1” and the bitmap data is set. It is transmitted to the encoding circuit 7. However, if they do not match, the corresponding pixel is set to “0” and transmitted to the bitmap data encoding circuit 7. The binary image data transmitted to the bitmap data encoding circuit 7 is losslessly encoded by the bitmap data encoding circuit 7 and stored in the bitmap memory 8.
【0014】また、ヒストグラム算出回路5で算出され
た濃度データは、抽出色判定回路6に伝送されると同時
に、色データ符号化回路10にも伝送され、色データ符
号化回路10によって可逆符号化され、色データメモリ
11に格納される。The density data calculated by the histogram calculation circuit 5 is transmitted to the extracted color determination circuit 6 and at the same time to the color data encoding circuit 10 so that the color data encoding circuit 10 performs reversible encoding. And stored in the color data memory 11.
【0015】一方、離散的コサイン変換(DCT)回路
13において、バッファ3から読み出された画像情報は
離散的コサイン変換され、離散的コサイン変換された画
像情報が量子化回路14においてQテーブルを用いて量
子化される。そして、量子化された画像情報は、イメー
ジデータ符号化回路16によって非可逆符号化され、圧
縮画像としてイメージメモリ17に格納される。On the other hand, in the discrete cosine transform (DCT) circuit 13, the image information read from the buffer 3 is subjected to the discrete cosine transform, and the discrete cosine transformed image information is used in the quantizing circuit 14 in the Q table. Are quantized. Then, the quantized image information is lossy encoded by the image data encoding circuit 16 and stored in the image memory 17 as a compressed image.
【0016】次に、図2を参照してそれぞれのメモリに
格納された画像情報が出力デバイスに出力されるまでの
プロセスについて述べる。Next, the process until the image information stored in each memory is output to the output device will be described with reference to FIG.
【0017】ビットマップメモリ8に格納された文字・
線画等の2値データは、ビットマップデータ復号化回路
9によって復号化され、多重化回路21に伝送される。
また、色データメモリ11に格納された色情報は、色デ
ータ復号化回路12によって復号化され、多重化回路2
1に伝送される。そして、イメージメモリ17に格納さ
れた画像情報は、イメージデータ復号化回路18によっ
て復号化され、復号化された画像情報が逆量子化回路1
9によって逆量子化される。ここで、逆量子化された画
像情報は、離散的コサイン逆変換(IDCT)回路20
に伝送される。離散的コサイン逆変換された画像情報
は、多重化回路21に伝送される。Characters stored in the bitmap memory 8
Binary data such as a line drawing is decoded by the bitmap data decoding circuit 9 and transmitted to the multiplexing circuit 21.
Further, the color information stored in the color data memory 11 is decoded by the color data decoding circuit 12, and the multiplexing circuit 2
1 is transmitted. Then, the image information stored in the image memory 17 is decoded by the image data decoding circuit 18, and the decoded image information is decoded by the inverse quantization circuit 1.
Dequantized by 9. Here, the inversely quantized image information is the discrete cosine inverse transform (IDCT) circuit 20.
Be transmitted to. The image information subjected to the discrete cosine inverse transform is transmitted to the multiplexing circuit 21.
【0018】次に、多重化回路21において、ビットマ
ップデータ復号化回路9から伝送された文字・線画等の
画素部(2値データの“1”)は、色データ復号化回路
12から伝送された色情報の値に変換され、例えば1画
素当たり24ビットの画像情報となる。そして、その画
像情報とIDCT回路20から伝送された画像情報とが
比較され、ビットマップデータ復号化回路9からの画像
データが“1”の画素部分では、色データ復号化回路1
2からの画像データが選択され、ビットマップデータ復
号化回路9からの画像データが“0”の画素部分では、
IDCT回路20からの画像データが選択され、それぞ
れ選択された画像データが多重化されてラスター化回路
22に伝送される。ラスター化回路22に伝送された画
像情報は、ラスター化された後、出力端子23から不図
示の出力デバイス、例えばページプリンタに出力され
る。Next, in the multiplexing circuit 21, the pixel portion (binary data “1”) such as a character / line drawing transmitted from the bit map data decoding circuit 9 is transmitted from the color data decoding circuit 12. The color information is converted into the color information value, and for example, it becomes 24 bits of image information per pixel. Then, the image information is compared with the image information transmitted from the IDCT circuit 20, and in the pixel portion where the image data from the bitmap data decoding circuit 9 is "1", the color data decoding circuit 1
In the pixel portion in which the image data from 2 is selected and the image data from the bitmap data decoding circuit 9 is “0”,
The image data from the IDCT circuit 20 is selected, and the selected image data are multiplexed and transmitted to the rasterization circuit 22. The image information transmitted to the rasterization circuit 22 is rasterized and then output from an output terminal 23 to an output device (not shown) such as a page printer.
【0019】以上、実施例では図示していないが、入力
される画像データはR,G,B等、各8ビットの階調を
有するフルカラーデータであり、R,G,B各々でブロ
ック化を行ない、各々のバッファに蓄えられる。それぞ
れのバッファ毎、つまりR,G,B各色毎にヒストグラ
ムの算出を行ない、抽出色を判定する。R,G,B各々
で求められた抽出画素領域及び抽出色(色データ)は、
不図示の多重化回路によって多重化され、抽出画素領域
は、2値画像としてビットマップデータ符号化回路7に
よって可逆符号化された後、ビットマップメモリ8に格
納され、また、色データは1ブロック当たり24ビット
のフルカラー1色を色データ符号化回路10によって可
逆符号化された後、色データメモリ11に格納される。As described above, although not shown in the embodiment, the input image data is full-color data such as R, G, B having a gradation of 8 bits, and R, G, B are divided into blocks. Performed and stored in each buffer. A histogram is calculated for each buffer, that is, for each R, G, B color, and the extracted color is determined. The extracted pixel area and the extracted color (color data) obtained for each of R, G, and B are
The extracted pixel region is multiplexed by a multiplexing circuit (not shown), losslessly encoded as a binary image by the bitmap data encoding circuit 7, and then stored in the bitmap memory 8, and one block of color data is stored. One full color of 24 bits per loss is losslessly encoded by the color data encoding circuit 10 and then stored in the color data memory 11.
【0020】また、入力画像データはR,G,Bに限ら
ず、例えばL* a* b* でもYUVでもよい。なお、入
力画像データがR,G,Bの場合、RGBからL* a*
b*又はYUVに変換する構成としてもよい。The input image data is not limited to R, G, B, but may be L * a * b * or YUV, for example. When the input image data is R, G, B, from RGB to L * a *
It may be configured to convert into b * or YUV.
【0021】更に、実施例では、R,G,B各プレーン
毎に処理を行なっているが、これに限るものではなく、
RGBをまとめて24ビット一括して処理することも可
能である。Further, in the embodiment, the processing is performed for each R, G, B plane, but the present invention is not limited to this.
It is also possible to collectively process RGB for 24 bits.
【0022】次に、上述したヒストグラム算出回路5に
おける算出処理を図3,図4に示すフローチャートに従
って以下に説明する。Next, the calculation processing in the above-mentioned histogram calculation circuit 5 will be described below with reference to the flowcharts shown in FIGS.
【0023】図3のステップS1では、レジスタA,B
0 ,B1 ,…,B63,C0 ,C1 ,…,C63,Dの計1
30コをすべて“0”に初期化する。ここで、レジスタ
Aは取り込んだ画素データを一時的に格納するレジスタ
であり、レジスタBn (n=0〜63)は異なる濃度の
画素データを格納するレジスタであり、レジスタC
m(m=0〜63)はレジスタBn に格納された画素デ
ータのヒストグラムを計数するためのレジスタである。
そして、レジスタDはヒストグラムの最大値を格納する
レジスタである。次のステップS2及びS3では、i=
0及びk=0とし、ステップS4及びS5では、8×8
ブロックの第i+1番目の画素を取り込み、レジスタA
に格納する。そして、ステップS6,S7,S9におい
て、第i番目までの画素データ中にレジスタAの内容と
等しい濃度の画素データが存在するかチェックする。つ
まり、ステップS6で、iの値とkの値を比較し、小さ
ければ(i>k)ステップS7へ処理を進め、レジスタ
Aの内容とレジスタBk の内容が等しいか判断する。こ
こで、等しくなければステップS9へ処理を進め、kの
値をプラス1し、ステップS6へ処理を戻し、上述の処
理を繰り返す。しかし、等しければステップS10へ処
理を進め、ヒストグラム用のレジスタCk の内容をプラ
ス1する。In step S1 of FIG. 3, the registers A and B are
0 , B 1 , ..., B 63 , C 0 , C 1 , ..., C 63 , D in total 1
All 30 are initialized to "0". Here, the register A is a register that temporarily stores the captured pixel data, the register B n (n = 0 to 63) is a register that stores pixel data of different densities, and the register C
m (m = 0 to 63) is a register for counting the histogram of the pixel data stored in the register B n .
The register D is a register that stores the maximum value of the histogram. In the next steps S2 and S3, i =
0 and k = 0, and 8 × 8 in steps S4 and S5.
The i + 1th pixel of the block is fetched and the register A
To store. Then, in steps S6, S7, and S9, it is checked whether or not the pixel data up to the i-th pixel data has the same density as the content of the register A. That is, in step S6, the value of i and the value of k are compared, and if smaller (i> k), the process proceeds to step S7, and it is determined whether the contents of register A and the contents of register B k are equal. Here, if they are not equal, the process proceeds to step S9, the value of k is incremented by 1, the process returns to step S6, and the above process is repeated. However, if they are equal, the process proceeds to step S10, and the contents of the histogram register C k is incremented by one.
【0024】一方、ステップS6において、iの値とk
の値が等しい場合、ステップS8へ処理を進め、第i+
1番目の画素データを新たに格納する。つまり、レジス
タAの内容をレジスタBi に格納し、次のステップS1
0で、その画素データに対応するヒストグラム用のレジ
スタCk の内容をプラス1する。そして、ステップS1
1では、画素データのインデックスであるiの値をプラ
ス1し、次のステップS12では、1ブロック(64画
素データ)について処理を終了したかどうかをチェック
し、終了していなければステップS3へ処理を戻し、ヒ
ストグラム作成処理を繰り返す。その後、64画素分の
ヒストグラムが作成されると(i=64)、図4のステ
ップS13へ処理を進め、ヒストグラムの最大値を求め
る。On the other hand, in step S6, the value of i and k
If the values are equal, the process proceeds to step S8, and the i-th
The first pixel data is newly stored. That is, the contents of the register A are stored in the register B i , and the next step S1
At 0, the contents of the histogram register C k corresponding to the pixel data are incremented by 1. And step S1
In 1, the value of i, which is the index of the pixel data, is incremented by 1, and in the next step S12, it is checked whether or not the process has been completed for one block (64 pixel data). If not, the process proceeds to step S3. Is returned, and the histogram creation process is repeated. After that, when a histogram for 64 pixels is created (i = 64), the process proceeds to step S13 in FIG. 4 to find the maximum value of the histogram.
【0025】まず、ステップS13では、インデックス
kを“0”に初期化し、ステップS14及びS15でレ
ジスタC0 及びB0 の内容をそれぞれD及びAに格納す
る。そして、ステップS16では、Kの値をプラス1
し、続くステップS17では、kと“64”を比較し、
すべて処理したか否かをチェックする。その結果、まだ
途中であれば(k<64)ステップS18へ処理を進
め、レジスタDとレジスタCk の内容を比較し、レジス
タCk の方がより小さいか等しければ(D≧Ck )ステ
ップS16へ処理を戻す。しかし、レジスタCk の方が
大きければ(D<C k )ステップS19へ処理を進め、
レジスタCk の内容をレジスタDに格納し、次のステッ
プS20では、対応する画素データの濃度であるレジス
タBk の内容をレジスタAに格納し、ステップS16へ
処理を戻す。First, in step S13, the index
k is initialized to "0", and in steps S14 and S15,
Dista C0 And B0 Store the contents of D in A and A respectively
It Then, in step S16, the value of K is increased by 1
Then, in the following step S17, k is compared with “64”,
Check whether all have been processed. As a result, still
If it is in the middle (k <64), the process proceeds to step S18.
Register D and register Ck Compare the contents of the
Ta Ck Is less than or equal to (D ≧ Ck )
The process returns to step S16. But register Ck Is better
If larger (D <C k ) The process proceeds to step S19,
Register Ck Is stored in register D and the next step
In step S20, the register which is the density of the corresponding pixel data
Bk Is stored in register A, and the process goes to step S16.
Return processing.
【0026】次に、上述の処理を繰り返し、1ブロック
内の画素データについて処理を終了すると、ステップS
17からステップS21へ処理を進め、レジスタAの内
容、つまり、ヒストグラムが最大である濃度の画素デー
タを抽出色判定回路6及び色データ符号化回路10に伝
送する。Next, when the above process is repeated and the process is completed for the pixel data in one block, step S
The process proceeds from step 17 to step S21, and the content of the register A, that is, the pixel data having the maximum density of the histogram is transmitted to the extraction color determination circuit 6 and the color data encoding circuit 10.
【0027】以上説明したように、第1の実施例によれ
ば、文字・線画等の画質の劣化を防ぎ、効率のよい画像
データの圧縮を行なうことができる。 <第2の実施例>次に、本発明に係る第2の実施例を図
面を参照して以下に説明する。As described above, according to the first embodiment, it is possible to prevent the deterioration of the image quality of characters, line drawings, etc. and efficiently compress the image data. <Second Embodiment> Next, a second embodiment according to the present invention will be described below with reference to the drawings.
【0028】図5は、第2の実施例における画像符号化
装置の前半構成を示すブロック図である。なお、後半の
構成は図2と同様であり、また第1の実施例と同一の機
能を有するブロックには同一の番号を付している。そし
て、この実施例では、非抽出画像の抽出部分に対して置
換を行なう機能を付加したものである。FIG. 5 is a block diagram showing the first half configuration of the image coding apparatus according to the second embodiment. The configuration of the latter half is the same as that of FIG. 2, and the blocks having the same functions as those in the first embodiment are designated by the same reference numerals. In this embodiment, the function of replacing the extracted portion of the non-extracted image is added.
【0029】また、図6〜図8は1ブロック、抽出画像
と非抽出画像を示したものであり、図6は抽出前の原画
像であり、図7は抽出された画像であり、図8は非抽出
画像である。そして、図8の抽出された部分(白色の部
分)は図9のように他の画像で置換する。6 to 8 show one block, an extracted image and a non-extracted image, FIG. 6 is an original image before extraction, FIG. 7 is an extracted image, and FIG. Is a non-extracted image. Then, the extracted portion (white portion) of FIG. 8 is replaced with another image as shown in FIG.
【0030】図5を参照して画像情報の入力からそれぞ
れのメモリへ格納までのプロセスを説明する。図5にお
いて、入力端子1からホストコンピュータ等より出力さ
れた画像情報が入力され、入力された画像情報はブロッ
ク化回路2によってブロック化され、バッファ3に蓄え
られる。バッファ3に蓄えられた画像情報からヒストグ
ラム算出回路5においてヒストグラムが算出され、ヒス
トグラムが最大となる画素データを抽出色判定回路24
に伝送する。1ブロック遅延回路4でヒストグラム算出
処理時間だけ遅延されてバッファ3から画像情報が抽出
色判定回路24へ読み込まれる。抽出色判定回路24に
おいて、バッファ3から入力された画像情報はヒストグ
ラム算出回路5から入力されたヒストグラムが最大とな
る画素データと1画素ずつ比較され、一致した場合、ビ
ットマップデータ符号化回路7へ“1”を、置換回路2
6へ“0”を伝送し、また一致しなかった場合は、ビッ
トマップデータ符号化回路7へ“0”を、置換回路26
へ“1”を伝送する。このビットマップデータ符号化回
路7へ伝送された2値の画像データは第1の実施例と同
様の過程を経て、ビットマップメモリ8に格納される。
色データ符号化回路10へ伝送された画素データも第1
の実施例と同様の過程を経て色データメモリ11に格納
される。The process from input of image information to storage in each memory will be described with reference to FIG. In FIG. 5, image information output from a host computer or the like is input from an input terminal 1, and the input image information is divided into blocks by a blocking circuit 2 and stored in a buffer 3. A histogram is calculated by the histogram calculation circuit 5 from the image information stored in the buffer 3, and the pixel data having the maximum histogram is extracted.
To transmit. The one-block delay circuit 4 delays the histogram calculation processing time, and the image information is read from the buffer 3 to the extracted color determination circuit 24. In the extraction color determination circuit 24, the image information input from the buffer 3 is compared pixel by pixel with the pixel data for which the histogram input from the histogram calculation circuit 5 is maximum, and if they match, to the bitmap data encoding circuit 7. Replace "1" with replacement circuit 2
6 is transmitted, and when they do not match, the bit map data encoding circuit 7 is replaced with “0” and the replacement circuit 26
"1" is transmitted to. The binary image data transmitted to the bit map data encoding circuit 7 is stored in the bit map memory 8 through the same process as in the first embodiment.
The pixel data transmitted to the color data encoding circuit 10 is also the first
The color data is stored in the color data memory 11 through the same process as in the above embodiment.
【0031】一方、抽出色判定回路24において、抽出
色が判定されるまでの時間だけ、2ブロック遅延回路2
5によって遅延され、置換回路26へバッファ3の画像
情報が読み込まれる。置換回路26において、バッファ
3からの画像情報の各画素は抽出色判定回路24から伝
送された2値データと比較され、2値データが“0”に
相当する画素は不図示の置換データ算出回路によってあ
らかじめ算出された値(非抽出画素の平均値)に置換さ
れ、2値データが“1”に相当する画素は置換されない
ように構成されている。On the other hand, in the extraction color judgment circuit 24, only the time until the extraction color is judged is 2 block delay circuit 2
After being delayed by 5, the image information in the buffer 3 is read into the replacement circuit 26. In the replacement circuit 26, each pixel of the image information from the buffer 3 is compared with the binary data transmitted from the extracted color determination circuit 24, and the pixel whose binary data corresponds to “0” is a replacement data calculation circuit (not shown). Is replaced with a value (average value of non-extracted pixels) calculated in advance, and a pixel corresponding to binary data “1” is not replaced.
【0032】次に、上述の如く置換された画像データ
は、以下、前述した第1の実施例1と同様のプロセスを
経て、圧縮画像としてイメージメモリ17へ格納され
る。そして、画像情報が各メモリから復号化され、出力
デバイスに出力されるまでのプロセスは第1の実施例と
同様であり、ここでは省略する。Next, the image data replaced as described above is stored in the image memory 17 as a compressed image through the same process as in the first embodiment described above. The process of decoding the image information from each memory and outputting it to the output device is the same as in the first embodiment, and will not be repeated here.
【0033】以上説明したように、第2の実施例によれ
ば、より高い画像データの圧縮を図ることができる。As described above, according to the second embodiment, higher image data compression can be achieved.
【0034】上述の実施例では、置換データとして非抽
出部分の平均値を用いたが、本発明はこれに限るもので
はなく、例えば平均自乗誤差を最小にする値でも良く、
また、テーブルを用いて全く別の値で置換しても良い。In the above-mentioned embodiment, the average value of the non-extracted portion is used as the replacement data, but the present invention is not limited to this. For example, a value that minimizes the mean square error may be used.
Alternatively, it may be replaced with a completely different value using a table.
【0035】尚、本発明は、例えばリーダー、インター
フェース、プリンタなど複数の機器から構成されるシス
テムに適用しても良いし、例えば複写機のように1つの
機器から成る装置に適用しても良い。また、システム或
は装置に例えばフロッピーディスクやICカード等に格
納されたプログラムを供給することによって達成される
場合にも適用できることは言うまでもない。The present invention may be applied to a system including a plurality of devices such as a reader, an interface, and a printer, or may be applied to an apparatus including a single device such as a copying machine. .. Further, it goes without saying that the present invention can also be applied to the case where it is achieved by supplying a program stored in a floppy disk, an IC card or the like to a system or an apparatus.
【0036】[0036]
【発明の効果】以上説明したように、本発明によれば、
圧縮プロセスを用いた装置において、文字や線画、特に
コンピュータ等で人工的に作成した文字や線画の再現性
を向上させることができる。As described above, according to the present invention,
In a device using a compression process, it is possible to improve the reproducibility of characters and line drawings, especially characters and line drawings artificially created by a computer or the like.
【図1】第1の実施例における符号化プロセスを示すブ
ロック構成図である。FIG. 1 is a block diagram showing an encoding process in a first embodiment.
【図2】第1,第2の実施例における復号化プロセスを
示すブロック構成図である。FIG. 2 is a block diagram showing a decoding process in the first and second embodiments.
【図3】[Figure 3]
【図4】本実施例におけるヒストグラム処理を示すフロ
ーチャートである。FIG. 4 is a flowchart showing a histogram process in this embodiment.
【図5】第2の実施例における符号化プロセスを示すブ
ロック構成図である。FIG. 5 is a block diagram showing an encoding process in the second embodiment.
【図6】[Figure 6]
【図7】[Figure 7]
【図8】[Figure 8]
【図9】抽出部と非抽出部を説明するための図である。FIG. 9 is a diagram for explaining an extraction unit and a non-extraction unit.
【図10】一般的な画像符号化装置の構成を示すブロッ
ク図である。FIG. 10 is a block diagram showing a configuration of a general image encoding device.
【符号の説明】 1 入力端子 2 ブロック化回路 3 バッファ 4 1ブロック遅延回路 5 ヒストグラム算出回路 6 抽出色判定回路 7 ビットマップデータ符号化回路 8 ビットマップメモリ 9 ビットマップデータ復号化回路 10 色データ符号化回路 11 色データメモリ 12 色データ復号化回路 13 DCT回路 14 量子化回路 15 Qテーブル 16 イメージデータ符号化回路 17 イメージメモリ 18 イメージデータ復号化回路 19 逆量子化回路 20 IDCT回路 21 多重化回路 22 ラスター化回路 23 出力端子[Explanation of Codes] 1 Input Terminal 2 Blocking Circuit 3 Buffer 4 1 Block Delay Circuit 5 Histogram Calculation Circuit 6 Extraction Color Judgment Circuit 7 Bitmap Data Encoding Circuit 8 Bitmap Memory 9 Bitmap Data Decoding Circuit 10 Color Data Code Coloring circuit 11 Color data memory 12 Color data decoding circuit 13 DCT circuit 14 Quantization circuit 15 Q table 16 Image data coding circuit 17 Image memory 18 Image data decoding circuit 19 Inverse quantization circuit 20 IDCT circuit 21 Multiplexing circuit 22 Rasterization circuit 23 Output terminal
Claims (3)
する画像符号化装置であって、 多値画像と線画の混在する画像のヒストグラムを算出す
る算出手段と、 該算出手段で算出されたヒストグラムに基づいて前記画
像の線画部を抽出する抽出手段と、 該抽出手段で抽出された線画部と該線画部以外の部分と
で異なる符号化を行なう符号化手段とを有することを特
徴とする画像符号化装置。1. An image coding apparatus for coding an image in which a multi-valued image and a line drawing are mixed, wherein a calculation means for calculating a histogram of an image in which a multi-valued image and a line drawing are mixed, and calculation by the calculation means. An extraction unit for extracting a line drawing portion of the image based on the histogram, and an encoding unit for performing different encoding on the line drawing portion extracted by the extraction unit and a portion other than the line drawing portion. Image encoding device.
とを特徴とする請求項1に記載の画像符号化装置。2. The image coding apparatus according to claim 1, wherein each of the means performs a block unit.
画像データで置換する置換手段を備えることを特徴とす
る請求項2に記載の画像符号化装置。3. The image coding apparatus according to claim 2, wherein the extraction unit includes a replacement unit that replaces the extracted line drawing portion with other image data.
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP3096683A JPH05308529A (en) | 1991-04-26 | 1991-04-26 | Image encoder |
US07/872,988 US5818970A (en) | 1991-04-26 | 1992-04-24 | Image encoding apparatus |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP3096683A JPH05308529A (en) | 1991-04-26 | 1991-04-26 | Image encoder |
Publications (1)
Publication Number | Publication Date |
---|---|
JPH05308529A true JPH05308529A (en) | 1993-11-19 |
Family
ID=14171594
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP3096683A Withdrawn JPH05308529A (en) | 1991-04-26 | 1991-04-26 | Image encoder |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH05308529A (en) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5995660A (en) * | 1996-08-28 | 1999-11-30 | Fuji Xerox Co., Ltd | Image processing apparatus |
JP2003085556A (en) * | 2001-09-07 | 2003-03-20 | Fuji Xerox Co Ltd | Image processing device and program |
-
1991
- 1991-04-26 JP JP3096683A patent/JPH05308529A/en not_active Withdrawn
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5995660A (en) * | 1996-08-28 | 1999-11-30 | Fuji Xerox Co., Ltd | Image processing apparatus |
JP2003085556A (en) * | 2001-09-07 | 2003-03-20 | Fuji Xerox Co Ltd | Image processing device and program |
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